リファレンスマニュアル日本語

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参考資料

RM0008

リ フ ァ レ ン ス ・ マニ ュ アル

中容量及び大容量 STM32F101xx 及び STM32F103xx

高性能 ARM ベース 32bit MCU

は じ めに

こ の リ フ ァ レ ン ス ・ マニ ュ アルには、 ア プ リ ケーシ ョ ン開発を行 う 開発者を対象 と し て中

容量及び大容量 STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト ロー ラ の メ モ リ やペ リ

フ ェ ラ ルについての詳細な情報が記載 さ れています。 特に記載がない限 り 、 こ のマニ ュ ア

ルでは中容量及び大容量 STM32F101xx 及び STM32F103xx の総称 と し て STM32F10xxx と 記

載 さ れています。

STM32F10xxx は異な る メ モ リ ・ サイ ズ、 パ ッ ケージ、 ペ リ フ ェ ラルを持 っ た フ ァ ミ リ 製品

にな り ます。

注文 コ ー ド 、 外形寸法、 電気特性の詳細については、 中容量及び大容量

STM32F101xx

及び

STM32F103xx デー タ シー ト

を参照 し て く だ さ い。

内蔵 さ れている Flash メ モ リ の書込み、 消去、 保護については、

STM32F10xxx Flash プ ログ

ラ ミ ング ・ マニ ュ アル

を参照 し て く だ さ い。

ARM Cortex ™ -M3 コ アの詳細な情報に関 し ては、

Cortex ™ -M3 Technical Reference Manual

参照 し て く だ さ い。

関連 ド キ ュ メ ン ト

次の資料が www.arm.com

か ら 入手で き ます。

■ Cortex ™ -M3 Technical Reference Manual

次の資料が www.st.com

: か ら 入手で き ます。

■ STM32F101xx STM32F103xx デー タ シー ト

■ STM32F10xxx Flash プ ログ ラ ミ ン グ ・ マニ ュ アル

July 2008 Rev 5 -日本語版 1/720

www.st.com

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 この資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

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3

4

1

参考資料

目次

目次

RM0008

こ のマニ ュ アルにおける表記の規則 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32

1.1

レ ジ ス タ に関する略記 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32

1.2

用語 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32

メ モ リ と バスの構成 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33

2.1

シ ス テム ・ アーキテ ク チ ャ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33

2.2

2.3

2.4

メ モ リ 構成 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

メ モ リ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35

2.3.1

2.3.2

2.3.3

2.3.4

ペ リ フ ェ ラル メ モ リ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

内蔵 SRAM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38

ビ ッ ト ・ バンデ ィ ン グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38

内蔵 Flash メ モ リ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39

ブー ト 構成 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42

CRC 計算ユニ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44

3.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44

3.2

3.3

3.4

主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44

CRC 機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45

CRC レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45

3.4.1

3.4.2

3.4.3

3.4.4

デー タ ・ レ ジ ス タ (CRC_DR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45

独立型デー タ ・ レ ジ ス タ (CRC_IDR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46

制御レ ジ ス タ (CRC_CR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46

CRC レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47

電源制御 (PWR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48

4.1

4.2

4.3

電源供給 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48

4.1.1

4.1.2

4.1.3

独立 し た A/D コ ンバー タ 電源 と 参照電圧 . . . . . . . . . . . . . . . . . . . . . . . . . 49

バ ッ テ リ ・ バ ッ ク ア ッ プ ・ ド メ イ ン . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49

電圧レギ ュ レー タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 50

電源供給管理 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 50

4.2.1

4.2.2

パワー ・ オ ン・ リ セ ッ ト (POR)/ パワー ・ ダウ ン・ リ セ ッ ト (PDR) . . . . . . 50

プ ロ グ ラ ム可能な電圧検出回路 (PVD) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 51

低電力モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 52

2/720 Rev 5-日本語版

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参考資料

RM0008

5

6

目次

4.4

4.3.1

4.3.2

4.3.3

4.3.4

4.3.5

4.3.6

ク ロ ッ ク 周波数の低減 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 52

ペ リ フ ェ ラル回路の ク ロ ッ ク ・ ス イ ッ チ . . . . . . . . . . . . . . . . . . . . . . . . . . 53

SLEEP モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 53

STOP モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 55

STANDBY モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 56

低電力モー ド か らの自動ウ ェ ー ク ア ッ プ (AWU : Auto-wakeup) . . . . . . . 58

電源制御レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 59

4.4.1

4.4.2

4.4.3

電源制御レ ジ ス タ (PWR_CR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 59

電源制御 / ス テー タ ス ・ レ ジ ス タ (PWR_CSR) . . . . . . . . . . . . . . . . . . . . . . 61

PWR レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62

バ ッ ク ア ッ プ ・ レ ジ ス タ (BKP) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 63

5.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 63

5.2

5.3

5.4

主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 63

機能解説 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 64

5.3.1

5.3.2

タ ンパ検出 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 64

RTC 周波数調整 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 64

BKP レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 65

5.4.1

5.4.2

5.4.3

5.4.4

5.4.5

バ ッ ク ア ッ プ ・ デー タ ・ レ ジ ス タ x (BKP_DRx) (x = 1 ..42) . . . . . . . . . . . 65

RTC ク ロ ッ ク較正レ ジ ス タ (BKP_RTCCR) . . . . . . . . . . . . . . . . . . . . . . . . . 66

バ ッ ク ア ッ プ制御レ ジ ス タ (BKP_CR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 67

バ ッ ク ア ッ プ制御 / ス テー タ ス ・ レ ジ ス タ (BKP_CSR) . . . . . . . . . . . . . . 68

BKP レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69

リ セ ッ ト と ク ロ ッ ク の制御 (RCC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72

6.1

6.2

リ セ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72

6.1.1

6.1.2

6.1.3

シ ス テム ・ リ セ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72

電源 リ セ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73

バ ッ ク ア ッ プ ・ ド メ イ ン ・ リ セ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73

ク ロ ッ ク . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73

6.2.1

6.2.2

6.2.3

6.2.4

6.2.5

6.2.6

HSE ク ロ ッ ク . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 75

HSI ク ロ ッ ク . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 76

PLL 回路 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 76

LSE ク ロ ッ ク . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77

LSI ク ロ ッ ク . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77

シ ス テム ・ ク ロ ッ ク (SYSCLK) の選択 . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78

Rev 5 -日本語版 3/720

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7

参考資料

目次

RM0008

6.3

6.2.7

6.2.8

6.2.9

6.2.10

ク ロ ッ ク ・ セキ ュ リ テ ィ シ ス テム (CSS) . . . . . . . . . . . . . . . . . . . . . . . . . 78

RTC ク ロ ッ ク . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79

ウ ォ ッ チ ド ッ グ ・ ク ロ ッ ク . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79

ク ロ ッ ク 信号出力 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79

RCC レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 80

6.3.1

6.3.2

6.3.3

6.3.4

6.3.5

6.3.6

6.3.7

6.3.8

6.3.9

6.3.10

6.3.11

ク ロ ッ ク 制御レ ジ ス タ (RCC_CR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 80

ク ロ ッ ク 構成レ ジ ス タ (RCC_CFGR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 82

ク ロ ッ ク 割込みレ ジ ス タ (RCC_CIR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 85

APB2 ペ リ フ ェ ラ ル ・ リ セ ッ ト ・ レ ジ ス タ (RCC_APB2RSTR) . . . . . . . . 87

APB1 ペ リ フ ェ ラ ル ・ リ セ ッ ト ・ レ ジ ス タ (RCC_APB1RSTR) . . . . . . . . 89

AHB ペ リ フ ェ ラル ・ ク ロ ッ ク ・ イ ネーブル ・ レ ジ ス タ

(RCC_AHBENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 91

APB2 ペ リ フ ェ ラ ル ・ ク ロ ッ ク ・ イ ネーブル ・ レ ジ ス タ

(RCC_APB2ENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 93

APB1 ペ リ フ ェ ラ ル ・ ク ロ ッ ク ・ イ ネーブル ・ レ ジ ス タ

(RCC_APB1ENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95

バ ッ ク ア ッ プ ・ ド メ イ ン制御レ ジ ス タ (RCC_BDCR) . . . . . . . . . . . . . . . 98

制御 / ス テー タ ス ・ レ ジ ス タ (RCC_CSR) . . . . . . . . . . . . . . . . . . . . . . . . 99

RCC レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 101

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO) . . . . . . . . . . . . . . . . 102

7.1

7.2

7.2.1

7.2.2

7.2.3

7.2.4

7.2.5

GPIO 機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 102

7.1.1

7.1.2

7.1.3

7.1.4

7.1.5

7.1.6

7.1.7

7.1.8

7.1.9

7.1.10

汎用入出力 (GPIO) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105

ア ト ミ ッ ク ・ ビ ッ ト のセ ッ ト / リ セ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . 105

外部割込み / ウ ェ ー ク ア ッ プ信号 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105

オル タ ネー ト 機能 (AF) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 106

ソ フ ト ウ ェ アに よ る オル タ ネー ト 機能の入出力ピ ンの再割当て . . . . . 106

GPIO ロ ッ ク 機構 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 106

入力回路の構成 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 107

出力回路の構成 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108

オル タ ネー ト 機能の構成 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109

アナ ロ グ入力の構成 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110

GPIO レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 111

ポー ト 構成レ ジ ス タ ( 下位 ) (GPIOx_CRL) (x=A..G) . . . . . . . . . . . . . . . . . 111

ポー ト 構成レ ジ ス タ ( 上位 ) (GPIOx_CRH) (x=A..G) . . . . . . . . . . . . . . . . . 112

ポー ト 入力デー タ ・ レ ジ ス タ (GPIOx_IDR) (x=A..G) . . . . . . . . . . . . . . . . . 113

ポー ト 出力デー タ ・ レ ジ ス タ (GPIOx_ODR) (x=A..G) . . . . . . . . . . . . . . . . 113

ポー ト ビ ッ ト ・ セ ッ ト / リ セ ッ ト ・ レ ジ ス タ (GPIOx_BSRR) (x=A..G) . 114

4/720 Rev 5-日本語版

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参考資料

RM0008

8

目次

7.3

7.4

7.5

7.2.6

7.2.7

ポー ト ビ ッ ト ・ リ セ ッ ト ・ レ ジ ス タ (GPIOx_BRR) (x=A..G) . . . . . . . . . . 114

ポー ト 構成ロ ッ ク レ ジ ス タ (GPIOx_LCKR) (x=A..G) . . . . . . . . . . . . . . . . . 115

7.3.2

7.3.3

7.3.4

7.3.5

7.3.6

7.3.7

7.3.8

7.3.9

オル タ ネー ト 入出力機能 と デバ ッ グ構成 (AFIO) . . . . . . . . . . . . . . . . . . . . . 116

7.3.1

GPIO ポー ト PC14/PC15 を OSC32_IN/OSC32_OUT ピ ン と し て

使用する には . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 116

GPIO ポー ト PD0/PD1 を OSC_IN/OSC_OUT ピ ン と し て使用する には 116

CAN オル タ ネー ト 機能のピ ン再割当て . . . . . . . . . . . . . . . . . . . . . . . . . . 116

JTAG/SWD オル タ ネー ト 機能のピ ン割当て . . . . . . . . . . . . . . . . . . . . . . 117

ADC オル タ ネー ト 機能のピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . 118

タ イ マ ・ オル タ ネー ト 機能のピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . . . 119

USART オル タ ネー ト 機能のピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . . . . 121

I2C 回路 1 オル タ ネー ト 機能のピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . 122

SPI 回路 1 オル タ ネー ト 機能のピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . 122

AFIO レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 123

7.4.1

7.4.2

7.4.3

7.4.4

7.4.5

7.4.6

イ ベ ン ト 制御レ ジ ス タ (AFIO_EVCR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 123

オル タ ネー ト 機能の再割当て と デバ ッ グ入出力構成レ ジ ス タ

(AFIO_MAPR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 124

外部割込み構成レ ジ ス タ 1 (AFIO_EXTICR1) . . . . . . . . . . . . . . . . . . . . . . . 127

外部割込み構成レ ジ ス タ 2 (AFIO_EXTICR2) . . . . . . . . . . . . . . . . . . . . . . . 127

外部割込み構成レ ジ ス タ 3 (AFIO_EXTICR3) . . . . . . . . . . . . . . . . . . . . . . . 128

外部割込み構成レ ジ ス タ 4 (AFIO_EXTICR4) . . . . . . . . . . . . . . . . . . . . . . . 128

GPIO ・ AFIO レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 129

割込み と イ ベン ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130

8.1

8.2

8.3

ネス ト 化 さ れたベ ク タ 割込みコ ン ト ロー ラ (NVIC) . . . . . . . . . . . . . . . . . . . 130

8.1.1

8.1.2

SysTick 較正値レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130

割込み ・ 例外ベ ク タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130

外部割込み / イ ベン ト コ ン ト ロー ラ (EXTI) . . . . . . . . . . . . . . . . . . . . . . . . . 134

8.2.1

8.2.2

8.2.3

8.2.4

8.2.5

主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 134

ブ ロ ッ ク 図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 134

ウ ェ ー ク ア ッ プ ・ イ ベン ト 管理 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 135

機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 135

外部割込み / イ ベ ン ト ラ イ ンの割当て . . . . . . . . . . . . . . . . . . . . . . . . . . . 136

EXTI レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 137

8.3.1

8.3.2

8.3.3

割込みマ ス ク ・ レ ジ ス タ (EXTI_IMR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 137

イ ベ ン ト マ ス ク ・ レ ジ ス タ (EXTI_EMR) . . . . . . . . . . . . . . . . . . . . . . . . . . 137

立上 り ト リ ガ選択レ ジ ス タ (EXTI_RTSR) . . . . . . . . . . . . . . . . . . . . . . . . . 138

Rev 5 -日本語版 5/720

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9

参考資料

目次

10

RM0008

8.3.4

8.3.5

8.3.6

8.3.7

立下 り ト リ ガ選択レ ジ ス タ (EXTI_FTSR) . . . . . . . . . . . . . . . . . . . . . . . . . . 138

ソ フ ト ウ ェ ア割込みイ ベ ン ト ・ レ ジ ス タ (EXTI_SWIER) . . . . . . . . . . . . . 139

ペンデ ィ ン グ ・ レ ジ ス タ (EXTI_PR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 139

EXTI レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 140

DMA コ ン ト ロー ラ (DMA) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 141

9.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 141

9.2

9.3

9.4

DMA の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 141

DMA の機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 142

9.3.1

9.3.2

9.3.3

9.3.4

9.3.5

9.3.6

DMA ト ラ ンザ ク シ ョ ン . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 142

アービ タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 143

DMA チ ャ ネル . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 143

エ ラ ー管理 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 144

割込み . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 145

DMA リ ク エ ス ト のマ ッ ピ ン グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 145

DMA レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 149

9.4.1

9.4.2

9.4.3

9.4.4

9.4.5

9.4.6

9.4.7

DMA 割込みス テー タ ス ・ レ ジ ス タ (DMA_ISR) . . . . . . . . . . . . . . . . . . . . . 149

DMA 割込み フ ラ グ ・ ク リ ア ・ レ ジ ス タ (DMA_IFCR) . . . . . . . . . . . . . . 150

DMA チ ャ ネル x 構成レ ジ ス タ (DMA_CCRx) (x = 1 ..7) . . . . . . . . . . . . . . 151

DMA チ ャ ネル x デー タ 数レ ジ ス タ (DMA_CNDTRx) (x = 1 ..7) . . . . . . . . 152

DMA チ ャ ネル x ぺ リ フ ェ ラル ・ ア ド レ ス ・ レ ジ ス タ

(DMA_CPARx) (x = 1 ..7) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 153

DMA チ ャ ネル x メ モ リ ・ ア ド レ ス ・ レ ジ ス タ

(DMA_CMARx) (x = 1 ..7) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 153

DMA レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 153

A/D コ ンバー タ (ADC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 156

10.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 156

10.2

ADC の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 156

10.3

ADC の機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 157

10.3.1

10.3.2

10.3.3

10.3.4

10.3.5

10.3.6

10.3.7

ADC 電源の制御 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 158

ADC ク ロ ッ ク . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 158

チ ャ ネル選択 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 158

シ ン グル変換モー ド (Single conversion mode) . . . . . . . . . . . . . . . . . . . . . 159

連続変換モー ド (Continuous conversion mode) . . . . . . . . . . . . . . . . . . . . . 159

タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 160

アナ ロ グ ・ ウ ォ ッ チ ド ッ グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 160

6/720 Rev 5-日本語版

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参考資料

RM0008

目次

10.3.8

10.3.9

スキ ャ ン ・ モー ド (Scan mode) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 161

イ ン ジ ェ ク ト ・ チ ャ ネルの管理 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 161

10.3.10

分割モー ド (Discontinuous mode) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 162

10.4

較正機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 163

10.5

デー タ の配置 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 164

10.6

入力チ ャ ネルご と のサン プ リ ン グ タ イムの設定 . . . . . . . . . . . . . . . . . . . . . 165

10.7

外部 ト リ ガによ る変換 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 165

10.8

DMA リ ク エ ス ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 167

10.9

デ ュ アル ADC モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 167

10.9.1

10.9.2

10.9.3

10.9.4

10.9.5

10.9.6

10.9.7

10.9.8

10.9.9

同時イ ン ジ ェ ク ト ・ モー ド (Injected simultaneous mode) . . . . . . . . . . . . 169

同時レギ ュ ラ ・ モー ド (Regular simultaneous mode) . . . . . . . . . . . . . . . . 169

高速イ ン タ リ ーブ ・ モー ド (Fast interleaved mode) . . . . . . . . . . . . . . . . 170

低速イ ン タ リ ーブ ・ モー ド (Slow interleaved mode) . . . . . . . . . . . . . . . . 170

オル タ ネー ト ・ ト リ ガ ・ モー ド (Alternate trigger mode) . . . . . . . . . . . . 171

独立モー ド (Independent mode) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 172

同時レギ ュ ラ ・ モー ド + 同時イ ン ジ ェ ク ト ・ モー ド . . . . . . . . . . . . . . . 172

並列レギ ュ ラ ・ モー ド + オル タ ネー ト ・ ト リ ガ ・ モー ド . . . . . . . . . . . 173

同時イ ン ジ ェ ク ト + イ ン タ リ ーブ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 173

10.10

温度セ ンサ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 174

10.11

ADC 割込み リ ク エ ス ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 175

10.12

ADC レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 176

10.12.1

ADC ス テー タ ス ・ レ ジ ス タ (ADC_SR) . . . . . . . . . . . . . . . . . . . . . . . . . . . 176

10.12.2

ADC 制御レ ジ ス タ 1 (ADC_CR1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 177

10.12.3

ADC 制御レ ジ ス タ 2 (ADC_CR2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 180

10.12.4

ADC サン プル ・ タ イ ム ・ レ ジ ス タ 1 (ADC_SMPR1) . . . . . . . . . . . . . . . . 183

10.12.5

ADC サン プル ・ タ イ ム ・ レ ジ ス タ 2 (ADC_SMPR2) . . . . . . . . . . . . . . . . 184

10.12.6

ADC イ ン ジ ェ ク ト ・ チ ャ ネル ・ デー タ ・ オ フ セ ッ ト ・ レ ジ ス タ x

(ADC_JOFRx)(x=1..4) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 184

10.12.7

ADC ウ ォ ッ チ ド ッ グ上限ス レ ッ シ ョ ル ド ・ レ ジ ス タ (ADC_HTR) . . . . 185

10.12.8

ADC ウ ォ ッ チ ド ッ グ下限ス レ ッ シ ョ ル ド ・ レ ジ ス タ (ADC_LTR) . . . . . 185

10.12.9

ADC レギ ュ ラ ・ シーケ ン ス ・ レ ジ ス タ 1 (ADC_SQR1) . . . . . . . . . . . . . . 185

10.12.10 ADC レギ ュ ラ ・ シーケ ン ス ・ レ ジ ス タ 2 (ADC_SQR2) . . . . . . . . . . . . . . 186

10.12.11 ADC レギ ュ ラ ・ シーケ ン ス ・ レ ジ ス タ 3 (ADC_SQR3) . . . . . . . . . . . . . . 187

10.12.12 ADC イ ン ジ ェ ク ト ・ シーケ ン ス ・ レ ジ ス タ (ADC_JSQR) . . . . . . . . . . . 187

10.12.13 ADC イ ン ジ ェ ク ト ・ デー タ ・ レ ジ ス タ x (ADC_JDRx) (x= 1..4) . . . . . . . 188

10.12.14 ADC レギ ュ ラ ・ デー タ ・ レ ジ ス タ (ADC_DR) . . . . . . . . . . . . . . . . . . . . . 189

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RM0008

10.12.15 ADC レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 189

D/A コ ンバー タ (DAC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 191

11.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 191

11.2

DAC の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 191

11.3

DAC 機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 193

11.3.1

11.3.2

11.3.3

11.3.4

11.3.5

11.3.6

11.3.7

11.3.8

11.3.9

DAC チ ャ ネル ・ イ ネーブル . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 193

DAC 出力バ ッ フ ァ ・ イ ネーブル . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 193

DAC デー タ ・ フ ォ ーマ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 193

DAC 変換 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 194

DAC 出力電圧 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 195

DAC ト リ ガ選択 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 195

DMA リ ク エ ス ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 196

ノ イ ズ生成 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 196

三角波生成 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 197

11.4

デ ュ アル DAC チ ャ ネル変換 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 199

11.4.1

11.4.2

11.4.3

11.4.4

11.4.5

11.4.6

11.4.7

11.4.8

波形生成な し の独立 ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 199

同 じ LFSR 生成に よ る独立 ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 199

異な る LFSR 生成に よ る独立 ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 200

同 じ 三角波生成に よ る独立 ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 200

異な る三角波生成に よ る独立 ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 200

同時 ソ フ ト ウ ェ ア ス タ ー ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 201

波形生成な し に よ る同時 ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 201

同 じ LFSR 生成に よ る同時 ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 202

11.4.9

異な る LFSR 生成に よ る同時 ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 202

11.4.10

同 じ 三角生成に よ る同時 ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 202

11.4.11

異な る三角生成に よ る同時 ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 203

11.5

DAC レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 204

11.5.1

11.5.2

11.5.3

11.5.4

11.5.5

11.5.6

DAC 制御レ ジ ス タ (DAC_CR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 204

DAC ソ フ ト ウ ェ ア ・ ト リ ガ ・ レ ジ ス タ (DAC_SWTRIGR) . . . . . . . . . . . . 208

DAC チ ャ ネル 1   12bit 右寄せデー タ 保持レ ジ ス タ

(DAC_DHR12R1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 208

DAC チ ャ ネル 1   12bit 左寄せデー タ 保持レ ジ ス タ

(DAC_DHR12L1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 209

DAC チ ャ ネル 1   8bit 右寄せデー タ 保持レ ジ ス タ

(DAC_DHR8R1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 209

DAC チ ャ ネル 2   12bit 右寄せデー タ 保持レ ジ ス タ

(DAC_DHR12R2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 210

8/720 Rev 5-日本語版

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報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

12

目次

11.5.7

11.5.8

DAC チ ャ ネル 2   12bit 左寄せデー タ 保持レ ジ ス タ

(DAC_DHR12L2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 210

DAC チ ャ ネル 2   8bit 右寄せデー タ 保持レ ジ ス タ

(DAC_DHR8R2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 211

11.5.9

デ ュ アル DAC   12bit 右寄せデー タ 保持レ ジ ス タ

(DAC_DHR12RD) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 211

11.5.10

デ ュ アル DAC   12bit 左寄せデー タ 保持レ ジ ス タ

(DAC_DHR12LD) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 212

11.5.11

デ ュ アル DAC   8bit 右寄せデー タ 保持レ ジ ス タ

(DAC_DHR8RD) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 212

11.5.12

DAC チ ャ ネル 1 デー タ 出力レ ジ ス タ (DAC_DOR1) . . . . . . . . . . . . . . . . . 213

11.5.13

DAC チ ャ ネル 2 デー タ 出力レ ジ ス タ (DAC_DOR2) . . . . . . . . . . . . . . . . . 213

11.5.14

DAC レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 214

高機能制御 タ イ マ (TIM1 及び TIM8) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 215

12.1

TIM1 及び TIM8 の概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 215

12.2

TIM1 及び TIM8 の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 216

12.3

TIM1 及び TIM8 機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 218

12.3.1

12.3.2

12.3.3

12.3.4

12.3.5

12.3.6

12.3.7

タ イ ムベース ・ ユニ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 218

カ ウ ン タ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 220

繰返 し カ ウ ン タ (ダウ ン カ ウ ン タ ) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 229

ク ロ ッ ク 選択 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 231

キ ャ プ チ ャ / 比較チ ャ ネル . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 234

入力キ ャ プ チ ャ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 236

PWM 入力モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 237

12.3.8

12.3.9

出力強制駆動モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 238

出力比較モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 238

12.3.10

PWM モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 240

12.3.11

相補出力 と デ ッ ド タ イ ム挿入 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 243

12.3.12

ブ レ ー ク 機能の利用 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 244

12.3.13

外部イ ベン ト に よ る OCxREF 信号の ク リ ア . . . . . . . . . . . . . . . . . . . . . . 247

12.3.14

6 ス テ ッ プ PWM 波形生成 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 248

12.3.15

単一パルス発生モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 249

12.3.16

エ ン コ ーダ ・ イ ン タ フ ェ ース ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . 250

12.3.17

タ イ マ入力 XOR 機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 253

12.3.18

ホール ・ セ ンサ ・ イ ン タ フ ェ ース . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 253

12.3.19

TIMx と 外部 ト リ ガ同期 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 255

12.3.20

タ イ マ間の同期 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 258

Rev 5 -日本語版 9/720

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参考資料

目次

13

RM0008

12.3.21

デバ ッ グ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 258

12.4

TIM1 及び TIM8 レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 259

12.4.1

12.4.2

12.4.3

12.4.4

12.4.5

12.4.6

12.4.7

12.4.8

制御レ ジ ス タ 1 (TIMx_CR1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 259

制御レ ジ ス タ 2 (TIMx_CR2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 260

ス レ ーブ ・ モー ド 制御レ ジ ス タ (TIMx_SMCR) . . . . . . . . . . . . . . . . . . . . . 262

DMA / 割込み リ ク エ ス ト 許可レ ジ ス タ (TIMx_DIER) . . . . . . . . . . . . . . . . 264

ス テー タ ス ・ レ ジ ス タ (TIMx_SR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 266

イ ベ ン ト 生成レ ジ ス タ (TIMx_EGR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 267

キ ャ プ チ ャ / 比較モー ド ・ レ ジ ス タ 1 (TIMx_CCMR1) . . . . . . . . . . . . . . 269

キ ャ プ チ ャ / 比較モー ド ・ レ ジ ス タ 2 (TIMx_CCMR2) . . . . . . . . . . . . . . 272

12.4.9

キ ャ プ チ ャ / 比較イ ネーブル ・ レ ジ ス タ (TIMx_CCER) . . . . . . . . . . . . . 273

12.4.10

カ ウ ン タ (TIMx_CNT) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 276

12.4.11

プ リ スケー ラ (TIMx_PSC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 276

12.4.12

自動再ロー ド ・ レ ジ ス タ (TIMx_ARR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 276

12.4.13

繰返 し カ ウ ン タ ・ レ ジ ス タ (TIMx_RCR) . . . . . . . . . . . . . . . . . . . . . . . . . . 277

12.4.14

キ ャ プ チ ャ / 比較レ ジ ス タ 1 (TIMx_CCR1) . . . . . . . . . . . . . . . . . . . . . . . 277

12.4.15

キ ャ プ チ ャ / 比較レ ジ ス タ 2 (TIMx_CCR2) . . . . . . . . . . . . . . . . . . . . . . . 278

12.4.16

キ ャ プ チ ャ / 比較レ ジ ス タ 3 (TIMx_CCR3) . . . . . . . . . . . . . . . . . . . . . . . 278

12.4.17

キ ャ プ チ ャ / 比較レ ジ ス タ 4 (TIMx_CCR4) . . . . . . . . . . . . . . . . . . . . . . . 279

12.4.18

ブ レ ー ク / デ ッ ド タ イ ムレ ジ ス タ (TIMx_BDTR) . . . . . . . . . . . . . . . . . . . 279

12.4.19

DMA 制御レ ジ ス タ (TIMx_DCR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 281

12.4.20

バース ト ・ モー ド DMA ア ド レ ス ・ レ ジ ス タ (TIMx_DMAR) . . . . . . . . . . 282

12.4.21

TIM1 及び TIM8 レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 283

汎用 タ イ マ (TIMx) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 285

13.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 285

13.2

TIMx の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 285

13.3

TIMx の機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 286

13.3.1

13.3.2

13.3.3

13.3.4

13.3.5

13.3.6

13.3.7

13.3.8

13.3.9

タ イ ムベース ・ ユニ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 286

カ ウ ン タ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 288

ク ロ ッ ク 選択 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 296

キ ャ プ チ ャ / 比較チ ャ ネル . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 299

入力キ ャ プ チ ャ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 301

PWM 入力モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 302

出力強制駆動モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 302

出力比較モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 303

PWM モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 304

10/720 Rev 5-日本語版

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参考資料

RM0008

14

目次

13.3.10

単一パルス発生モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 307

13.3.11

外部イ ベン ト に よ る OCxREF 信号の ク リ ア . . . . . . . . . . . . . . . . . . . . . . . 308

13.3.12

エ ン コ ーダ ・ イ ン タ フ ェ ース ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . 309

13.3.13

タ イ マ入力 XOR 機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 311

13.3.14

タ イ マの外部 ト リ ガ同期 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 311

13.3.15

タ イ マ間の同期 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 314

13.3.16

デバ ッ グ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 320

13.4

TIMx レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 321

13.4.1

13.4.2

13.4.3

13.4.4

13.4.5

13.4.6

13.4.7

13.4.8

制御レ ジ ス タ 1 (TIMx_CR1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 321

制御レ ジ ス タ 2 (TIMx_CR2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 322

ス レ ーブ ・ モー ド 制御レ ジ ス タ (TIMx_SMCR) . . . . . . . . . . . . . . . . . . . . . 323

DMA/ 割込みイ ネーブル ・ レ ジ ス タ (TIMx_DIER) . . . . . . . . . . . . . . . . . . . 326

ス テー タ ス ・ レ ジ ス タ (TIMx_SR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 327

イ ベ ン ト 生成レ ジ ス タ (TIMx_EGR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 328

キ ャ プ チ ャ / 比較モー ド ・ レ ジ ス タ 1 (TIMx_CCMR1) . . . . . . . . . . . . . . 330

キ ャ プ チ ャ / 比較モー ド ・ レ ジ ス タ 2 (TIMx_CCMR2) . . . . . . . . . . . . . . 333

13.4.9

キ ャ プ チ ャ / 比較イ ネーブル ・ レ ジ ス タ (TIMx_CCER) . . . . . . . . . . . . . 334

13.4.10

カ ウ ン タ (TIMx_CNT) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 335

13.4.11

プ リ スケー ラ (TIMx_PSC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 336

13.4.12

自動再ロー ド ・ レ ジ ス タ (TIMx_ARR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 336

13.4.13

キ ャ プ チ ャ / 比較レ ジ ス タ 1 (TIMx_CCR1) . . . . . . . . . . . . . . . . . . . . . . . . 336

13.4.14

キ ャ プ チ ャ / 比較レ ジ ス タ 2 (TIMx_CCR2) . . . . . . . . . . . . . . . . . . . . . . . . 337

13.4.15

キ ャ プ チ ャ / 比較レ ジ ス タ 3 (TIMx_CCR3) . . . . . . . . . . . . . . . . . . . . . . . . 337

13.4.16

キ ャ プ チ ャ / 比較レ ジ ス タ 4 (TIMx_CCR4) . . . . . . . . . . . . . . . . . . . . . . . . 338

13.4.17

DMA 制御レ ジ ス タ (TIMx_DCR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 338

13.4.18

バース ト ・ モー ド DMA ア ド レ ス ・ レ ジ ス タ (TIMx_DMAR) . . . . . . . . . . 339

13.4.19

TIMx レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 340

ベーシ ッ ク ・ タ イ マ (TIM6 及び TIM7) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 342

14.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 342

14.2

TIM6 及び TIM7 の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 342

14.3

TIM6 及び TIM7 の機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 343

14.3.1

14.3.2

14.3.3

14.3.4

タ イ ムベース ・ ユニ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 343

カ ウ ン タ 動作モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 345

ク ロ ッ ク ・ ソ ース . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 347

デバ ッ グ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 348

14.4

TIM6 及び TIM7 レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 348

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14.4.1

14.4.2

14.4.3

14.4.4

14.4.5

14.4.6

14.4.7

14.4.8

14.4.9

制御レ ジ ス タ 1 (TIMx_CR1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 348

制御レ ジ ス タ 2 (TIMx_CR2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 350

DMA / 割込み リ ク エ ス ト 許可レ ジ ス タ (TIMx_DIER) . . . . . . . . . . . . . . . . 350

ス テー タ ス ・ レ ジ ス タ (TIMx_SR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 351

イ ベ ン ト 生成レ ジ ス タ (TIMx_EGR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 351

カ ウ ン タ (TIMx_CNT) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 352

プ リ スケー ラ (TIMx_PSC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 352

自動再ロー ド ・ レ ジ ス タ (TIMx_ARR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 352

TIM6 及び TIM7 レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 353

リ アル タ イ ム ・ ク ロ ッ ク (RTC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 354

15.1

RTC の概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 354

15.2

RTC の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 355

15.3

RTC の機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 355

15.3.1

15.3.2

15.3.3

15.3.4

15.3.5

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 355

RTC レ ジ ス タ の リ セ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 356

RTC レ ジ ス タ の読出 し . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 356

RTC レ ジ ス タ の構成設定 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 357

RTC フ ラ グセ ッ ト の条件 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 358

15.4

RTC レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 359

15.4.1

15.4.2

15.4.3

15.4.4

15.4.5

15.4.6

15.4.7

RTC 制御レ ジ ス タ (上位) (RTC_CRH) . . . . . . . . . . . . . . . . . . . . . . . . . . . 359

RTC 制御レ ジ ス タ (下位) (RTC_CRL) . . . . . . . . . . . . . . . . . . . . . . . . . . . 360

RTC プ リ スケー ラ ・ ロー ド ・ レ ジ ス タ (RTC_PRLH / RTC_PRLL) . . . . 362

RTC プ リ スケー ラ 分周レ ジ ス タ (RTC_DIVH / RTC_DIVL) . . . . . . . . . . . 363

RTC カ ウ ン タ ・ レ ジ ス タ (RTC_CNTH / RTC_CNTL) . . . . . . . . . . . . . . . . 364

RTC ア ラ ーム ・ レ ジ ス タ (上位) (RTC_ALRH / RTC_ALRL) . . . . . . . . . 365

RTC レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 366

独立型ウ ォ ッ チ ド ッ グ (IWDG) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 367

16.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 367

16.2

IWDG の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 367

16.3

IWDG の機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 367

16.3.1

16.3.2

16.3.3

ハー ド ウ ェ アウ ォ ッ チ ド ッ グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 367

レ ジ ス タ ・ ア ク セスに対する保護 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 368

デバ ッ グ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 368

16.4

IWDG レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 369

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16.4.1

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16.4.4

16.4.5

キーレ ジ ス タ (IWDG_KR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 369

プ リ スケー ラ ・ レ ジ ス タ (IWDG_PR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 369

再ロー ド 値レ ジ ス タ (IWDG_RLR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 370

ス テー タ ス ・ レ ジ ス タ (IWDG_SR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 371

IWDG レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 372

Window 型ウ ォ ッ チ ド ッ グ (WWDG) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 373

17.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 373

17.2

WWDG の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 373

17.3

WWDG の機能解説 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 374

17.4

ウ ォ ッ チ ド ッ グに よ る タ イ ムアウ ト を利用するには . . . . . . . . . . . . . . . . . 376

17.5

デバ ッ グ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 377

17.6

WWDG レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 377

17.6.1

17.6.2

17.6.3

17.6.4

制御レ ジ ス タ (WWDG_CR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 377

構成レ ジ ス タ (WWDG_CFR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 378

ス テー タ ス ・ レ ジ ス タ (WWDG_SR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 378

WWDG レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 379

フ レキシ ブル ・ ス タ テ ィ ッ ク ・ メ モ リ ・ コ ン ト ロー ラ (FSMC) . . . . . . . . 380

18.1

FSMC の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 380

18.2

ブ ロ ッ ク 図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 381

18.3

AHB イ ン タ フ ェ ース . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 382

18.3.1

サポー ト さ れる メ モ リ 及び ト ラ ンザ ク シ ョ ン . . . . . . . . . . . . . . . . . . . . . 382

18.4

外部デバイ ス ・ ア ド レ ス ・ マ ッ ピ ング . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 383

18.4.1

18.4.2

NOR/PSRAM ア ド レ ス ・ マ ッ ピ ン グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 383

NAND/PC カ ー ド ・ ア ド レ ス ・ マ ッ ピ ン グ . . . . . . . . . . . . . . . . . . . . . . . . 384

18.5

NOR 型 Flash/PSRAM コ ン ト ロー ラ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 385

18.5.1

18.5.2

18.5.3

18.5.4

18.5.5

18.5.6

外部 メ モ リ ・ イ ン タ フ ェ ース信号 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 386

サポー ト さ れる メ モ リ 及び ト ラ ンザ ク シ ョ ン . . . . . . . . . . . . . . . . . . . . . 388

一般的な タ イ ミ ン グ規則 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 389

NOR 型 Flash/PSRAM コ ン ト ロー ラ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . . . . 389

同期バース ト 読込み . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 407

NOR/PSRAM 制御レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 413

18.6

NAND 型 Flash/PC カ ー ド ・ コ ン ト ロー ラ . . . . . . . . . . . . . . . . . . . . . . . . . . 419

18.6.1

外部 メ モ リ ・ イ ン タ フ ェ ース信号 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 420

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18.6.4

18.6.5

18.6.6

NAND 型 Flash/PC カ ー ド がサポー ト さ れる メ モ リ 及び

ト ラ ンザ ク シ ョ ン . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 421

NAND、 ATA 及び PC カ ー ド に関する タ イ ミ ン グ図 . . . . . . . . . . . . . . . . 421

NAND 型 Flash   レデ ィ / ビ ジー管理 . . . . . . . . . . . . . . . . . . . . . . . . . . . . 424

エ ラ ー訂正 コ ー ド 生成 ECC (NAND 型 Flash) . . . . . . . . . . . . . . . . . . . . . 425

NAND 型 Flash/PC カ ー ド 制御レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . 425

SDIO イ ン タ フ ェ ース (SDIO) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 432

19.1

SDIO の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 432

19.2

SDIO バス ・ ト ポロ ジ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 433

19.3

SDIO の機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 435

19.3.1

19.3.2

SDIO アダ プ タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 436

SDIO AHB イ ン タ フ ェ ース . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 446

19.4

カ ー ド 機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 447

19.4.1

19.4.2

19.4.3

19.4.4

19.4.5

19.4.6

19.4.7

カ ー ド 識別モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 447

カ ー ド ・ リ セ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 447

動作電圧範囲検証 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 447

カ ー ド 識別プ ロ セス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 448

ブ ロ ッ ク 書込み . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 449

ブ ロ ッ ク 読出 し . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 449

ス ト リ ーム ・ ア ク セス、 ス ト リ ーム書込み、 ス ト リ ーム読込み

(MultiMediaCard のみ) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 450

19.4.8

19.4.9

消去 : グループ消去 と セ ク タ 消去 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 451

ワ イ ド バス選択または非選択 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 451

19.4.10

保護管理 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 452

19.4.11

カ ー ド ・ ス テー タ ス ・ レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 455

19.4.12

SD ス テー タ ス ・ レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 458

19.4.13

SD I/O モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 463

19.4.14

コ マ ン ド と レ スポン ス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 464

19.5

レ スポン ス ・ フ ォ ーマ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 467

19.5.1

19.5.2

19.5.3

19.5.4

19.5.5

19.5.6

19.5.7

R1 ( ノ ーマル ・ レ スポン ス ・ コ マ ン ド ) . . . . . . . . . . . . . . . . . . . . . . . . . 467

R1b . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 468

R2 (CID、 CSD レ ジ ス タ ) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 468

R3 (OCR レ ジ ス タ ) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 468

R4 ( 高速 I/O) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 469

R4b . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 469

R5 (割込み リ ク エ ス ト ) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 470

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目次

19.5.8

R6 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 470

19.6

SDIO I/O カ ー ド 仕様動作 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 471

19.6.1

19.6.2

19.6.3

19.6.4

SDIO_D2 信号に よ る SDIO I/O 読込みウ ェ イ ト 動作 . . . . . . . . . . . . . . . . 471

SDIO_CK 停止に よ る SDIO 読込みウ ェ イ ト 動作 . . . . . . . . . . . . . . . . . . . 471

SDIO サスペン ド / リ ジ ュ ーム動作 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 471

SDIO 割込み . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 472

19.7

CE-ATA 仕様動作 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 472

19.7.1

19.7.2

19.7.3

19.7.4

コ マ ン ド 完了信号デ ィ セーブル . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 472

コ マ ン ド 完了信号イ ネーブル . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 472

CE-ATA 割込み . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 472

CMD61 のアボー ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 472

19.8

HW フ ロー制御 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 473

19.9

SDIO レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 473

19.9.1

19.9.2

19.9.3

19.9.4

19.9.5

19.9.6

19.9.7

SDIO 電源制御レ ジ ス タ (SDIO_POWER) . . . . . . . . . . . . . . . . . . . . . . . . . . 473

SDIO ク ロ ッ ク制御レ ジ ス タ (SDIO_CLKCR) . . . . . . . . . . . . . . . . . . . . . . . 474

SDIO 引数レ ジ ス タ (SDIO_ARG) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 475

SDIO コ マ ン ド ・ レ ジ ス タ (SDIO_CMD) . . . . . . . . . . . . . . . . . . . . . . . . . . . 475

SDIO コ マ ン ド ・ レ スポ ン ス ・ レ ジ ス タ (SDIO_RESPCMD) . . . . . . . . . . 476

SDIO レ スポン ス 0..4 レ ジ ス タ (SDIO_RESPx) . . . . . . . . . . . . . . . . . . . . . . 477

SDIO デー タ タ イ マ レ ジ ス タ (SDIO_DTIMER) . . . . . . . . . . . . . . . . . . . . . . 477

19.9.8

19.9.9

SDIO デー タ 長レ ジ ス タ (SDIO_DLEN) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 478

SDIO デー タ 制御レ ジ ス タ (SDIO_DCTRL) . . . . . . . . . . . . . . . . . . . . . . . . . 478

19.9.10

SDIO デー タ ・ カ ウ ン タ ・ レ ジ ス タ (SDIO_DCOUNT) . . . . . . . . . . . . . . . 480

19.9.11

SDIO ス テー タ ス ・ レ ジ ス タ (SDIO_STA) . . . . . . . . . . . . . . . . . . . . . . . . . 480

19.9.12

SDIO 割込み ク リ ア ・ レ ジ ス タ (SDIO_ICR) . . . . . . . . . . . . . . . . . . . . . . . . 482

19.9.13

SDIO マ ス ク ・ レ ジ ス タ (SDIO_MASK) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 483

19.9.14

SDIO FIFO カ ウ ン タ ・ レ ジ ス タ (SDIO_FIFOCNT) . . . . . . . . . . . . . . . . . . . 486

19.9.15

SDIO デー タ FIFO レ ジ ス タ (SDIO_FIFO) . . . . . . . . . . . . . . . . . . . . . . . . . . 487

19.9.16

SDIO レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 488

USB フルス ピー ド ・ デバイ ス ・ イ ン タ フ ェ ース (USB) . . . . . . . . . . . . . . . 489

20.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 489

20.2

USB の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 489

20.3

USB の機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 490

20.3.1

USB ブ ロ ッ ク . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 491

20.4

プ ロ グ ラ ミ ングの際の注意 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 493

Rev 5 -日本語版 15/720

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

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ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

目次

21

RM0008

20.4.1

20.4.2

20.4.3

20.4.4

20.4.5

一般的な USB デバイ スのプ ロ グ ラ ミ ン グ . . . . . . . . . . . . . . . . . . . . . . . . 493

シ ス テム ・ リ セ ッ ト と パワー ・ オ ン ・ リ セ ッ ト . . . . . . . . . . . . . . . . . . . 493

ダブルバ ッ フ ァ ・ エ ン ド ポ イ ン ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 499

ア イ ソ ク ロ ナス転送 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 501

サスペ ン ド / レ ジ ュ ーム イ ベン ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 502

20.5

USB レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 504

20.5.1

20.5.2

20.5.3

20.5.4

一般レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 504

エ ン ド ポ イ ン ト に対応する レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 511

バ ッ フ ァ ・ デ ィ ス ク リ プ タ ・ テーブル . . . . . . . . . . . . . . . . . . . . . . . . . . . 516

USB レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 519

CAN (Controller Area Network) (bxCAN) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 521

21.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 521

21.2

bxCAN の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 521

21.2.1

詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 522

21.3

bxCAN の動作モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 524

21.3.1

21.3.2

21.3.3

21.3.4

21.3.5

21.3.6

21.3.7

初期化モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 524

通常モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 525

SLEEP モー ド (低消費電力) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 525

テ ス ト モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 525

サイ レ ン ト ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 526

ループバ ッ ク ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 526

サイ レ ン ト ・ モー ド と ループバ ッ ク ・ モー ド の組合わせ . . . . . . . . . . . 527

21.4

bxCAN の機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 527

21.4.1

21.4.2

21.4.3

21.4.4

21.4.5

21.4.6

21.4.7

送信動作 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 527

タ イ ム ト リ ガ通信モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 529

受信動作 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 529

ID に よ る フ ィ ル タ リ ン グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 530

メ ッ セージ ・ メ モ リ ( メ ールボ ッ ク ス) . . . . . . . . . . . . . . . . . . . . . . . . . . 535

エ ラ ー管理 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 536

ビ ッ ト ・ タ イ ミ ン グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 537

21.5

bxCAN の割込み . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 538

21.6

CAN レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 540

21.6.1

21.6.2

21.6.3

レ ジ ス タ ・ ア ク セスに対する保護 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 540

CAN 制御 / ス テー タ ス ・ レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 541

メ ールボ ッ ク ス ・ レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 553

16/720 Rev 5-日本語版

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参考資料

RM0008

22

目次

21.6.4

21.6.5

CAN フ ィ ル タ ・ レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 560

bxCAN レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 564

SPI (Serial peripheral interface) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 567

22.1

SPI の概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 567

22.2

SPI と I

2

S の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 568

22.2.1

22.2.2

SPI 機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 568

I

2

S 機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 569

22.3

SPI の機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 570

22.3.1

22.3.2

22.3.3

22.3.4

22.3.5

22.3.6

22.3.7

22.3.8

22.3.9

概説 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 570

SPI ス レーブ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 574

SPI マ ス タ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 575

一方向の通信 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 575

ス テー タ ス ・ フ ラ グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 576

CRC の計算 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 577

DMA (direct memory addressing) を使用する SPI 通信 . . . . . . . . . . . . . 578

エ ラ ー ・ フ ラ グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 578

SPI のデ ィ セーブル . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 579

22.3.10

SPI 割込み . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 579

22.4

I

2

S 機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 579

22.4.1

22.4.2

22.4.3

22.4.4

22.4.5

22.4.6

22.4.7

22.4.8

詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 579

サポー ト さ れる オーデ ィ オ ・ プ ロ ト コ ル . . . . . . . . . . . . . . . . . . . . . . . . . 581

ク ロ ッ ク ・ ジ ェ ネ レー タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 588

I

2

S マス タ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 589

I

2

S ス レーブ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 590

ス テー タ ス ・ フ ラ グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 592

エ ラ ー ・ フ ラ グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 593

I

2

S 割込み . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 593

22.4.9

22.5.1

DMA 機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 593

22.5

SPI と I

2

S レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 594

SPI 制御レ ジ ス タ 1 (SPI_CR1) (I

2

S モー ド では使用 し ません。 ) . . . . . . 594

22.5.2

SPI 制御レ ジ ス タ 2 (SPI_CR2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 596

22.5.3

22.5.4

22.5.5

22.5.6

SPI ス テー タ ス ・ レ ジ ス タ (SPI_SR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 596

SPI デー タ ・ レ ジ ス タ (SPI_DR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 598

SPI CRC 多項式レ ジ ス タ (SPI_CRCPR)

(I

2

S モー ド では使用 し ません。 ) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 598

SPI Rx CRC レ ジ ス タ (SPI_RXCRCR) (I

2

S モー ド では使用 し ません。 ) . 599

Rev 5 -日本語版 17/720

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参考資料

目次

23

24

RM0008

22.5.7

22.5.8

22.5.9

SPI Tx CRC レ ジ ス タ (SPI_TXCRCR) (I

2

S モー ド では使用 し ません。 ) . 599

SPI_I

2

S 構成レ ジ ス タ (SPI_I2SCFGR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 600

SPI_I

2

S プ リ スケー ラ ・ レ ジ ス タ (SPI_I2SPR) . . . . . . . . . . . . . . . . . . . . . . 601

22.5.10

SPI レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 602

I2C (Inter-integrated circuit) イ ン タ フ ェ ース . . . . . . . . . . . . . . . . . . . . . . . . 603

23.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 603

23.2

I2C の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 604

23.3

I2C の機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 605

23.3.1

23.3.2

23.3.3

23.3.4

23.3.5

23.3.6

23.3.7

23.3.8

モー ド 選択 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 605

I2C ス レーブ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 606

I2C マ ス タ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 609

エ ラ ー条件 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 613

SDA/SCL ラ イ ン制御 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 614

SMBus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 615

DMA リ ク エ ス ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 618

パケ ッ ト ・ エ ラ ーの検出 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 620

23.4

I2C 割込み . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 621

23.5

I

2

C デバ ッ グ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 623

23.6

I2C レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 623

23.6.1

23.6.2

23.6.3

23.6.4

23.6.5

23.6.6

23.6.7

23.6.8

制御レ ジ ス タ 1 (I2C_CR1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 623

制御レ ジ ス タ 2 (I2C_CR2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 625

自己ア ド レ ス ・ レ ジ ス タ 1 (I2C_OAR1) . . . . . . . . . . . . . . . . . . . . . . . . . . . 627

自己ア ド レ ス ・ レ ジ ス タ 2 (I2C_OAR2) . . . . . . . . . . . . . . . . . . . . . . . . . . . 627

デー タ ・ レ ジ ス タ (I2C_DR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 628

ス テー タ ス ・ レ ジ ス タ 1 (I2C_SR1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 629

ス テー タ ス ・ レ ジ ス タ 2 (I2C_SR2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 632

ク ロ ッ ク 制御レ ジ ス タ (I2C_CCR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 634

23.6.9

TRISE レ ジ ス タ (I2C_TRISE) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 635

23.6.10

I2C レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 636

USART . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 637

24.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 637

24.2

USART の主な機能 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 638

24.3

USART の機能詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 639

24.3.1

USART の特性詳細 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 642

18/720 Rev 5-日本語版

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参考資料

RM0008

25

26

目次

24.3.2

24.3.3

24.3.4

24.3.5

24.3.6

24.3.7

24.3.8

24.3.9

送信回路 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 643

受信回路 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 645

ボーレー ト 生成回路 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 649

複数プ ロ セ ッ サ間の通信 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 651

パ リ テ ィ 制御 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 652

LIN (local interconnection network) モー ド . . . . . . . . . . . . . . . . . . . . . . . . . 653

USART 同期シ リ アル ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 655

単線式半二重通信 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 657

24.3.10

ス マー ト カ ー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 658

24.3.11

IrDA SIR ENDEC ブ ロ ッ ク . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 660

24.3.12

DMA を使用する連続的な通信 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 662

24.3.13

ハー ド ウ ェ ア ・ フ ロー制御 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 663

24.4

USART 割込み . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 665

24.5

USART モー ド 構成 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 666

24.6

USART レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 666

24.6.1

24.6.2

24.6.3

24.6.4

24.6.5

24.6.6

24.6.7

24.6.8

ス テー タ ス ・ レ ジ ス タ (USART_SR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 666

デー タ ・ レ ジ ス タ (USART_DR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 669

ボーレー ト ・ レ ジ ス タ (USART_BRR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 670

制御レ ジ ス タ 1 (USART_CR1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 670

制御レ ジ ス タ 2 (USART_CR2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 673

制御レ ジ ス タ 3 (USART_CR3) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 675

ガー ド タ イ ム / プ リ スケー ラ ・ レ ジ ス タ (USART_GTPR) . . . . . . . . . . . 676

USART レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 678

デバイ ス電子署名 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 679

25.1

メ モ リ ・ サイ ズ ・ レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 679

25.1.1

25.1.2

Flash サイ ズ ・ レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 679

RAM サイ ズ ・ レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 679

25.2

ユニー ク ・ デバイ ス ID レ ジ ス タ (96bit) . . . . . . . . . . . . . . . . . . . . . . . . . . . 680

デバ ッ グ ・ サポー ト (DBG) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 682

26.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 682

26.2

ARM ド キ ュ メ ン ト の参照 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 684

26.3

SWJ デバ ッ グ ・ ポー ト (シ リ アル ・ ワ イヤ と JTAG) . . . . . . . . . . . . . . . . 684

26.3.1

JTAG-DP も し く は SW-DP 選択 メ カ ニズム . . . . . . . . . . . . . . . . . . . . . . . 685

26.4

ピ ン配置 と デバ ッ グ ・ ポー ト ピ ン . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 685

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参考資料

目次

RM0008

26.4.1

26.4.2

26.4.3

26.4.4

SWJ デバ ッ グ ・ ポー ト ピ ン . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 685

フ レ キシ ブルな SWJ-DP ピ ン配置 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 685

JTAG ピ ンの内部プルア ッ プ / プルダウ ン . . . . . . . . . . . . . . . . . . . . . . . 686

GPIO と し て も シ リ アル ・ ワ イ ヤの使用 と 未使用デバ ッ グ ピ ンの解放 687

26.5

STM32F10xxx JTAG TAP 接続 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 688

26.6

ID コ ー ド と ロ ッ ク メ カ ニズム . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 689

26.6.1

26.6.2

26.6.3

26.6.4

MCU デバイ ス ID コ ー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 689

バウ ン ダ リ ・ スキ ャ ン TAP . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 690

Cortex-M3 TAP . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 690

Cortex-M3 JEDEC-106 ID コ ー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 690

26.7

JTAG デバ ッ グ ・ ポー ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 690

26.8

SW デバ ッ グ ・ ポー ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 692

26.8.1

26.8.2

26.8.3

26.8.4

26.8.5

26.8.6

SW プ ロ ト コ ル概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 692

SW プ ロ ト コ ル手順 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 692

SW-DP ス テー ト マ シ ン ( リ セ ッ ト 、 ア イ ド ルス テー ト 、 ID コ ー ド ) . 693

DP 及び AP の読出 し / 書込みア ク セス . . . . . . . . . . . . . . . . . . . . . . . . . . 694

SW-DP レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 695

SW-AP レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 696

26.9

AHB-AP (AHB ア ク セスポー ト ) - JTAG-DP も し く は SW-DP で有効 . 696

26.10

コ ア ・ デバ ッ グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 697

26.11

シ ス テム ・ リ セ ッ ト 時のデバ ッ グ ・ ホス ト 接続 . . . . . . . . . . . . . . . . . . . . . 697

26.12

FPB (Flash patch breakpoint : Flash パ ッ チ ・ ブ レー ク ポ イ ン ト ) . . . . . . . 698

26.13

DWT (data watchpoint trigger : デー タ ・ ウ ォ ッ チポ イ ン ト ・ ト リ ガ) . . . 698

26.14

ITM (instrumentation trace macrocell : 計測 ト レース ・ マ ク ロ セル) . . . . 699

26.14.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 699

26.14.2

タ イ ムス タ ン プ ・ パケ ッ ト 、 同期及びオーバ フ ロー ・ パケ ッ ト . . . . . 699

26.15

MCU デバ ッ グ ・ コ ンポーネ ン ト (MCUDBG) . . . . . . . . . . . . . . . . . . . . . . . . 701

26.15.1

低電力モー ド におけ るデバ ッ グのサポー ト . . . . . . . . . . . . . . . . . . . . . . . 701

26.15.2

タ イ マ、 ウ ォ ッ チ ド ッ グ、 bxCAN と I

2

C に対する

デバ ッ グ ・ サポー ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 701

26.15.3

デバ ッ グ MCU 構成レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 702

26.16

TPIU (trace port interface unit) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 704

26.16.1

概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 704

26.16.2

ト レ ース ・ ピ ン配置 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 705

26.16.3

TPIU フ ォ ーマ ッ タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 707

26.16.4

TPIU フ レーム同期パケ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 707

20/720 Rev 5-日本語版

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参考資料

RM0008

27

目次

26.16.5

同期 フ レ ームパケ ッ ト の発行 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 708

26.16.6

同期モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 708

26.16.7

非同期モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 708

26.16.8

STM32F10xxx 内部の TRACECLKIN 接続 . . . . . . . . . . . . . . . . . . . . . . . . . . 708

26.16.9

TPIU レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 709

26.16.10 設定例 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 710

26.17

DBG レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 711

改版履歴 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 712

Rev 5 -日本語版 21/720

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表 25.

表 26.

表 27.

表 28.

表 29.

表 30.

表 31.

表 32.

表 17.

表 18.

表 19.

表 20.

表 21.

表 22.

表 23.

表 24.

表 9.

表 10.

表 11.

表 12.

表 13.

表 14.

表 15.

表 16.

表 1.

表 2.

表 3.

表 4.

表 5.

表 6.

表 7.

表 8.

表 41.

表 42.

表 43.

表 44.

表 45.

表 46.

表 47.

表 48.

表 33.

表 34.

表 35.

表 36.

表 37.

表 38.

表 39.

表 40.

参考資料

表の一覧

表の一覧

RM0008

レ ジ ス タ ・ バウ ン ダ リ ・ ア ド レ ス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

Flash モ ジ ュ ールの構成 (中容量デバイ ス) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39

Flash モ ジ ュ ールの構成 (大容量デバイ ス) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40

ブー ト ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42

CRC 計算ユニ ッ ト -レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 値 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47

低電力モー ド 要約 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 52

Sleep-now . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 54

Sleep-on-exit. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 54

STOP モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 56

STANDBY モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 57

PWR - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62

BKP - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69

RCC - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 101

ポー ト ・ ビ ッ ト 構成表 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 104

出力モー ド ビ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 104

CAN オル タ ネー ト 機能のピ ン割当て変更 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 116

デバ ッ グ ・ イ ン タ フ ェ ース信号 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 117

デバ ッ グ ・ ポー ト のピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 117

ADC1 外部 ト リ ガ ・ イ ン ジ ェ ク ト 変換オル タ ネー ト 機能のピ ン割当て . . . . . . . . . . . . . . . . 118

ADC1 外部 ト リ ガ ・ レギ ュ ラ変換オル タ ネー ト 機能のピ ン割当て. . . . . . . . . . . . . . . . . . . . 118

ADC2 外部 ト リ ガ ・ イ ン ジ ェ ク ト 変換オル タ ネー ト 機能のピ ン割当て . . . . . . . . . . . . . . . . 118

ADC2 外部 ト リ ガ ・ レギ ュ ラ変換オル タ ネー ト 機能のピ ン割当て. . . . . . . . . . . . . . . . . . . . 118

タ イ マ 5 オル タ ネー ト 機能のピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 119

タ イ マ 4 オル タ ネー ト 機能のピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 119

タ イ マ 3 オル タ ネー ト 機能のピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 119

タ イ マ 2 オル タ ネー ト 機能のピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 119

タ イ マ 1 オル タ ネー ト 機能のピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 120

USART3 ピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 121

USART2 ピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 121

USART1 ピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 121

I2C1 ピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 122

SPI1 ピ ン割当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 122

GPIO -レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 129

AFIO -レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 129

ベ ク タ テーブル . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130

外部割込み / イ ベ ン ト コ ン ト ロー ラ (EXTI) レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 . . . . . 140

DMA 割込み リ ク エ ス ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 145

チ ャ ネルに対する DMA1 リ ク エ ス ト の一覧 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 147

チ ャ ネルに対する DMA2 リ ク エ ス ト の一覧. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 148

DMA - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 153

ADC ピ ン . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 158

アナ ロ グ ・ ウ ォ ッ チ ド ッ グ ・ チ ャ ネル選択. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 161

ADC1 と ADC2 のレギ ュ ラ ・ チ ャ ネルのための外部 ト リ ガ. . . . . . . . . . . . . . . . . . . . . . . . . . 165

ADC1 と ADC2 のイ ン ジ ェ ク ト ・ チ ャ ネルのための外部 ト リ ガ . . . . . . . . . . . . . . . . . . . . . . 166

ADC3 のレギ ュ ラ ・ チ ャ ネルのための外部 ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 166

ADC3 のイ ン ジ ェ ク ト ・ チ ャ ネルのための外部 ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 166

ADC 割込み . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 175

ADC - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 189

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参考資料

RM0008

表 73.

表 74.

表 75.

表 76.

表 77.

表 78.

表 79.

表 80.

表 65.

表 66.

表 67.

表 68.

表 69.

表 70.

表 71.

表 72.

表 57.

表 58.

表 59.

表 60.

表 61.

表 62.

表 63.

表 64.

表 49.

表 50.

表 51.

表 52.

表 53.

表 54.

表 55.

表 56.

表 92.

表 93.

表 94.

表 95.

表 96.

表 97.

表 98.

表 99.

表 100.

表 81.

表 82.

表 83.

表 84.

表 85.

表 86.

表 87.

表 88.

表 89.

表 90.

表 91.

表の一覧

DAC ピ ン . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 192

外部 ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 195

DAC -レ ジ ス タ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 214

カ ウ ン ト の方向 と エ ン コ ーダ信号. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 251

TIMx 内部 ト リ ガ接続 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 264

ブ レー ク 機能を も つ相補出力 OCx 及び OCxN チ ャ ネルの出力制御ビ ッ ト . . . . . . . . . . . . 275

TIM1 及び TIM8 -レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 283

カ ウ ン ト の方向 と エ ン コ ーダ信号. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 310

TIMx 内部 ト リ ガ接続 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 325

標準 OCx チ ャ ネルの出力制御ビ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 335

TIMx -レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 340

TIM6 及び TIM7 - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 353

RTC - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 366

ウ ォ ッ チ ド ッ グ ・ タ イムアウ ト 時間 (40 kHz ク ロ ッ ク 入力時). . . . . . . . . . . . . . . . . . . . . . 368

IWDG -レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 372

WWDG -レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 379

NOR/PSRAM バン ク 選択. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 383

外部 メ モ リ ・ ア ド レ ス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 384

メ モ リ ・ マ ッ ピ ン グ と タ イ ミ ン グ ・ レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 384

NAND バン ク選択 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 385

プ ロ グ ラ マ ブル NOR/PSRAM ア ク セス ・ パ ラ メ ー タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 386

非マルチ プ レ ク ス I/O NOR 型 Flash . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 386

マルチ プ レ ク ス I/O NOR 型 Flash . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 387

PSRAM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 387

NOR 型 Flash /PSRAM がサポー ト する メ モ リ 及び ト ラ ンザ ク シ ョ ン . . . . . . . . . . . . . . . . . 388

FSMC_BCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 391

FSMC_TCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 392

FSMC_BCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 394

FSMC_TCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 394

FSMC_BWTRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 394

FSMC_BCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 398

FSMC_TCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 398

FSMC_BWTRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 398

FSMC_BCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 400

FSMC_TCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 401

FSMC_BWTRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 401

FSMC_BCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 403

FSMC_TCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 404

FSMC_BWTRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 404

FSMC_BCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 406

FSMC_TCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 407

FSMC_BCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 410

FSMC_TCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 410

FSMC_BCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 412

FSMC_TCRx ビ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 412

プ ロ グ ラ マ ブル NAND/PC カ ー ド ・ ア ク セス ・ パラ メ ー タ . . . . . . . . . . . . . . . . . . . . . . . . . 419

8bit NAND 型 Flash . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 420

16bit NAND 型 Flash . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 420

16bit PC カ ー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 420

サポー ト さ れる メ モ リ 及び ト ラ ンザ ク シ ョ ン . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 421

ECC リ ザル ト 関連ビ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 431

SDIO I/O 定義 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 436

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表 117.

表 118.

表 119.

表 120.

表 121.

表 122.

表 123.

表 124.

表 125.

表 126.

表 127.

表 128.

表 129.

表 130.

表 131.

表 132.

表 101.

表 102.

表 103.

表 104.

表 105.

表 106.

表 107.

表 108.

表 109.

表 110.

表 111.

表 112.

表 113.

表 114.

表 115.

表 116.

表 144.

表 145.

表 146.

表 147.

表 148.

表 149.

表 150.

表 151.

表 152.

表 133.

表 134.

表 135.

表 136.

表 137.

表 138.

表 139.

表 140.

表 141.

表 142.

表 143.

表の一覧

RM0008

コ マ ン ド ・ フ ォ ーマ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 440

シ ョ ー ト ・ レ スポ ン ス ・ フ ォ ーマ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 441

ロ ン グ ・ レ スポン ス ・ フ ォ ーマ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 441

コ マ ン ド ・ パス ・ ス テー タ ス ・ フ ラ グ. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 441

デー タ ・ ト ー ク ン ・ フ ォ ーマ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 444

送信 FIFO ス テー タ ス ・ フ ラ グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 445

受信 FIFO ス テー タ ス ・ フ ラ グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 446

カ ー ド ・ ス テー タ ス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 456

SD ス テー タ ス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 459

速度 ク ラ ス ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 460

パ フ ォ ーマ ン ス ・ ムーブ ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 460

AU_SIZE フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 461

最大 AU サイ ズ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 461

消去サイ ズ ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 461

消去 タ イ ムアウ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 462

消去オ フ セ ッ ト ・ フ ィ ール ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 462

ブ ロ ッ ク 重視書込み コ マ ン ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 465

ブ ロ ッ ク 重視書込み保護 コ マ ン ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 465

消去 コ マ ン ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 466

I/O モー ド ・ コ マ ン ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 466

ロ ッ ク ・ カ ー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 466

ア プ リ ケーシ ョ ン固有 コ マ ン ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 467

R1 レ スポン ス. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 467

R2 レ スポン ス. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 468

R3 レ スポン ス. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 468

R4 レ スポン ス. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 469

R4b レ スポン ス. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 469

R5 レ スポン ス. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 470

R6 レ スポン ス. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 470

レ スポン ス タ イ プ と SDIO_RESPx レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 477

SDIO -レ ジ ス タ ・ マ ッ プ. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 488

ダ ブルバ ッ フ ァ リ ン グ ・ バ ッ フ ァ ・ フ ラ グ定義 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 499

バル ク ・ ダ ブルバ ッ フ ァ リ ン グ ・ メ モ リ ・ バ ッ フ ァ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 500

ア イ ソ ク ロ ナス ・ メ モ リ ・ バ ッ フ ァ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 501

レ ジ ュ ーム ・ イ ベ ン ト 検出 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 503

受信ス テー タ ス ・ エ ン コ ーデ ィ ン グ. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 515

エ ン ド ポ イ ン ト ・ タ イ プ ・ エ ン コ ーデ ィ ン グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 515

EP_KIND ビ ッ ト の意味. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 515

送信ス テー タ ス ・ エ ン コ ーデ ィ ン グ. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 515

ア ロ ケー ト さ れたバ ッ フ ァ ・ メ モ リ ・ サイ ズの定義 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 519

USB -レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 519

送信 メ ールボ ッ ク スのマ ッ ピ ン グ. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 535

受信 メ ールボ ッ ク スのマ ッ ピ ン グ. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 535

bxCAN - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 564

I

SPI 割込み リ ク エ ス ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 579

2

S 割込み リ ク エ ス ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 593

SPI -レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 602

SMBus ・ I2C 比較 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 615

I2C 割込み リ ク エ ス ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 621

I2C - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 636

サン プルデー タ から の ノ イ ズ検出. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 647

ボーレ ー ト 設定 と 周波数の誤差 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 650

24/720 Rev 5 -日本語版

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参考資料

RM0008

表 153.

表 154.

表 155.

表 156.

表 157.

表 158.

表 159.

表 160.

表 161.

表 162.

表 163.

表 164.

表 165.

表 166.

表 167.

表 168.

表 169.

表 170.

表 171.

表 172.

表 173.

表の一覧

フ レーム ・ フ ォ ーマ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 652

USART 割込み リ ク エ ス ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 665

USART モー ド 設定. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 666

USART -レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 678

SWJ デバ ッ グ ・ ポー ト ピ ン . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 685

融通性の高い SWJ-DP ピ ンの割 り 当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 686

JTAG デバ ッ グ ・ ポー ト ・ デー タ ・ レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 691

A[3:2] で選択 さ れる 32bit デバ ッ グ ・ ポー ト ・ レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . 692

パケ ッ ト ・ リ ク エ ス ト (8bit) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 693

ACK 応答 (3bit) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 693

DATA 転送 (33bit). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 693

SW-DP レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 695

Cortex-M3 AHB-AP レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 696

コ ア ・ デバ ッ グ ・ レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 697

主な ITM レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 700

非同期 ト レース ・ ピ ン割 り 当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 705

同期 ト レ ース ・ ピ ン割 り 当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 705

融通性の高い ト レース ・ ピ ン割 り 当て. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 706

重要な TPIU レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 709

DBG - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 711

改版履歴 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 712

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図 25.

図 26.

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図 28.

図 29.

図 30.

図 31.

図 32.

図 17.

図 18.

図 19.

図 20.

図 21.

図 22.

図 23.

図 24.

図 9.

図 10.

図 11.

図 12.

図 13.

図 14.

図 15.

図 16.

図 1.

図 2.

図 3.

図 4.

図 5.

図 6.

図 7.

図 8.

図 41.

図 42.

図 43.

図 44.

図 45.

図 46.

図 47.

図 48.

図 33.

図 34.

図 35.

図 36.

図 37.

図 38.

図 39.

図 40.

参考資料

図の一覧

図の一覧

RM0008

シ ス テム ・ アーキテ ク チ ャ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33

メ モ リ ・ マ ッ プ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35

CRC 計算ユニ ッ ト ・ ブ ロ ッ ク図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44

電源系の概要 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48

パワー ・ オ ン ・ リ セ ッ ト / パワー ・ ダウ ン ・ リ セ ッ ト 波形 . . . . . . . . . . . . . . . . . . . . . . . . . . 50

PVD ス レ ッ シ ョ ル ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 51

リ セ ッ ト 回路 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73

ク ロ ッ ク 構成図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74

HSE/ LSE ク ロ ッ ク ・ ソ ース . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 75

入出力ポー ト の基本構造 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103

5V 耐性入出力ポー ト の基本構造 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103

入力回路の構造 ( フ ローテ ィ ン グ / プルア ッ プ / プルダウ ン ) . . . . . . . . . . . . . . . . . . . . . . 107

出力回路の構造 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108

オル タ ネー ト 機能時のポー ト の構成. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109

ハイ ・ イ ン ピーダ ン ス ・ アナ ロ グ入力の構成. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110

外部割込み / イ ベ ン ト コ ン ト ロー ラ (EXTI) ブ ロ ッ ク図 . . . . . . . . . . . . . . . . . . . . . . . . . . . 134

外部割込み / イ ベ ン ト の GPIO 割当て . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 136

DMA ブ ロ ッ ク構成 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 142

DMA1 リ ク エ ス ト のマ ッ ピ ン グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 146

DMA2 リ ク エ ス ト のマ ッ ピ ン グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 148

シ ン グル ADC ブ ロ ッ ク 図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 157

タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 160

アナ ロ グ ・ ウ ォ ッ チ ド ッ グの保護 ド メ イ ン . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 160

イ ン ジ ェ ク ト 変換の遅延時間 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 162

較正動作の タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 164

デー タ の右寄せ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 164

デー タ の左寄せ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 164

デ ュ アル ADC ブ ロ ッ ク 図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 168

4 チ ャ ネルの同時イ ン ジ ェ ク ト ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 169

16 チ ャ ネルの同時レ ギ ュ ラ 変換モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 170

連続変換モー ド におけ る 1 チ ャ ネルの高速イ ン タ リ ーブ ・ モー ド . . . . . . . . . . . . . . . . . . . 170

1 チ ャ ネルの低速イ ン タ リ ーブ ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 171

オル タ ネー ト ・ ト リ ガ : 各 ADC のイ ン ジ ェ ク ト ・ チ ャ ネル ・ グループ . . . . . . . . . . . . . . 172

オル タ ネー ト ・ ト リ ガ : 分割モデルの (各 ADC ご と の) 4 イ ン ジ ェ ク ト ・ チ ャ ネル . . . 172

オル タ ネー ト + 同時レ ギ ュ ラ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 173

イ ン ジ ェ ク ト 変換中に ト リ ガが発生 し た場合. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 173

イ ン ジ ェ ク ト ・ シーケ ン ス CH11、 CH12 でのイ ン タ リ ーブ ・ シ ン グル ・ チ ャ ネル . . . . . 174

温度セ ンサ及び VREFINT チ ャ ネル ・ ブ ロ ッ ク 図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 174

DAC チ ャ ネル ・ ブ ロ ッ ク 図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 192

シ ン グル DAC チ ャ ネル ・ モー ド のデー タ ・ レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 194

デ ュ アル DAC チ ャ ネル ・ モー ド のデー タ ・ レ ジ ス タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 194

ト リ ガ ・ デ ィ セーブル時 (TEN = 0) の変換 タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . . . 195

DAC LFSR レ ジ ス タ 計算アルゴ リ ズム . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 196

LFSR 波形生成に よ る DAC 変換 (SW ト リ ガ ・ イ ネーブル). . . . . . . . . . . . . . . . . . . . . . . . . 197

DAC 三角波生成 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 197

三角波生成に よ る DAC 変換 (SW ト リ ガ ・ イ ネーブル) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 198

高機能制御 タ イ マ ・ ブ ロ ッ ク 図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 217

プ リ スケー ラ 分周比が 1 か ら 2 に変化 し た時のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . 219

26/720 Rev 5 -日本語版

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参考資料

RM0008

図 73.

図 74.

図 75.

図 76.

図 77.

図 78.

図 79.

図 80.

図 65.

図 66.

図 67.

図 68.

図 69.

図 70.

図 71.

図 72.

図 57.

図 58.

図 59.

図 60.

図 61.

図 62.

図 63.

図 64.

図 49.

図 50.

図 51.

図 52.

図 53.

図 54.

図 55.

図 56.

図 92.

図 93.

図 94.

図 95.

図 96.

図 97.

図 98.

図 99.

図 100.

図 81.

図 82.

図 83.

図 84.

図 85.

図 86.

図 87.

図 88.

図 89.

図 90.

図 91.

図の一覧

プ リ スケー ラ 分周比が 1 か ら 4 に変化 し た時のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . 219

内部 ク ロ ッ ク 分周比が 1 の場合のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . . 220

内部 ク ロ ッ ク 分周比が 2 の場合のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . . 221

内部 ク ロ ッ ク 分周比が 4 の場合のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . . 221

内部 ク ロ ッ ク 分周比が N の場合のカ ウ ン タ ・ タ イ ミ ン グ図. . . . . . . . . . . . . . . . . . . . . . . . . 221

ARPE=0 時 (TIMx_ARR はプ リ ロー ド な し )、 更新イ ベ ン ト 時の タ イ ミ ン グ図. . . . . . . . . . 222

ARPE=1 時 (TIMx_ARR はプ リ ロー ド )、 更新イ ベン ト の タ イ ミ ン グ図 . . . . . . . . . . . . . . . 222

内部 ク ロ ッ ク 分周比が 1 の場合のカ ウ ン タ ・ タ イ ミ ン グ図. . . . . . . . . . . . . . . . . . . . . . . . . 224

内部 ク ロ ッ ク 分周比が 2 の場合のカ ウ ン タ ・ タ イ ミ ン グ図. . . . . . . . . . . . . . . . . . . . . . . . . 224

内部 ク ロ ッ ク 分周比が 4 の場合のカ ウ ン タ ・ タ イ ミ ン グ図. . . . . . . . . . . . . . . . . . . . . . . . . 224

内部 ク ロ ッ ク 分周比が N の場合のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . 225

繰返 し カ ウ ン タ が使用 さ れない と きの更新イ ベン ト 時の タ イ ミ ン グ図 . . . . . . . . . . . . . . . 225

内部 ク ロ ッ ク 分周比が 1 の場合のカ ウ ン タ ・ タ イ ミ ン グ図 (TIMx_ARR=0x6). . . . . . . . . . . 227

内部 ク ロ ッ ク 分周比が 2 の場合のカ ウ ン タ ・ タ イ ミ ン グ図. . . . . . . . . . . . . . . . . . . . . . . . . 227

内部 ク ロ ッ ク 分周比が 4 の場合のカ ウ ン タ ・ タ イ ミ ン グ図 (TIMx_ARR=0x36). . . . . . . . . . 227

内部 ク ロ ッ ク 分周比が N の場合のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . 228

ARPE=1 時の更新イ ベン ト の タ イ ミ ン グ図 (カ ウ ン タ はア ン ダ フ ロー). . . . . . . . . . . . . . . 228

ARPE=1 時の更新イ ベン ト の タ イ ミ ン グ図 (カ ウ ン タ はオーバ フ ロー). . . . . . . . . . . . . . . 229

カ ウ ン タ モー ド と TIMx_RCR レ ジ ス タ の設定に よ る更新状況の例 . . . . . . . . . . . . . . . . . . . 230

内部 ク ロ ッ ク 分周比 1 の場合の通常モー ド の制御回路. . . . . . . . . . . . . . . . . . . . . . . . . . . . . 231

TI2 外部 ク ロ ッ クの接続例 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 232

外部 ク ロ ッ ク ・ モー ド 1 の制御回路 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 232

外部 ト リ ガ入力ブ ロ ッ ク . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 233

外部 ク ロ ッ ク ・ モー ド 2 の制御回路 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 233

キ ャ プ チ ャ / 比較チ ャ ネル (例 : チ ャ ネル 1 入力ス テージ) . . . . . . . . . . . . . . . . . . . . . . . . 234

キ ャ プ チ ャ / 比較チ ャ ネル 1 メ イ ン回路. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 234

キ ャ プ チ ャ / 比較チ ャ ネル (チ ャ ネル 1 - 3) の出力ス テージ . . . . . . . . . . . . . . . . . . . . . . 235

キ ャ プ チ ャ / 比較チ ャ ネル (チ ャ ネル 4) の出力ス テージ . . . . . . . . . . . . . . . . . . . . . . . . . 235

PWM 入力モー ド の タ イ ミ ン グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 237

出力比較モー ド 、 OC1 出力の ト グル . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 239

エ ッ ジ ア ラ イ ン PWM 波形 (ARR=8) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 241

セ ン タ ーア ラ イ ン PWM 波形 (ARR=8). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 242

デ ッ ド タ イ ム挿入のあ る相補出力. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 243

負のパルス よ り 長い遅延があ る と きのデ ッ ド タ イ ムの波形 . . . . . . . . . . . . . . . . . . . . . . . . . 243

正のパルス よ り 長い遅延があ る と きのデ ッ ド タ イ ムの波形 . . . . . . . . . . . . . . . . . . . . . . . . . 244

ブ レー ク に対する出力の動作 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 246

OCxREF の ク リ ア動作. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 247

6 ス テ ッ プ PWM 波形の生成 と CO 例 (OSSR=1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 248

単一パルス発生モー ド の例 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 249

エ ン コ ーダ ・ イ ン タ フ ェ ース ・ モー ド におけ る カ ウ ン タ の動作例 . . . . . . . . . . . . . . . . . . . 252

TI1FP1 の極性を反転 し たエ ン コ ーダ ・ イ ン タ フ ェ ース ・ モー ド の例 . . . . . . . . . . . . . . . . 252

ホール ・ セ ンサ ・ イ ン タ フ ェ ースの例. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 254

リ セ ッ ト ・ モー ド におけ る制御回路. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 255

ゲー ト ・ モー ド の制御回路 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 256

ト リ ガ ・ モー ド の制御回路 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 257

外部 ク ロ ッ ク ・ モー ド 2 + ト リ ガ ・ モー ド の制御回路 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 258

汎用 タ イ マのブ ロ ッ ク 図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 286

プ リ スケー ラ 分周比が 1 か ら 2 に変化 し た時のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . 287

プ リ スケー ラ 分周比が 1 か ら 4 に変化 し た時のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . 288

内部 ク ロ ッ ク 分周比が 1 の場合のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . . 289

内部 ク ロ ッ ク 分周比が 2 の場合のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . . 289

内部 ク ロ ッ ク 分周比が 4 の場合のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . . 289

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参考資料

図 128.

図 129.

図 130.

図 131.

図 132.

図 133.

図 134.

図 135.

図 136.

図 137.

図 138.

図 139.

図 140.

図 141.

図 142.

図 143.

図 144.

図 145.

図 146.

図 147.

図 148.

図 149.

図 150.

図 151.

図 112.

図 113.

図 114.

図 115.

図 116.

図 117.

図 118.

図 119.

図 120.

図 121.

図 122.

図 123.

図 124.

図 125.

図 126.

図 127.

図 101.

図 102.

図 103.

図 104.

図 105.

図 106.

図 107.

図 108.

図 109.

図 110.

図 111.

図の一覧

RM0008

内部 ク ロ ッ ク 分周比が N の場合のカ ウ ン タ ・ タ イ ミ ン グ図. . . . . . . . . . . . . . . . . . . . . . . . . 290

ARPE=0 (TIMx_ARR はプ リ ロー ド な し ) の時の更新イ ベン ト のカ ウ ン タ ・ タ イ ミ ン グ図. 290

ARPE=1 (TIMx_ARR はプ リ ロー ド ) の時の更新イ ベ ン ト のカ ウ ン タ ・ タ イ ミ ン グ図. . . . . 291

内部 ク ロ ッ ク 分周比が 1 の場合のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . . 292

内部 ク ロ ッ ク 分周比が 2 の場合のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . . 292

内部 ク ロ ッ ク 分周比が 4 の場合のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . . 292

内部 ク ロ ッ ク 分周比が N の場合のカ ウ ン タ ・ タ イ ミ ン グ図. . . . . . . . . . . . . . . . . . . . . . . . . 293

繰 り 返 し カ ウ ン タ が使用 さ れない時の更新イ ベン ト のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . 293

内部 ク ロ ッ ク 分周比が 1 の場合のカ ウ ン タ ・ タ イ ミ ン グ図 (TIMx_ARR=0x6) . . . . . . . . . . 294

内部 ク ロ ッ ク 分周比が 2 の場合のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . . 294

ロー ド ・ レ ジ ス タ 内部 ク ロ ッ ク分周比が 4 の場合のカ ウ ン タ ・ タ イ ミ ン グ図

(TIMx_ARR=0x36) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 295

内部 ク ロ ッ ク 分周比が N の場合のカ ウ ン タ ・ タ イ ミ ン グ図. . . . . . . . . . . . . . . . . . . . . . . . . 295

ARPE=1 ( カ ウ ン タ はア ン ダ フ ロー ) の時の更新イ ベ ン ト のカ ウ ン タ ・ タ イ ミ ン グ図 . . . 295

ARPE=1 ( カ ウ ン タ はオーバ フ ロー ) の時の更新イ ベ ン ト のカ ウ ン タ ・ タ イ ミ ン グ図 . . . 296

内部 ク ロ ッ ク 分周比が 1 の場合の、 通常モー ド の制御回路 . . . . . . . . . . . . . . . . . . . . . . . . . 297

TI2 外部 ク ロ ッ クの接続例 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 297

外部 ク ロ ッ ク ・ モー ド 1 の制御回路. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 298

外部 ト リ ガ入力ブ ロ ッ ク . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 298

外部 ク ロ ッ ク ・ モー ド 2 の制御回路. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 299

キ ャ プ チ ャ / 比較チ ャ ネル (例 : チ ャ ネル 1 入力ス テージ) . . . . . . . . . . . . . . . . . . . . . . . . 299

キ ャ プ チ ャ / 比較チ ャ ネル 1 メ イ ン回路. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 300

キ ャ プ チ ャ / 比較チ ャ ネル (チ ャ ネル 1) の出力ス テージ . . . . . . . . . . . . . . . . . . . . . . . . . 300

PWM 入力モー ド の タ イ ミ ン グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 302

出力比較モー ド 、 OC1 出力の ト グル . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 304

エ ッ ジ ア ラ イ ン PWM 波形 (ARR=8) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 305

セ ン タ ーア ラ イ ン PWM 波形 (ARR=8) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 306

単一パルス発生モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 307

TIMx OCxREF の ク リ ア動作 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 309

エ ン コ ーダ ・ イ ン タ フ ェ ース ・ モー ド におけ る カ ウ ン タ の動作例 . . . . . . . . . . . . . . . . . . . 310

IC1FP1 の極性を反転 し たエ ン コ ーダ ・ イ ン タ フ ェ ース ・ モー ド の例 . . . . . . . . . . . . . . . . 311

リ セ ッ ト ・ モー ド の制御回路 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 312

ゲー ト ・ モー ド の制御回路 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 313

ト リ ガ ・ モー ド の制御回路 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 313

外部 ク ロ ッ ク ・ モー ド 2 + ト リ ガ ・ モー ド の制御回路 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 314

マ ス タ / ス レ ーブ タ イ マの例 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 315

タ イ マ 1 の OC1REF に よ る タ イ マ 2 のゲー ト 操作. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 316

タ イ マ 1 のイ ネーブルに よ る タ イ マ 2 のゲー ト 制御 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 317

タ イ マ 1 のア ッ プデー ト に よ る タ イ マ 2 の ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 318

タ イ マ 1 のイ ネーブルに よ る タ イ マ 2 の ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 319

タ イ マ 1 の TI1 入力に よ る タ イ マ 1 と タ イ マ 2 の ト リ ガ . . . . . . . . . . . . . . . . . . . . . . . . . . . 320

基本 タ イ マ ・ ブ ロ ッ ク 図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 343

プ リ スケー ラ 分周比が 1 か ら 2 に変化 し た時のカ ウ ン タ ・ タ イ ミ ン グ図. . . . . . . . . . . . . 344

プ リ スケー ラ 分周比が 1 か ら 4 に変化 し た時のカ ウ ン タ ・ タ イ ミ ン グ図. . . . . . . . . . . . . 344

内部 ク ロ ッ ク 分周比が 1 の場合のカ ウ ン タ ・ タ イ ミ ン グ図. . . . . . . . . . . . . . . . . . . . . . . . . 345

内部 ク ロ ッ ク 分周比が 2 の場合のカ ウ ン タ ・ タ イ ミ ン グ図. . . . . . . . . . . . . . . . . . . . . . . . . 346

内部 ク ロ ッ ク 分周比が 4 の場合のカ ウ ン タ ・ タ イ ミ ン グ図. . . . . . . . . . . . . . . . . . . . . . . . . 346

内部 ク ロ ッ ク 分周比が N の場合のカ ウ ン タ ・ タ イ ミ ン グ図 . . . . . . . . . . . . . . . . . . . . . . . . 346

ARPE=0 時 (TIMx_ARR はプ リ ロー ド な し )、 更新イ ベ ン ト 時の タ イ ミ ン グ図. . . . . . . . . . 347

ARPE=1 時 (TIMx_ARR はプ リ ロー ド )、 更新イ ベン ト の タ イ ミ ン グ図 . . . . . . . . . . . . . . . 347

内部 ク ロ ッ ク 分周比 1 の場合の、 通常モー ド の制御回路. . . . . . . . . . . . . . . . . . . . . . . . . . . 348

RTC ブ ロ ッ ク構成 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 356

28/720 Rev 5 -日本語版

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参考資料

RM0008

図 168.

図 169.

図 170.

図 171.

図 172.

図 173.

図 174.

図 175.

図 176.

図 177.

図 178.

図 179.

図 180.

図 181.

図 182.

図 183.

図 152.

図 153.

図 154.

図 155.

図 156.

図 157.

図 158.

図 159.

図 160.

図 161.

図 162.

図 163.

図 164.

図 165.

図 166.

図 167.

図 184.

図 185.

図 186.

図 187.

図 188.

図 189.

図 190.

図 191.

図 192.

図 193.

図 194.

図 195.

図 196.

図 197.

図 198.

図 199.

図 200.

図 201.

図 202.

図の一覧

RTC 秒及びア ラ ーム波形 (PR=0003、 ALARM=00004)STANDBY モー ド . . . . . . . . . . . . . . . . 358

RTC オーバ フ ロー波形 (PR=0003) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 358

独立型ウ ォ ッ チ ド ッ グのブ ロ ッ ク 図. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 368

ウ ォ ッ チ ド ッ グブ ロ ッ ク図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 374

Window 型ウ ォ ッ チ ド ッ グの タ イ ミ ン グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 376

FSMC ブ ロ ッ ク図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 381

FSMC メ モ リ ・ バン ク . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 383

モー ド 1 読込みア ク セス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 390

モー ド 1 書込みア ク セス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 391

モー ド A 読込みア ク セス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 392

モー ド A 書込みア ク セス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 393

モー ド 2/B 読込みア ク セス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 395

モー ド 2 書込みア ク セス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 396

モー ド B 書込みア ク セス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 397

モー ド C 読込みア ク セス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 399

モー ド C 書込みア ク セス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 400

モー ド D 読込みア ク セス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 402

モー ド D 書込みア ク セス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 403

マルチ プ レ ク ス し た読込みア ク セス. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 405

マルチ プ レ ク ス し た書込みア ク セス. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 406

同期読込みモー ド - NOR、 CRAM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 409

同期書込みモー ド - CRAM. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 411

コ モ ン ・ メ モ リ ・ ア ク セス用 NAND コ ン ト ロー ラ の タ イ ミ ン グ . . . . . . . . . . . . . . . . . . . . . 422

‘CE don’ t care’ で ない NAND 型 Flash へのア ク セス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 424

SDIO “no response” と “no data” 動作 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 433

SDIO (複数) ブ ロ ッ ク読込み動作 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 433

SDIO (複数) ブ ロ ッ ク書込み動作 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 434

SDIO 連続読込み動作 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 434

SDIO 連続書込み動作 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 434

SDIO ブ ロ ッ ク図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 435

SDIO アダ プ タ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 436

制御ユニ ッ ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 437

SDIO アダ プ タ ・ コ マ ン ド ・ パス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 438

コ マ ン ド ・ パス ・ ス テー ト ・ マ シ ン (CPSM) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 439

SDIO コ マ ン ド 転送 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 440

デー タ ・ パス . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 442

デー タ ・ パス ・ ス テー ト ・ マ シ ン (DPSM) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 443

USB ペ リ フ ェ ラ ル ・ ブ ロ ッ ク図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 490

バ ッ フ ァ ・ デ ィ ス ク リ プ シ ョ ン ・ テーブル ・ ロ ケーシ ョ ンの

パケ ッ ト ・ バ ッ フ ァ ・ ド メ イ ン . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 495

CAN ネ ッ ト ワー クの ト ポロ ジ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 522

CAN ブ ロ ッ ク図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 523

bxCAN 動作モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 524

bxCAN サイ レ ン ト ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 526 bxCAN ループバ ッ ク ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 526

bxCAN 組合わせモー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 527

送信 メ ールボ ッ ク スのス テー ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 528

受信 FIFO のス テー ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 529

フ ィ ル タ ・ バン クのスケール設定 - レ ジ ス タ 構成. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 532

フ ィ ル タ 番号の例 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 533

フ ィ ル タ の メ カ ニズム-例 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 534

CAN エ ラ ー状態図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 536

Rev 5 -日本語版 29/720

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参考資料

図 219.

図 220.

図 221.

図 222.

図 223.

図 224.

図 225.

図 226.

図 227.

図 228.

図 229.

図 230.

図 231.

図 232.

図 233.

図 234.

図 203.

図 204.

図 205.

図 206.

図 207.

図 208.

図 209.

図 210.

図 211.

図 212.

図 213.

図 214.

図 215.

図 216.

図 217.

図 218.

図 246.

図 247.

図 248.

図 249.

図 250.

図 251.

図 252.

図 253.

図 254.

図 235.

図 236.

図 237.

図 238.

図 239.

図 240.

図 241.

図 242.

図 243.

図 244.

図 245.

図の一覧

RM0008

ビ ッ ト ・ タ イ ミ ン グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 537

CAN フ レ ーム . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 538

イ ベ ン ト ・ フ ラ グ と 割込み生成 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 539

SPI ブ ロ ッ ク図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 570

シ ン グル ・ マ ス タ / シ ン グル ・ ス レ ーブ ・ ア プ リ ケーシ ョ ン . . . . . . . . . . . . . . . . . . . . . . . 571

ハー ド ウ ェ ア / ソ フ ト ウ ェ ア ・ ス レ ーブ選択の管理 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 571

I

I

I

デー タ と ク ロ ッ クの タ イ ミ ン グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 573

2

2

2

S ブ ロ ッ ク図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 580

S フ ィ リ ッ プ ス プ ロ ト コ ル波形 (16/32bit フ ル精度、 CPOL = 0) . . . . . . . . . . . . . . . . . . . . 582

S フ ィ リ ッ プ ス標準波形 (24bit フ レ ーム、 CPOL = 0) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 582

0x8EAA33 の送信 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 582

I

0x8EAA33 の受信 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 583

2

S フ ィ リ ッ プ ス標準 (32bit パケ ッ ト フ レームに拡張 さ れた 16bit、 CPOL = 0) . . . . . . . . . 583

例 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 583

MSB づめ 16bit または 32bit フル精度長、 CPOL = 0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 584

MSB づめ 24bit フ レ ーム長、 CPOL = 0. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 584

MSB づめ 32bit パケ ッ ト フ レ ームに拡張 さ れた 16bit、 CPOL = 0 . . . . . . . . . . . . . . . . . . . . 584

LSB づめ 16bit ま たは 32bit フル精度、 CPOL = 0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 585

LSB づめ 24bit フ レ ーム、 CPOL = 0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 585

0x3478AE を送信するのに必要な動作 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 585

0x3478AE の受信に必要な動作. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 586

LSB づめ 32bit パケ ッ ト フ レ ームへ拡張 さ れた 16bit、 CPOL = 0 . . . . . . . . . . . . . . . . . . . . . 586

例 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 586

PCM 標準波形 (16bit). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 587

PCM 標準波形 (32bit パケ ッ ト フ レ ームに拡張 さ れた 16bit) . . . . . . . . . . . . . . . . . . . . . . . . 587

I

オーデ ィ オサン プ リ ン グ周波数定義. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 588

2

S ク ロ ッ ク生成アーキテ ク チ ャ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 588

I2C バス プ ロ ト コ ル . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 605

I2C ブ ロ ッ ク図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 606

ス レーブ ・ ト ラ ン ス ミ ッ タ の交信手順. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 607

ス レーブ レ ・ シーバの交信手順 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 608

マ ス タ ト ラ ン ス ミ ッ タ の交信手順. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 611

マ ス タ レ シーバの交信手順 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 612

I2C 割込みマ ッ ピ ン グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 622

USART ブ ロ ッ ク図. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 641

ワー ド 長の設定 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 642

制御 STOP ビ ッ ト の設定 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 644

ノ イ ズ検出のためのデー タ サン プ リ ン グ. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 647

ア イ ド ル ・ ラ イ ン検出を利用する ミ ュ ー ト モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 651

ア ド レ ス マー ク 検出を利用する ミ ュ ー ト モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 652

LIN モー ド におけ る ブ レー ク 検出 (11 ビ ッ ト ブ レ ー ク 長 (LBDL=1) ) . . . . . . . . . . . . . . . . . 654

LIN モー ド におけ る ブ レー ク 検出 と フ レー ミ ン グ ・ エ ラ ー検出 . . . . . . . . . . . . . . . . . . . . . 655

USART 同期シ リ アル送信の例 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 656

USART デー タ ク ロ ッ ク タ イ ミ ン グ (M=0). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 656

USART デー タ ク ロ ッ ク タ イ ミ ン グ (M=1). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 657

RX デー タ セ ッ ト ア ッ プ / ホール ド タ イ ム. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 657

ISO 7816-3 非同期プ ロ ト コ ル . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 658

1.5 STOP ビ ッ ト を利用 し たパ リ テ ィ ・ エ ラ ー検出 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 659

IrDA SIR ENDEC - ブ ロ ッ ク 図 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 661

IrDA デー タ 変調 (3/16) - ノ ーマル ・ モー ド . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 661

2 個の USART 間のハー ド ウ ェ ア ・ フ ロー制御 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 663

RTS フ ロー制御 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 664

30/720 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

図 255.

図 256.

図 257.

図 258.

図 259.

図 260.

図の一覧

CTS フ ロー制御 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 664

USART 割込みマ ッ ピ ン グ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 665

ブ ロ ッ ク 図 - STM32F10xxx レ ベル と Cortex-M3 レ ベルのデバ ッ グ ・ サポー ト . . . . . . . . 683

SWJ デバ ッ グ ・ ポー ト . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 684

JTAG TAP 接続 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 688

TPIU ブ ロ ッ ク図. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 704

Rev 5 -日本語版 31/720

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参考資料

メ モ リ と バスの構成

1 こ のマニ ュ アルにおける表記の規則

1.1

RM0008

レ ジ ス タ に関する略記

レ ジ ス タ の各ビ ッ ト に関 し ては、 次の略記が使用 さ れます。 read/write (rw) read-only (r) write-only (w) read/clear (rc_w1 read/clear (rc_w0) read/set (rs)

toggle(t)

ソ フ ト ウ ェ アか ら ビ ッ ト (bit) の読出 し / 書込みがで き ます。

ソ フ ト ウ ェ ア では、 ビ ッ ト (bit) の読出 し のみが可能です。

ソ フ ト ウ ェ ア ではビ ッ ト (bit) への書込みのみが可能です。 ビ ッ ト (bit) の読

出 し では、 常に リ セ ッ ト 時の値が読出 さ れます。

ソ フ ト ウ ェ ア ではビ ッ ト (bit) に” 1” を書込む と 、 読み出 し と ク リ アがで き

ます。” 0” を書込んだ と き にはビ ッ ト の値は変化 し ません。

ソ フ ト ウ ェ ア ではビ ッ ト (bit) に” 0” を書込む と 、 読み出 し と ク リ アがで き

ます。” 1” を書込んだ と き にはビ ッ ト の値は変化 し ません。

ソ フ ト ウ ェ ア ではビ ッ ト (bit) の読出 し と セ ッ ト がで き ます。” 0” を書込んだ

と き にはビ ッ ト の値は変化 し ません。

ソ フ ト ウ ェ ア ではビ ッ ト (bit) に” 1” を書込む と ト グル ( 反転) のみがで き

ます。” 0” を書込んだ と き にはビ ッ ト の値は変化 し ません。

1.2 用語

Flash メ モ リ 容量が32~128KbyteのSTM32F101xx及びSTM32F103xxマ イ ク ロ コ ン ト ロー

ラ は、 中容量デバイ スです。

Flash メ モ リ 容量が 256 ~ 512Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト

ロー ラ は、 大容量デバイ スです。

32/720 Rev 5 -日本語版

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参考資料

RM0008

2 メ モ リ と バスの構成

2.1

メ モ リ と バスの構成

シス テム ・ アーキテ ク チ ャ

シ ス テムの中核は次の要素で構成 さ れています。

5 個のマス タ 回路 :

- Cortex

TM

-M3 コ ア、 ICode バス (I-bus)、 DCode バス (D-bus)、 シ ス テム ・ バス (Sbus)

- GP-DMA1 及び 2 ( 汎用 DMA)

3 個のス レ ーブ回路 :

- 内蔵 SRAM

- 内蔵 Flash メ モ リ

- すべての APB 周辺回路を接続する ための AHB/APB ブ リ ッ ジ (AHB2APBx)

こ れ ら は

図  1

に示 さ れている よ う に、 マルチ レ イ ヤ AHB バス ・ アーキテ ク チ ャ で相互に

接続 さ れています。

図 1.

シ ス テム ・ アーキテ ク チ ャ

IC ode

Cortex

TM

-M3

DCode

FLI TF

Flas h

システム

DMA1

Ch.1

Ch.2

Ch.7

DMA2

SRAM

FSMC

SD IO

AHB

システムバス

ブリッジ

ブリッジ

1

2

DMAリクエスト

APB 1

APB2

ADC1

ADC2

ADC3

USA RT1

SPI1

TIM1

TIM8

GPIO A

GPIOB

GP IOC DAC

GP IOD

GPIO E

GPI OF

GPIO G

EX TI

AFIO

PWR

BKP bxCAN

US B

I2C2

I2C1

SPI 2/I2S

IWDG

WWDG

RT C

TIM7

TIM6

UART 5

UART 4

US ART3

US ART2

TIM5

TIM4

TIM3

Ch.1

Ch.2

Ch.5

DMAリクエスト ai14800b

ICode バス

こ のバスは Cortex

TM

-M3 コ アの命令語バス (Instruction bus) を Flash メ モ リ の命令語イ ン タ

フ ェ ースに接続 し ています。 命令語のプ リ フ ェ ッ チは こ のバス を経由 し て行われます。

Rev 5 -日本語版 33/720

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参考資料

メ モ リ と バスの構成

注意 :

RM0008

DCode バス

こ のバスは Cortex

TM

-M3 コ アの Dcode バス ( リ テ ラルのロー ド と デバ ッ グのためのア ク セ

ス) と Flash メ モ リ ・ イ ン タ フ ェ ースに接続 し ています。

シ ス テム ・ バス

こ のバスは Cortex

TM

-M3 のシ ス テム ・ バス (ペ リ フ ェ ラ ル ・ バス) をバス ・ マ ト リ ッ ク ス

と 接続 し 、 コ ア と DMA の間のア ク セスの競合を管理 し ています。

DMA バス

こ のバスは DMA の AHB マ ス タ ・ イ ン タ フ ェ ース と バス ・ マ ト リ ッ ク スの間を接続 し 、

CPU の DCode バス と DMA か ら SRAM や Flash メ モ リ 、 周辺回路へのア ク セス を管理 し て

います。

バス ・ マ ト リ ッ ク ス (BusMatrix)

バス ・ マ ト リ ッ ク スは コ ア シ ス テム ・ バス と DMA マ ス タ バスの間のア ク セス競合を ラ ウ

ン ド ロ ビ ン方式で管理 し ています。 バス ・ マ ト リ ッ ク スは 3 個のマス タ (CPU DCode バ

ス、 シ ス テム ・ バス、 DMA バス) と 3 個のス レ ーブ (FLITF、 SRAM、 AHB/APB ブ リ ッ

ジ) か ら 構成 さ れています。

AHB ペ リ フ ェ ラ ルは DMA ア ク セス を可能 と する ため、 バス ・ マ ト リ ッ ク ス を経由 し て シ

ス テム ・ バスに接続 さ れています。

AHB/APB ブ リ ッ ジ (APB)

2 個の AHB/APB ブ リ ッ ジは AHB と 2 個の APB バスの間の、 完全同期式の接続を提供 し

ています。 APB1 は上限周波数 36 MHz で、 APB2 は フルス ピー ド (デバイ スに依存 し 、 最

大 72 MHz) で動作 し ます。

各ブ リ ッ ジに接続 さ れている周辺回路のア ド レ ス割当てに関 し ては

表  1 (36 ページ)

を参

照 し て く だ さ い。

各デバイ ス ・ リ セ ッ ト の後、 すべてのペ リ フ ェ ラ ル ・ ク ロ ッ ク はデ ィ セーブルにな り ま

す。 (SRAM と FLITF は除 く ) ペ リ フ ェ ラルを使 う 前に、 RCC_AHBENR、 RCC_APB2ENR ま

たは RCC_APB1ENR レ ジ ス タ で、 ク ロ ッ ク を イ ネーブルにする必要があ り ます。

APB レ ジス タ へ 16 または 8bit ア ク セスが行われる と 、 ア ク セスは 32bit ア ク セスへ変換 さ

れます。 ブ リ ッ ジが 16 または 8bit デー タ を複製 し 、 32bit のベ ク タ を提供 し ます。

2.2 メ モ リ 構成

プ ロ グ ラ ム メ モ リ 、 デー タ メ モ リ 、 レ ジ ス タ と 入出力ポー ト は同 じ 4 G バイ ト の リ ニア な

ア ド レ ス空間に配置 さ れています。

メ モ リ の各バイ ト は リ ト ル ・ エ ンデ ィ ア ン形式で、 ワー ド 内の も っ と も小 さ な ア ド レ スの

バイ ト が最下位バイ ト に、 も っ と も 大き な ア ド レ スのバイ ト が最上位バイ ト にな り ます。

STM32F10xxx の メ モ リ ・ マ ッ プは

図  2 (35 ページ)

に示 さ れています。 周辺回路のレ ジ

ス タ のア ド レ スに関 し ては、 対応する個々の章を参照 し て く だ さ い。

ア ド レ ス可能な メ モ リ 空間は、 8 個の、 それぞれ 512 MB のブ ロ ッ ク に分け られています。

チ ッ プ上の メ モ リ やペ リ フ ェ ラ ル回路に割当て ら れていない メ モ リ ・ ド メ イ ンは、 すべて

「予約済み」 にな り ます。 ( こ の ド メ イ ンは

図  2 (35 ページ)

では網掛けが施 さ れていま

す。)

34/720 Rev 5 -日本語版

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参考資料

RM0008

2.3 メ モ リ ・ マ ッ プ

図 2.

メ モ リ ・ マ ッ プ

メ モ リ と バスの構成

0xFFFF FFFF

512-Mbyte

ブロック 7

Cortex-M3の

内部ペリフェラル

0xE000 0000

0xDFFF FFFF

512-Mbyte

ブロック 6

未使用

メモリブロック

0xC000 0000

0xBFFF FFFF

512-Mbyte

ブロック 5

FSMC レジスタ

0xA000 0000

0x9FFF FFFF

512-Mbyte

ブロック 4

FSMC バンク 3

& バンク4

0x8000 0000

0x7FFF FFFF

512-Mbyte

ブロック 3

FSMC バンク1

& バンク2

0x6000 0000

0x5FFF FFFF

512-Mbyte

ブロック 2

ペリフェラル

0x4000 0000

0x3FFF FFFF

512-Mbyte

ブロック 1

SRAM

0x2000 0000

0x1FFF FFFF

512-Mbyte

ブロック 0

Code

0x0000 0000

予約済み

SRAM(ビット・バンディング

による64KBアライアス)

オプション

システムメモリ

予約済み

Flash

予約済み

BOOTピンによるFrash、

システムメモリもしくは

SRAMのアライアス

予約済み

FSMC レジスタ

FSMC バンク4 PCCARD

FSMC バンク3 NAND (NAND2)

FSMC バンク2 NAND (NAND1)

FSMC バンク1 NOR/PSRAM 4

FSMC バンク1 NOR/PSRAM 3

FSMC バンク1 NOR/PSRAM 2

FSMC バンク1 NOR/PSRAM 1

予約済み

CRC

予約済み

Flash インタフェース

予約済み

RCC

予約済み

DMA2

DMA1

予約済み

SDIO

予約済み

ADC3

USART1

TIM8

SPI1

TIM1

ADC2

ADC1

ポート G

ポート F

ポート E

ポート D

ポート C

ポート B

ポート A

EXTI

AFIO

予約済み

DAC

PWR

BKP

予約済み

BxCAN

共有 USB/CAN SRAM

512 bytes

USB registers

I2C2

I2C1

UART5

UART4

USART3

USART2

予約済み

SPI3/I

2

S3

SPI2/I

2

S2

予約済み

IWDG

WWDG

RTC

予約済み

TIM7

TIM6

TIM5

TIM4

TIM3

TIM2

0xA000 1000 - 0xBFFF FFFF

0xA000 0000 - 0xA000 0FFF

0x9000 0000 - 0x9FFF FFFF

0x8000 0000 - 0x8FFF FFFF

0x7000 0000 - 0x7FFF FFFF

0x6C00 0000 - 0x6FFF FFFF

0x6800 0000 - 0x6BFF FFFF

0x6400 0000 - 0x67FF FFFF

0x6000 0000 - 0x63FF FFFF

0x4002 4400 - 0x5FFF FFFF

0x4002 3000 - 0x4002 33FF

0x4002 2400 - 0x4002 2FFF

0x4002 2000 - 0x4002 23FF

0x4002 1400 - 0x4002 1FFF

0x4002 1000 - 0x4002 13FF

0x4002 0400 - 0x4002 0FFF

0x4002 0400 - 0x4002 07FF

0x4002 0000 - 0x4002 03FF

0x4001 8400 - 0x4001 FFFF

0x4001 8000 - 0x4001 83FF

0x4001 4000 - 0x4001 7FFF

0x4001 3C00 - 0x4001 3FFF

0x4001 3800 - 0x4001 3BFF

0x4001 3400 - 0x4001 37FF

0x4001 3000 - 0x4001 33FF

0x4001 2C00 - 0x4001 2FFF

0x4001 2800 - 0x4001 2BFF

0x4001 2400 - 0x4001 27FF

0x4001 2000 - 0x4001 23FF

0x4001 1C00 - 0x4001 1FFF

0x4001 1800 - 0x4001 1BFF

0x4001 1400 - 0x4001 17FF

0x4001 1000 - 0x4001 13FF

0x4001 0C00 - 0x4001 0FFF

0x4001 0800 - 0x4001 0BFF

0x4001 0400 - 0x4001 07FF

0x4001 0000 - 0x4001 03FF

0x4000 7800 - 0x4000 FFFF

0x4000 7400 - 0x4000 77FF

0x4000 7000 - 0x4000 73FF

0x4000 6C00 - 0x4000 6FFF

0x4000 6800 - 0x4000 6BFF

0x4000 6400 - 0x4000 67FF

0x4000 6000 - 0x4000 63FF

0x4000 5C00 - 0x4000 5FFF

0x4000 5800 - 0x4000 5BFF

0x4000 5400 - 0x4000 57FF

0x4000 5000 - 0x4000 53FF

0x4000 4C00 - 0x4000 4FFF

0x4000 4800 - 0x4000 4BFF

0x4000 4400 - 0x4000 47FF

0x4000 4000 - 0x4000 43FF

0x4000 3C00 - 0x4000 3FFF

0x4000 3800 - 0x4000 3BFF

0x4000 3400 - 0x4000 37FF

0x4000 3000 - 0x4000 33FF

0x4000 2C00 - 0x4000 2FFF

0x4000 2800 - 0x4000 2BFF

0x4000 1800 - 0x4000 27FF

0x4000 1400 - 0x4000 17FF

0x4000 1000 - 0x4000 13FF

0x4000 0C00 - 0x4000 0FFF

0x4000 0800 - 0x4000 0BFF

0x4000 0400 - 0x4000 07FF

0x4000 0000 - 0x4000 03FF

0x3FFF FFFF

0x2001 0000

0x2000 FFFF

0x2000 0000

0x1FFF F800 - 0x1FFF F80F

0x1FFF F000 - 0x1FFF F7FF

0x1FFF EFFF

0x0808 0000

0x0807 FFFF

0x0800 0000

0x07FF FFFF

0x0008 0000

0x0007 FFFF

0x0000 0000 ai14753c

Rev 5 -日本語版 35/720

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正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

メ モ リ と バスの構成

2.3.1

RM0008

ペ リ フ ェ ラル メ モ リ ・ マ ッ プ

表 1.

レ ジ ス タ ・ バウ ン ダ リ ・ ア ド レ ス

ア ド レ スの範囲 ペ リ フ ェ ラル回路 バス レ ジ ス タ ・ マ ッ プ

0x4002 2400 - 0x4002 2FFF

0x4002 3000 - 0x4002 33FF

0x4002 2000 - 0x4002 23FF

予約済み

CRC

Flash メ モ リ

イ ン タ フ ェ ース

予約済み 0x4002 1400 - 0x4002 1FFF

0x4002 1000 - 0x4002 13FF

0x4002 0800 - 0x4002 0FFF

0x4002 0400 - 0x4002 07FF

0x4002 0000 - 0x4002 03FF

0x4001 8400 - 0x4001 FFFF

0x4001 8000 - 0x4001 83FF

0x4001 4000 - 0x4001 7FFF

リ セ ッ ト ・ ク ロ ッ ク制御

RCC

AHB

予約済み

DMA2

DMA1

予約済み

SDIO

予約済み

0x4001 3C00 - 0x4001 3FFF ADC3

0x4001 3800 - 0x4001 3BFF USART1

0x4001 3400 - 0x4001 37FF

0x4001 3000 - 0x4001 33FF

TIM8 タ イ マ

SPI1

0x4001 2C00 - 0x4001 2FFF TIM1 タ イ マ

0x4001 2800 - 0x4001 2BFF ADC2

0x4001 2400 - 0x4001 27FF

0x4001 2000 - 0x4001 23FF

ADC1

GPIO ポー ト G

0x4001 1C00 - 0x4001 1FFF GPIO ポー ト F

0x4001 1800 - 0x4001 1BFF GPIO ポー ト E

APB2

0x4001 1400 - 0x4001 17FF

0x4001 1000 - 0x4001 13FF

GPIO ポー ト D

GPIO ポー ト C

0x4001 0C00 - 0x4001 0FFF GPIO ポー ト B

0x4001 0800 - 0x4001 0BFF GPIO ポー ト A

0x4001 0400 - 0x4001 07FF

0x4001 0000 - 0x4001 03FF

EXTI

AFIO

セ ク シ ョ ン 3.4.4 (47 ページ)

セ ク シ ョ ン 6.3.11 (101 ページ)

セ ク シ ョ ン 9.4.7 (153 ページ)

セ ク シ ョ ン 9.4.7 (153 ページ)

セ ク シ ョ ン 19.9.16 (488 ページ)

セ ク シ ョ ン 10.12.15 (189 ページ)

セ ク シ ョ ン 24.6.8 (678 ページ)

セ ク シ ョ ン 12.4.21 (283 ページ)

セ ク シ ョ ン 22.5 (594 ページ)

セ ク シ ョ ン 12.4.21 (283 ページ)

セ ク シ ョ ン 10.12.15 (189 ページ)

セ ク シ ョ ン 10.12.15 (189 ページ)

セ ク シ ョ ン 7.5 (129 ページ)

セ ク シ ョ ン 7.5 (129 ページ)

セ ク シ ョ ン 7.5 (129 ページ)

セ ク シ ョ ン 7.5 (129 ページ)

セ ク シ ョ ン 7.5 (129 ページ)

セ ク シ ョ ン 7.5 (129 ページ)

セ ク シ ョ ン 7.5 (129 ページ)

セ ク シ ョ ン 8.3.7 (140 ページ)

セ ク シ ョ ン 7.5 (129 ページ)

36/720 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

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参考資料

RM0008

メ モ リ と バスの構成

表 1.

レ ジ ス タ ・ バウ ン ダ リ ・ ア ド レ ス (続き)

ア ド レ スの範囲 ペ リ フ ェ ラル回路 バス レ ジ ス タ ・ マ ッ プ

0x4000 7800 - 0x4000 FFFF

0x4000 7400 - 0x4000 77FF

0x4000 7000 - 0x4000 73FF

0x4000 6C00 - 0x4000 6FFF

0x4000 6800 - 0x4000 6BFF

0x4000 6400 - 0x4000 67FF

0x4000 6000 - 0x4000 63FF

予約済み

DAC

電源制御 PWR

バ ッ ク ア ッ プ ・ レ ジ ス タ

BKP

予約済み bxCAN

USB/CAN 共用 SRAM

512bytes

0x4000 5C00 - 0x4000 5FFF USB レ ジス タ

0x4000 5800 - 0x4000 5BFF I2C2

0x4000 5400 - 0x4000 57FF

0x4000 5000 - 0x4000 53FF

I2C1

UART5

0x4000 4C00 - 0x4000 4FFF UART4

0x4000 4800 - 0x4000 4BFF USART3

0x4000 4400 - 0x4000 47FF

0x4000 4000 - 0x4000 3FFF

USART2

予約済み

APB1

0x4000 3C00 - 0x4000 3FFF SPI3/I2S

0x4000 3800 - 0x4000 3BFF SPI2/I2S

0x4000 3400 - 0x4000 37FF

0x4000 3000 - 0x4000 33FF

0x4000 2C00 - 0x4000 2FFF

0x4000 2800 - 0x4000 2BFF

Reserved

独立型ウ ォ ッ チ ド ッ グ

IWDG

Window 型ウ ォ ッ チ ド ッ

グ WWDG

RTC

0x4000 1800 - 0x4000 27FF

0x4000 1400 - 0x4000 17FF

予約済み

TIM7 タ イ マ

0x4000 1000 - 0x4000 13FF TIM6 タ イ マ

0x4000 0C00 - 0x4000 0FFF TIM5 タ イ マ

0x4000 0800 - 0x4000 0BFF

0x4000 0400 - 0x4000 07FF

0x4000 0000 - 0x4000 03FF

TIM4 タ イ マ

TIM3 タ イ マ

TIM2 タ イ マ

セ ク シ ョ ン 11.5.14 (214 ページ)

セ ク シ ョ ン 4.4.3 (62 ページ)

セ ク シ ョ ン 5.4.5 (69 ページ)

セ ク シ ョ ン 21.6.5 (564 ページ)

セ ク シ ョ ン 20.5.4 (518 ページ)

セ ク シ ョ ン 23.6.10 (636 ページ)

セ ク シ ョ ン 23.6.10 (636 ページ)

セ ク シ ョ ン 24.6.8 (678 ページ)

セ ク シ ョ ン 24.6.8 (678 ページ)

セ ク シ ョ ン 24.6.8 (678 ページ)

セ ク シ ョ ン 24.6.8 (678 ページ)

セ ク シ ョ ン 22.5 (594 ページ)

セ ク シ ョ ン 22.5 (594 ページ)

セ ク シ ョ ン 16.4.5 (372 ページ)

セ ク シ ョ ン 17.6.4 (379 ページ)

セ ク シ ョ ン 15.4.7 (366 ページ)

セ ク シ ョ ン 14.4.9 (353 ページ)

セ ク シ ョ ン 14.4.9 (353 ページ)

セ ク シ ョ ン 13.4.19 (340 ページ)

セ ク シ ョ ン 13.4.19 (340 ページ)

セ ク シ ョ ン 13.4.19 (340 ページ)

セ ク シ ョ ン 13.4.19 (340 ページ)

Rev 5 -日本語版 37/720

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参考資料

メ モ リ と バスの構成

2.3.2

2.3.3

RM0008

内蔵 SRAM

STM32F10xxx は 64Kbytes の SRAM を搭載 し ています。 SRAM は、 バイ ト 、 ハー フ ワー ド

(16bit)、 フ ルワー ド (32bit) に よ る ア ク セスが可能で、 そのア ド レ スは 0x2000 0000 か ら

始ま り ます。

ビ ッ ト ・ バンデ ィ ン グ

Cortex

TM

-M3 の メ モ リ ・ マ ッ プには 2 つのビ ッ ト バン ド ・ ド メ イ ンが組込まれています。

こ れ ら の ド メ イ ン では、 メ モ リ のエ イ リ ア ス ・ ド メ イ ンの各ワー ド を メ モ リ のビ ッ ト バン

ド ・ ド メ イ ンのビ ッ ト に配置 し ています。 エ イ リ ア ス ・ ド メ イ ンのワー ド への書込みは、

ビ ッ ト バン ド ・ ド メ イ ンの対象ビ ッ ト に読込み / モデ ィ フ ァ イ / 書込み動作で ア ク セスす

る こ と と 同 じ 効果を も ち ます。

STM32F10xxx では、 周辺回路のレ ジ ス タ も SRAM ド メ イ ン と 同 じ ビ ッ ト バン ド ・ ド メ イ ン

にマ ッ ピ ン グ さ れています。 こ れに よ り 、 ビ ッ ト バン ド ・ ド メ イ ンの書込み ・ 読出 し 操作

を同 じ よ う に実行する こ と がで き ます。

マ ッ ピ ン グの計算式は、 ビ ッ ト バン ド ・ ド メ イ ンの対象ビ ッ ト がどのよ う にエ イ リ ア ス ・

ド メ イ ンのワー ド に対応 さ せ られるかを示 し ています。 こ の式は、 bit_word_addr

= bit_band_base

+ ( byte_offset

x 32) + ( bit_number

- 4 )

こ こ で、 bit_word_addr

は対象ビ ッ ト に対応 さ せら れる エ イ リ ア ス ・ ド メ イ ンのワー ド のア ド レ

ス です。 bit_band_base

はエ イ リ ア ス ・ ド メ イ ンの開始ア ド レ スです。 byte_offset

は対象ビ ッ ト を含む、 ビ ッ ト バン ド ・ ド メ イ ン内のバイ ト のオ フ セ ッ ト 値

です。 bit_number

は対象ビ ッ ト のビ ッ ト 位置 (0-7) です。

例 :

以下の例は SRAM ア ド レ ス 0x20000300 のバイ ト がエ イ リ ア ス ・ ド メ イ ン にどのよ う に配

置 さ れてい るかを示 し ています。

0x22006008 = 0x22000000 + (0x300*32) + (2*4).

ア ド レ ス 0x22006008 への書込みは SRAM ア ド レ ス 0x20000300 のバイ ト のビ ッ ト 2 に対 し

て読込み / モデ ィ フ ァ イ / 書込みを実行する こ と と 同 じ 効果があ り ます。

ア ド レ ス 0x22006008 の読出 し では、 SRAM ア ド レ ス 0x20000300 のバイ ト のビ ッ ト 2 の状

態が、 ビ ッ ト がセ ッ ト さ れていれば 0x01 と し て、 リ セ ッ ト さ れていれば 0x00 と し て読出

し さ れます。

ビ ッ ト ・ バンデ ィ ン グの詳細に関 し ては、

ニ ュ アル

を参照 し て く だ さ い。

Cortex

TM

-M3 テ ク ニ カル ・ リ フ ァ レ ン ス ・ マ

38/720 Rev 5 -日本語版

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頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

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参考資料

RM0008

2.3.4

メ モ リ と バスの構成

内蔵 Flash メ モ リ

高機能な Flash メ モ リ ・ モ ジ ュ ールは次の特徴を も っ ています。

容量 512Kbyte

メ モ リ 構成 : Flash メ モ リ は メ イ ン ブ ロ ッ ク と 情報ブ ロ ッ ク で構成 さ れています。

- 中容量デバイ スは 16Kb × 64bits を 1Kbyte のページ 128 ページ で分割 し ます。

表  2

を参照 )

- 大容量デバイ スでは 64 Kb × 64bits を 2Kbytes の 256 ページへ分割 し ます。

( 表  3

を参照)

- 情報ブ ロ ッ ク は 258 × 64bits で、 2Kbytes と 16bytes の 2 つのページに分割 し ま

す。 (

表  2

を参照)

Flash メ モ リ ・ イ ン タ フ ェ ース (ELITF) は次の機能を持 っ ています。

プ リ フ ェ ッ チ ・ バ ッ フ ァ を持つ読込みイ ン タ フ ェ ース (2 x 64bit ワー ド )

オプ シ ョ ンバイ ト ・ ローダ

Flash プ ロ グ ラ ム書込み / 消去操作

読込み / 書込み禁止機能

表 2.

ブ ロ ッ ク

Flash モ ジ ュ ールの構成 (中容量デバイ ス)

メ イ ン ・ メ モ リ

情報ブ ロ ッ ク

Flash メ モ リ ・

イ ン タ フ ェ ース ・

レ ジ ス タ

名称

ページ 0

ページ 1

ページ 2

ページ 3

ページ 4

.

.

.

ページ 127

シ ス テム ・ メ モ リ

オプ シ ョ ン ・ バイ ト

FLASH_ACR

FLASH_KEYR

FLASH_OPTKEYR

FLASH_SR

FLASH_CR

FLASH_AR

予約済み

FLASH_OBR

FLASH_WRPR

ア ド レ ス

0x0800 0000 - 0x0800 03FF

0x0800 0400 - 0x0800 07FF

0x0800 0800 - 0x0800 0BFF

0x0800 0C00 - 0x0800 0FFF

0x0800 1000 - 0x0800 13FF

.

.

.

0x0801 FC00 - 0x0801 FFFF

0x1FFF F000 - 0x1FFF F7FF

0x1FFF F800 - 0x1FFF F80F

0x4002 2000 - 0x4002 2003

0x4002 2004 - 0x4002 2007

0x4002 2008 - 0x4002 200B

0x4002 200C - 0x4002 200F

0x4002 2010 - 0x4002 2013

0x4002 2014 - 0x4002 2017

0x4002 2018 - 0x4002 201B

0x4002 201C - 0x4002 201F

0x4002 2020 - 0x4002 2023

サイ ズ (bytes)

2 Kbytes

16

4

4

4

4

4

4

4

4

4

1 Kbyte

1 Kbyte

1 Kbyte

1 Kbyte

1 Kbyte

.

.

.

1 Kbyte

Rev 5 -日本語版 39/720

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参考資料

メ モ リ と バスの構成

注意 :

RM0008

表 3.

ブ ロ ッ ク

Flash モ ジ ュ ールの構成 (大容量デバイ ス)

メ イ ン ・ ブ ロ ッ ク

情報ブ ロ ッ ク

Flash メ モ リ ・

イ ン タ フ ェ ース ・

レ ジ ス タ

名称

ページ 0

ページ 1

ページ 2

ページ 3

.

.

.

ページ 255

シ ス テム ・ メ モ リ

オプ シ ョ ン ・ バイ ト

FLASH_ACR

FLASH_KEYR

FLASH_OPTKEYR

FLASH_SR

FLASH_CR

FLASH_AR

予約済み

FLASH_OBR

FLASH_WRPR

ア ド レ ス

0x0800 0000 - 0x0800 07FF

0x0800 0800 - 0x0800 0FFF

0x0800 1000 - 0x0800 17FF

0x0800 1800 - 0x0800 1FFF

.

.

.

0x0807 F800 - 0x0807 FFFF

0x1FFF F000 - 0x1FFF F7FF

0x1FFF F800 - 0x1FFF F80F

0x4002 2000 - 0x4002 2003

0x4002 2004 - 0x4002 2007

0x4002 2008 - 0x4002 200B

0x4002 200C - 0x4002 200F

0x4002 2010 - 0x4002 2013

0x4002 2014 - 0x4002 2017

0x4002 2018 - 0x4002 201B

0x4002 201C - 0x4002 201F

0x4002 2020 - 0x4002 2023

サイ ズ (bytes)

2 Kbytes

2 Kbytes

2 Kbytes

2 Kbytes

.

.

.

2 Kbytes

2 Kbytes

16

4

4

4

4

4

4

4

4

4

Flash メ モ リ ・ イ ン タ フ ェ ース ・ レ ジ ス タ の詳細は、 STM32F10xxx Flash プ ログ ラ ミ ン グマ

ニ ュ アルを参照 し て く だ さ い。

40/720 Rev 5 -日本語版

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参考資料

RM0008

メ モ リ と バスの構成

Flash メ モ リ の読出 し

Flash メ モ リ の操作やデー タ ・ ア ク セスは AHB バス を経由 し て行われます。 ICode バス を

通 し ての命令語 フ ェ ッ チでは、 プ リ フ ェ ッ チ回路が使用 さ れます。 ア ク セス競合の管理は

Flash メ モ リ ・ イ ン タ フ ェ ース で行われ、 DCode バス を経由するデー タ ・ ア ク セスが最 も

優先 さ れます。

Flash メ モ リ の読出 し の際には、 次のオプ シ ョ ンが指定で き ます。

遅延 : 読込みア ク セスの際のウ ェ イ ト ・ ス テー ト 数は on-the-fly で プ ロ グ ラ ム設定が

で き ます。

プ リ フ ェ ッ チ ・ バ ッ フ ァ (2 x 64bit ブ ロ ッ ク) : こ の機能は、 リ セ ッ ト 後に イ ネーブル

する こ と が出来ます。 ブ ロ ッ ク ・ サイ ズが Flash メ モ リ のバン ド 幅に適合する よ う に、

全体のブ ロ ッ ク は Flash メ モ リ か ら 一回の読込みで置き換え る こ と が出来ます。 プ リ

フ ェ ッ チ ・ バ ッ フ ァ があ る ため、 CPU がプ リ フ ェ ッ チ ・ バ ッ フ ァ です ぐ に利用で き

る、 次のワー ド で一度に一つのワー ド を フ ェ ッ チする ため、 よ り 高速な CPU 動作を

行 う こ と が出来ます。

ハー フ ・ サイ ク ル : 消費電力 と の関連で決める こ と が出来ます。

注意 : 1 これらのオプ シ ョ ンは Flash メ モ リ のア ク セス タ イム と の兼ね合いで選択 さ れます。 ウ ェ

イ ト ・ ス テー ト は Flash メ モ リ ・ ア ク セス タ イムに対する SYSCLK (シス テム ・ ク ロ ッ ク)

周期の比率を表 し ます。

0 < SYSCLK ≦ 24 MHz の場合、 ゼロウ ェ イ ト ・ ス テー ト

24 MHz < SYSCLK ≦ 48 MHz の場合、 1 ウ ェ イ ト ・ ス テー ト

48 MHz < SYSCLK ≦ 72 MHz の場合、 2 ウ ェ イ ト ・ ス テー ト

2 ハー フサイ クルの構成は AHB 上のプ リ スケー ラ と 同時に利用する こ と はで き ません。 シ

ス テム ・ ク ロ ッ ク (SYSCLK) は HCLK ク ロ ッ ク と 同 じ にする必要があ り ます。 このため、

この機能は 8 MHz 以下の低周波数ク ロ ッ クのみで使用 さ れます。 また、 ク ロ ッ クは HSI も

し く は HSE から生成 さ れ、 PLL からは生成 さ れません。

3 AHB ク ロ ッ ク では 1 と 異な る プ リ スケー ラ を使用する場合、 プ リ フ ェ ッ チ ・ バ ッ フ ァ は維

持 さ れる必要があ り ます。

4 プ リ フ ェ ッ チ ・ バ ッ フ ァ は SYSCLK が 24MHz よ り 低い と きのみ、 オン / オ フ し なければ

な り ません。 プ リ フ ェ ッ チ ・ バ ッ フ ァ は、 通常初期化ルーチ ン でマ イ ク ロ コ ン ト ロー ラが

内部 8MHzRC (HSI) オシ レー タ で動作中にオン / オ フ さ れます。

5 DMA の利用 : DMA 回路は DCode バス を経由 し て Flash メ モ リ にア ク セス し てお り 、 ICode

からのア ク セス よ り 優先 さ れます。 DMA では、 各転送動作のあ と に 1 サイ クル分の空き時

間がおかれる よ う 制御 し ています。 い く つかの命令語は DMA 転送 と 同時に実行 さ れます。

注意 :

Flash メ モ リ の書込み と 消去

Flash メ モ リ は一度に 16bit (ハー フ ・ ワー ド ) ずつ書込まれます。

Flash メ モ リ の消去はページ単位か、 も し く は Flash メ モ リ 全体に対 し て (全体消去) 実行

さ れます。 全体消去の場合で も、 情報ブ ロ ッ クは消去 さ れません。

正確な Flash 書込み時間を維持する ため、 Flash 書込み / 消去 コ ン ト ロー ラ には固定 さ れた

の ク ロ ッ クが供給 さ れています。

デー タ 書込みや消去の終了時に割込み リ ク エ ス ト を発生 さ せる こ と がで き ます。 FLITF ク

ロ ッ ク がイ ネーブルの場合は、 こ の割込み ト リ ガで WFI モー ド か ら 終了する こ と がで き ま

す。 FLITF ク ロ ッ クがデ ィ セーブルの と き には WFI モー ド か ら 終了 し た後に割込み処理動

作が行われます。

Flash メ モ リ 動作 と レ ジ ス タ 設定についての詳細は、 STM32F10xxx Flash プ ログ ラ ミ ングマ

ニ ュ アルを参照 し て く だ さ い。

Rev 5 -日本語版 41/720

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

メ モ リ と バスの構成

2.4

RM0008

ブー ト 構成

STM32F10xxx では 3 種のブー ト 動作が可能で、 次の

表  4

のよ う に BOOT[1:0] ピ ン に よ っ

て選択で き ます。

表 4.

ブ ー ト ・ モ ー ド

ブー ト ・ モー ド 選択

ピ ン

ブー ト ・ モー ド

BOOT1 BOOT0 x

0

1

0

1

1

メ イ ン Flash メ モ リ

シ ス テム ・ メ モ リ

内蔵 SRAM

摘要

メ イ ン Flash メ モ リ か ら ブー ト が行われます。

シ ス テム ・ メ モ リ か ら ブー ト が行われます。

内蔵 SRAM から ブー ト が行われます。

ブー ト ・ モー ド で指定 さ れた物理 メ モ リ は Block 000 (ブー ト ・ メ モ リ ) に割付け られま

す。 BOOT ピ ンの状態は 、 リ セ ッ ト 後 SYSCLK の 4 番目の立上が り エ ッ ジ で ラ ッ チ さ れま

す。 ユーザは リ セ ッ ト 後のブー ト ・ モー ド を指定する ために BOOT1 と BOOT0 ピ ン に必要

な設定をする必要があ り ます。

BOOT ピ ンは STANDBY モー ド を終了する場合に もサン プル さ れます。 し たが っ て、 こ れ

らのピ ンは STANDBY モー ド の中で必要 と さ れる ブー ト ・ モー ド を指示する よ う 、 信号レ

ベルが維持する必要があ り ます。

ブー ト ・ メ モ リ 空間に割 り 当て ら れている関連する メ モ リ (Flash メ モ リ も し く は SRAM

メ モ リ ) は、 同時に、 メ モ リ と し ての通常のア ド レ スか ら も ア ク セスが可能です。

起動時、 所定の時間が経過 し た後、 ブー ト ・ メ モ リ の最下位ア ド レ ス 0x0000 0000 か ら

CPU の命令実行が始ま り ます。

内蔵ブー ト ローダ

内蔵ブー ト ローダは USART1 シ リ アル ・ イ ン タ フ ェ ースに よ り 、 Flash メ モ リ を再プ ロ グ

ラ ムする ために使われます。 こ のプ ロ グ ラ ムは ST に よ り 生産時にプ ロ グ ラ ム さ れ、 シ ス

テム ・ メ モ リ に配置 さ れます。 詳細については AN2606 を参照 し て く だ さ い。

42/720 Rev 5 -日本語版

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RM0008

メ モ リ と バスの構成

Rev 5 -日本語版 43/720

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CRC 計算ユニ ッ ト

3 CRC 計算ユニ ッ ト

RM0008

Flash メ モ リ 容量が 32 ~ 128Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト ロー

ラは、 中容量デバイ ス です。

Flash メ モ リ 容量が 256 ~ 512Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト

ロー ラ は、 大容量デバイ ス です。

こ のセ ク シ ョ ンは、 注意書きがない限 り 、 STM32F10xxx フ ァ ミ リ 全てに適応 さ れます。

3.1 概要

CRC (Cyclic Redundancy Check) 計算ユニ ッ ト は、 32bit デー タ ワー ド と 決め られた生成多

項式か ら CRC コ ー ド を取得 し ます。

他のア プ リ ケーシ ョ ンの中で も、 CRC ベースのテ ク ニ ッ クはデー タ 転送やス ト レ ージの整

合性を実証する ために用い ら れます。 EN/IEC60335-1 標準の中で、 Flash メ モ リ の整合性を

実証する こ と が挙げ ら れています。 リ ン ク 時に生成 さ れ、 与え られた メ モ リ ・ ロ ケーシ ョ

ン上に保存 さ れた リ フ ァ レ ン ス符号 と 比較する ために、 CRC 計算ユニ ッ ト は、 ラ ン タ イ ム

時に ソ フ ト ウ ェ アの符号計算を支援 し ます。

3.2 主な機能

CRC-32 (Ethernet) 多項式 : 0x4C11DB7 を使用

– X

32

+ X

26

+ X

23

+ X

22

+ X

16

+ X

12

+ X

11

+ X

10

+X

8

+ X

7

+ X

5

+ X

4

+ X

2

+ X +1

シ ン グル入力 / 出力 32bit デー タ ・ レ ジ ス タ

CRC の計算は 4 AHB ク ロ ッ ク ・ サイ クル (HCLK) で完了

汎用 8bit レ ジ ス タ (テ ンポ ラ リ ・ ス ト レージ と し て利用可能)

図  3

にブ ロ ッ ク図を示 し ます。

図 3.

CRC 計算ユニ ッ ト ・ ブ ロ ッ ク 図

AHB

バス

32bit

(読込みアクセス)

CRCの計算(多項式:0x4C11DB7) ai14968

44/681 Rev 5 -日本語版

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参考資料

RM0008

3.3

CRC 計算ユニ ッ ト

CRC 機能詳細

CRC 計算ユニットは、 主に次のような 1 つの 32bit データ ・ レジスタから構成されています。

CRC 計算機に新たなデー タ を入力する (レ ジ ス タ へ書込みする場合) 入力レ ジ ス タ と

し て使用

前の CRC 計算結果を保持 (レ ジ ス タ を読込みする場合)

デー タ ・ レ ジ ス タ への各書込みオペ レ ーシ ョ ンは、 前の CRC 値 と 新たな値 (CRC 計算は

32bit デー タ ・ ワー ド 単位で行われ、 バイ ト 毎ではあ り ません。) の組み合わせを作 り ます。

CPU は処理の間は停止しているため、 ソフトウェア ・ ウェイト ・ サイクルを挿入せずに、 backto-back の書込みアクセスや、 連続した書込みと読込みアクセスを可能にします。

CRC 計算機は、 CRC_CR レ ジ ス タ の RESET 制御ビ ッ ト で、 FFFF FFFFh に リ セ ッ ト する こ

と が出来ます。 こ のオペ レーシ ョ ンは CRC_IDR レ ジ ス タ の内容に影響 し ません。

3.4 CRC レ ジ ス タ

CRC 計算ユニ ッ ト には、 2 つのデー タ ・ レ ジ ス タ と 制御レ ジ ス タ か ら 構成 さ れています。

3.4.1

31 rw

15

30

デー タ ・ レ ジ ス タ (CRC_DR)

ア ド レ ス ・ オ フ セ ッ ト : 0x00

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23

DR [31:16] rw

14 rw

13 rw

12 rw

11 rw

10 rw

9 rw

8

DR [15:0] rw

7 rw rw rw rw rw rw rw rw rw

22 rw

6

21 rw

5

20 rw

4

19 rw

3 rw rw rw

Bits 31:0 デー タ ・ レ ジ ス タ ・ ビ ッ ト

新たなデー タ を CRC 計算機に書込む時に入力レ ジ ス タ と し て使います。

読込み時は、 前の CRC 計算結果を保持 し ています。 rw

18 rw

2 rw

17 rw

1 rw

16 rw

0 rw

Rev 5 -日本語版 45/681

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CRC 計算ユニ ッ ト

RM0008

3.4.2

31 30

独立型デー タ ・ レ ジ ス タ (CRC_IDR)

ア ド レ スオ フ セ ッ ト : 0x04

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23

予約済み

-

15

-

-

14

-

-

13

-

-

12

予約済み

-

11

-

-

10

-

-

9

-

-

8

-

-

7 rw

22

-

6

21

-

5

20 19

-

4

IDR[7:0]

-

3 rw rw

18

-

2

17

-

1

16

-

0 rw rw rw rw rw

Bits 31:8 予約済み

Bits 7:0 汎用 8bit デー タ ・ レ ジ ス タ ・ ビ ッ ト

1 バイ ト のテ ンポ ラ リ ス ト レージ と し て使 う 事が出来ます。

こ のレ ジ ス タ は、 CRC_CR レ ジ ス タ の RESET ビ ッ ト によ り 生成 さ れる CRC リ セ ッ ト の影響を受

けません。

3.4.3

31 30

制御レ ジ ス タ (CRC_CR)

ア ド レ スオ フ セ ッ ト : 0x08

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25

-

15

-

14

-

13

-

12

-

11

-

10

24 23

予約済み

-

9

-

8

予約済み

-

7

22

-

6

21

-

5

20

-

4

19

-

3

18

-

2

17

-

Bits 31:1

予約済み

Bits 0 RESET ビ ッ ト

CRC 計算ユニ ッ ト を リ セ ッ ト し 、 デー タ ・ レ ジス タ を FFFF FFFFh にセ ッ ト し ます。

こ のビ ッ ト はセ ッ ト のみで、 ハー ド ウ ェ アによ り 自動的に ク リ ア さ れます。

-

-

1

16

-

0

RESET w

46/681 Rev 5 -日本語版

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RM0008

3.4.4

CRC 計算ユニ ッ ト

CRC レ ジ ス タ ・ マ ッ プ

次のテーブルは、 CRC レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 値を示 し ます。

表 5.

オ フ

セ ッ ト

CRC 計算ユニ ッ ト -レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 値

レ ジ ス タ

31-24 23-16 15-8

0x00

0x04

0x08

CRC_DR

リ セ ッ ト 値

CRC_IDR

リ セ ッ ト 値

CRC_CR

リ セ ッ ト 値

予約済み

7 6 5 4 3 2 1

デー タ ・ レ ジ ス タ

0xFFFF FFFF

予約済み

独立型デー タ ・ レ ジ ス タ

0x00

予約済み

0

0

RESET

0

Rev 5 -日本語版 47/681

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電源制御 (PWR)

4 電源制御 (PWR)

RM0008

Flash メ モ リ 容量が 32 ~ 128Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト

ロー ラ は、 中容量デバイ スです。

Flash メ モ リ 容量が 256 ~ 512Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト

ロー ラ は、 大容量デバイ スです。

こ のセ ク シ ョ ンは、 注意書きがない限 り 、 STM32F10xxx フ ァ ミ リ 全てに適応 さ れます。

4.1 電源供給

こ のデバイ スは 2.0 ~ 3.6 V の V

DD

電源供給を必要 と し ます。 内部の 1.8 V デジ タ ル電源

を供給する ために、 レギ ュ レ ー タ が搭載 さ れています。

リ アル タ イ ム ・ ク ロ ッ ク (RTC) と バ ッ ク ア ッ プ ・ レ ジ ス タ の電源は、 主電源 V

DD

の時には V

BAT

か ら 供給 さ れます。

がオ フ

図 4.

電源系の概要

(2.4 V から V

(V

DDA

SSA

)

V

REF-

まで )

V

REF+

(V

DD

(V

SS

)

)

V

DDA

V

SSA

V

DDA

ド メ イ ン

A/D コ ンバー タ

温度センサ

リ セ ッ ト ・ブ ロ ッ ク

PLL

V

V

SS

DD

V

BAT

V

DD

ドメイン

I/O リング

STANDBY 回路

( ウェークアップ

1.8 V ドメイン

コア

メモリ

デジタル

ペリフェラル

電圧レギュレータ

電圧低下検出

バックアップ・ドメイン

LSE ク リ ス タ ル 32k osc

BKP レジスタ

RCC BDCR レジスタ

RTC

注意 : 1 V

DDA

と V

SSA

はそれぞれ V

DD

と V

SS

へ接続する必要があ り ます。

48/681 Rev 5 -日本語版

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RM0008

4.1.1

4.1.2

電源制御 (PWR)

独立 し た A/D コ ンバー タ 電源 と 参照電圧

AD 変換の精度を向上 さ せる ため、 ADC には独立 し た電源が供給 さ れます。 こ の電源回路

には フ ィ ル タ やシール ド を内蔵 し てい る ため、 PCB 上の ノ イ ズを防ぐ こ と がで き ます。

ADC 電源の入力は他 と 分離 し た V

DDA

ピ ンから 供給 さ れます。

ADC 電源のグ ラ ン ド は、 独立 し た V

SSA

ピ ン と し て引出 さ れています。

パッケージにより V

REF-

は、 V

SSA

に接続する必要があります。

100 ピ ン及び 144 ピ ンのパ ッ ケージ

高精度を維持 し 入力電圧を低 く 保つため、 独自の外部参照電圧を ADC の V

REF+

. に接続する こ と がで き ます。 V

REF+

の電圧は 2.4V か ら V

DDA

及び V

の範囲にな り ます。

REF-

64 ピ ンのパ ッ ケージ

V

REF

ド (V

+ と V

REF

- は提供 さ れていません。 こ れ らはチ ッ プ内で ADC 電源 (V

DDA

SSA

) と 接続 さ れています。

) 及びグ ラ ン

バ ッ テ リ ・ バ ッ ク ア ッ プ ・ ド メ イ ン

V

DD

がオ フ の と き にバ ッ ク ア ッ プ ・ レ ジ ス タ の内容を保持するの と RTC の機能を提供す

る ため、 V

BAT

ピ ン を電池な どの待機電源に よ り 提供 さ れる オプ シ ョ ンの STANDBY 電源

に接続する こ と がで き ます。

V

BAT

力は メ イ ンのデジ タ ル電源 (V

DD

V

BAT

ピ ンか ら は RTC 回路に も 電源供給 さ れてお り 、 LSE オシ レ ー タ と PC13 ~ 15 の入出

路に よ っ て行われます。

) がオ フの間 も RTC が動作 し つづけ る こ と がで き ます。

電源への切替えは リ セ ッ ト ブ ロ ッ ク に組込まれてい るパワー ・ ダウ ン ・ リ セ ッ ト 回

注意 :

要注意 : V

DD

ス タ ー ト 時の過渡時間

イ ッ チは V

BAT

し て く だ さ い。

側に接続 さ れています。 V

DD

DD

と V

流が流入 し ます。 t

BAT

の間のダ イ オー ド を通 し て V

RSTTEMPO

の立上が り が早 く 、

こ の時間内に所定の電圧に達する場合には、 V

BAT

り 低 く な る と V t

RSTTEMPO

の間、 V

BAT

/V

DD

の電源ス

が V

DD

-0.6V

BAT

に電

の値に関 し てはデー タ シー ト を参照

外部バ ッ テ リ が使用 さ れないア プ リ ケーシ ョ ン では、 V

BAT

ラ ミ ッ ク 安定化 コ ンデンサを経由 し て V

DD

はチ ッ プ外で 100 n F の外部セ

と 接続 し ます。 (詳細は AN2586 を参照)

バ ッ ク ア ッ プ ・ ド メ イ ンが V

DD

(アナ ロ グス イ ッ チ を V

い る場合には次の機能が利用で き ます。

DD

へ接続) に よ っ て供給を受けて

PC14 と PC15 は GPIO あ る いは LSE ピ ン と し て使 う こ と がで き ます

PC13 は GPIO、 TAMPER ピ ン、 RTC 較正 ク ロ ッ ク、 RTC ア ラ ームまたは第二出力 と し

て使 う こ と がで き ます (

セ ク シ ョ ン 5: バ ッ ク ア ッ プ ・ レ ジス タ (BKP) (63 ページ)

を参照)

ス イ ッ チに流す こ と がで き る電流の量は限られているので (3mA)、 GPIO の PC13 から

PC15 の利用は限られ、 同時に 1 つの出力のみ使用する こ と が出来ます。 最大負荷 30 p F

時の最大速度は 2MHz で、 こ れらの入出力は電流ソ ース と し て使 う こ と はで き ません。

50 p F 負荷で 3.6V の平均消費電流は、 2MHz で 0.4mA です。

Rev 5 -日本語版 49/681

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参考資料

電源制御 (PWR)

4.1.3

RM0008

バ ッ ク ア ッ プ ・ ド メ イ ンが V

BAT

(V

DD

は存在 し ないので アナ ロ グス イ ッ チは V

続) に よ っ て供給を う けてい る場合には、 次の機能が利用で き ます。

BAT

へ接

PC14 と PC15 は LSE ピ ン と し てのみ使 う こ と がで き ます。

PC13 は TAMPER ピ ン、 RTC ア ラ ームまたは第二出力 と し て使 う こ と がで き ます。 (

ク シ ョ ン 5.4.2: RTC ク ロ ッ ク較正レ ジス タ (BKP_RTCCR) (66 ページ)

を参照)

電圧レギ ュ レー タ

リ セ ッ ト 後、 電圧レギ ュ レ ー タ は常に動作状態 と な り 、 ア プ リ ケーシ ョ ンの状態に応 じ て

3 種類のモー ド で動作 し ます。

Run モー ド : レ ギ ュ レ ー タ は 1.8 V ド メ イ ン ( コ ア、 メ モ リ 、 デジ タ ルペ リ フ ェ ラ ル回

路) に全電力を供給 し ます。

STOP モー ド : レギ ュ レー タ は 1.8 V ド メ イ ン に対 し て、 レ ジ ス タ や SRAM の内容を

保持で き る、 限定 さ れた電力を供給 し ます。

STANDBY モー ド : レギ ュ レー タ はパワー ・ オ フ状態です。 STANDBY 回路 と バ ッ ク

ア ッ プ ・ ド メ イ ン以外のレ ジ ス タ や SRAM の内容は失われます。

4.2

4.2.1

電源供給管理

パワー ・ オ ン・ リ セ ッ ト (POR)/ パワー ・ ダウン・ リ セ ッ ト (PDR)

こ のデバイ スには、 電源電圧が 2 V を超え、 も し く は低下 し た と き に必要な動作を行わせ

る ための、 POR/PDR 回路が搭載 さ れています。

デバイ スは V

DD

/ V

DDA

が所定のス レ ッ シ ョ ル ド (V

POR/PDR

) を下回 っ ている間は、 外部の

リ セ ッ ト 回路を必要 と せずに、 リ セ ッ ト ・ モー ド を維持する こ と がで き ます。 POR/PDR

閾値に関 し ては、 デー タ シー ト の電気特性の項を ご参照 く だ さ い。

図 5.

パワー ・ オ ン ・ リ セ ッ ト / パワー ・ ダウ ン ・ リ セ ッ ト 波形

V

DD

/V

DDA

POR

40 mV

ヒステリシス

PDR

遅延時間 t

RSTTEMPO

リセット

50/681 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

4.2.2

電源制御 (PWR)

プ ロ グ ラ ム可能な電圧検出回路 (PVD)

電源電圧 V

DD

/ V

DDA

電源制御レ ジ ス タ (PWR_CR)

の PLS[2:0] で指定 さ れている ス レ ッ

シ ョ ル ド を比べる ために PVD を利用する こ と がで き ます。

PVD は PVDE ビ ッ ト を セ ッ ト する と き に有効 と な り ます。

電源制御 / ス テー タ ス ・ レ ジ ス タ (PWR_CSR)

の PVDO フ ラ グは電源電圧 V

DD

/ V

DDA

PVD ス レ ッ シ ョ ル ド よ り 高いか、 低いかを示 し ます。 こ の状態はイ ベ ン ト と し て EXTI の

ラ イ ン 16 に接続 さ れてお り 、 EXTI レ ジ ス タ で許可状態であれば、 割込み リ ク エ ス ト を生

成 し ます。 V

DD

/ V

DDA

が電圧ス レ ッ シ ョ ル ド を上回る場合に リ ク エ ス ト が生成するか、 下

回る と き に リ ク エ ス ト が生成するかは、 EXTI ラ イ ン 16 で割込み リ ク エ ス ト が発生する信

号エ ッ ジの設定で決ま り ます。 こ れを利用 し て、 サービ ス ・ ルーチ ン で緊急停止処理を行

わせる こ と な どがで き ます。

図 6.

PVD ス レ ッ シ ョ ル ド

V

DD

/V

DDA

PVD スレッショルド

100 mV

ヒステリシス

PVD 出力

Rev 5 -日本語版 51/681

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参考資料

電源制御 (PWR)

4.3

4.3.1

RM0008

低電力モー ド

標準状態では、 シ ス テム ・ リ セ ッ ト も し く は電源 リ セ ッ ト 後、 マ イ ク ロ コ ン ト ロー ラは

Run モー ド の状態です。 Run モー ド では、 CPU ク ロ ッ ク と し て HCLK が使用 さ れ、 プ ロ グ

ラ ム コ ー ド が実行 さ れます。 外部か らのイ ベ ン ト 待ち な ど で CPU がプ ロ グ ラ ムの実行が

必要ない と き に、 消費電力を小 さ く する ために、 い く つかの低電力モー ド が用意 さ れてい

ます。 低電力モー ド は、 消費電力 と 、 ウ ェ ー ク ア ッ プのための最短ス タ ー ト ア ッ プ時間 と

イ ベ ン ト と の関連で選択 さ れます。

STM32F10xxx デバイ スは次の 3 種の低電力モー ド を持 っ ています。

SLEEP モー ド (Cortex-M3 コ ア停止、 ペ リ フ ェ ラ ルは動作継続)

STOP モー ド (すべての ク ロ ッ クが停止)

STANDBY モー ド (1.8V 系 ド メ イ ンの電源オ フ)

加えて、 Run モー ド の消費電力を低下 さ せる ために次の手段を と る こ と がで き ます。

シ ス テム ・ ク ロ ッ ク周波数の低減

使用 さ れない APB、 AHB のペ リ フ ェ ラ ル ・ ク ロ ッ クの停止

表 6.

低電力モー ド 要約

モー ド 名称

モー ド 遷移

イ ベン ト

ウ ェ ー ク ア ッ プ

イ ベン ト

1.8V ド メ イ ンの

ク ロ ッ ク

V

DD

ド メ イ ン

ク ロ ッ ク

電圧

レギ ュ レー タ

SLEEP

(Sleep-now

も し く は

Sleep-on-exit)

STOP

STANDBY

WFI

WFE

PDDS 及び

LPDS ビ ッ ト +

SLEEPDEEP

ビ ッ ト + WFI

または WFE

割込み発生

ウ ェ ー ク ア ッ プ

(Wake-up)

イ ベン ト

EXTI ラ イ ン

(EXTI レ ジ ス タ

設定に依存)

PDDS ビ ッ ト

+ SLEEPDEEP

ビ ッ ト + WFI

または WFE

WKUP ピ ン立上 り

エ ッ ジ、 RTC ア

ラ ーム、 NRST ピ

ン外部 リ セ ッ ト 、

IWDG リ セ ッ ト

CPU CLK OFF

アナログ、 及び

他のク ロ ッ ク へ

の影響な し

無 し

ON

全 1.8V ド メ イ ン

ク ロ ッ ク OFF

HSI、 HSE

オシ レー タ

OFF

ON も し く は

低電力モー ド

電源制御レ

ジス タ

(PWR_CR)

よ る)

OFF

ク ロ ッ ク 周波数の低減

Run モー ド では、 プ リ スケー ラ ・ レ ジ ス タ のプ ロ グ ラ ム設定で Run モー ド のシ ス テム ・ ク

ロ ッ ク (SYSCLK、 HCLK、 PCLK1、 PCLK2) の周波数を低下 さ せる こ と がで き ます。 また、

プ リ スケー ラ を使用 し て、 SLEEP モー ド に入る前に、 ペ リ フ ェ ラルの周波数を低下 さ せて

お く こ と も で き ます。

こ の詳細は

セ ク シ ョ ン 6.3.2: ク ロ ッ ク構成レ ジス タ (RCC_CFGR)

を参照 し て く だ さ い。

52/681 Rev 5 -日本語版

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参考資料

RM0008

4.3.2

4.3.3

電源制御 (PWR)

ペ リ フ ェ ラル回路のク ロ ッ ク ・ ス イ ッ チ

Run モー ド で、 個々のペ リ フ ェ ラ ル と メ モ リ に対する HCLK 及び PCLKx を任意に停止 し 、

消費電力を低減する こ と がで き ます。

SLEEP モー ド における更な る電力低減のために、 WFI 及び WFE 命令を実行する前にペ リ

フ ェ ラ ル ・ ク ロ ッ ク を停止 し てお く こ と がで き ます。

ペ リ フ ェ ラ ルの ク ロ ッ クは

AHB ペ リ フ ェ ラル ・ ク ロ ッ ク ・ イ ネーブル ・ レ ジス タ

(RCC_AHBENR) 、

APB1 ペ リ フ ェ ラル ・ ク ロ ッ ク ・ イ ネーブル ・ レ ジ ス タ

(RCC_APB1ENR) 及び

APB2 ペ リ フ ェ ラル ・ ク ロ ッ ク ・ イ ネーブル ・ レ ジ ス タ

(RCC_APB2ENR)

で制御 さ れます。

SLEEP モー ド

SLEEP モー ド に入るには

WFI (Wait For Interrupt) も し く は WFE (Wait for Event) 命令を実行する こ と で、 SLEEP モー

ド に入 り ます。 こ の際には、 Cortex-M3 シ ス テム制御レ ジ ス タ の SLEEPONEXIT ビ ッ ト の

設定に応 じ て、 SLEEP モー ド に入る メ カ ニズムを選択する ために 2 つのオプ シ ョ ンが利用

で き ます。

SLEEP-NOW: SLEEPONEXIT ビ ッ ト が ク リ ア さ れる と 、 MCU は WFI、 WFE 命令の実行

と 同時に SLEEP モー ド に入 り ます。

SLEEP-ON-EXIT: SLEEPONEXIT ビットがセットされている時には、 MCU は最も優先度の

低い ISR を終了した時点で SLEEP モードに入ります。

SLEEP モー ド に入る際の動作の詳細は

表 7

及び

表 8

を参照 し て く だ さ い。

SLEEP モー ド を終了するには

WFI 命令に よ っ て SLEEP モー ド に入 っ た時には、 ペ リ フ ェ ラ ルの割込み リ ク エ ス ト がネ

ス ト 化 さ れたベ ク タ 割込み コ ン ト ロー ラ (NVIC) で受付け られる と 、 デバイ スは SLEEP

モー ド を終了 し ます。

WFE 命令に よ り SLEEP モー ド に入 っ た場合、 イ ベン ト が発生する と 同時に MCU は

SLEEP モー ド を終了 し ます。 ペ リ フ ェ ラ ル回路の制御レ ジ ス タ で割込み リ ク エ ス ト と し て

許可 さ れお り NVIC では受付けが許可 さ れていないペ リ フ ェ ラ ル回路の割込み リ ク エ ス ト

と 、 イ ベ ン ト モー ド が指定 さ れてい る EXTI ラ イ ンか らの信号が、 こ のイ ベ ン ト と な り ま

す。

こ のモー ド は割込みの入 り 口 と 出口で余分な時間を必要 と し ないため、 ウ ェ ー ク ア ッ プ時

間は最 も 短 く な り ます。

SLEEP モー ド か らの終了の詳細は、

表 7

及び

表 8

を参照 し て く だ さ い。

Rev 5 -日本語版 53/681

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報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

電源制御 (PWR)

RM0008

表 7.

Sleep-now

Sleep-now モー ド 詳細

モー ド 遷移

次の条件下の WFI (Wait for Interrupt) も し く は WFE (Wait for Event) 命令

- SLEEPDEEP = 0 及び

- SLEEPONEXIT = 0

Cortex TM -M3 シ ス テム制御レ ジ ス タ の説明を参照

モー ド 終了

WFI 命令で SLEEP モー ド に入 っ た場合、

割込み :

表 35: ベ ク タ テーブル

を参照

WFE 命令で SLEEP モー ド に入 っ た場合、

ウ ェ ー ク ア ッ プ (Wake-up) イ ベ ン ト :

プ ・ イ ベン ト 管理

を参照

セ ク シ ョ ン 8.2.3: ウ ェ ー ク ア ッ

ウ ェ ー ク ア ッ プ時の遅延 な し

表 8.

Sleep-on-exit

Sleep-on-exit 摘要

モー ド 遷移

次の条件下の WFI (Wait for Interrupt) も し く は WFE (Wait for Event) 命令

- SLEEPDEEP = 0 及び

- SLEEPONEXIT = 1

Cortex ™ -M3 シ ス テム制御レ ジ ス タ の説明を参照

モー ド 終了 割込み :

表 35: ベ ク タ テーブル

を参照

ウ ェ ー ク ア ッ プ時の遅延 な し

54/681 Rev 5 -日本語版

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報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

4.3.4

電源制御 (PWR)

STOP モー ド

STOP モー ド は、 Cortex-M3 のデ ィ ープ ス リ ープ (deepsleep) モー ド と ペ リ フ ェ ラル回路の

ク ロ ッ ク ・ ス イ ッ チ機能を組合わせた も のです。 電圧レ ギ ュ レ ー タ は通常モー ド か、 低電

力モー ド のいずれかです。 STOP モー ド では 1.8 V ド メ イ ンのすべての ク ロ ッ クは停止 し 、

PLL、 HSI、 HSE RC 発振回路はデ ィ セーブル状態 と な り ます。 SRAM と レ ジ ス タ の内容は

保持 さ れています。

STOP モー ド に入る には

STOP モー ド への入 り 方については 表 9

を参照 し て く だ さ い。

STOP モー ド で、 消費電力を よ り 削減する には、 内蔵 さ れてい る電圧レギ ュ レ ー タ を低電

力モー ド に し ます。 こ の設定は 電源制御レ ジス タ (PWR_CR)

の LPDS ビ ッ ト で指定 し ます。

Flash メ モ リ の書込みが進行中の と き には、 STOP モー ド への遷移は メ モ リ ・ ア ク セスが

終了する ま で待た さ れます。

APB ド メ イ ン にア ク セス中の と き には、 STOP モー ド への遷移は APB ア ク セスが終了す

る ま で待た さ れます。

STOP モー ド では、 次の回路で、 個別の制御ビ ッ ト に よ る機能設定がで き ます。

独立型ウ ォ ッ チ ド ッ グ (IWDG) : IWDG の動作は、 キーレ ジ ス タ への書込み、 も し く は

ハー ド ウ ェ アの設定で開始 さ れます。 ウ ォ ッ チ ド ッ グの動作がい っ たん開始 さ れる

と 、 リ セ ッ ト 以外では停止する こ と がで き ません。

セ ク シ ョ ン 16: 独立型ウ ォ ッ チ

ド ッ グ (IWDG)

セ ク シ ョ ン 16.3

を参照 し て く だ さ い。

リ アル タ イム ・ ク ロ ッ ク (RTC) : こ の設定は

(RCC_BDCR)

の RTCEN ビ ッ ト で行います。

バ ッ ク ア ッ プ ・ ド メ イ ン制御レ ジス タ

内蔵 RC オシ レー タ (LSI RC) : こ の設定は

制御 / ス テー タ ス ・ レ ジ ス タ (RCC_CSR)

の LSION ビ ッ ト で行います。

外部 32.768 kHz のオシ レ ー タ (LSE OSC) : こ の設定は

バ ッ ク ア ッ プ ・ ド メ イ ン制御レ

ジス タ (RCC_BDCR)

の LSEON ビ ッ ト で行います。

ADC や DAC は、 STOP モー ド に入る前にデ ィ セーブルに さ れない限 り 、 STOP モー ド の間

は電力を消費 し ます。 デ ィ セーブルする には、 ADC_CR2 レ ジ ス タ の ADON ビ ッ ト と

DAC_CR レ ジ ス タ の ENx ビ ッ ト の両方に 0 を書き込ま なければな り ません。

STOP モー ド を抜け出すには

STOP モー ド か ら抜け出す条件の詳細は

表 9

を参照 し て く だ さ い。

割込み も し く はウ ェ ー ク ア ッ プ ・ イ ベ ン ト の発生で STOP モー ド を終了す場合、 HSI RC

オシ レ ー タ がシ ス テム ・ ク ロ ッ ク と し て選択 さ れます。

電圧レ ギ ュ レー タ が低電力モー ド の時には、 STOP モー ド か ら のウ ェ ー ク ア ッ プの際に余

分なス タ ー ト ア ッ プ時間を必要 と し ます。 STOP モー ド の間 も 内蔵レ ギ ュ レ ー タ を オ ン状

態に保つ こ と で、 消費電力は増加 し ますがウ ェ ー ク ア ッ プに要する時間は短縮 さ れます。

Rev 5 -日本語版 55/681

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参考資料

電源制御 (PWR)

4.3.5

RM0008

表 9.

STOP モー ド

STOP モー ド

モー ド 遷移

モー ド 終了

摘要

次の条件下の WFI (Wait for Interrupt) も し く は WFE (Wait for Event) 命令

- Cortex

TM

-M3 シ ス テム制御レ ジ ス タ の SLEEPDEEPbit を セ ッ ト

- 電力制御レ ジ ス タ (PWR_CR) の PDDS bit を ク リ ア

- PWR_CR レ ジ ス タ の LPDS ビ ッ ト で電圧レギ ュ レー タ のモー ド を選択 さ

れている

注 : STOP モー ド に入るには、 EXTI ラ イ ンのペ ンデ ィ ングビ ッ ト (

ペン

デ ィ ング ・ レ ジス タ (EXTI_PR) ) すべて と RTC ア ラ ーム フ ラ グは リ セ ッ ト

する必要があ り ます。 リ セ ッ ト し ない場合、 STOP モー ド に入る手順は無

視 さ れ、 プ ログ ラ ムの実行が続け られます。

WFI 命令で STOP モー ド に入っ た場合、

割込みモー ド に設定 さ れている任意の EXTI ラ イ ン (対応する割込みベ

ク タ が NVIC で有効 と さ れてい る ラ イ ン)。

表 35: ベ ク タ テーブル (130

ページ)

を参照

WFE 命令で STOP モー ド に入 っ た場合、

イ ベン ト モー ド に設定 さ れている任意の EXTI ラ イ ン。 セ ク シ ョ ン 8.2.3:

ウ ェ ー ク ア ッ プ ・ イ ベン ト 管理 (135 ページ)

を参照

ウ ェ ー ク ア ッ プ時の

遅延

HSI RC ウ ェ ー ク ア ッ プ時間 + 低電力モー ド から の通常起動時間

STANDBY モー ド

STANDBY モー ド では消費電力を最 も 少な く で き ます。 こ のモー ド は電圧レギ ュ レ ー タ が

デ ィ セーブルで Cortex

TM

-M3 のデ ィ ープ ス リ ープ (deepsleep) モー ド で 1.8 V ド メ イ ン も電

源オ フ 状態 と な り ます。 また、 PLL、 HSI オシ レー タ 及び HSE オシ レ ー タ も オ フ 状態 と さ

れます。 SRAM と レ ジ ス タ の内容はバ ッ ク ア ッ プ ド メ イ ンのレ ジ ス タ と STANDBY 回路

図 4

参照) を除いて失われます。

STANDBY モー ド に入るには

STANDBY モー ド への入 り 方については

表 10

を参照 し て く だ さ い。

STANDBY モー ド では次の回路で、 個別の制御ビ ッ ト に よ る機能設定がで き ます。

独立型ウ ォ ッ チ ド ッ グ (IWDG): IWDG の動作は、 キーレ ジ ス タ への書込み、 も し く は

ハー ド ウ ェ アの設定で開始 さ れます。 ウ ォ ッ チ ド ッ グの動作がい っ たん開始 さ れる

と 、 リ セ ッ ト 以外では停止する こ と がで き ません。

セ ク シ ョ ン 16: 独立型ウ ォ ッ チ

ド ッ グ (IWDG)

セ ク シ ョ ン 16.3

を参照 し て く だ さ い。

リ アル タ イム ・ ク ロ ッ ク (RTC) : こ れはバ ッ ク ア ッ プ ・ ド メ イ ン ・ レ ジ ス タ

(RCC_BDCR) の RTCEN ビ ッ ト で設定 さ れます。

内蔵 RC オシ レー タ (LSI RC) : こ れは制御 / ス テー タ ス ・ レ ジ ス タ (RCC_CSR) の

LSION ビ ッ ト で設定 さ れます。

外部 32.768 kHz オシ レ ー タ (LSE OSC) : こ れはバ ッ ク ア ッ プ ・ ド メ イ ン制御レ ジ ス タ

(RCC_BDCR) レ ジ ス タ の LSEON ビ ッ ト で設定 さ れます。

56/681 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

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報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

電源制御 (PWR)

STANDBY モー ド の終了

マ イ ク ロ コ ン ト ロー ラ は 外部 リ セ ッ ト (NRST ピ ン)、 IWDG リ セ ッ ト 、 WKUP ピ ン信号の

立上が り エ ッ ジ、 も し く は RTC ア ラ ームのいずれかの発生で、 STANDBY モー ド を終了 し

ます。 電源制御 / ス テー タ ス ・ レ ジ ス タ (PWR_CSR)

を除 く すべてのレ ジ ス タ は、

STANDBY モー ド か らの起動時に リ セ ッ ト さ れます。

STANDBY モー ド か らのウ ェ ー ク ア ッ プ後、 プ ロ グ ラ ムは リ セ ッ ト 直後 と 同様に (ブー ト

ピ ン信号のサン プル、 リ セ ッ ト ・ ベ ク タ の フ ェ ッ チ、 な ど) 開始 さ れます。 電源制御 / ス

テー タ ス ・ レ ジ ス タ (PWR_CSR)

の SBF ス テー タ ス ・ フ ラ グは、 MCU が STANDBY モー ド

か否かを示 し ます。

STANDBY モー ド か ら抜け出す条件の詳細は

表 10

を参照 し て く だ さ い。

表 10.

モー ド 遷移

モー ド 終了

STANDBY モー ド

STANDBY モー ド 摘要

次の条件下の WFI (Wait for Interrupt) も し く は WFE (Wait for Event) 命令

- Cortex ™ -M3 シ ス テム制御レ ジ ス タ の SLEEPDEEPbit を セ ッ ト

- 電力制御レ ジ ス タ (PWR_CR) の PDDSbit を セ ッ ト

- 電力制御 / ス テー タ ス ・ レ ジ ス タ (PWR_CSR) の WUFbit を ク リ ア

WKUP ピ ン信号の立上が り エ ッ ジ、 RTC ア ラ ーム、

NRST ピ ンの外部 リ セ ッ ト 信号、 IWDG リ セ ッ ト

ウ ェ ー ク ア ッ プ時の

遅延

リ セ ッ ト 状態か らの通常のス タ ー ト ア ッ プ

STANDBY モー ド における入出力の状態

STANDBY モー ド では、 以下の信号を除いて、 すべての入出力ピ ンはハイ ・ イ ン ピーダ ン

ス状態 と な り ます。

リ セ ッ ト パ ッ ド (有効)

TAMPE ピ ン ( タ ンパ も し く は較正出力に設定 さ れてい る場合)

WKUP ピ ン (イ ネーブル状態の場合)

デバ ッ グ ・ モー ド

デバ ッ グ機能が使用 さ れてい る と き に、 ア プ リ ケーシ ョ ンの動作 と し て MCU が STOP

モー ド も し く は STANDBY モー ド に入る と 、 デバ ッ グ接続は失われます。 こ れは

Cortex

TM

-M3 コ アに ク ロ ッ クが供給 さ れな く な る こ と に よ る ものです。

し か し 、 DBGMCU_CR レ ジ ス タ の構成ビ ッ ト を セ ッ ト する こ と に よ り 低電力モー ド で も 使

用する場合、 ソ フ ト ウ ェ アはデバ ッ グ を行 う こ と がで き ます。 こ の詳細は

セ ク シ ョ

ン 26.15.1: 低電力モー ド におけるデバ ッ グのサポー ト

を参照 し て く だ さ い。

Rev 5 -日本語版 57/681

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 この資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

電源制御 (PWR)

4.3.6

RM0008

低電力モー ド から の自動ウ ェ ー ク ア ッ プ (AWU : Auto-wakeup)

外部割込み (AWU モー ド ) を使用せずに、 RTC を利用 し て MCU を低電力モー ド か ら

ウ ェ ー ク ア ッ プする こ と がで き ます (Auto-Wake-Up mode)。 RTC は 一定の時間間隔で

STOP モー ド も し く は STANDBY モー ド か ら ウ ェ ー ク ア ッ プする ための設定可能な タ イ ム

ベース機能を提供 し ています。 こ の目的のため、 3 種の RTC ク ロ ッ クの う ち、 次のいず

れかを

バ ッ ク ア ッ プ ・ ド メ イ ン制御レ ジス タ (RCC_BDCR)

の RTCSEL[1:0] で選択する こ

と がで き ます。 :

低電力 32.768 kHz 外部 ク リ ス タ ル ・ オシ レー タ (LSE OSC)

こ の ク ロ ッ クは低電力 (標準的な使用で 1μA 以下) で高精度の タ イ ムベース を備え

ています。

低電力内蔵 RC オシ レー タ (LSI RC)

こ の ク ロ ッ ク を利用する こ と で、 32.768 kHz の ク リ ス タ ル発振子の コ ス ト を省 く こ と

がで き ます。 内部 RC オシ レー タ は、 オシ レ ー タ の消費電力が最小 と な る よ う 設計 さ

れています。

RTC ア ラ ームに よ り STOP モー ド か ら ウ ェ ー ク ア ッ プする ためには、 次の設定が必要で

す。

EXTI ラ イ ン 17 を立上が り エ ッ ジが有効 と な る よ う 設定 し ます。

RTC 回路を、 RTC ア ラ ームを発生する よ う 設定 し ます。

Stnadby モー ド か らのウ ェ ー ク ア ッ プ では、 EXTI ラ イ ン 17 の設定は必要 と さ れません。

58/681 Rev 5 -日本語版

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参考資料

RM0008

電源制御 (PWR)

4.4 電源制御レ ジ ス タ

4.4.1

31

15

電源制御レ ジ ス タ (PWR_CR)

ア ド レ スオ フ セ ッ ト : 0x00

リ セ ッ ト 値 : 0000 0000h (STANDBY モー ド か らのウ ェ ー ク ア ッ プ時に リ セ ッ ト さ れます)

30 29 28 27 26 25 20 19 18 17 16

14 13 12

予約済み

11

Res

10 9

24 23

予約済み

8

DBP

Res.

7

22

6

PLS[2:0]

21

5 rw rw rw rw

4 3 2 1 0

PVDE CSBF CWUF PDDS LPDS rw rc_w1 rc_w1 rw rw

Bits 31:9 予約済み、 常に 0 が読込まれます。

Bit 8 DBP: バ ッ ク ア ッ プ ・ ド メ イ ン書込み禁止解除

リ セ ッ ト 時には RTC レ ジ ス タ と バ ッ ク ア ッ プ ・ レ ジ ス タ は過渡状態における書込みア ク セスから

保護 さ れています。 こ れら のレ ジ ス タ への書込みを可能 と するには、 こ のビ ッ ト を セ ッ ト し なけれ

ばな り ません。

0: RTC と バ ッ ク ア ッ プ ・ レ ジ ス タ へのア ク セスは禁止 さ れています。

1: RTC と バ ッ ク ア ッ プ ・ レ ジ ス タ へのア ク セスが可能です。

Bits 7:5 PLS[2:0]:

PVD レベル選択

これ らのビ ッ ト には、 電源電圧検出回路 (PVD: Power Voltage Detector) の電圧ス レ ッ シ ョ ル ド 値を

ソ フ ト ウ ェ ア で設定 し ます。

000: 2.2V

001: 2.3V

010: 2.4V

011: 2.5V

100: 2.6V

101: 2.7V

110: 2.8V

111: 2.9V

注 : 電気特性の詳細に関 し てはデー タ シー ト を参照 し て く だ さ い。

Bit 4 PVDE:

PVD (Power Voltage Detector) イ ネーブル

このビ ッ ト は ソ フ ト ウ ェ ア でセ ッ ト / ク リ アがで き ます。

0: PVD デ ィ セーブル

1: PVD イ ネーブル

Bit 3 CSBF:

STANDBY フ ラ グのク リ ア

このビ ッ ト の読出 し は常に 0 が戻 さ れます。

0: ビ ッ ト の値に影響を与え ません。

1: SBF (STANDBY フ ラ グ) を ク リ ア し ます。 (書込み時)

Bit 2 CWUF:

ウ ェ ー ク ア ッ プ (Wake-up) フ ラ グのク リ ア

このビ ッ ト の読出 し は常に 0 が戻 さ れます。

0: ビ ッ ト の値に影響を与え ません。

1: WUF (ウ ェ ー ク ア ッ プ ・ フ ラ グ) を 2 シス テム ・ ク ロ ッ ク後に ク リ ア し ます。 (書込み時)

Rev 5 -日本語版 59/681

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電源制御 (PWR)

RM0008

Bit 1 PDDS:

パワー ・ ダウン ・ デ ィ ープ ス リ ープ Power Down Deepsleep.

このビ ッ ト は ソ フ ト ウ ェ ア でセ ッ ト / ク リ ア で き ます。 こ のビ ッ ト は LPDS ビ ッ ト と の組合わせで

動作 し ます。

0: CPU がデ ィ ープ ス リ ープに入る と 、 STOP モー ド にな り ます。 レギ ュ レー タ の状態は LPDS ビ ッ

ト に依存 し ます。

1: CPU がデ ィ ープ ス リ ープに入る と 、 STANDBY モー ド と な り ます。

Bit 0 LPDS:

低電力 ・ デ ィ ープ ス リ ープ Low-Power Deepsleep.

このビ ッ ト は ソ フ ト ウ ェ ア でセ ッ ト / ク リ ア で き ます。 こ のビ ッ ト は PDDS ビ ッ ト と の組合わせで

動作 し ます

0: 電圧レギ ュ レー タ は STOP モー ド の間も オン状態を保ち ます。

1: 電圧レギ ュ レー タ は STOP モー ド の間は低電力モー ド と な り ます。

60/681 Rev 5 -日本語版

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RM0008

電源制御 (PWR)

4.4.2

31

15

電源制御 / ス テー タ ス ・ レ ジ ス タ (PWR_CSR)

ア ド レ スオ フ セ ッ ト : 0x04h

リセット値 : 0000 0000h (STANDBY モードからのウェークアップ時にはリセットされません)

このレジスタを読込むためには、 標準 APB 読込みに対する追加の APB サイクルが必要です。

30 29 28 27 26 25 22 21 20 19 18 17 16

14 13 12

予約済み

11

Res.

10 9

24 23

8

予約済み

Res.

7

EWUP rw

6 5

予約済み

Res.

4 3 2

PVDO r

1

SBF r

0

WUF r

Bits 31:9 予約済み、 常に 0 が読込まれます。

Bit 8 EWUP:

WKUP ピ ン ・ イ ネーブル

こ のビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アで き ます。

0: WKUP ピ ンは汎用入出力 (GPIO) と し て使用 さ れます。 こ の WKUP ピ ンのイ ベン ト は STANDBY

モー ド か らのウ ェ ー ク ア ッ プ をする ものはあ り ません。

1: WKUP ピ ンは STANDBY モー ド から のウ ェ ー ク ア ッ プに使用 さ れます。 こ のピ ンは強制的にプ

ルダウン入力モー ド に設定 さ れます。 (WKUP ピ ンの立上が り エ ッ ジで STANDBY モー ド から の

ウ ェ ー ク ア ッ プが発生 し ます。)

注 : こ のビ ッ ト はシス テム ・ リ セ ッ ト で リ セ ッ ト さ れます。

Bits 7:3 予約済み、 常に 0 が読込まれます。

Bit 2 PVDO: PVD 出力

こ のビ ッ ト のセ ッ ト / ク リ アはハー ド ウ ェ アが行います。 こ のビ ッ ト は PVDE ビ ッ ト の設定で

PVD がイ ネーブル状態 と な っ ている と き に限 り 有効です。

0: V

DD

/V

DDA

は PLS[2:0]bit で設定 さ れてい る PVD ス レ ッ シ ョ ル ド よ り 高い電圧です。

1: V

DD

/V

DDA

は PLS[2:0]bit で設定 さ れてい る PVD ス レ ッ シ ョ ル ド よ り 低い電圧です。

注 : PVD は STANDBY モー ド で停止 し ます。 こ のため、 こ のビ ッ ト は STANDBY 及び リ セ ッ ト 後は

PVDE ビ ッ ト がセ ッ ト さ れる ま で 0 を戻 し ます。

Bit 1 SBF:

STANDBY フ ラ グ

こ のビ ッ ト はハー ド ウ ェ アでセ ッ ト さ れ、 POR/PDR (パワー ・ オン ・ リ セ ッ ト / パワー ・ ダウ

ン ・ リ セ ッ ト ) も し く は

電源制御レ ジス タ (PWR_CR)

の CSBF ビ ッ ト に 1 を書込む こ と で ク リ ア

さ れます。

0: デバイ スは STANDBY モー ド ではあ り ません。

1: デバイ スは STANDBY モー ド です。

Bit 0 WUF:

ウ ェ ー ク ア ッ プ ・ フ ラ グ

こ のビ ッ ト はハー ド ウ ェ アでセ ッ ト さ れ、 POR/PDR (パワー ・ オン ・ リ セ ッ ト / パワー ・ ダウ

ン ・ リ セ ッ ト ) も し く は

電源制御レ ジス タ (PWR_CR)

の CWUF ビ ッ ト 1 を書込む こ と で ク リ ア さ

れます。

0: ウ ェ ー ク ア ッ プ (Wake-up) イ ベン ト は発生 し ていません。

1: WKUP ピ ン、 も し く は RTC ア ラ ームによ り 、 ウ ェ ー ク ア ッ プ (Wake-up) イ ベ ン ト が受付け られ

ま し た。

注 : WKUP ピ ンのレ ベルが常にハイの場合、 WKUP ピ ンがイ ネーブル (EWUPbit で設定) さ れる と 追

加のウ ェ アー ク ア ッ プ イ ベン ト が検出 さ れます。

Rev 5 -日本語版 61/681

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参考資料

電源制御 (PWR)

RM0008

4.4.3

表 11.

オ フ

セ ッ ト

PWR レ ジ ス タ ・ マ ッ プ

次の表は PWR レ ジ ス タ の一覧です。

PWR - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値

レ ジ ス タ

0x000

0x004

PWR_CR

リ セ ッ ト 値

PWR_CSR

リ セ ッ ト 値

予約済み

予約済み

PLS[2:0]

0 0 0 0 0 0 0 0 0

予約済み

0

レ ジ ス タ のア ド レ ス範囲に関 し ては

表 1 (36 ページ)

を参照 し て く だ さ い。

0 0 0

62/681 Rev 5 -日本語版

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参考資料

RM0008

5 バ ッ ク ア ッ プ ・ レ ジ ス タ (BKP)

バ ッ ク ア ッ プ ・ レ ジ ス タ (BKP)

Flash メ モ リ 容量が 32 ~ 128Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト ロー

ラは、 中容量デバイ ス です。

Flash メ モ リ 容量が 256 ~ 512Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト

ロー ラ は、 大容量デバイ スです。

こ のセ ク シ ョ ンは、 注意書きがない限 り 、 STM32F10xxx フ ァ ミ リ 全てに適応 さ れます。

5.1 概要

バ ッ ク ア ッ プ ・ レ ジ ス タ は、 84bytes のユーザア プ リ ケーシ ョ ンのデー タ を保存する事が

可能な 42 個の 16bit レ ジ ス タ で構成 さ れています。 こ れら のレ ジ ス タ は、 V

DD

さ れた時に、 V

BAT

電源が遮断

に よ り 電源を維持するバ ッ ク ア ッ プ ・ ド メ イ ン に搭載 さ れています。 こ

れ らのレ ジ ス タ は、 デバイ スが STANDBY か ら ウ ェ ー ク ア ッ プ し た場合や、 シ ス テム ・ リ

セ ッ ト または電源 リ セ ッ ト さ れて も リ セ ッ ト さ れません。

更に、 BKP 制御レ ジ ス タ は タ ンパ検出機能や RTC 周波数調整に も 使用 さ れます。

リ セ ッ ト 後、 バ ッ ク ア ッ プ ・ レ ジ ス タ と RTC へのア ク セスはデ ィ セーブル状態で、 バ ッ

ク ア ッ プ ・ ド メ イ ン (BKP) は過渡的に発生 し 得る予期 し ない書込みア ク セスから 保護 さ

れています。 バ ッ ク ア ッ プ ・ レ ジ ス タ や RTC へのア ク セス を可能 と する には、 次の手順

が必要です。

RCC_APB1ENR レ ジ ス タ の PWREN と BKPEN ビ ッ ト を セ ッ ト し 、 パワー と バ ッ ク ア ッ

プ ・ イ ン タ フ ェ ース ・ ク ロ ッ ク を イ ネーブルに し ます。

電源制御レ ジ ス タ (PWR_CR) の DBP ビ ッ ト を セ ッ ト し 、 バ ッ ク ア ッ プ ・ レ ジ ス タ と

RTC へのア ク セス を イ ネーブルに し ます。

5.2 主な機能

20bytes のデー タ ・ レ ジ ス タ (中容量デバイ ス) あ る いは 84bytes デー タ ・ レ ジ ス タ

(大容量デバイ ス)

割込みに よ る タ ンパ検出管理のためのス テー タ ス / 制御レ ジ ス タ

RTC 周波数の調整値を格納する較正レ ジ ス タ

RTC 較正ク ロ ッ ク 、RTC ア ラ ームパルス、も し く は タ ンパピ ン PC13 の 2 つ目のパルス

( こ のピ ンが タ ンパ検出に使われていない場合) の出力

Rev 5 -日本語版 63/681

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参考資料

バ ッ ク ア ッ プ ・ レ ジ ス タ (BKP)

5.3

5.3.1

注意 :

5.3.2

RM0008

機能解説

タ ンパ検出

ANTI_TAMP ピ ンは、 バ ッ ク ア ッ プ制御レ ジ ス タ (BKP_CR)

の TPAL ビ ッ ト に応 じ て、 信号

が 0 か ら 1 も し く は 0 か ら 1 に変化 し た と き に タ ンパ検出イ ベン ト を発生 さ せます。 タ ン

パ検出イ ベ ン ト は、 全てのバ ッ ク ア ッ プ ・ デー タ ・ レ ジ ス タ の内容を リ セ ッ ト し ます。

し か し 、 タ ンパ ・ イ ベ ン ト の見落 し を防ぐ ため、 エ ッ ジ検出に使用 さ れる信号は タ ンパ ・

イ ネーブル ・ ビ ッ ト と の論理積が と られています。 こ れに よ り 、 タ ンパピ ンがイ ネーブル

にな る前にすでに発生 し ていた タ ンパ ・ イ ベ ン ト も検出する こ と がで き ます。

TPAL=0 の と き : タ ンパ ・ ピ ンが TPE ビ ッ ト を セ ッ ト する こ と で イ ネーブル と さ れる

前か らハイ レ ベルであれば、 タ ンパ ・ ピ ンがイ ネーブルに さ れる と 同時に タ ンパ ・ イ

ベン ト が発生 し ます。 ( こ の と き、 TPE がセ ッ ト さ れた後には タ ンパ ・ ピ ンの信号に

は立上 り エ ッ ジは存在 し ていません。)

TPAL=1 の と き : タ ンパ ・ ピ ンが TPE ビ ッ ト を セ ッ ト する こ と で イ ネーブル と さ れる

前か ら ローレ ベルであれば、 タ ンパ ・ ピ ンがイ ネーブルに さ れる と 同時に タ ンパ ・ イ

ベン ト が発生 し ます。 ( こ の と き、 TPE がセ ッ ト さ れた後には タ ンパ ・ ピ ンの信号に

は立下 り エ ッ ジは存在 し ていません。)

BKP_CSR レ ジ ス タ の TPIE ビ ッ ト を セ ッ ト する こ と に よ り 、 タ ンパ検出イ ベン ト が発生 し

た時に割込みが発生 し ます。

タ ンパ ・ イ ベン ト が検出 さ れ、 その後に ク リ ア さ れた と き には、 タ ンパ ・ ピ ンは一旦デ ィ

セーブル と し 、 その後バ ッ ク ア ッ プ ・ デー タ ・ レ ジ ス タ (BKP_DRx) に書込みを行 う 前に

TPE ビ ッ ト で イ ネーブル と さ れなければな り ません。 こ れは、 タ ンパ検出がイ ネーブル と

さ れる前に タ ンパ ・ ピ ンの値が タ ンパ検出を示 し ている と き に、 ソ フ ト ウ ェ アがバ ッ ク

ア ッ プ ・ デー タ ・ レ ジ ス タ (BKP_DRx) への書込みを行 っ て し ま う のを防ぎ ます。 こ れは タ

ンパ ・ ピ ン で レ ベル検出を行 っ てい るの と 同 じ 働き を も ち ます。

タ ンパ検出は VDD 電源がオ フの と き に も有効に動作 し ます。 バ ッ ク ア ッ プ ・ デー タ ・ レ

ジ ス タ の内容が不用意に リ セ ッ ト さ れる こ と を防ぐ ため、 ANTI_TAMP ピ ンは外部で適当な

信号レ ベルに接続 し てお く こ と が必要です。

RTC 周波数調整

ク ロ ッ ク 周波数を測定する ため、 32.768 kHz RTC ク ロ ッ ク を タ ンパ ・ ピ ン に出力する こ と

がで き ます。 こ の動作は

RTC ク ロ ッ ク較正レ ジス タ (BKP_RTCCR)

の CCO ビ ッ ト を セ ッ ト

する こ と で指示 し ます。

ク ロ ッ ク 周波数は CAL[6:0] の設定で最大 121 ppm ま で低下 さ せる こ と がで き ます。

RTC 周波数調整及び厳密な タ イ ミ ン グ管理方法の詳細については、 AN2604 「STM32Fxx と

STM32F103xxRTC 周波数調整」 を参照 し て く だ さ い。

64/681 Rev 5 -日本語版

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参考資料

RM0008

バ ッ ク ア ッ プ ・ レ ジ ス タ (BKP)

5.4 BKP レ ジ ス タ

レ ジ ス タ の詳細で使用 さ れてい る略語については

セ ク シ ョ ン 1.1 (32 ページ)

を参照 し て

く だ さ い。

5.4.1

15

14

バ ッ ク ア ッ プ ・ デー タ ・ レ ジ ス タ x (BKP_DRx) (x = 1 ..42)

ア ド レ ス ・ オ フ セ ッ ト : 0x04 ~ 0x28、 0x40 ~ 0xBC

リ セ ッ ト 値 : 0x0000 0000

13 12 11 10 9 8 7 6 5 4 3 rw rw rw rw rw rw rw rw

D[15:0] rw rw rw rw rw

2 1

0 rw rw rw

Bits 15:0 D[15:0]:

バ ッ ク ア ッ プ ・ デー タ

これ らのビ ッ ト には任意のユーザデー タ を書込む こ と がで き ます。

注 : BKP_DRx レ ジ ス タ はシ ス テム ・ リ セ ッ ト やパワー ・ リ セ ッ ト 、 も し く は STANDBY モー ド か ら の

ウ ェ ー ク ア ッ プ では リ セ ッ ト さ れません。

レ ジ ス タ の内容はバ ッ ク ア ッ プ ・ ド メ イ ン ・ リ セ ッ ト も し く は タ ンパピ ン ・ イ ベン ト ( こ の機能が

有効な場合) によ っ て リ セ ッ ト さ れます。

Rev 5 -日本語版 65/681

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ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

バ ッ ク ア ッ プ ・ レ ジ ス タ (BKP)

RM0008

5.4.2

15 14

RTC ク ロ ッ ク 較正レ ジ ス タ (BKP_RTCCR)

ア ド レ スオ フ セ ッ ト : 0x2C

リ セ ッ ト 値 : 0x0000 0000

13 12 11 10 9 8 7 6

予約済み ASOS ASOE CCO

Res.

rw rw rw rw

5 4 rw

3

CAL[6:0] rw

2 rw

1 0 rw rw rw

Bits 15:10 予約済み、 常に 0 が読出 さ れます。

Bit 9 ASOS

ア ラ ームまたはセ カ ン ド 出力選択

ASOE がセ ッ ト さ れた時、 ASOS ビ ッ ト を使 っ て タ ンパピ ンの信号出力を RTC セ カ ン ド パルス信

号にするか、 ア ラ ームパルス信号にするかを選択で き ます。

0: RTC ア ラ ームパルス出力を選択 し ます。

1: RTC セ カ ン ド パルス出力を選択 し ます。

注 : このビ ッ ト を リ セ ッ ト するのは、 バ ッ ク ア ッ プ ・ ド メ イ ンの リ セ ッ ト だけです。

Bit 8 ASOE

ア ラ ームまたはセ カ ン ド 出力イ ネーブル

このビ ッ ト を セ ッ ト する こ と で、 RTC ア ラ ームパルス信号か、 ASOS ビ ッ ト の設定に応 じ て タ ン

パピ ン上のセ カ ン ド パルス信号を出力する事が出来ます。

出力パルス周期は、 1RTC ク ロ ッ ク周期です。 ASOE ビ ッ ト がセ ッ ト さ れている間は、 タ ンパピ ン

を イ ネーブルに し てはいけません。

注 : このビ ッ ト を リ セ ッ ト するのは、 バ ッ ク ア ッ プ ・ ド メ イ ンの リ セ ッ ト だけです。

Bit 7 CCO:

較正ク ロ ッ ク出力

0: 影響な し

1: このビ ッ ト を セ ッ ト する と 、 64 分周 さ れた RTC ク ロ ッ クが タ ンパピ ンか ら出力 さ れます。 タ ン

パ検出の誤動作を防ぐ ため、 CCO ビ ッ ト がセ ッ ト さ れている と き には タ ンパピ ン を イ ネーブルに

する こ と はで き ません。

注 : こ のビ ッ ト は V

DD

供給がオ フ と な っ た時には ク リ ア さ れます。

Bit 6:0 CAL[6:0]

較正値

この値は、 2^20 ク ロ ッ ク パルス毎に無視 さ れる ク ロ ッ ク パルス数を示 し ます。 こ れによ り 、 RTC

の較正が出来、 ク ロ ッ ク を 1000000/2^20 ppm のス テ ッ プ で下げる事が出来ます。

RTC ク ロ ッ クは、 0 ~ 121 ppm の間で下げる こ と が出来ます。

66/681 Rev 5 -日本語版

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参考資料

RM0008

バ ッ ク ア ッ プ ・ レ ジ ス タ (BKP)

5.4.3

15

14

バ ッ ク ア ッ プ制御レ ジ ス タ (BKP_CR)

ア ド レ ス ・ オ フ セ ッ ト : 0x30

リ セ ッ ト 値 : 0x0000 0000

13 12 11 10 9 8 7

予約済み

Res.

6 5 4 3 2 1

TPAL rw

0

TPE rw

Bits 15:2 予約済み、 常に 0 が読出 さ れます。

Bit 1 TPAL: タ ンパ ・

ピ ン ・ ア ク テ ィ ブ ・ レベル

0: タ ンパ ・ ピ ンのハイ レ ベルで全バ ッ ク ア ッ プ ・ デー タ ・ レ ジ ス タ が リ セ ッ ト さ れます。

(TPE ビ ッ ト がセ ッ ト さ れている場合)

  1: タ ンパ ・ ピ ンのローレ ベルで全バ ッ ク ア ッ プ ・ デー タ ・ レ ジス タ が リ セ ッ ト さ れます。

  (TPE   ビ ッ ト がセ ッ ト さ れている場合)

Bit 0 TPE: タ ンパ ・

ピ ン ・ イ ネーブル

0: タ ンパ ・ ピ ンは汎用入出力 (GPIO) と し て使用する こ と がで き ます。

  1: タ ンパ ・ オル タ ネー ト 入出力機能が有効 と な り ます。

注意 : TPAL と TPE ビ ッ ト を同時にセ ッ ト する こ と は常に可能ですが、 両方を同時に ク リ アする

こ と は副作用 と し て タ ンパ ・ イ ベン ト を発生 さ せて し ま う こ と があ り ます。 このため、

TPAL ビ ッ ト の変更は TPE ビ ッ ト がク リ ア さ れている と き に限る よ う に し て く だ さ い。

Rev 5 -日本語版 67/681

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バ ッ ク ア ッ プ ・ レ ジ ス タ (BKP)

RM0008

5.4.4

15

14

バ ッ ク ア ッ プ制御 / ス テー タ ス ・ レ ジ ス タ (BKP_CSR)

ア ド レ ス ・ オ フ セ ッ ト : 0x34

リ セ ッ ト 値 : 0x0000 0000

13 12 11 10 9 8 7 6 5 4 3

予約済み

Res.

TIF r

TEF r

予約済み

Res.

2

TPIE rw

1

CTI w

0

CTE w

Bits 15:10 予約済み、 常に 0 が読出 さ れます。

Bit 9 TIF:

タ ンパ割込み リ ク エス ト ・ フ ラ グ

このビ ッ ト は タ ンパ ・ イ ベン ト が検出 さ れ、 TPIE ビ ッ ト がセ ッ ト さ れている と き に、 ハー ド ウ ェ

アによ っ てセ ッ ト さ れます。 こ のビ ッ ト は CTI ビ ッ ト に 1 を書込む こ と で ク リ ア さ れます。 また、

TPIE ビ ッ ト を ク リ ア し た と き に も ク リ ア さ れます。

0: タ ンパ割込み リ ク エ ス ト は発生 し ません。

1: タ ンパ割込み リ ク エ ス ト が発生 し ま し た。

注 : このビットはシステム ・ リセット、 もしくは STANDBY モードからのウェークアップでのみリセットされま

す。

Bit 8 TEF:

タ ンパ ・ イ ベン ト ・ フ ラ グ

このビ ッ ト は タ ンパ ・ イ ベン ト が検出 さ れた と き に、 ハー ド ウ ェ ア でセ ッ ト さ れます。 こ のビ ッ

ト を ク リ アするには、 CTE ビ ッ ト に 1 を書込みます。

0: タ ンパ ・ イ ベン ト は発生 し ていません。

1: タ ンパ ・ イ ベン ト が発生 し ま し た。

注 : タ ンパ ・ イ ベ ン ト はすべての BKP_DRx レ ジ ス タ を リ セ ッ ト し ます。 レ ジ ス タ は TEF ビ ッ ト が

セ ッ ト さ れている間、 リ セ ッ ト 状態に置かれます。 フ ラ グがセ ッ ト さ れている と き に BKP_DRx レ

ジ ス タ への書込みを行っ て も、 その値は格納 さ れません。

Bits 7:3 予約済み、 常に 0 が読出 さ れます。

Bit 2 TPIE:

タ ンパ ・ ピ ン割込み リ ク エス ト 許可

0: タ ンパ割込み リ ク エ ス ト は禁止 さ れています。

1: タ ンパ割込み リ ク エ ス ト は許可 さ れています。 (BKP_CR レ ジ ス タ の TPE ビ ッ ト はセ ッ ト さ れて

いなければな り ません。)

  注 1: タ ンパ割込みは、 コ ア を低電力モー ド から ウ ェ ー ク ア ッ プする こ と はあ り ません。

注 2: こ のビ ッ ト はシ ス テム ・ リ セ ッ ト 、 も し く は STANDBY モー ド か らのウ ェ ー ク ア ッ プ で リ

セ ッ ト さ れます。

Bit 1

CTI: タ ンパ割込み リ ク エス ト ・ ク リ ア

このビ ッ ト は書込み専用で、 読出 し では常に 0 が戻 さ れます。

0: 影響な し

1: タ ンパ割込み リ ク エ ス ト と TIF タ ンパ割込み リ ク エス ト ・ フ ラ グ を ク リ ア し ます。

Bit 0

CTE : タ ンパ ・ イ ベン ト ・ ク リ ア

このビ ッ ト は書込み専用で、 読出 し では常に 0 が戻 さ れます。

0: 影響な し

1: タ ンパ ・ イ ベン ト ・ フ ラ グを ク リ ア し ます。 (同時に タ ンパ検出回路も リ セ ッ ト さ れます。)

68/681 Rev 5 -日本語版

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RM0008

バ ッ ク ア ッ プ ・ レ ジ ス タ (BKP)

0x04

0x08

0x0C

0x10

0x14

0x18

0x1C

0x20

0x24

0x28

0x2C

0x30

0x34

BKP_DR5

リ セ ッ ト 値

BKP_DR6

リ セ ッ ト 値

BKP_DR7

リ セ ッ ト 値

BKP_DR8

リ セ ッ ト 値

BKP_DR1

リ セ ッ ト 値

BKP_DR2

リ セ ッ ト 値

BKP_DR3

リ セ ッ ト 値

BKP_DR4

リ セ ッ ト 値

BKP_DR9

リ セ ッ ト 値

BKP_DR10

リ セ ッ ト 値

BKP_RTCCR

リ セ ッ ト 値

BKP_CR

リ セ ッ ト 値

BKP_CSR

リ セ ッ ト 値

0x38

0x3C

5.4.5

表 12.

オ フ

セ ッ ト

0x00

BKP レ ジス タ ・ マ ッ プ

BKP レ ジ ス タ は、 次の表のよ う に、 すべて 16bit のレ ジ ス タ です。

BKP - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値

レ ジス タ

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

CAL[6:0]

0 0 0 0 0 0 0 0 0 0

0 0

予約済み

0 0 0 0 0

予約済み

予約済み

Rev 5 -日本語版 69/681

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バ ッ ク ア ッ プ ・ レ ジ ス タ (BKP)

RM0008

表 12.

オ フ

セ ッ ト

BKP - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 (続き)

レ ジス タ

0x40

0x44

0x48

0x4C

0x50

0x54

0x58

0x5C

0x60

0x64

0x68

0x6C

0x70

0x74

0x78

0x7C

0x80

BKP_DR20

リ セ ッ ト 値

BKP_DR21

リ セ ッ ト 値

BKP_DR22

リ セ ッ ト 値

BKP_DR23

リ セ ッ ト 値

BKP_DR24

リ セ ッ ト 値

BKP_DR25

リ セ ッ ト 値

BKP_DR26

リ セ ッ ト 値

BKP_DR27

リ セ ッ ト 値

BKP_DR16

リ セ ッ ト 値

BKP_DR17

リ セ ッ ト 値

BKP_DR18

リ セ ッ ト 値

BKP_DR19

リ セ ッ ト 値

BKP_DR11

リ セ ッ ト 値

BKP_DR12

リ セ ッ ト 値

BKP_DR13

リ セ ッ ト 値

BKP_DR14

リ セ ッ ト 値

BKP_DR15

リ セ ッ ト 値

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

70/681 Rev 5 -日本語版

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参考資料

RM0008

バ ッ ク ア ッ プ ・ レ ジ ス タ (BKP)

表 12.

オ フ

セ ッ ト

BKP - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 (続き)

レ ジス タ

0x84

0x88

0x8C

0x90

0x94

0x98

0x9C

0xA0

0xA4

0xA8

0xAC

0xB0

0xB4

0xB8

0xBC

BKP_DR33

リ セ ッ ト 値

BKP_DR34

リ セ ッ ト 値

BKP_DR35

リ セ ッ ト 値

BKP_DR36

リ セ ッ ト 値

BKP_DR28

リ セ ッ ト 値

BKP_DR29

リ セ ッ ト 値

BKP_DR30

リ セ ッ ト 値

BKP_DR31

リ セ ッ ト 値

BKP_DR32

リ セ ッ ト 値

BKP_DR37

リ セ ッ ト 値

BKP_DR38

リ セ ッ ト 値

BKP_DR39

リ セ ッ ト 値

BKP_DR40

リ セ ッ ト 値

BKP_DR41

リ セ ッ ト 値

BKP_DR42

リ セ ッ ト 値

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

レ ジ ス タ のア ド レ ス範囲に関 し ては

表 1 (36 ページ)

を参照 し て く だ さ い。

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

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D[15:0]

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D[15:0]

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D[15:0]

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D[15:0]

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D[15:0]

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D[15:0]

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D[15:0]

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D[15:0]

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D[15:0]

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D[15:0]

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D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

D[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

Rev 5 -日本語版 71/681

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参考資料

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

6 リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

RM0008

Flash メ モ リ 容量が 32 ~ 128Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト ロー

ラは、 中容量デバイ ス です。

Flash メ モ リ 容量が 256 ~ 512Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト

ロー ラ は、 大容量デバイ スです。

こ のセ ク シ ョ ンは、 注意書きがない限 り 、 STM32F10xxx フ ァ ミ リ 全てに適応 さ れます。

6.1

6.1.1

リ セ ッ ト

リ セ ッ ト 動作には、 シ ス テム ・ リ セ ッ ト 、 電源 リ セ ッ ト 、 バ ッ ク ア ッ プ ・ ド メ イ ン ・ リ

セ ッ ト の 3 種類の リ セ ッ ト 動作があ り ます。

シ ス テム ・ リ セ ッ ト

システム ・ リセットは、 クロック ・ コントローラ CSR レジスタのリセット ・ フラグとバックアップ ・ ド

メインのレジスタ (

図  4

を参照) を除いた、 すべてのレジスタを初期値にリセットします。

シ ス テム ・ リ セ ッ ト は次のイ ベ ン ト のいずれかの発生時に実行 さ れます。

1.

NRST ピ ン信号のローレ ベル (外部 リ セ ッ ト )

2. Window 型ウ ォ ッ チ ド ッ グのカ ウ ン ト 終了 (WWDG リ セ ッ ト )

3. 独立型ウ ォ ッ チ ド ッ グのカ ウ ン ト 終了 (IWDG リ セ ッ ト )

4. ソフトウェア ・ リセット (SW リセット) (

セ ク シ ョ ン  : ソ フ ト ウ ェ ア ・ リ セ ッ ト

を参照)

5. 低電力管理 リ セ ッ ト (

セ ク シ ョ ン  : 低電力管理 リ セ ッ ト

を参照)

発生したリセットの要因は制御 / ステータス ・ レジスタのリセット ・ フラグから知ることができま

す。 (

セ ク シ ョ ン  6.3.10: 制御 / ステー タ ス ・ レ ジス タ (RCC_CSR)

を参照)

ソ フ ト ウ ェ ア ・ リ セ ッ ト

デバイ ス上で ソ フ ト ウ ェ ア ・ リ セ ッ ト を実行する には、 Cortex ™ -M3 のア プ リ ケーシ ョ ン

割込みレ ジ ス タ 、 リ セ ッ ト 制御レ ジ ス タ の SYSRESETREQ ビ ッ ト がセ ッ ト する必要があ り

ます。 詳細は Cortex ™ -M3 テ ク ニ カル ・ リ フ ァ レ ン ス ・ マニ ュ アルを参照 し て く だ さ い。

低電力管理 リ セ ッ ト

低電力管理 リ セ ッ ト を発生する には、 2 種類の方法があ り ます。

1.

STANDBY モー ド に入る際の リ セ ッ ト 動作

こ の リ セ ッ ト は ユーザ ・ オプ シ ョ ン ・ バイ ト の nRST_STDBY ビ ッ ト を リ セ ッ ト する

こ と で有効 と な り ます。 こ の場合、 STANDBY モー ド に入る動作が正常に実行 さ れる

と 、 STANDBY モー ド に入る代わ り にデバイ スが リ セ ッ ト さ れます。

2. STOP モー ド に入る際の リ セ ッ ト 動作

こ の リ セ ッ ト はユーザ ・ オプ シ ョ ン ・ バイ ト の nRST_STOP ビ ッ ト を r リ セ ッ ト する

こ と で有効 と な り ます。 こ の場合、 STOP モー ド に入る動作が正常に実行 さ れる と 、

STOP モー ド に入る代わ り にデバイ スが リ セ ッ ト さ れます。

ユーザ ・ オプ シ ョ ン ・ バイ ト の詳細に関 し ては STM32F10x Flash プ ロ グ ラ ミ ン グマニ ュ ア

ルを参照 し て く だ さ い。

72/681 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 この資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

6.1.2

6.1.3

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

電源 リ セ ッ ト

パワー ・ リ セ ッ ト は次のいずれかの場合に実行 さ れます。

1.

パワー ・ オ ン / パワー ・ ダウ ン ・ リ セ ッ ト (POR/PDR リ セ ッ ト )

2. STANDBY モー ド を抜け出す場合

パワー ・ リ セ ッ ト はバ ッ ク ア ッ プ ・ ド メ イ ン (

図  4

を参照) 以外のすべてのレ ジ ス タ を初

期化 し ます。

これらの信号は RESET ピンに対して働き、 ピンを所定の時間ローレベルに保ちます。 RESET

サービスルーチンのベクタはメモリ ・ マップ上で固定された

0x0000_0000

-

0x0000_0004

に配置され

ています。 詳細は

表  35: ベ ク タ テーブル (130 ページ) を参照してください。

図 7.

リ セ ッ ト 回路

外部 リ セ ッ ト

V

DD

/V

DDA

R

PU

フ ィ ル タ

シ ス テム・ リ セ ッ ト

NRST

パルス

発生回路

( 最小 20 µ s)

WWDG リ セ ッ ト

IWDG リ セ ッ ト

POR/PDR リ セ ッ ト

ソ フ ト ウ ェ ア・ リ セ ッ ト

低電力管理 リ セ ッ ト

バ ッ ク ア ッ プ ・ ド メ イ ン (

図  4

を参照) は、 こ の ド メ イ ン にのみ有効な 2 種類の リ セ ッ ト

があ り ます。

バ ッ ク ア ッ プ ・ ド メ イ ン ・ リ セ ッ ト

バ ッ ク ア ッ プ ・ ド メ イ ンの リ セ ッ ト は、 次のいずれかのイ ベン ト に よ り 実行 さ れます。

1.

ソ フ ト ウ ェ ア ・ リ セ ッ ト 、

バ ッ ク ア ッ プ ・ ド メ イ ン制御レ ジス タ (RCC_BDCR)

BDRST ビ ッ ト を セ ッ ト する こ と で ト リ ガ さ れます。

2. V

DD

も し く は V

た場合。

BAT

パワー ・ オ ン、 ただ し 、 両方の電源供給が と も にオ フ 状態であ っ

6.2 ク ロ ッ ク

次の 3 信号が、 シ ス テム ・ ク ロ ッ ク (SYSCLK) の駆動源 と し て利用で き ます。

HSI オシ レー タ ・ ク ロ ッ ク

HSE オシ レ ー タ ・ ク ロ ッ ク

PLL ク ロ ッ ク

デバイ スは、 また、 次の 2 種の信号を補助的な ク ロ ッ ク ・ ソ ース と する こ と も で き ます。

40 kHz 低速内蔵 RC (LSI RC)、 こ の信号は独立型ウ ォ ッ チ ド ッ グ を駆動 し ています。

また、 設定に よ っ ては STOP/STANDBY モー ド か らの自動ウ ェ ー ク ア ッ プ (Auto

Wake-up) に使用 さ れる RTC 回路を駆動する こ と も で き ます。

32.768 kHz 低速外部発振子 (LSE ク リ ス タ ル )、 こ の信号は設定に よ り 、 RTCCLK と し

て リ アル タ イ ム ・ ク ロ ッ ク を駆動する こ と がで き ます。

それぞれのクロック ・ ソースは、 未使用時の電力消費を省くために、 個別にオン ・ オフが可能

です。

Rev 5 -日本語版 73/681

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参考資料

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

図 8.

ク ロ ッ ク構成図

RM0008

OSC _OUT

OS C_IN

OSC32_ IN

OS C32_OUT

US B

プリスケーラ

/1, 1.5

48 MHz

USBCLK

をUSBインタフェースへ

I2S3CLK

I2S3へ

8 MHz

HS I R C

PLLS RC

PLLMUL

4-16 MHz

HS E OSC

LSE OSC

32.768 kHz

..., x16 x2, x3, x4

PLL

ペリフェラル・クロック

イネーブル

I2S2CLK

HSI

/2

PLLXTPRE

/2

/128

LS E

I2S2へ

HS I

PL LC LK

HSE

SW

CSS

RTCCLK

SYSC LK

72 MHz

max

RTCへ

AHB

プリスケーラ

/1, 2..512

ペリフェラル・クロック

イネーブル

ペリフェラル・クロック

イネーブル

SDIOCLK

SDIOへ

FSMCCLK

FSMCへ

ペリフェラル・クロック

イネーブル

72 MHz max

クロック

イネーブル(4bits)

HCLKをAHBバス、コア

メモリおよびDMAへ

/8 Cortex システム・タイマへ

FCLK Cortex

フリーランニング・クロック

APB1

プリスケーラ

36 MHz max PC LK1

APB1

/1, 2, 4, 8, 16 else x2

ペリフェラルへ

ペリフェラル・クロック

イネーブル(20 bits)

TIM2,3,4,5,6,7

If (APB1 プリスケーラ =1) x1

TIM2,3,4,5,6 および 7へ

TIMXCLK

ペリフェラル・クロック

イネーブル(6bits)

APB2

プリスケーラ

/1, 2, 4, 8, 16

72 MHz max PCLK2

ペリフェラルをAPB2へ

ペリフェラル・クロック

イネーブル(15bits)

TIM1 & 8 タイマ

If (APB2 プリスケーラ=1) x1 else x2

ADC

プリスケーラ

/2, 4, 6, 8

TIM1 およびTIM8へ

TIMxCLK

ペリフェラル・クロック

イネーブル(2bit)

ADC1,2もしくは3

ADC CLK

LSI RC

40 kHz

RTCSE L[1:0]

LSI

独立型ウォッチドッグ(IWDG)へ

IWDG CLK

/2

HCLK/2

SDIO AHBインタフェースへ

ペリフェラル・クロック

イネーブル

MCO

メインクロック出力

MCO

/2

PLLCLK

HS I

HSE

SYSCLK

略称:

HSE = 高速外部クロック信号

HSI = 高速内蔵クロック信号

LSI = 低速内蔵クロック信号

LSE = 低速外部クロック信号  ai14752b

1.

HSI が PLL ク ロ ッ ク入力 と し て使用 さ れる場合、 最大シ ス テム ・ ク ロ ッ ク周波数は 64MHz です。

複数のプ リ スケー ラ を利用 し て、 AHB 周波数、 高速 APB (APB2) 及び低速 APB (APB1) ド

メ イ ンの周波数を設定する こ と がで き ます。 AHB 及び APB2 ド メ イ ンの最高周波数は 72

MHz で、 APB1 ド メ イ ンの最高周波数は 36 MHz です。 SDIO AHB イ ン タ フ ェ ースは

HCLK/2 と 等 し い固定 ク ロ ッ ク で動作 し ます。

RCC は Cortex シ ス テム タ イ マ (SysTick) 外部 ク ロ ッ ク に AHB ク ロ ッ ク を 8 分周 し た信号

を供給 し ています。 SysTick は こ の分周 さ れた ク ロ ッ ク か、 Cortex ク ロ ッ ク (AHB) のいず

れかで動作する こ と がで き、 こ れは SysTick 制御 と ス テー タ ス ・ レ ジ ス タ で選択 さ れます。

ADC には高速 APB (APB2) ク ロ ッ ク を 2、 4、 6 も し く は 8 分周 し た ク ロ ッ クが供給 さ れま

す。

74/681 Rev 5 -日本語版

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参考資料

RM0008

6.2.1

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

タ イ マ ・ ク ロ ッ ク周波数はハー ド ウ ェ ア で自動的に決定 さ れます。 こ れには、 2 つのケー

スがあ り ます。

1.

APB プ リ スケー ラが 1 の と き には、 タ イ マの ク ロ ッ ク周波数は接続 さ れている APB

ド メ イ ンの ク ロ ッ ク と 同 じ にな り ます。

2. その設定ではない場合、 タ イ マ ・ ク ロ ッ クの周波数は タ イ マが接続 さ れている APB

ド メ イ ンの ク ロ ッ クの 2 倍です。

FCLK は Cortex ™ -M3 フ リ ー ラ ニ ン グ ク ロ ッ ク と し て動作 し ます。詳細は ARM Cortex ™ -M3

テ ク ニ カル ・ リ フ ァ レ ン ス ・ マニ ュ アルを参照 し て く だ さ い。

HSE ク ロ ッ ク

高速外部 ク ロ ッ ク信号 (HSE) は次のいずれかの方法で生成する こ と がで き ます。

HSE 外部 ク リ ス タ ル / セ ラ ミ ッ ク発振子

HSE 外部 ク ロ ッ ク信号

波形ひずみ と 発振開始時の安定動作のため、 発振子 と 負荷キ ャ パシ タ はオシ レ ー タ のピ ン

ので き る だけ近 く に配置する必要があ り ます。 同調キ ャ パシ タ の容量は使用 さ れてい る発

振子にあわせて調整する こ と が必要です。

図 9.

HSE/ LSE ク ロ ッ ク ・ ソ ース

ハー ド ウ ェ ア構成

外部信号ソ ース

OSC_OUT

(HiZ)

OSC_IN OSC_OUT

C

L1

負荷キ ャ パシ タ

C

L2

外部ソ ース (HSE バイパス)

こ のモー ド は外部に ク ロ ッ ク ・ ソ ース と な る 25 MHz 以下の信号が必要です。 こ のモー ド

ク ロ ッ ク制御レ ジス タ (RCC_CR)

の HSEBYP ビ ッ ト と HSEON ビ ッ ト を セ ッ ト する こ

と で指定 し ます。 供給 さ れる ク ロ ッ ク 信号はデ ュ ーテ ィ サイ クルがほぼ 50 % の矩形波、 正

Rev 5 -日本語版 75/681

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参考資料

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

6.2.2

6.2.3

RM0008

弦波、 三角波のいずれかで、 OSC_IN ピ ン を駆動 し ます。 こ の と き OSC_OUT ピ ンはハイ ・

イ ン ピーダ ン スの状態 と し ます。 (

図  9

を参照)

外部ク リ ス タ ル / セ ラ ミ ッ ク 発振子 (HSE ク リ ス タ ル)

4 ~ 16 MHz の発振子を外部に付加する こ と に よ り 、 メ イ ン ク ロ ッ ク の周波数を高精度 と す

る こ と がで き る利点が生 じ ます。

関連するハー ド ウ ェ アの構成は

図  9

に示 さ れています。 詳細は、 デー タ シー ト の電気特性

の項を参照 し て く だ さ い。

ク ロ ッ ク制御レ ジス タ (RCC_CR)

の HSERDY フ ラ グは外部オシ レ ー タ が安定に動作 し て

い るか否かを示 し ます。 起動時には こ のビ ッ ト がハー ド ウ ェ ア でセ ッ ト さ れる ま で、 ク

ロ ッ ク 信号は送出 さ れません。

ク ロ ッ ク割込みレ ジス タ (RCC_CIR)

で許可 さ れていれば、

フ ラ グのセ ッ ト 時に割込み リ ク エ ス ト が発生 し ます。

HSE ク リ ス タ ル ・ モー ド は、

オ フ さ れます。

ク ロ ッ ク制御レ ジス タ (RCC_CR)

の HSEON ビ ッ ト でオ ン ・

HSI ク ロ ッ ク

HSI ク ロ ッ ク信号は内蔵 さ れてい る 8 MHz RC オシ レー タ で生成 さ れ、 直接にシ ス テム ・

ク ロ ッ ク と し て、 も し く は 2 分周 さ れ PLL 入力 と し て直接使用 さ れます。

HSI RC オシ レー タ の利用は、 低 コ ス ト (外付部品な し ) で ク ロ ッ ク信号を得 ら れる利点が

あ り ます。 同時に、 HSE ク リ ス タ ル発振子を使用する場合に比べ、 ス タ ー ト ア ッ プに要す

る時間が短縮 さ れますが、 較正を実施 し ていて も 、 外部の ク リ ス タ ル / セ ラ ミ ッ ク 発振子

を使用する場合に比べて周波数の精度は劣 り ます。

周波数の調整 (較正)

RC オシ レ ー タ の周波数は、 製造工程でのば ら つ きのため、 チ ッ プ ご と に異な り ます。 こ

のため、 T

A

=25 ℃で 1 % の精度を確保する よ う 、 製造時に ST 社においてデバイ ス ご と の

較正が行われています。

リ セ ッ ト 直後に 製造時の較正値は、

ロー ド さ れます。

ク ロ ッ ク制御レ ジス タ (RCC_CR)

の HSICAL[7:0] に

RC オシ レ ー タ の周波数に影響を与え る電圧や温度の環境で利用 さ れる と き には、

ク ロ ッ

ク制御レ ジス タ (RCC_CR)

の HSITRIM[4:0] フ ィ ール ド を使用 し て、 ア プ リ ケーシ ョ ン で

HSI 周波数の調整を行 う こ と がで き ます。

ク ロ ッ ク制御レ ジス タ (RCC_CR)

の HSIRDY フ ラ グは HSI RC オシ レー タ が安定状態か否

かを示 し ます。 HSI RC 出力は こ の フ ラ グがハー ド ウ ェ ア でセ ッ ト さ れる ま で HIS RC 信号

は出力 さ れません。

HSI RC 回路は

ク ロ ッ ク制御レ ジ ス タ (RCC_CR)

の HSION ビ ッ ト に よ り 、 オ ン ・ オ フ を切

り 替え る こ と がで き ます。

HSI 信号は HSE ク リ ス タ ル ・ オシ レ ー タ の動作が異常の場合はバ ッ ク ア ッ プ (補助 ク ロ ッ

ク) と し て使用する こ と も で き ます。 こ れに関 し ては

セ ク シ ョ ン  6.2.7: ク ロ ッ ク ・ セキ ュ

リ テ ィ シ ス テム (CSS) (78 ページ)

を参照 し て く だ さ い。

PLL 回路

HSI RC 出力や HSE ク リ ス タ ル出力の ク ロ ッ ク周波数を逓倍する ために、 内蔵 さ れてい る

PLL 回路を利用する こ と がで き ます。 こ れに関 し ては

図  8

ク ロ ッ ク制御レ ジス タ

(RCC_CR)

を参照 し て く だ さ い。

76/681 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

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報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

6.2.4

6.2.5

注意 :

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

PLL の設定 (PLL 入力ク ロ ッ ク が HSI 2 分周信号 も し く は HSE 信号かの選択、 及び逓倍

数) は PLL 回路がイ ネーブルにな る前に行 う 必要があ り ます。 PLL 回路がイ ネーブルにな

る と 、 PLL のパラ メ ー タ は変更で き ません。

ク ロ ッ ク割込みレ ジス タ (RCC_CIR)

で許可 さ れていれば、 PLL が安定 し た動作状態に

入 っ た と き に割込み リ ク エ ス ト が生成 さ れます。

ア プ リ ケーシ ョ ン で USB イ ン タ フ ェ ースが使用 さ れる と き には、 48 MHz の USBCLK を得

る ために、 PLL 出力は 48 MHz も し く は 72 MHz に設定 さ れなければな り ません。

LSE ク ロ ッ ク

LSE ク リ ス タ ルは 32.768 kHz 低速外部 ク リ ス タ ル / セ ラ ミ ッ ク発振子を使用 し ます。 こ の

ク ロ ッ ク は、時計 / カ レ ン ダ、 その他の タ イ ミ ン グ機能のための リ アル タ イ ム ・ ク ロ ッ ク

(RTC) に、低電力で高精度の ク ロ ッ ク信号を供給で き ます。

LSE ク リ ス タ ルは

バ ッ ク ア ッ プ ・ ド メ イ ン制御レ ジス タ (RCC_BDCR)

の LSEON ビ ッ ト

でオ ン ・ オ フ を切 り 替え る こ と がで き ます。

バ ッ ク ア ッ プ ・ ド メ イ ン制御レ ジス タ (RCC_BDCR)

の LSERDY フ ラ グは LSE オシ レー タ

が安定 し て動作 し てい るか否かを表示 し ています。 起動時に LSE ク リ ス タ ル出力 ク ロ ッ

ク信号は、 ハー ド ウ ェ アが こ のビ ッ ト を セ ッ ト する ま では出力 さ れません。

ク ロ ッ ク割込

みレ ジス タ (RCC_CIR)

で許可 さ れている場合、 フ ラ グがセ ッ ト さ れた と き に割込み リ ク

エ ス ト が発生 し ます。

外部ク ロ ッ ク ・ ソ ース (LSE バイパス)

こ のモー ド は外部に ク ロ ッ ク ・ ソ ース と な る 32.768 kHz の信号が必要です。 こ のモー ド は

バ ッ ク ア ッ プ ・ ド メ イ ン制御レ ジス タ (RCC_BDCR)

の LSEBYP ビ ッ ト と LSEON ビ ッ ト

を セ ッ ト する こ と で指定 し ます。 供給 さ れる外部 ク ロ ッ ク信号はデ ュ ーテ ィ サイ ク ルがほ

ぼ 50 % の矩形波、 正弦波、 三角波のいずれかで、 OSC_32IN ピ ン を駆動 し ます。 こ の と き

OSC_32OUT ピ ンはハイ ・ イ ン ピーダ ン スの状態にな り ます。 (

図  9

を参照)

LSI ク ロ ッ ク

LSI RC は、 独立型ウ ォ ッ チ ド ッ グ (IWDG) や自動ウ ェ ー ク ア ッ プ ・ ユニ ッ ト (AWU) のため

に STOP モー ド 及び STANDBY モー ド で動作する低電力の ク ロ ッ ク ・ ソ ース と し て動作 し

ます。 ク ロ ッ ク 周波数は約 40 kHz 前後 (30 kHz ~ 60kHz) にな り ます。 詳細はデー タ シー

トの電気特性の項を ご参照 し て く だ さ い。

LSI RC 回路は

制御 / ス テー タ ス ・ レ ジ ス タ (RCC_CSR)

の LSION ビ ッ ト でオ ン ・ オ フが

切 り 替え られます。

制御 / ス テー タ ス ・ レ ジス タ (RCC_CSR)

の LSIRDY フ ラ グは内蔵オシ レ ー タ が安定 し て

動作 し てい るか否かを表示 し ています。 起動時、 こ の ク ロ ッ ク はハー ド ウ ェ アが フ ラ グ を

セ ッ ト する ま では、 ク ロ ッ ク 信号は出力 さ れません。

ク ロ ッ ク割込みレ ジ ス タ (RCC_CIR)

で許可 さ れてい る場合、 フ ラ グセ ッ ト 時に割込み リ ク エ ス ト が発生 し ます。

LSI の較正は、 大容量デバイ スに限 り 利用可能です。

LSI 周波数調整 (較正)

低速内部 RC (LSI) 発振子の周波数のば ら つ きは、 RTC 基準時間及び / も し く は妥当な精

度の IWDG タ イ ムアウ ト ( こ れ ら のペ リ フ ェ ラ ルに LSI が ク ロ ッ ク ・ ソ ース と し て使われ

る時) にたい し て較正する事が出来ます。

Rev 5 -日本語版 77/681

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 この資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

6.2.6

6.2.7

注意 :

RM0008

こ の較正は、 TIM5 入力 ク ロ ッ ク (TIM5CLK) に対 し て LSI ク ロ ッ ク を計測する こ と で行わ

れます。 HSE 発振子の精度で行われる こ の計測は、 正確な基準時間を得る、 ま たは正確な

IWDG タ イ ムアウ ト を計算する為に、 ソ フ ト ウ ェ アは RTC の 20 ビ ッ ト プ リ スケー ラ を調

整する事が出来ます。

LSI を較正する には、 次の手順に従 っ て く だ さ い。

1.

TIM5 タ イ マ を イ ネーブル し 、 チ ャ ネル 4 を入力キ ャ プ チ ャ ・ モー ド に設定する。

2. 較正用に LSI ク ロ ッ ク を内部で TIM5 チ ャ ネル 4 入力キ ャ プ チ ャへ接続する ために、

AFIO_MAPR レ ジ ス タ の TIM5CH4_IREMAP ビ ッ ト を セ ッ ト する。

3. TIM5 キ ャ プ チ ャ / 比較 4 イ ベ ン ト あ る いは割込みを使 っ て、 LSI ク ロ ッ ク を計測す

る。

4. 必要な基準時間及び / も し く は、 IWDG タ イ ムアウ ト の計算に よ り 、 RTC の 20bit プ リ

スケー ラ を更新する ために、 計測 し た LSI 周波数を使 う 。

シ ス テム ・ ク ロ ッ ク (SYSCLK) の選択

シ ス テム ・ リ セ ッ ト の直後は HSI オシ レー タ がシ ス テム ・ ク ロ ッ ク と し て選択 さ れていま

す。 ク ロ ッ ク ・ ソ ースが直接、 も し く は PLL を経由 し て シ ス テム ・ ク ロ ッ ク と し て使用 さ

れている と き には、 こ のク ロ ッ ク 信号を停止する こ と はで き ません。

あ る ク ロ ッ ク ・ ソ ースから 別のク ロ ッ ク ・ ソ ースに切 り 替え る と き には、 目的の ク ロ ッ ク

信号が動作中 (ス タ ー ト ア ッ プ遅延後に ク ロ ッ ク が安定 し ているか、 も し く は PLL がロ ッ

ク さ れてい る状態) で なければな り ません。 ク ロ ッ クが動作状態で なければ、 こ のク ロ ッ

クの動作が安定するのを待 っ て切 り 替えが行われます。

ク ロ ッ ク制御レ ジス タ (RCC_CR)

のス テー タ ス ・ ビ ッ ト は個々のク ロ ッ ク が動作状態であ るか否か と 、 どの ク ロ ッ ク がシ ス

テム ・ ク ロ ッ ク と し て利用可能であ るかを示 し ています。

ク ロ ッ ク ・ セキ ュ リ テ ィ シ ス テム (CSS)

ク ロ ッ ク ・ セキ ュ リ テ ィ シ ス テムは ソ フ ト ウ ェ ア で有効にで き ます。 こ の と き、 HSE オシ

レ ー タ のス タ ー ト ア ッ プ遅延時間の後に ク ロ ッ ク 検出回路の動作が開始 さ れ、 オシ レ ー タ

が停止する と 検出回路 も デ ィ セーブル状態 と な り ます。

HSE オシ レー タ の ク ロ ッ ク 信号に異常が検出 さ れた と き には、 オシ レ ー タ は自動的に停止

し 、 ク ロ ッ ク 異常イ ベ ン ト が高機能制御 タ イ マ TIM1 のブ レ ー ク入力に送 られます。 また、

ソ フ ト ウ ェ アに異常を通知 し 、 割込み リ ク エ ス ト ( ク ロ ッ ク ・ セキ ュ リ テ ィ シ ス テム割込

み (CSSI)) が生成 さ れ MCU が対応処理を行 う こ と が許可 さ れます。 CSSI は Cortex ™ -M3

NMI (Non-Maskable Interrupt) 例外ベ ク タ と 対応 し ています。

CSS がイ ネーブル と な り 、 HSE ク ロ ッ ク異常が発生する と 、 CSS 割込みが リ ク エス ト さ

れ、 NMI が自動的に発生 し ます。 NMI 動作は CSS 割込みペンデ ィ ングビ ッ ト がク リ ア さ れ

ない限 り 、 無条件に実行 し ます。 つま り 、 NMI ISR の中でユーザが

ク ロ ッ ク割込みレ ジス

タ (RCC_CIR) の CSSC ビ ッ ト を セ ッ ト し 、 CSS 割込みを ク リ ア し なければな り ません。

HSE オシ レー タ が直接 も し く は間接的 ( こ の信号が PLL 入力で、 PLL 出力がシ ス テム ・ ク

ロ ッ ク と し て使用 さ れている場合) にシ ス テム ・ ク ロ ッ ク と し て使用 さ れてい る と き に

は、 異常検出に よ り シ ス テム ・ ク ロ ッ クは HSI オシ レ ー タ に切 り 替わ り 、 外部 HSE 発振回

路はデ ィ セーブル と な り ます。 HSE オシ レ ー タ の ク ロ ッ クが PLL 入力で、 PLL 出力がシ ス

テム ・ ク ロ ッ ク と し て使用 さ れてい る と き に異常が発生する と 、 PLL 回路 も デ ィ セーブル

にな り ます。

78/681 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 この資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

6.2.8

6.2.9

6.2.10

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

RTC ク ロ ッ ク

RTCCLK クロックは HSE/128、 LSE、 もしくは LSI クロックのいずれかから供給されます。 これ

バ ッ ク ア ッ プ ・ ド メ イ ン制御レ ジ ス タ (RCC_BDCR)

の RTCSEL[1:0] ビットで選択ができ

ます。 この選択はバックアップ ・ ドメインをリセットしない限り変更することはできません。

LSE ク ロ ッ ク はバ ッ ク ア ッ プ ・ ド メ イ ン に属 し ますが、 HSE と LSI ク ロ ッ ク はそ う ではあ

り ません。 こ のため、

LSE が RTC ク ロ ッ ク と し て使われている と き には、

- V

DD

供給がオ フ と な っ て も V

ます。

BAT

の供給が保たれてい る限 り 、 RTC は動作を続け

LSI が自動ウ ェ ー ク ア ッ プ (AWU) ク ロ ッ ク と し て使われている と き には、

- V

DD

供給がオ フ と な っ た と き、 AWU の状態は保証 さ れません。 LSI 較正の詳細に

ついては

セ ク シ ョ ン  6.2.5: LSI ク ロ ッ ク (77 ページ)

を参照 し て く だ さ い。

128 分周 し た HSE ク ロ ッ クが RTC ク ロ ッ ク と し て使われてい る と き には、

- V

DD

供給がオフとなったとき、 もしくは内蔵されている電圧レギュレータがオフとなり

1.8 V ドメインの電源供給が停止したときは、 RTC の状態は保証されません。

ウ ォ ッ チ ド ッ グ ・ ク ロ ッ ク

独立型ウ ォ ッ チ ド ッ グ (IWDG) がハー ド ウ ェ アのオプ シ ョ ン と し て、 も し く は ソ フ ト ウ ェ

アに よ っ て開始 さ れた と き、 LSI オシ レ ー タ は強制的にオ ン にな り 、 オ フ にする こ と はで

き ません。 LSI オシ レー タ の立上 り の過渡状態が終わる と 、 こ の ク ロ ッ ク が IWDG に供給

さ れます。

ク ロ ッ ク 信号出力

マ イ ク ロ コ ン ト ロー ラ ・ ク ロ ッ ク 出力機能 (MCO) は、 ク ロ ッ ク 信号を外部の MCO ピ ン に

出力 し ます。 こ の と き、 対応する GPIO ポー ト の設定レ ジ ス タ はオル タ ネー ト 機能が選択

する必要があ り ます。 以下の 4 つの信号の一つが、 MCU の ク ロ ッ ク と し て選択する こ と が

出来ます。

SYSCLK

HSI

HSE

2 分周 さ れた PLL ク ロ ッ ク

出力 さ れる ク ロ ッ ク は

ク ロ ッ ク構成レ ジス タ (RCC_CFGR)

の MCO[2:0] ビ ッ ト で指定 し ま

す。

Rev 5 -日本語版 79/681

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参考資料

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

RM0008

6.3 RCC レ ジ ス タ

レ ジ ス タ の詳細記述で使用 さ れてい る略語については

セ ク シ ョ ン 1.1 (32 ページ)

を参照

し て く だ さ い。

6.3.1

31

15 r

ク ロ ッ ク 制御レ ジ ス タ (RCC_CR)

ア ド レ スオ フ セ ッ ト : 0x00

リ セ ッ ト 値 : 0x0000 XX83   X は不定

ア ク セス : ノ ーウ ェ イ ト 、 ワー ド ・ ハー フ ワー ド ・ バイ ト ア ク セス

30 29 28

予約済み

14 r

予約済み

13 12 r

27

11

HSICAL[7:0] r r

26

10 r

25

PLL

RDY r

9

24

PLLON rw

8 r r

23

7 rw

22 21

予約済み

6

予約済み

5

20

4 rw

HSITRIM[4:0] rw rw

19

CSS

ON rw

3

18

HSE

BYP rw

2

予約

済み rw

17

HSE

RDY r

1

HSI

RDY r

16

HSE

ON rw

0

HSION rw

Bits 31:26 予約済み、 常に 0 が読出 さ れます。

Bit 25 PLLRDY: PLL ク ロ ッ ク ・ レデ ィ ・ フ ラ グ

ハー ド ウ ェ アでセ ッ ト さ れ、 PLL がロ ッ ク 状態である こ と を示 し ています。

0: PLL はロ ッ ク状態ではあ り ません。

1: PLL はロ ッ ク状態です。

Bit 24 PLLON: PLL イ ネーブル

PLL を イ ネーブル と する ため、 ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

STOP モー ド 、 STANDBY モー ド に入る と き、 ハー ド ウ ェ アによ っ て ク リ ア さ れます。 こ のビ ッ ト

は PLL 出力がシス テム ・ ク ロ ッ ク と し て使用 さ れている と き、 も し く は こ れか ら シス テム ・ ク

ロ ッ ク と し て使用 さ れよ う と し ている と き には リ セ ッ ト で き ません。

0: PLL オ フ

1: PLL オ ン

Bits 23:20 予約ビ ッ ト 、 常に 0 が読出 さ れます。

Bit 19 CSSON:

ク ロ ッ ク ・ セキ ュ リ テ ィ システム ・ イ ネーブル

ク ロ ッ ク 検出回路を イ ネーブル と する ため、 ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: ク ロ ッ ク 検出回路オ フ

1: ク ロ ッ ク 検出回路オン (1-25MHz HSE オシ レー タ の動作時のみ)

Bit 18 HSEBYP:

高速外部 (HSE) ク ロ ッ ク ・ バイパス ・ モー ド

デバ ッ グ時に、 オシ レー タ をバイパス し て外部か らの ク ロ ッ ク信号の利用を指示する ために、 ソ

フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。 こ のビ ッ ト は 外部 1 ~ 25MHz オシ レー タ がデ ィ セー

ブルの時にのみ書込む こ と がで き ます。

0: 外部 1 ~ 25MHz オシ レー タ はバイパス さ れません。

1: 外部 1 ~ 25MHz オシ レー タ はバイパス さ れ、 外部 ク ロ ッ クが使用 さ れます。

80/681 Rev 5 -日本語版

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RM0008

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

Bit 17 HSERDY:

高速外部 (HSE) ク ロ ッ ク ・ レデ ィ ・ フ ラ グ

外部 1 ~ 25MHz オシ レー タ が安定 し た動作状態であるか否かを示すよ う 、 ハー ド ウ ェ ア でセ ッ ト

さ れます。 HSEON が リ セ ッ ト さ れてから フ ラ グがク リ ア さ れる ま で、 外部 1 ~ 25MHz オシ レー タ

のク ロ ッ ク は 6 サイ クル相当の時間を必要にな り ます。

0: 外部 1 ~ 25MHz オシ レー タ はレデ ィ 状態ではあ り ません。

1: 外部 1 ~ 25MHz オシ レー タ はレデ ィ 状態です。

Bit 16 HSEON:

高速外部 (HSE) ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト さ れます。

STOP モー ド 、 STANDBY モー ド に入 り 外部 1 ~ 25MHz が停止する と ハー ド ウ ェ アによ り リ セ ッ

ト さ れます。 外部 1 ~ 25MHz が直接、 も し く は間接的にシ ス テム ・ ク ロ ッ ク と し て使用 さ れてい

る と き、 または こ れか ら使用 さ れよ う と し ている と き には、 こ のビ ッ ト を リ セ ッ ト で き ません。

0: HSE オシ レー タ OFF

1: HSE オシ レー タ ON

Bits 15:8 HSICAL[7:0]:

高速内蔵 (HSI) ク ロ ッ ク ・ ト リ ミ ング

こ れら のビ ッ ト は、 ス タ ー ト ア ッ プ時に自動的に初期化 さ れます。

Bits 7:3 HSITRIM[4:0]:

高速内蔵 (HSI) ク ロ ッ ク ・ ト リ ミ ング

こ れら のビ ッ ト は、 ユーザがプ ログ ラ ム可能な ト リ ミ ング値を HSICAL[7:0] ビ ッ ト に追加で書込む

事が出来ます。 こ れは電圧や温度の変化に対応する ためにプ ログ ラ ムで変更する こ と がで き、 内

蔵 HSI RC の周波数に影響 し ます。

デ ィ フ ォル ト 値は 16 で HSICAL 値を追加 し た場合は HSI を 8MHz ± 1%に ト リ ムする必要があ り

ます。

Bit 2 予約済み、 常に 0 が読出 さ れます。

Bit 1 HSIRDY:

高速内蔵 (HSI) ク ロ ッ ク ・ レデ ィ ・ フ ラ グ

内蔵 8 MHz RC オシ レー タ が安定 し た動作状態であるか否かを示すために、 ハー ド ウ ェ ア でセ ッ ト

さ れます。 HSION が リ セ ッ ト さ れてから フ ラ グがク リ ア さ れる ま で、 内蔵 8MHz RC オシ レー タ の

ク ロ ッ ク で 6 サイ クル相当の時間を必要にな り ます。

0: 内蔵 8 MHz RC オシ レー タ はレデ ィ 状態ではあ り ません。

1: 内蔵 8 MHz RC オシ レー タ はレデ ィ 状態です。

Bit 0 HSION:

高速内蔵 (HSI) ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト さ れます。

STOP モー ド 、 STANDBY モー ド を終了 し た と き、 も し く は 外部 1 ~ 25MHz オシ レー タ の ク ロ ッ

ク が直接 / 間接的にシ ス テム ・ ク ロ ッ ク と し て使用 さ れ、 こ の ク ロ ッ ク に異常が検出 さ れた と き

に、 内蔵 8 MHz RC 回路を強制的にオン と する ためにハー ド ウ ェ アによ り セ ッ ト さ れます。 内蔵 8

MHz RC ク ロ ッ クが直接、 も し く は間接的にシス テム ・ ク ロ ッ ク と し て使用 さ れている と き、 また

は こ れから 使用 さ れよ う と し ている と き には、 こ のビ ッ ト を リ セ ッ ト で き ません。

0: 内蔵 8 MHz RC オシ レー タ OFF

1: 内蔵 8 MHz RC オシ レー タ ON

Rev 5 -日本語版 81/681

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参考資料

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

RM0008

6.3.2

31

15

ク ロ ッ ク 構成レ ジ ス タ (RCC_CFGR)

ア ド レ スオ フ セ ッ ト : 0x04

リ セ ッ ト 値 : 0000 0000h

ア ク セス : 0 <= ウ ェ イ ト 数 <= 2、 ワー ド ・ ハー フ ワー ド ・ バイ ト ア ク セス

ク ロ ッ ク ・ ソ ースの切 り 替え中のア ク セスに限 り 、 1 ない し 2 個のウ ェ イ ト ・ ス テー ト が

挿入 さ れます。

30 29

予約済み

28

14

予約済み

13 12

27

11

26 25

MCO[2:0]

24 rw

10 rw

9 rw

8

23

予約

済み

予約済

み .

7

22

USB

PRE rw

6

21 rw

5

20 19

PLLMUL[3:0] rw

4 rw

3

18 rw

2

17

PLL

XTPRE

16

PLL

SRC rw

1 rw

0

ADC PRE[1:0] PPRE2[2:0] PPRE1[2:0] HPRE[3:0] SWS[1:0] SW[1:0] rw rw rw rw rw rw rw rw rw rw rw rw r r rw rw

Bits 31:26 予約済み、 常に 0 が読出 さ れます。

Bits 26:24 MCO:

マ イ ク ロ コ ン ト ロー ラ ク ロ ッ ク出力

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0xx: ク ロ ッ ク出力な し 。

100: シス テム ・ ク ロ ッ クが出力 さ れます。

101: 内蔵 8 MHz RC オシ レー タ (HSI) ク ロ ッ クが出力 さ れます。

110: 外部 1-25 MHz オシ レー タ (HSE) ク ロ ッ クが出力 さ れます。

111: 2 分周 さ れた PLL ク ロ ッ クが出力 さ れます。

注 :

-   こ のク ロ ッ ク 出力は、 ス タ ー ト ア ッ プ時も し く は MCO ク ロ ッ ク ・ ソ ースがス イ ッ チ さ れる間に、

  サイ クルを短縮する こ と がで き ます。

-   MCO ピ ンにシ ス テム ・ ク ロ ッ クが出力 さ れる場合、 その周波数が最大入出力速度の 50 MHz を超

  えない よ う 、 注意 し て く だ さ い。

Bit 22 USBPRE:

USB プ リ スケー ラ

48 MHz の USB ク ロ ッ ク を生成する ために、 ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。 こ の

ビ ッ ト は RCC_APB1ENR レ ジ ス タ で USB ク ロ ッ ク がイ ネーブル と さ れる前に有効な値がセ ッ ト さ

れていなければな り ません。 また、 USB ク ロ ッ ク がイ ネーブル状態の と き に、 こ のビ ッ ト を リ

セ ッ ト する こ と はで き ません。

0: PLL ク ロ ッ クは 1.5 分周 さ れます。

1: PLL ク ロ ッ クは分周 さ れません。

82/681 Rev 5 -日本語版

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参考資料

RM0008

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

Bits 21:18 PLLMUL:

PLL 逓倍数

これ らのビ ッ ト には、 PLL の逓倍数の指定を ソ フ ト ウ ェ アで書込みます。 書込みは PLL がデ ィ

セーブル状態の と き に限 られます。

注意 : PLL 出力周波数は 72 MHz を超え る こ と はで き ません。

0000: PLL 入力周波数 x 2

0001: PLL 入力周波数 x 3

0010: PLL 入力周波数 x 4

0011: PLL 入力周波数 x 5

0100: PLL 入力周波数 x 6

0101: PLL 入力周波数 x 7

0110: PLL 入力周波数 x 8

0111: PLL 入力周波数 x 9

1000: PLL 入力周波数 x 10

1001: PLL 入力周波数 x 11

1010: PLL 入力周波数 x 12

1011: PLL 入力周波数 x 13

1100: PLL 入力周波数 x 14

1101: PLL 入力周波数 x 15

1110: PLL 入力周波数 x 16

1111: PLL 入力周波数 x 16

Bit 17 PLLXTPRE: PLL 入力に対する HSE 分周

PLL 入力信号 と し て使用 さ れる HSE の分周比を設定する ため、 ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト

し ます。 この設定は PLL がデ ィ セーブル状態の時にのみ書込みが可能です。

0: HSE ク ロ ッ クは分周 さ れません。 (直に入力 さ れます。)

1: HSE ク ロ ッ クは 2 分周 さ れます。

Bit 16 PLLSRC:

PLL 入力ク ロ ッ ク ・ ソ ース

PLL ク ロ ッ ク ・ ソ ース を選択する ため、 ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。 こ のビ ッ

ト は PLL がデ ィ セーブル状態の と き にのみ書込みが可能です。

0: HSI ク ロ ッ ク / 2 が PLL 入力 と な り ます。

1: HSE ク ロ ッ クが PLL 入力 と な り ます。

Bits 14:14 ADCPRE:

ADC プ リ スケー ラ

ソ フ ト ウ ェ ア で ADC の ク ロ ッ ク周波数を選択 し ます。

00: PLCK2 2 分周

01: PLCK2 4 分周

10: PLCK2 6 分周

11: PLCK2 8 分周

Bits 13:11 PPRE2:

APB 高速 プ リ スケー ラ (APB2)

ソ フ ト ウ ェ ア で APB 高速 ク ロ ッ ク分周を制御する ためにセ ッ ト / リ セ ッ ト がで き ます。

0xx: HCLK は分周 さ れません (= HCLK)

100: HCLK 2 分周

101: HCLK 4 分周

110: HCLK 8 分周

111: HCLK 16 分周

Rev 5 -日本語版 83/681

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参考資料

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

RM0008

Bits 10:8 PPRE1:

APB 低速プ リ スケー ラ (APB1)

ソ フ ト ウ ェ ア で APB 低速 の ク ロ ッ ク分周を制御する ためのセ ッ ト / リ セ ッ ト がで き ます。

0xx: HCLK は分周 し ません。

100: HCLK 2 分周

101: HCLK 4 分周

110: HCLK 8 分周

111: HCLK 16 分周

Bits 7:4 HPRE:

AHB プ リ スケー ラ

ソ フ ト ウ ェ ア で AHB の ク ロ ッ ク分周を制御する ためのセ ッ ト / リ セ ッ ト がで き ます。

0xxx: SYSCLK は分周 し ません。 (= SYSCLK)

1000: SYSCLK 2 分周

1001: SYSCLK 4 分周

1010: SYSCLK 8 分周

1011: SYSCLK 16 分周

1100: SYSCLK 64 分周

1101: SYSCLK 128 分周

1110: SYSCLK 256 分周

1111: SYSCLK 512 分周

注 : AHB ク ロ ッ ク で 1 と は異な る プ リ スケー ラ を使 う 場合、 プ リ フ ェ ッ チ ・ バ ッ フ ァ は保持する

必要があ り ます。 詳細については

Flash メ モ リ の読出 し (41 ページ)

を参照 し て く だ さ い。

Bits 3:2 SWS: システム ・ ク ロ ッ ク ・ ス イ ッ チ ・ ステー タ ス

どの信号がシ ス テム ・ ク ロ ッ ク を生成する ために使われているかを表示する ため、 ハー ド ウ ェ ア

によ っ てセ ッ ト / リ セ ッ ト がで き ます。

00: HSI オシ レー タ がシス テム ・ ク ロ ッ ク と し て使われています。

01: HSE オシ レー タ がシス テム ・ ク ロ ッ ク と し て使われています。

10: PLL がシ ス テム ・ ク ロ ッ ク と し て使われています。

11: 未使用

Bits 1:0 SW:

システム ・ ク ロ ッ ク ・ ス イ ッ チ

ソ フ ト ウ ェ ア で、 SYSCLK のソ ース と し て使われる信号を セ ッ ト / リ セ ッ ト し ます。

STOP モー ド 、 STANDBY モー ド を終了する時、 も し く は HSE 発信回路が直接 / 間接的にシ ス テ

ム ・ ク ロ ッ ク と し て使用 さ れてお り 、 この信号に異常が検出 さ れた と き に、 ハー ド ウ ェ アによ っ

て値がセ ッ ト さ れます。 (後者は ク ロ ッ ク ・ セキ ュ リ テ ィ シ ス テムが有効な場合のみ)

00: HSI がシス テム ・ ク ロ ッ ク と し て使用 さ れます。

01: HSE がシス テム ・ ク ロ ッ ク と し て使用 さ れます。

10: PLL がシ ス テム ・ ク ロ ッ ク と し て使用 さ れます。

11: 設定禁止

84/681 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 この資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

6.3.3

31

ク ロ ッ ク 割込みレ ジ ス タ (RCC_CIR)

ア ド レ スオ フ セ ッ ト : 0x08

リ セ ッ ト 値 : 0000 0000h

ア ク セス : ノ ーウ ェ イ ト 、 ワー ド ・ ハー フ ワー ド ・ バイ ト ア ク セス

30 29 26 25 24

15 14

予約済み

13

予約済み

28 27

予約済み

23

CSSC

予約済み w

12 11 10

PLL

RDYIE

HSE

RDYIE

HSI

RDYIE

9

LSE

RDYIE

8

LSI

RDYIE

7

CSSF rw rw rw rw rw r

22 21

予約済み

6

予約済み

5

20

PLL

RDYC

19 18

HSE

RDYC

HSI

RDYC

17

LSE

RDYC

16

LSI

RDYC w w w w w

4

PLL

RDYF

3

HSE

RDYF

2

HSI

RDYF

1

LSE

RDYF

0

LSI

RDYF r r r r r

Bits 31:24 予約済み、 常に 0 が読出 さ れます。

Bit 23 CSSC

ク ロ ッ ク ・ セキ ュ リ テ ィ システム割込みク リ ア

このビ ッ ト を ソ フ ト ウ ェ ア でセ ッ ト する こ と で、 CSSF フ ラ グがク リ ア さ れます。 フ ラ グ ・ ク リ ア

後に、 このビ ッ ト はハー ド ウ ェ ア で リ セ ッ ト さ れます。

0: CSSF は ク リ ア さ れません。

1: CSSF が ク リ ア さ れます。

Bits 22:21 予約済み、 常に 0 が読出 さ れます。

Bit 20 PLLRDYC:

PLL レデ ィ 割込みク リ ア

ソ フ ト ウ ェ ア でセ ッ ト する こ と で、 PLLRDYF フ ラ グがク リ ア さ れます。 フ ラ グ ・ ク リ ア後、 こ の

ビ ッ ト はハー ド ウ ェ ア で リ セ ッ ト さ れます。

0: PLLRDYF はク リ ア さ れません。

1: PLLRDYF がク リ ア さ れます。

Bit 19 HSERDYC: HSE レデ ィ 割込みク リ ア

ソ フ ト ウ ェ ア でセ ッ ト する こ と で、 HSERDYF フ ラ グがク リ ア さ れます。 フ ラ グ ・ ク リ ア後、 こ の

ビ ッ ト はハー ド ウ ェ ア で リ セ ッ ト さ れます。

0: HSERDYF はク リ ア さ れません。

1: HSERDYF がク リ ア さ れます。

Bit 18 HSIRDYC:

HSI レデ ィ 割込みク リ ア

ソ フ ト ウ ェ ア でセ ッ ト する こ と で、 HSIRDYF フ ラ グがク リ ア さ れます。 フ ラ グ ・ ク リ ア後、 こ の

ビ ッ ト はハー ド ウ ェ ア で リ セ ッ ト さ れます。

0: HSIRDYF はク リ ア さ れません。

1: HSIRDYF がク リ ア さ れます。

Bit 17 LSERDYC: LSE レデ ィ 割込みク リ ア

ソ フ ト ウ ェ ア でセ ッ ト する こ と で、 LSERDYF フ ラ グが ク リ ア さ れます。 フ ラ グ ・ ク リ ア後、 こ の

ビ ッ ト はハー ド ウ ェ ア で リ セ ッ ト さ れます。

0: LSERDYF は ク リ ア さ れません。

1: LSERDYF が ク リ ア さ れます。

Rev 5 -日本語版 85/681

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参考資料

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

RM0008

Bit 16 LSIRDYC:

LSI レデ ィ 割込みク リ ア

ソ フ ト ウ ェ ア でセ ッ ト する こ と で、 LSIRDYF フ ラ グがク リ ア さ れます。 フ ラ グを ク リ ア後、 こ の

ビ ッ ト はハー ド ウ ェ ア で リ セ ッ ト さ れます。

0: LSIRDYF は ク リ ア さ れません。

1: LSIRDYF が ク リ ア さ れます。

Bits 15:13 予約済み、 常に 0 が読出 さ れます。

Bit 12 PLLRDYIE:

PLL レデ ィ 割込み リ ク エス ト ク リ ア

PLL ロ ッ ク によ り 発生する割込み リ ク エス ト を許可 / 禁止する ために、 ソ フ ト ウ ェ アでセ ッ ト /

リ セ ッ ト がで き ます。

0: PLL ロ ッ ク割込み リ ク エス ト 禁止

1: PLL ロ ッ ク割込み リ ク エス ト 許可

Bit 11 HSERDYIE: HSE レデ ィ 割込み リ ク エス ト 許可

外部 1 ~ 25MHz オシ レー タ の安定動作によ り 発生する割込み リ ク エス ト を許可 / 禁止する ため、

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: HSE レデ ィ 割込み リ ク エス ト 禁止

1: HSE レデ ィ 割込み リ ク エス ト 許可

Bit 10 HSIRDYIE:

HSI レデ ィ 割込み リ ク エス ト 許可

内部 8 MHz RC オシ レー タ の安定動作によ り 発生する割込み リ ク エス ト を許可 / 禁止する ため、 ソ

フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: HSI レデ ィ 割込み リ ク エス ト 禁止

1: HSI レデ ィ 割込み リ ク エス ト 許可

Bit 9 LSERDYIE: LSE レデ ィ 割込み リ ク エス ト 許可

外部 32 kHz オシ レー タ の安定動作によ り 発生する割込み リ ク エス ト を許可 / 禁止する ため、 ソ フ

ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: LSE レデ ィ 割込み リ ク エス ト 禁止

1: LSE レデ ィ 割込み リ ク エス ト 許可

Bit 8 LSIRDYIE:

LSI レデ ィ 割込み リ ク エス ト 許可

内蔵 RC 40kHz オシ レー タ の安定動作によ り 発生する割込み リ ク エス ト を許可 / 禁止する ため、 ソ

フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: LSI レデ ィ 割込み リ ク エス ト 禁止

1: LSI レデ ィ 割込み リ ク エス ト 許可

Bit 7 CSSF: ク ロ ッ ク ・ セキ ュ リ テ ィ システム割込み リ ク エス ト ・ フ ラ グ

外部 1 ~ 25 MHz オシ レー タ で異常が検出 さ れた と き にハー ド ウ ェ ア でセ ッ ト さ れ、 ソ フ ト ウ ェ ア

によ り CSSC ビ ッ ト に 1 を書込む こ と で リ セ ッ ト さ れます。

0: HSE ク ロ ッ ク異常によ る ク ロ ッ ク セキ ュ リ テ ィ 割込みは発生 し ていません。

1: HSE ク ロ ッ ク異常によ る ク ロ ッ ク セキ ュ リ テ ィ 割込みが発生 し ま し た。

Bits 6:5 予約済み、 常に 0 が読出 さ れます。

Bit 4 PLLRDYF:

PLL レデ ィ 割込み リ ク エス ト ・ フ ラ グ

PLLRDYIE ビ ッ ト がセ ッ ト さ れている と き、 PLL がロ ッ ク状態 と な る と ハー ド ウ ェ ア でセ ッ ト さ

れ、 ソ フ ト ウ ェ ア で PLLRDYC ビ ッ ト に 1 を書込む こ と で リ セ ッ ト さ れます。

0: PLL レデ ィ 割込み リ ク エス ト は発生 し ていません。

1: PLL レデ ィ 割込み リ ク エス ト が発生 し ま し た。

Bit3 HSERDYF:

HSE レデ ィ 割込み リ ク エス ト ・ フ ラ グ

HSERDYIE ビットがセットされて、 外部低速クロックの動作が安定するとハードウェアによってセットされ、

ソフトウェアで HSERDYC ビットに 1 を書込むことでリセットされます。

0: HDE (1 ~ 25 MHz オシ レー タ ) レデ ィ 割込み リ ク エス ト は発生 し ていません。

1: HDE (1 ~ 25 MHz オシ レー タ ) レデ ィ 割込み リ ク エス ト が発生 し ま し た。

86/681 Rev 5 -日本語版

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参考資料

RM0008

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

Bit 2 HSIRDYF:

HSI レデ ィ 割込み リ ク エス ト ・ フ ラ グ

HSIRDYIE ビットがセットされて、 内部高速クロックの動作が安定するとハードウェアによってセットされ、

ソフトウェアで HSIRDYC ビットに 1 を書込むことでリセットされます。

0: HSI (内蔵 8 MHz RC オシ レー タ ) レデ ィ 割込み リ ク エス ト は発生 し ていません。

1: HSI (内蔵 8 MHz RC オシ レー タ ) レデ ィ 割込み リ ク エス ト が発生 し ま し た。

Bit 1 LSERDYF: LSE レデ ィ 割込み リ ク エス ト ・ フ ラ グ

LSERDYIE ビットがセットされ、 外部高速クロックの動作が安定するとハードウェアによってセットされ、 ソ

フトウェアで LSERDYC ビットに 1 を書込むことでリセットされます。

0: LSE (外部 32 kHz オシ レー タ ) レデ ィ 割込み リ ク エ ス ト は発生 し ていません。

1: LSE (外部 32 kHz オシ レー タ ) レデ ィ 割込み リ ク エ ス ト が発生 し ま し た。

Bit 0 LSIRDYF:

LSI レデ ィ 割込み リ ク エス ト ・ フ ラ グ

LSIRDYIE ビットがセットされて、 内部低速クロックの動作が安定するとハードウェアによってセットされ、

ソフトウェアで LSIRDYC ビットに 1 を書込むことでリセットされます。

0: LSI (内蔵 32 kHz オシ レー タ ) レデ ィ 割込み リ ク エ ス ト は発生 し ていません。

1: LSI (内蔵 32 kHz オシ レー タ ) レデ ィ 割込み リ ク エ ス ト が発生 し ま し た。

6.3.4

31 30

APB2 ペ リ フ ェ ラル ・ リ セ ッ ト ・ レ ジ ス タ (RCC_APB2RSTR)

ア ド レ スオ フ セ ッ ト : 0x0C

リ セ ッ ト 値 : 0000 0000h

ア ク セス : ノ ーウ ェ イ ト 、 ワー ド ・ ハー フ ワー ド ・ バイ ト ア ク セス

29 28 27 26 25 24

予約済み

23 22 21 20 19 18 17 16

15

ADC3

RST

14

USART1

RST

13

TIM8

RST

12

SPI1

RST rw rw rw rw

予約済み

11

TIM1

RST

10

ADC2

RST

9

ADC1

RST

8

IOPG

RST rw rw rw rw

7

IOPF

RST rw

6

IOPE

RST

5

IOPD

RST

4

IOPC

RST

3

IOPB

RST rw rw rw rw

2

IOPA

RST rw

1

予約

済み

予約済

0

AFIO

RST rw

Bits 31:16 予約済み、 常に 0 が読出 さ れます。

Bit 15 ADC3RST

ADC3 イ ン タ フ ェ ース ・ リ セ ッ ト

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: ADC3 を リ セ ッ ト し ます。

Bit 14 USART1RST: USART1 リ セ ッ ト

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: USART1 を リ セ ッ ト し ます。

Bit 13 TIM8RST TIM8 タ イ マ ・ リ セ ッ ト

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: TIM8 を リ セ ッ ト し ます。

Rev 5 -日本語版 87/681

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参考資料

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

Bit 12 SPI1RST:

SPI 1 リ セ ッ ト

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: SPI 1 を リ セ ッ ト し ます。

Bit 11 TIM1RST:

TIM1 タ イ マ ・ リ セ ッ ト

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: TIM1 タ イ マ を リ セ ッ ト し ます。

Bit 10 ADC2RST:

ADC2 イ ン タ フ ェ ース ・ リ セ ッ ト

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: ADC2 イ ン タ フ ェ ース を リ セ ッ ト し ます。

Bit 9 ADC1RST:

ADC1 イ ン タ フ ェ ース ・ リ セ ッ ト

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: ADC1 イ ン タ フ ェ ース を リ セ ッ ト し ます。

Bit 8 IOPGRST

入出力ポー ト G リ セ ッ ト

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: 入出力ポー ト G を リ セ ッ ト し ます。

Bit 7 IOPFRST

入出力ポー ト F リ セ ッ ト

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: 入出力ポー ト F を リ セ ッ ト し ます。

Bit 6 IOPERST:

入出力ポー ト E リ セ ッ ト

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

  1: 入出力ポー ト E を リ セ ッ ト し ます。

Bit 5 IOPDRST

入出力ポー ト D リ セ ッ ト

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: 入出力ポー ト D を リ セ ッ ト し ます。

Bit 4 IOPCRST

入出力ポー ト C リ セ ッ ト

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: 入出力ポー ト C を リ セ ッ ト し ます。

Bit 3 IOPBRST

入出力ポー ト B リ セ ッ ト

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: 入出力ポー ト B を リ セ ッ ト し ます。

Bit 2 IOPARST:

入出力ポー ト A リ セ ッ ト

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: 入出力ポー ト A を リ セ ッ ト し ます。

Bit 1 予約済み、 常に 0 が読出 さ れます。

RM0008

88/681 Rev 5 -日本語版

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参考資料

RM0008

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

Bit 0 AFIORST:

オル タ ネー ト 機能入出力 リ セ ッ ト

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: オル タ ネー ト 機能ポー ト を リ セ ッ ト し ます。

6.3.5 APB1 ペ リ フ ェ ラル ・ リ セ ッ ト ・ レ ジ ス タ (RCC_APB1RSTR)

ア ド レ スオ フ セ ッ ト : 0x10

リ セ ッ ト 値 : 0000 0000h

ア ク セス : ノ ーウ ェ イ ト 、 ワー ド ・ ハー フ ワー ド ・ バイ ト ア ク セス

31 30

予約済み

29

DAC

RST

28

PWR

RST

予約済み

15

SPI3

RST

14

SPI2

RST rw rw rw rw

13 12

予約済み

予約済み

27

BKP

RST

26

予約

済み rw

11

WWD

GRST

予約済

10 rw

25

CAN

RST

24

予約

済み rw

9

予約済

8

予約済み rw

7

予約済み

23

USB

RST

22

I2C2

RST rw

6

21

I2C1

RST

20

UART

5

RST

19

UART

4

RST

18 17

USART

3

RST

USART

2

RST

16

予約

済み rw

5

TIM7

RST rw rw

4

TIM6

RST rw rw

3

TIM5

RST rw rw

2

TIM4

RST rw rw

1

TIM3

RST

予約済

0

TIM2

RST rw rw

Bits 31:30 予約済み、 常に 0 が読出 さ れます。

Bit 29 DACRST

DAC イ ン タ フ ェ ース ・ リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: DAC イ ン タ フ ェ ース を リ セ ッ ト し ます。

Bit 28 PWRRST:

電源イ ン タ フ ェ ース ・ リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: 電源イ ン タ フ ェ ース を リ セ ッ ト し ます。

Bit 27 BKPRST:

バ ッ ク ア ッ プ ・ イ ン タ フ ェ ース ・ リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: バ ッ ク ア ッ プ ・ イ ン タ フ ェ ース を リ セ ッ ト し ます。

Bit 26 予約済み、 常に 0 が読出 さ れます。

Bit 25 CANRST: CAN リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: CAN を リ セ ッ ト し ます。

Bit 24 予約済み、 常に 0 が読出 さ れます。

Bit 23 USBRST:

USB リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: USB を リ セ ッ ト し ます。

Rev 5 -日本語版 89/681

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参考資料

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

Bit 22 I2C2RST:

I 2C 2 リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: I 2C2 を リ セ ッ ト し ます。

Bit 21 I2C1RST:

I 2C1 リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: I 2C1 を リ セ ッ ト し ます。

Bit 20 USART5RST: USART5 リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: USART5 を リ セ ッ ト し ます。

Bit 19 USART4RST: USART4 リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: USART4 を リ セ ッ ト し ます。

Bit 18 USART3RST: USART3 リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: USART3 を リ セ ッ ト し ます。

Bit 17 USART2RST: USART2 リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: USART2 を リ セ ッ ト し ます。

Bits 16 予約済み、 常に 0 が読出 さ れます。

Bit 15 SPI3RST:

SPI 3 リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: SPI 3 を リ セ ッ ト し ます。

Bit 14 SPI2RST:

SPI 2 リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: SPI 2 を リ セ ッ ト し ます。

Bits 13:12 予約済み、 常に 0 が読出 さ れます。

Bit 11 WWDGRST:

Window 型ウ ォ ッ チ ド ッ グ ・ リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: Window 型ウ ォ ッ チ ド ッ グを リ セ ッ ト し ます。

Bits 10:6 予約済み、 常に 0 が読出 さ れます。

Bit 5 TIM7RST:

タ イ マ 7 リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: タ イ マ 7 を リ セ ッ ト し ます。

RM0008

90/681 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 この資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

Bit 4 TIM6RST:

タ イ マ 6 リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: タ イ マ 6 を リ セ ッ ト し ます。

Bit 3 TIM5RST:

タ イ マ 5 リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: タ イ マ 5 を リ セ ッ ト し ます。

Bit 2 TIM4RST:

タ イ マ 4 リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: タ イ マ 4 を リ セ ッ ト し ます。

Bit 1 TIM3RST:

タ イ マ 3 リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: タ イ マ 3 を リ セ ッ ト し ます。

Bit 0 TIM2RST:

タ イ マ 2 リ セ ッ ト

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 影響な し

1: タ イ マ 3 を リ セ ッ ト し ます。

6.3.6

31

AHB ペ リ フ ェ ラル ・ ク ロ ッ ク ・ イ ネーブル ・ レ ジス タ (RCC_AHBENR)

ア ド レ スオ フ セ ッ ト : 0x14

リ セ ッ ト 値 : 0000 0014h

ア ク セス : ノ ーウ ェ イ ト 、 ワー ド ・ ハー フ ワー ド ・ バイ ト ア ク セス

30 29 28 27 26 25 24 23 22 21 20 19 18 17 16

予約済み

15 14 13

予約済み

12 11 10

SDIO

EN rw

9

予約

済み

8

FSMC

EN rw

7

予約

済み

6

CRCE

N rw

5

予約

済み

4

FLITF

EN rw

3

予約

済み

2

SRAM

EN rw

1

DMA2

EN rw

0

DMA1

EN rw

Bits 31:11 予約済み、 常に 0 が読出 さ れます。

Bit 10 SDIOEN SDIO ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: SDIO には ク ロ ッ クが供給 さ れません。

1: SDIO に ク ロ ッ クが供給 さ れます。

Bits 9 予約済み、 常に 0 が読出 さ れます。

Bit 8 FSMCEN

FSMC ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: FSMC にはク ロ ッ ク が供給 さ れません。

1: FSMC に ク ロ ッ ク が供給 さ れます。

Rev 5 -日本語版 91/681

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

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参考資料

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

RM0008

Bit 7 予約済み、 常に 0 が読出 さ れます。

Bit 6 CRCEN CRC ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: CRC には ク ロ ッ クが供給 さ れません。

1: CRC に ク ロ ッ クが供給 さ れます。

Bit 5 予約済み、 常に 0 が読出 さ れます。

Bit 4 FLITFEN:

FLITF ク ロ ッ ク ・ イ ネーブル

SLEEP モー ド における FLITF ク ロ ッ クのオン / オ フ を切 り 替え る ため、 ソ フ ト ウ ェ アでセ ッ ト /

リ セ ッ ト がで き ます。

0: SLEEP モー ド で、 FLITF には ク ロ ッ クが供給 さ れません。

1: SLEEP モー ド で、 FLITF に ク ロ ッ クが供給 さ れます。

Bit 3 予約済み、 常に 0 が読出 さ れます。

Bit 2 SRAMEN:

SRAM イ ン タ フ ェ ース ・ ク ロ ッ ク ・ イ ネーブル

SLEEP モー ド における SRAM ク ロ ッ ク のオン / オ フ を切 り 替え る ため、 ソ フ ト ウ ェ ア でセ ッ ト /

リ セ ッ ト がで き ます。

0: SLEEP モー ド で、 SRAM には ク ロ ッ クが供給 さ れません。

1: SLEEP モー ド で、 SRAM に ク ロ ッ クが供給 さ れます。

Bit 1 DMA2EN DMA2 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: DMA2 には ク ロ ッ クが供給 さ れません。

1: DMA2 に ク ロ ッ クが供給 さ れます。

Bit 0 DMAEN: DMA ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: DMA にはク ロ ッ ク が供給 さ れません。

1: DMA に ク ロ ッ ク が供給 さ れます。

92/681 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

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製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

6.3.7

31

APB2 ペ リ フ ェ ラル ・ ク ロ ッ ク ・ イ ネーブル ・ レ ジ ス タ (RCC_APB2ENR)

ア ド レ スオ フ セ ッ ト : 18h

リ セ ッ ト 値 : 0000 0000h

ア ク セス : ワー ド ・ ハー フ ワー ド ・ バイ ト ア ク セス

ア ク セスは ノ ーウ ェ イ ト で行われます。 ただ し 、 APB2 ド メ イ ンのペ リ フ ェ ラ ルにア ク セ

ス中の場合は、 こ れが終了する ま でウ ェ ー ト ス テー ト が挿入 さ れます。

30 29 28 27 26 25 22 21 20 19 18 17 16 24 23

予約済み

15

ADC3

EN

14

USAR

T1EN

13

TIM8

EN rw rw rw

12

SPI1

EN

11

TIM1

EN

10

ADC2

EN

9

ADC1

EN

予約済み

8

IOPG

EN

7

IOPF

EN rw rw rw rw rw rw

6

IOPE

EN

5

IOPD

EN

4

IOPC

EN

3

IOPB

EN rw rw rw rw

2

IOPA

EN rw

1

予約

済み

予約済

0

AFIO

EN rw

Bits 31:16 予約済み、 常に 0 が読出 さ れます。

Bit 15 ADC3EN

ADC 3 イ ン タ フ ェ ース ・ ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: ADC3 イ ン タ フ ェ ースにはク ロ ッ ク が供給 さ れません。

1: ADC3 イ ン タ フ ェ ースに ク ロ ッ ク が供給 さ れます。

Bit 14 USART1EN

USART1 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: USART1 には ク ロ ッ クが供給 さ れません。

1: USART1 に ク ロ ッ クが供給 さ れます。

Bit 13 TIM8EN

TIM8 タ イ マ ・ ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: TIM8 にはク ロ ッ ク が供給 さ れません。

1: TIM8 に ク ロ ッ ク が供給 さ れます。

Bit 12 SPI1EN:

SPI 1 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: SPI 1 にはク ロ ッ ク が供給 さ れません。

1: SPI 1 に ク ロ ッ ク が供給 さ れます。

Bit 11 TIM1EN:

TIM 1 タ イ マ ・ ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: TIM1 には タ イ マ ・ ク ロ ッ ク が供給 さ れません。

1: TIM1 に タ イ マ ・ ク ロ ッ ク が供給 さ れます。

Bit 10 ADC2EN:

ADC 2 イ ン タ フ ェ ース ・ ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: ADC 2 イ ン タ フ ェ ースにはク ロ ッ ク が供給 さ れません。

1: ADC 2 イ ン タ フ ェ ースに ク ロ ッ ク が供給 さ れます。

Rev 5 -日本語版 93/681

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製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

Bit 9 ADC1EN:

ADC 1 イ ン タ フ ェ ース ・ ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: ADC 1 イ ン タ フ ェ ースにはク ロ ッ ク が供給 さ れません。

1: ADC 1 イ ン タ フ ェ ースに ク ロ ッ ク が供給 さ れます。

Bit 8 IOPEEN:

入出力ポー ト G ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 入出力ポー ト G にはク ロ ッ ク が供給 さ れません。

1: 入出力ポー ト G に ク ロ ッ ク が供給 さ れます。

Bit 7 IOPEEN:

入出力ポー ト F ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 入出力ポー ト F には ク ロ ッ クが供給 さ れません。

1: 入出力ポー ト F に ク ロ ッ クが供給 さ れます。

Bit 6 IOPEEN:

入出力ポー ト E ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 入出力ポー ト E には ク ロ ッ クが供給 さ れません。

1: 入出力ポー ト E に ク ロ ッ クが供給 さ れます。

Bit 5 IOPDEN:

入出力ポー ト D ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 入出力ポー ト D には ク ロ ッ クが供給 さ れません。

1: 入出力ポー ト D に ク ロ ッ クが供給 さ れます。

Bit 4 IOPCEN:

入出力ポー ト C ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 入出力ポー ト C にはク ロ ッ ク が供給 さ れません。

1: 入出力ポー ト C に ク ロ ッ ク が供給 さ れます。

Bit 3 IOPBEN:

入出力ポー ト B ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 入出力ポー ト B にはク ロ ッ ク が供給 さ れません。

1: 入出力ポー ト B に ク ロ ッ ク が供給 さ れます。

Bit 2 IOPAEN:

入出力ポー ト A ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 入出力ポー ト A には ク ロ ッ クが供給 さ れません。

1: 入出力ポー ト A に ク ロ ッ クが供給 さ れます。

Bit 1 予約済み、 常に 0 が読出 さ れます。

Bit 0 AFIOEN: オル タ ネー ト 機能入出力ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: オル タ ネー ト 機能入出力には ク ロ ッ クが供給 さ れません。

1: オル タ ネー ト 機能入出力に ク ロ ッ クが供給 さ れます。

RM0008

94/681 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

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製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

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参考資料

RM0008

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

6.3.8 APB1 ペ リ フ ェ ラル ・ ク ロ ッ ク ・ イ ネーブル ・ レ ジ ス タ (RCC_APB1ENR)

ア ド レ スオ フ セ ッ ト : 0x1C

リ セ ッ ト 値 : 0000 0000h

ア ク セス : ワー ド ・ ハー フ ワー ド ・ バイ ト ア ク セス

ア ク セスは ノ ーウ ェ イ ト で行われます。 ただ し 、 APB1 ド メ イ ンのペ リ フ ェ ラ ルにア ク セ

ス中の場合は、 こ れが終了する ま でウ ェ ー ト ス テー ト が挿入 さ れます。

31 30

予約済み

15

SPI3

EN rw

Res

14

SPI2

EN rw

29

DAC

EN rw

13

予約済み

Res

28

PWR

EN rw

12

27

BKP

EN rw

11

WWD

GEN rw

26

予約

済み

Res

10

25

CAN

EN rw

9

24

予約

済み

Res

8

予約済み

23

USB

EN rw

7

Res

22

I2C2

EN rw

6

21

I2C1

EN rw

5

TIM7

EN rw

20 19

UART5E

N rw

UART4

EN rw

4

TIM6

EN rw

3

TIM5

EN rw

18

USART

3EN rw

17

USART

2EN rw

2

TIM4

EN rw

1

TIM3

EN rw

16

予約

済み

Res

0

TIM2

EN rw

Bits 31:30 予約済み、 常に 0 が読出 さ れます。

Bit 29 DACEN

DAC イ ン タ フ ェ ース ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: DAC イ ン タ フ ェ ースには ク ロ ッ クが供給 さ れません。

1: DAC イ ン タ フ ェ ースに ク ロ ッ クが供給 さ れます。

Bit 28 PWREN:

電源イ ン タ フ ェ ース ・ ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 電源イ ン タ フ ェ ースには ク ロ ッ クが供給 さ れません。

1: 電源イ ン タ フ ェ ースに ク ロ ッ クが供給 さ れます。

Bit 27 BKPEN:

バ ッ ク ア ッ プ ・ イ ン タ フ ェ ース ・ ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: バ ッ ク ア ッ プ ・ イ ン タ フ ェ ースには ク ロ ッ クが供給 さ れません。

1: バ ッ ク ア ッ プ ・ イ ン タ フ ェ ースに ク ロ ッ クが供給 さ れます。

Bit 26 予約済み、 常に 0 が読出 さ れます。

Bit 25 CANEN: CAN ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: CAN には ク ロ ッ クが供給 さ れません。

1: CAN に ク ロ ッ クが供給 さ れます。

Bit 24 予約済み、 常に 0 が読出 さ れます。

Bit 23 USBEN:

USB ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: USB にはク ロ ッ ク が供給 さ れません。

1: USB に ク ロ ッ ク が供給 さ れます。

Bit 22 I2C2EN: I

2C 2 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: I 2C 2 には ク ロ ッ クが供給 さ れません。

1: I 2C 2 に ク ロ ッ クが供給 さ れます。

Rev 5 -日本語版 95/681

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

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ていない場合があ り ます。 この資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

Bit 21 I2C1EN:

I 2C 1 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: I 2C 1 には ク ロ ッ クが供給 さ れません。

1: I 2C 1 に ク ロ ッ クが供給 さ れます。

Bit 20 USART5EN:

USART 5 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: USART 5 には ク ロ ッ クが供給 さ れません。

1: USART 5 に ク ロ ッ クが供給 さ れます。

Bit 19 USART4EN:

USART 4 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: USART 4 には ク ロ ッ クが供給 さ れません。

1: USART 4 に ク ロ ッ クが供給 さ れます。

Bit 18 USART3EN:

USART 3 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: USART 3 にはク ロ ッ ク が供給 さ れません。

1: USART 3 に ク ロ ッ ク が供給 さ れます。

Bit 17 USART2EN:

USART 2 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: USART 2 にはク ロ ッ ク が供給 さ れません。

1: USART 2 に ク ロ ッ ク が供給 さ れます。

Bits 16 予約済み、 常に 0 が読出 さ れます。

Bit 15 SPI3EN: SPI 3 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: SPI 3 にはク ロ ッ クが供給 さ れません。

1: SPI 3 に ク ロ ッ ク が供給 さ れます。

Bit 14 SPI2EN: SPI 2 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: SPI 2 には ク ロ ッ クが供給 さ れません。

1: SPI 2 に ク ロ ッ クが供給 さ れます。

Bits 13:12 予約済み、 常に 0 が読出 さ れます。

Bit 11 WWDGEN:

Window 型ウ ォ ッ チ ド ッ グ ・ ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: Window 型ウ ォ ッ チ ド ッ グには ク ロ ッ クが供給 さ れません。

1: Window 型ウ ォ ッ チ ド ッ グに ク ロ ッ クが供給 さ れます。

Bits 10:6 予約済み、 常に 0 が読出 さ れます。

Bit 5 TIM7EN: タ イ マ 7 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: タ イ マ 7 には ク ロ ッ クが供給 さ れません。

1: タ イ マ 7 に ク ロ ッ クが供給 さ れます。

Bit 4 TIM6EN: タ イ マ 6 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: タ イ マ 6 には ク ロ ッ クが供給 さ れません。

1: タ イ マ 6 に ク ロ ッ クが供給 さ れます。

RM0008

96/681 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 この資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

Bit 3 TIM5EN:

タ イ マ 5 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: タ イ マ 5 には ク ロ ッ クが供給 さ れません。

1: タ イ マ 5 に ク ロ ッ クが供給 さ れます。

Bit 2 TIM4EN:

タ イ マ 4 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: タ イ マ 4 にはク ロ ッ ク が供給 さ れません。

1: タ イ マ 4 に ク ロ ッ ク が供給 さ れます。

Bit 1 TIM3EN:

タ イ マ 3 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: タ イ マ 3 にはク ロ ッ ク が供給 さ れません。

1: タ イ マ 3 に ク ロ ッ ク が供給 さ れます。

Bit 0 TIM2EN

タ イ マ 2 ク ロ ッ ク ・ イ ネーブル

ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: タ イ マ 2 にはク ロ ッ ク が供給 さ れません。

1: タ イ マ 2 に ク ロ ッ ク が供給 さ れます。

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

Rev 5 -日本語版 97/681

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 この資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

RM0008

6.3.9 バ ッ ク ア ッ プ ・ ド メ イ ン制御レ ジ ス タ (RCC_BDCR)

ア ド レ スオ フ セ ッ ト : 0x20

リ セ ッ ト 値 : 0000 0000h (バ ッ ク ア ッ プ ・ ド メ イ ン ・ リ セ ッ ト 信号で リ セ ッ ト さ れます。)

ア ク セス : 0 ≦ウ ェ ー ト 数 ≦ 3、 ワー ド ・ ハー フ ワー ド ・ バイ ト ア ク セス

こ のレ ジ ス タ への連続 し たア ク セス で、 ウ ェ ー ト ス テー ト が挿入 さ れます。

バ ッ ク ア ッ プ ・ ド メ イ ン制御レ ジス タ (RCC_BDCR)

の LSEON、 LSEBYP、 RTCSEL、

RTCEN の各ビ ッ ト はバ ッ ク ア ッ プ ・ ド メ イ ンに属 し ています。 こ のため、 リ セ ッ ト 後こ れ

らのビ ッ ト は書込み禁止状態にあ り 、 ビ ッ ト の値を変更するには、 その前に

電源制御レ ジ

ス タ (PWR_CR)

の DBP ビ ッ ト を セ ッ ト し なければな り ません。 詳細は

セ ク シ ョ ン 5 (63

ページ)

を参照 し て く だ さ い。 こ れらのビ ッ ト は V

BAT

電源がオ ン でバ ッ ク ア ッ プ ・ ド メ

イ ン ・ リ セ ッ ト の時にのみ リ セ ッ ト さ れます。 他の リ セ ッ ト 機能は こ れらのビ ッ ト の値に

は影響を与え ません。

注意 :

31

15

RTC

EN rw

30

14

29 28 27

13 12

予約済み

11

Res

26

10

25 24

予約済み

23

9

Res

8

RTCSEL[1:0] rw rw

7

22 21 20

6 5

予約済み

4

Res

19

3

18 17 16

BDRST

2

LSE

BYP rw

1

LSE

RDY r rw

0

LSEON rw

Bits 31:17 予約済み、 常に 0 が読出 さ れます。

Bit 16 BDRST:

バ ッ ク ア ッ プ ・ ド メ イ ン ・ ソ フ ト ウ ェ ア ・ リ セ ッ ト

こ のビ ッ ト はソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: リ セ ッ ト が有効ではあ り ません。

1: バ ッ ク ア ッ プ ・ ド メ イ ン全体が リ セ ッ ト さ れます。

Bit 15 RTCEN:

RTC ク ロ ッ ク ・ イ ネーブル

こ のビ ッ ト はソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: RTC には ク ロ ッ クが供給 さ れません。

1: RTC に ク ロ ッ クが供給 さ れます。

Bits 14:10 予約済み、 常に 0 が読出 さ れます。

Bits 9:8 RTCSEL[1:0] : RTC ク ロ ッ ク ・ ソ ースの選択

こ れら のビ ッ ト はソ フ ト ウ ェ アで RTC のク ロ ッ ク ・ ソ ース を選択する セ ッ ト を行 う こ と がで き ま

す。 RTC ク ロ ッ ク ・ ソ ースの選択が行われる と バ ッ ク ア ッ プ ド メ イ ンの リ セ ッ ト 無 し で変更をす

る こ と はで き ません。 こ の内容の リ セ ッ ト は BDRST ビ ッ ト で行います。

00: ク ロ ッ ク な し

01: LSE オシ レー タ の ク ロ ッ クが RTC ク ロ ッ ク と し て使用 さ れます。

10: LSI オシ レー タ の ク ロ ッ クが RTC ク ロ ッ ク と し て使用 さ れます。

11: HSE オシ レー タ の ク ロ ッ ク を 128 分周 し た信号が RTC ク ロ ッ ク と し て使用 さ れます。

Bits 7:3 予約済み、 常に 0 が読出 さ れます。

Bit 2 LSEBYP:

外部低速オシ レー タ ・ バイパス

デバ ッ グ ・ モー ド で、 オシ レー タ をバイパスする ために ソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト する こ

と がで き ます。 こ のビ ッ ト は外部 32kHz オシ レー タ がデ ィ セーブルの時にのみ書込みが出来ます。

0: LSE オシ レー タ はバイパス さ れません。

1: LSE オシ レー タ がバイパス さ れます。

98/681 Rev 5 -日本語版

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参考資料

RM0008

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

Bit 1 LSERDY: 外部

低速オシ レー タ ・ レデ ィ

外部 32kHz オシ レー タ が安定 し た動作状態であるか否かを示すよ う にハー ド ウ ェ ア でセ ッ ト / リ

セ ッ ト さ れます。 LSEON が リ セ ッ ト さ れてか ら フ ラ グが ク リ ア さ れる ま で、 この外部低速オシ

レー タ ・ ク ロ ッ ク で 6 サイ クル相当の時間を必要 と し ます。

0: LSE オシ レー タ はレデ ィ 状態ではあ り ません。

1: LSE オシ レー タ はレデ ィ 状態です。

Bit 0 LSEON: 外部

低速オシ レー タ ・ イ ネーブル

こ のビ ッ ト はソ フ ト ウ ェ アでセ ッ ト / リ セ ッ ト がで き ます。

0: 外部 32kHz オシ レー タ OFF

1: 外部 32kHz オシ レー タ ON

6.3.10 制御 / ス テー タ ス ・ レ ジ ス タ (RCC_CSR)

ア ド レ スオ フ セ ッ ト : 0x24

リ セ ッ ト 値 : 0C00 0000h (シ ス テム ・ リ セ ッ ト で リ セ ッ ト さ れます。 ただ し リ セ ッ ト ・ フ

ラ グ類は電源 リ セ ッ ト 時のみ リ セ ッ ト さ れます)

ア ク セス : 0 ≦ウ ェ イ ト 数 ≦ 3、 ワー ド ・ ハー フ ワー ド ・ バイ ト ア ク セス

こ のレ ジ ス タ への連続 し たア ク セス で、 ウ ェ ー ト ス テー ト が挿入 さ れます。

31 30

LPWR

RSTF

WWDG

RSTF

29

IWDG

RSTF rw

15 rw

14 rw

13

28

SFT

RSTF rw

12

27

POR

RSTF rw

11

26

PIN

RSTF rw

10

25

予約

済み

Res

9

予約済み

24

RMVF rw

8

予約済み

23

7

22

6

21

5

20 19

予約済み

4

予約済み

3

18

2

17 16

1

LSI

RDY r

0

LSION rw

Bit 31 LPWRRSTF:

低電力 リ セ ッ ト ・ フ ラ グ

低電力管理 リ セ ッ ト が発生 し た と き、 ハー ド ウ ェ アによ っ てセ ッ ト さ れ、 ソ フ ト ウ ェ ア で RMVF

ビ ッ ト に 1 を書込む こ と で リ セ ッ ト さ れます。

0: 低電力管理 リ セ ッ ト は発生 し ていません。

1: 低電力管理 リ セ ッ ト が発生 し ま し た。

低電力管理 リ セ ッ ト の詳細は

セ ク シ ョ ン  : 低電力管理 リ セ ッ ト

を参照 し て く だ さ い。

Bit 30 WWDGRSTF: Window 型ウ ォ ッ チ ド ッ グ ・ リ セ ッ ト ・ フ ラ グ

Window 型ウ ォ ッ チ ド ッ グ ・ リ セ ッ ト が発生 し た と き にハー ド ウ ェ アでセ ッ ト さ れ、 ソ フ ト ウ ェ ア

で RMVF ビ ッ ト に 1 を書込む こ と で リ セ ッ ト さ れます。

0: Window 型ウ ォ ッ チ ド ッ グ ・ リ セ ッ ト は発生 し ていません。

1: Window 型ウ ォ ッ チ ド ッ グ ・ リ セ ッ ト が発生 し ま し た。

Bit 29 IWDGRSTF:

独立型ウ ォ ッ チ ド ッ グ ・ リ セ ッ ト ・ フ ラ グ

V

DD

ド メ イ ン でウ ォ ッ チ ド ッ グ ・ リ セ ッ ト が発生 し た と き にハー ド ウ ェ アによ っ てセ ッ ト さ れ、

ソ フ ト ウ ェ ア で RMVF ビ ッ ト に 1 を書込む こ と で リ セ ッ ト さ れます。

0: ウ ォ ッ チ ド ッ グ ・ リ セ ッ ト は発生 し ていません。

1: ウ ォ ッ チ ド ッ グ ・ リ セ ッ ト が発生 し ま し た。

Rev 5 -日本語版 99/681

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参考資料

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

RM0008

Bit 28 SFTRSTF:

ソ フ ト ウ ェ ア ・ リ セ ッ ト ・ フ ラ グ

ソ フ ト ウ ェ ア ・ リ セ ッ ト が発生 し た と き にハー ド ウ ェ アによ っ てセ ッ ト さ れ、 ソ フ ト ウ ェ ア で

RMVF ビ ッ ト に 1 を書込む こ と で リ セ ッ ト さ れます。

0: ソ フ ト ウ ェ ア ・ リ セ ッ ト は発生 し ていません。

1: ソ フ ト ウ ェ ア ・ リ セ ッ ト が発生 し ま し た。

Bit 27 PORRSTF: POR/PDR リ セ ッ ト ・ フ ラ グ

POR/PDR リ セ ッ ト が発生 し た と き にハー ド ウ ェ アでセ ッ ト さ れ、 ソ フ ト ウ ェ ア で RMVF ビ ッ ト

に 1 を書込む こ と で リ セ ッ ト さ れます。

0: POR/PDR リ セ ッ ト は発生 し ていません。

1: POR/PDR リ セ ッ ト が発生 し ま し た。

Bit 26 PINRSTF:

ピ ン ・ リ セ ッ ト ・ フ ラ グ

NRST ピ ン で リ セ ッ ト が発生 し た と き にハー ド ウ ェ ア でセ ッ ト さ れ、 ソ フ ト ウ ェ ア で RMVF ビ ッ

ト に 1 を書込む こ と で リ セ ッ ト さ れます。

0: NRST ピ ンの リ セ ッ ト は発生 し ていません。

1: NRST ピ ンの リ セ ッ ト が発生 し ま し た。

Bit 25 予約済み、 常に 0 が読出 さ れます。

Bit 24 RMVF:

リ セ ッ ト ・ フ ラ グ解除

リ セ ッ ト ・ フ ラ グの値を初期値に戻すため、 ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト し ます。

0: リ セ ッ ト ・ フ ラ グの初期化は行われません。

1: リ セ ッ ト ・ フ ラ グの初期化を行います。

Bits 23:2 予約済み、 常に 0 が読出 さ れます。

Bit 1 LSIRDY: 内蔵低速 オシ レー タ ・ レデ ィ

内蔵 RC40kHz オシ レー タ が安定 し た動作状態であるか否かを示すよ う に、 ハー ド ウ ェ アでセ ッ ト

/ リ セ ッ ト さ れます。 LSION が リ セ ッ ト さ れてか ら フ ラ グが ク リ ア さ れる ま で、 この内蔵

RC40kHz オシ レー タ の ク ロ ッ ク で 3 サイ ク ル相当の時間を必要 と し ます。

0: 内蔵 RC40kHz オシ レー タ はレデ ィ 状態ではあ り ません。

1: 内蔵 RC40kHz オシ レー タ はレデ ィ 状態です。

Bit 0 LSION: 内蔵低速オシ レー タ ・ イ ネーブル

このビ ッ ト は ソ フ ト ウ ェ ア でセ ッ ト / リ セ ッ ト がで き ます。

0: 内蔵 RC40kHz オシ レー タ OFF

1: 内蔵 RC40kHz オシ レー タ ON

100/681 Rev 5 -日本語版

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参考資料

RM0008

リ セ ッ ト と ク ロ ッ ク の制御 (RCC)

6.3.11

表 13.

オ フ

セ ッ ト

RCC レ ジ ス タ ・ マ ッ プ

次の表は RCC レ ジ ス タ ・ マ ッ プ及び リ セ ッ ト 値について示 し ています。

RCC - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値

レ ジス タ

0x000

RCC_CR

リ セ ッ ト 値

0x004

RCC_CFGR

リ セ ッ ト 値

予約済み

予約済み

MCO [2:0]

0

0

0

0

0

予約済み

HSICAL[7:0] HSITRIM[4:0]

0 0 0 0 0 0 0 0 0 0 0 0 1 0 0 0 0

PLLMUL[3:0]

ADC

PRE

[1:0]

PPRE2

[2:0]

PPRE1

[2:0]

HPRE[3:0]

1 1

SWS

[1:0]

SW

[1:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

0x008

RCC_CIR

リ セ ッ ト 値

予約済み

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

0x00C

RCC_APB2RSTR

リ セ ッ ト 値

予約済み

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

0x010

RCC_APB1RSTR 予約

済み

リ セ ッ ト 値

0 0 0

0x014

RCC_AHBENR

リ セ ッ ト 値

0 0 0 0 0

予約済み

0 0 0 0 0 0

予約済み

0 0 0 0 0 0

0 0 0 1 1 0 0

0x018

RCC_APB2ENR

リ セ ッ ト 値

予約済み

0 0 0 0 0 0 0 0 0 0 0 0 0 0

0x01C

RCC_APB1ENR

予約

済み

リ セ ッ ト 値

0 0 0

0x020

RCC_BDCR

リ セ ッ ト 値

0 0 0 0 0 0 0 0

予約済み

0 0 0

予約済み

0 0

予約済み

RTC

SEL

[1:0]

0 0

0

0 0 0 0 0 0

予約済み

0 0 0

0x024

RCC_CSR

予約済み

リ セ ッ ト 値

0 0 0 0 1 1 0

レ ジ ス タ のア ド レ ス範囲に関 し ては

表  1 (36 ページ)

を参照 し て く だ さ い。

0 0

Rev 5 -日本語版 101/681

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参考資料

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

7

RM0008

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

Flash メ モ リ 容量が 32 ~ 128Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト ロー

ラは、 中容量デバイ ス です。

Flash メ モ リ 容量が 256 ~ 512Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト

ロー ラ は、 大容量デバイ スです。

こ のセ ク シ ョ ンは、 注意書きがない限 り 、 STM32F10xxx フ ァ ミ リ 全てに適応 さ れます。

7.1 GPIO 機能

汎用入出力ポー ト (GPIO) には、 それぞれに、 32bit の構成レ ジ ス タ (GPIOx_CRL、

GPIOx_CRH) と 、 2 個の 32bit デー タ ・ レ ジ ス タ (GPIOx_IDR、 GPIOx_ODR)、 32bit のセ ッ ト /

リ セ ッ ト ・ レ ジ ス タ (GPIOx_BSRR) 、 16bit の リ セ ッ ト ・ レ ジ ス タ (GPIOx_BRR)、 32bit の

ロ ッ ク レ ジ ス タ (GPIOx_LCKR) が備え られています。

個々の入出力ポー ト の特定のハー ド ウ ェ ア特性に関 し ては、 デー タ シー ト に記載 さ れてい

ます。 汎用入出力 (GPIO) ポー ト の各ビ ッ ト は、 個々に、 ソ フ ト ウ ェ ア で以下の動作モー

ド を選択で き ます。

- フ ローテ ィ ン グ入力

- プルア ッ プ付き入力

- プルダウ ン付き入力

- アナ ロ グ入力

- オープ ン ド レ イ ン出力

- プ ッ シ ュ プル出力

- オル タ ネー ト 機能対応プ ッ シ ュ プル

- オル タ ネー ト 機能対応オープ ン ド レ イ ン

個々の入出ポー ト ビ ッ ト は任意に設定で き ますが、 入出力ポー ト ・ レ ジ ス タ は 32 ビ ッ ト

ワー ド と し て ア ク セス し なければな り ません。 ハー フ ワー ド やバイ ト 単位でのア ク セスは

で き ません。 GPIOx_BSRR レ ジ ス タ と GPIOx_BRR レ ジ ス タ を利用すれば、 GPIO レ ジ ス タ

に ビ ッ ト 単位で ア ク セス し 、 値を変更する こ と がで き ます。 こ れに よ り 、 一部ビ ッ ト の変

更を複数命令で行 う 際に生 じ る、 読出 し と 変更の間の割込み リ ク エ ス ト の発生 リ ス ク を回

避する こ と がで き ます。

図  10

は、 入出力ポー ト ビ ッ ト の基本的な構造を示 し ています。

102/681 Rev 5 -日本語版

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参考資料

RM0008

図 10.

入出力ポー ト の基本構造

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

オンチップ

ペリフェラル

読込み

書込み

アナログ入力

オルタネート機能入力

読込み/書込み

オンチップ

ペリフェラル

オルタネート機能出力

オン/オフ

V

DD

オン/オフ

TTLシュミット

トリガ

入力ドライバ

出力ドライバ

出力

コントロール

オン/オフ

V

SS

V

DD

P-MOS

N-MOS

V

SS プッシュプル、

オープンドレイン、

両オフのいずれか

V

DD

保護ダイオード

I/O

ピン

保護ダイオード

V

SS ai14781

図 11.

5V 耐性入出力ポー ト の基本構造

オンチップ

ペリフェラル

アナログ入力

オルタネート機能入力

読込み

書込み

読込み/書込み

オンチップ

ペリフェラル

オルタネート機能出力

オン/オフ

V

DD

オン/オフ

V

DD_FT

(1)

入力ドライバ

出力ドライバ

TTLシュミット

トリガ オン/オフ

V

SS

V

DD

P-MOS

出力

コントロール

N-MOS

V

SS

プッシュプル、

オープンドレイン、

両オフのいずれか

V

SS

I/O ピン

保護ダイオード ai14782

1.

V

DD_FT

は、 5V 耐性入出力の電位で、 V

DD

と は異な り ます。

Rev 5 -日本語版 103/681

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参考資料

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

RM0008

表 14.

ポー ト ・ ビ ッ ト 構成表

汎用出力

オル タ ネー ト 機能 ・

出力

入力

ポー ト 構成

プ ッ シ ュ プル

オープ ン ド レ イ ン

プ ッ シ ュ プル

オープ ン ド レ イ ン

アナログ入力

フ ローテ ィ ング入力

入力・プルダウン付入力

入力・プルア ッ プ付入力

CNF1 CNF0 MODE1 MODE0

0

1

0

1

0

1

0

1

0

1

0

01

10

11

表  15

を参照

00

PxODR

レ ジ ス タ

0 または 1

0 または 1

無視

無視

無視

無視

0

1

表 15.

出力モー ド ビ ッ ト

MODE[1:0]

00

01

10

11

意味

予約値

最大出力速度 10 MHz

最大出力速度 2 MHz

最大出力速度 50 MHz

104/681 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

7.1.1

7.1.2

7.1.3

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

汎用入出力 (GPIO)

リ セ ッ ト 中、 及び リ セ ッ ト 直後は、 オル タ ネー ト 機能は有効ではな く 、 入出力ポー ト は フ

ローテ ィ ン グ入力モー ド (CNFx[1:0]=01b、 MODEx[1:0]=00b) に設定 さ れています。

リ セ ッ ト 直後、 JTAG ピ ンはプルア ッ プ / プルダウ ン を有する入力モー ド と な っ ています。

PA15: JTDI 入力 ( プルア ッ プ付き )

PA14: JTCK 入力 ( プルダウ ン付き )

PA13: JTMS 入力 ( プルア ッ プ付き )

PB4: JNTRST 入力 ( プルア ッ プ付き )

ポー ト ビ ッ ト が出力に設定 さ れる と 、 出力デー タ ・ レ ジ ス タ (GPIOx_ODR) に書込まれてい

たデー タ の値がピ ン に出力 さ れます。 出力 ド ラ イバは、 プ ッ シ ュ プル ・ モー ド かオープ ン

ド レ イ ン ・ モー ド (出力が 0 の時に N-MOS のみがア ク テ ィ ブ (ON) と な り ます) のいずれ

かを指定で き ます。

入力デー タ ・ レ ジ ス タ (GPIOx_IDR) は、 APB2 ク ロ ッ ク ・ サイ クルご と に、 入出力ピ ン上の

信号の状態を反映 し ます。

プルア ッ プ / プルダウ ンが選択 さ れているか否かにかかわ ら ず、 入力モー ド に設定 さ れた

GPIO ピ ンは常に内部に高い抵抗値のプルア ッ プ と プルダウ ン を搭載 し ています。

ア ト ミ ッ ク ・ ビ ッ ト のセ ッ ト / リ セ ッ ト

GPIOx_ODR を ビ ッ ト レ ベルで操作する際に、 ソ フ ト ウ ェ ア で割込みを禁止する必要はあ り

ません。 一回のア ト ミ ッ ク APB2 書込みア ク セスのみで、 1 も し く は数ビ ッ ト のみを変更

する こ と がで き ます。 こ のためには、 ビ ッ ト セ ッ ト / リ セ ッ ト ・ レ ジ ス タ (GPIOx_BSRR、

も し く は リ セ ッ ト のみであれば GPIOx_BRR) の変更 し たい ビ ッ ト に対応する位置に 1 を書

込みます。 選択 さ れなかっ た (= 0) 出力ビ ッ ト の値は変わ り ません。

外部割込み / ウ ェ ー ク ア ッ プ信号

各ポートで、 外部割込みを発生させることができます。 外部割込みを利用するには、 そのポー

トは入力モードにする必要があります。 詳細は、 次のセクションを参照してください。

セ ク シ ョ ン 8.2: 外部割込み / イ ベン ト コ ン ト ロー ラ (EXTI) (134 ページ)

セ ク シ ョ ン  8.2.3: 再起動イ ベン ト 管理 (130 ページ)

Rev 5 -日本語版 105/681

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参考資料

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

7.1.4

注意 :

7.1.5

7.1.6

RM0008

オル タ ネー ト 機能 (AF)

オル タ ネー ト 機能を使用する には、 デ フ ォ ル ト のピ ン接続であ っ て も 、 事前にポー ト ビ ッ

ト 構成レ ジ ス タ の設定を行 う 必要があ り ます。

オル タ ネー ト 機能の入力では、 ポー ト は入力モー ド ( フ ローテ ィ ン グ、 プルア ッ プ、

プルダウ ン) に設定 し 、 入力ピ ンは外部か ら 駆動 し なければな り ません。

汎用入出力コ ン ト ロー ラ を プ ログ ラ ムする事で、 ソ フ ト ウ ェ ア で AFI 入力ピ ン を エ ミ ュ

レー ト する こ と が出来ます。 こ の場合、 ポー ト を オル タ ネー ト 機能出力モー ド に設定する

必要があ り ます。 こ の際明らかに、 対応するポー ト は汎用入出力コ ン ト ロー ラ を使い ソ フ

ト ウ ェ アに よ り 駆動 さ れるので、 外部から駆動 し てはな り ません。

オル タ ネー ト 機能の出力では、 オル タ ネー ト 機能出力 (プ ッ シ ュ プル、 オープ ン ド レ

イ ン) を選択 し ます。

オル タ ネー ト 機能の信号が両方向の場合は、 ポー ト ビ ッ ト はオル タ ネー ト 機能出力

(プ ッ シ ュ プル、 オープ ン ド レ イ ン) に設定 し ます。 こ の と き、 入力 ド ラ イバは フ

ローテ ィ ン グ入力モー ド と な っ ています。

ポー ト ビ ッ ト を オル タ ネー ト 機能出力に設定 し た時には、 ピ ンは GPIO 出力レ ジ ス タ か ら

切離 さ れ、 オ ン チ ッ プ ・ ペ リ フ ェ ラ ル回路の出力信号に接続 さ れます。

ソ フ ト ウ ェ ア でオル タ ネー ト 機能出力を選択 し た場合でペ リ フ ェ ラ ル回路がア ク テ ィ ブ で

はない と き、 その出力ピ ンの信号は確定 し ません。

ソ フ ト ウ ェ アによ る オル タ ネー ト 機能の入出力ピ ンの再割当て

異な る種類のデバイ スパ ッ ケージ で複数のペ リ フ ェ ラ ル入出力機能を利用する場合、 い く

つかのペ リ フ ェ ラ ル回路を別のピ ン に割当て る こ と に よ り 適切な割当てにする こ と がで き

ます。 こ の場合は、 対応する レ ジ ス タ の設定を行います。 (

AFIO レ ジ ス タ (123 ページ)

を参照 し て く だ さ い。) また、 そのオル タ ネー ト 機能では標準割当てのピ ンは使用で き ま

せん。

GPIO ロ ッ ク機構

ロ ッ ク 機構は I/O ポー ト 構成の設定を ロ ッ ク し ます。 ポー ト の個々のビ ッ ト に ロ ッ クの手

順が適用 さ れる と 、 次の リ セ ッ ト ま で、 そのポー ト ビ ッ ト の値を変更で き な く な り ます。

106/681 Rev 5 -日本語版

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参考資料

RM0008

7.1.7

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

入力回路の構成

入出力ポー ト で入力モー ド が選択 さ れた と き には、

出力バ ッ フ ァ は無効にな り ます。

シ ュ ミ ッ ト ・ ト リ ガ入力が有効 と な り ます。

入力のモー ド 設定 (プルア ッ プ、 プルダウ ン、 フ ローテ ィ ン グ) にかかわ ら ず、 高抵

抗のプルア ッ プ、 プルダウ ン抵抗はア ク テ ィ ブ です。

入出力ピン上のデータは、 APB2 クロック ・ サイクルごとに入力データ ・ レジスタに読込ま

れます。

入力デー タ ・ レ ジ ス タ を読出す こ と で、 入出力ピ ンの状態を得る こ と がで き ます。

図  12 (107 ページ)

は、 入力モー ド 時の入出力ポー ト の状態を示 し ています。

図 12.

入力回路の構造 ( フ ローテ ィ ン グ / プルア ッ プ / プルダウ ン )

オン/オフ

V

DD on

読込み

書込み

V

DD

又は V

DD_FT

(1)

保護ダイオード

I/O ピン

保護ダイオード

V

SS

読込み/書込み

入力ドライバ

出力ドライバ

TLLシュミット

トリガ

オン/オフ

V

SS ai14783

1.

V

DD_FT

は、 5V 耐性入出力の電位で、 V

DD

と は異な り ます。

Rev 5 -日本語版 107/681

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汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

7.1.8

RM0008

出力回路の構成

入出力ポー ト で出力モー ド が選択 さ れた と き には、

出力バ ッ フ ァ が有効 と な り ます。

- オープ ン ド レ イ ン ・ モー ド : 出力レ ジ ス タ が 0 の と き N-MOS がア ク テ ィ ブ (ON)

と な り 、 1 の と き にはポー ト はハイ ・ イ ン ピーダ ン ス状態 と な り ます。 (P-MOS

がア ク テ ィ ブ と な る こ と はあ り ません。)

- プ ッ シ ュ プル ・ モー ド : 出力レ ジ ス タ が 0 の と き N-MOS がア ク テ ィ ブ (ON) と な

り 、 1 の と き には P-MOS がア ク テ ィ ブ (ON) と な り ます。

シ ュ ミ ッ ト ・ ト リ ガ入力は有効で動作 し ます。

高抵抗のプルア ッ プ、 プルダウ ン抵抗は無効です。

入出力ピン上のデータは、 APB2 クロック ・ サイクルごとに入力データ ・ レジスタに読込ま

れます。

オープ ン ド レ イ ン ・ モー ド では、 入力デー タ ・ レ ジ ス タ を読出す こ と で、 入出力ピ ン

の状態を得る こ と がで き ます。

プ ッ シ ュ プル ・ モー ド では、 出力デー タ ・ レ ジ ス タ を読み出す こ と で、 最後に書込ま

れたデー タ を得る こ と がで き ます。

図  13 (108 ページ) は、 出力モー ド 時の入出力ポー ト の状態を示 し ています。

図 13.

出力回路の構造

読込み

書込み

読込み/書込み

入力ドライバ

出力ドライバ

オン

TTLシュミット

トリガ

出力

コントロール

V

DD

P-MOS

V

SS

N-MOS

プッシュプルまたは

オープンドレイン

V

DD

または V

DD_FT

(1

保護ダイオード

I/O ピン

保護ダイオード

V

SS ai14784

1.

V

DD_FT

は、 5V 耐性入出力の電位で、 V

DD

と は異な り ます。

108/681 Rev 5 -日本語版

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RM0008

7.1.9

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

オル タ ネー ト 機能の構成

入出力ポー ト がオル タ ネー ト 機能に設定 さ れている場合には、

出力バ ッ フ ァ はオープ ン ド レ イ ン も し く はプ ッ シ ュ プル ・ モー ド で動作 し ます。

出力バッファはペリフェラル回路からの信号で駆動されます。 (オルタネート機能出力)

シ ュ ミ ッ ト ・ ト リ ガ入力は有効です。

高抵抗のプルア ッ プ、 プルダウ ン抵抗は無効にな り ます。

入出力ピ ン上のデー タ は、 APB2 ク ロ ッ ク ・ サイ クルご と に、 入力デー タ ・ レ ジ ス タ

に読込まれます。

オープ ン ド レ イ ン ・ モー ド では、 入力デー タ ・ レ ジ ス タ を読出す こ と で、 入出力ピ ン

の状態を得る こ と がで き ます。

プ ッ シ ュ プル ・ モー ド では、 出力デー タ ・ レ ジ ス タ を読み出す こ と で、 最後に出力レ

ジ ス タ に書込まれたデー タ を得る こ と がで き ます。

図  14 (109 ページ)

は、 オルタネート機能を選択した時の入出力ポートの状態を示していま

す。 同時に、

セ ク シ ョ ン 7.4: AFIO レ ジス タ (123 ページ)

をあわせて参照してください

オル タ ネー ト 機能入出力 (AFIO) レ ジ ス タ の設定で、 オル タ ネー ト 機能のピ ン割当て を変更

する こ と がで き ます。

図 14.

オル タ ネー ト 機能時のポー ト の構成

オンチップ

ペリフェラル

オルタネート機能入力

読込み on

書込み

読込み/書込み

入力ドライバ

TTLシュミット

トリガ

出力ドライバ

出力

コントロール

V

DD

P-MOS

V

SS

N-MOS

プッシュプルまたは

オープンドレイン

オンチップ

ペリフェラル

オルタネート機能出力

1.

V

DD_FT

は、 5V 耐性入出力の電位で、 V

DD

と は異な り ます。

V

DD

or V

DD_FT

(1)

保護ダイオード

I/O

ピン

VS S

保護ダイオード ai14785

Rev 5 -日本語版 109/681

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汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

7.1.10

RM0008

アナロ グ入力の構成

入出力ポー ト で アナ ロ グ入力が選択 さ れた と き には、

出力バ ッ フ ァ はデ ィ セーブル状態にな り ます。

入出力ピ ン に負荷を与え ないため、 シ ュ ミ ッ ト ・ ト リ ガ入力はオ フ状態 と な り ます。

シ ュ ミ ッ ト ・ ト リ ガ回路の出力は常に 0 と な り ます。

高抵抗のプルア ッ プ、 プルダウ ン抵抗は存在 し ません。 (デ ィ セーブル状態です。)

入力デー タ ・ レ ジ ス タ か らは、 0 が読出 さ れます。

図  15 (110 ページ) は、 ハイ ・ イ ン ピーダ ン ス ・ アナ ロ グ入力の構成を示 し ています。

図 15.

ハイ ・ イ ン ピーダ ン ス ・ アナ ロ グ入力の構成

オンチップ

ペリフェラル

読込み

アナログ入力

書込み

入力ドライバ

オフ

0

TTLシュミット

トリガ

V

DD

または V

DD_FT

(1)

保護ダイオード

I/O

ピン

保護ダイオード

V

SS

読込み/書込み

オンチップ

ペリフェラル ai14786

110/681 Rev 5 -日本語版

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RM0008

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

7.2 GPIO レ ジ ス タ

レ ジ ス タ の詳細記述で使用 さ れてい る略語については セ ク シ ョ ン  1.1 (32 ページ) を参照

し て く だ さ い。

7.2.1 ポー ト 構成レ ジ ス タ ( 下位 ) (GPIOx_CRL) (x=A..G)

ア ド レ スオ フ セ ッ ト : 0x00

リ セ ッ ト 値 : 0x4444 4444

31

CNF7[1:0]

30 29 28

MODE7[1:0] rw

15

CNF3[1:0] rw

14 rw

13 rw

12

MODE3[1:0]

27 26

CNF6[1:0] rw

11

CNF2[1:0] rw

10

25 24

MODE6[1:0] rw

9

MODE2[1:0] rw

8

23

CNF5[1:0]

22 rw

7

CNF1[1:0] rw

6 rw rw rw rw rw rw rw rw rw rw

21 20

MODE5[1:0] rw

5

MODE1[1:0] rw

4 rw rw

19

CNF4[1:0]

18 rw

3

CNF0[1:0] rw

2 rw rw

17 16

MODE4[1:0] rw

1

MODE0[1:0] rw

0 rw rw

Bits 31:30, 27:26, 23:22,

19:18, 15:14, 11:10, 7:6, 3:2

CNFx[1:0]: ポー ト x 構成ビ ッ ト (x = 0 .. 7)

こ れら のビ ッ ト は対応するポー ト の構成を指定する ため、 ソ フ ト ウ ェ アで書込ま

れます。

表  14: ポー ト ・ ビ ッ ト 構成表 (104 ページ)

を参照 し て く だ さ い。

入力モー ド 時 (MODE[1:0] = 00):

00: アナログ入力モー ド

01: フ ローテ ィ ング入力 ( リ セ ッ ト 時の値)

10: プルア ッ プ / プルダウン付きの入力

11: 予約値

出力モー ド 時 (MODE[1:0]

>

00):

00: プ ッ シ ュ プル ・ 汎用出力

01: オープ ン ド レ イ ン ・ 汎用出力

10: ブ ッ シ ュ プル ・ オル タ ネー ト 機能出力

11: オープ ン ド レ イ ン ・ オル タ ネー ト 機能

Bits 29:28, 25:24, 21:20,

17:16, 13:12, 9:8, 5:4, 1:0

MODEx[1:0]:

ポー ト x モー ド ビ ッ ト (x = 0 .. 7)

こ れら のビ ッ ト は対応するポー ト の構成を指定する ため、 ソ フ ト ウ ェ アで書込ま

れます。

表  14: ポー ト ・ ビ ッ ト 構成表 (104 ページ)

を参照 し て く だ さ い。

00: 入力モー ド ( リ セ ッ ト 時の値)

01: 出力モー ド 、 最大速度 10 MHz

10: 出力モー ド 、 最大速度 2 MHz

11: 出力モー ド 、 最大速度 50 MHz

Rev 5 -日本語版 111/681

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汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

RM0008

7.2.2 ポー ト 構成レ ジ ス タ ( 上位 ) (GPIOx_CRH) (x=A..G)

ア ド レ スオ フ セ ッ ト : 0x04

リ セ ッ ト 値 : 0x4444 4444

31 30 29

CNF15[1:0] rw

15 rw

14

CNF11[1:0] rw rw

28

MODE15[1:0] rw

13 rw

12

MODE11[1:0] rw rw

27 26

CNF14[1:0] rw

11 rw

10

CNF10[1:0] rw rw

25 24

MODE14[1:0] rw

9 rw

8

MODE10[1:0] rw rw

23 22

CNF13[1:0] rw

7 rw

6 rw

CNF9[1:0] rw

21 20

MODE13[1:0] rw

5 rw

4

MODE9[1:0] rw rw

19 18

CNF12[1:0] rw

3 rw

2 rw

CNF8[1:0] rw

17 16

MODE12[1:0] rw

1 rw

0

MODE8[1:0] rw rw

Bits 31:30, 27:26, 23:22,

19:18, 15:14, 11:10, 7:6, 3:2

CNFx[1:0]:

ポー ト x 構成ビ ッ ト (x = 8 .. 15)

こ れ らのビ ッ ト には対応するポー ト の構成を指定する ため、 ソ フ ト ウ ェ ア で書込

まれます。

表  14: ポー ト ・ ビ ッ ト 構成表 (104 ページ)

を参照 し て く だ さ い。

入力モー ド 時 (MODE[1:0] = 00):

00: アナログ入力モー ド

01: フ ローテ ィ ング入力 ( リ セ ッ ト 時の値)

10: プルア ッ プ / プルダウン付きの入力

11: 予約値

出力モー ド 時 (MODE[1:0]

>

00):

00: プ ッ シ ュ プル ・ 汎用出力

01: オープ ン ド レ イ ン ・ 汎用出力

10: ブ ッ シ ュ プル ・ オル タ ネー ト 機能出力

11: オープ ン ド レ イ ン ・ オル タ ネー ト 機能

Bits 29:28, 25:24, 21:20,

17:16, 13:12, 9:8, 5:4, 1:0

MODEx[1:0]: ポー ト x モー ド ビ ッ ト (x = 8 .. 15)

こ れ らのビ ッ ト には対応するポー ト の構成を指定する ため、 ソ フ ト ウ ェ ア で書込

まれます。

表  14: ポー ト ・ ビ ッ ト 構成表 (104 ページ)

を参照 し て く だ さ い。

00: 入力モー ド ( リ セ ッ ト 時の値)

01: 出力モー ド 、 最大速度 10 MHz

10: 出力モー ド 、 最大速度 2 MHz

11: 出力モー ド 、 最大速度 50 MHz

112/681 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

7.2.3

31

ポー ト 入力デー タ ・ レ ジ ス タ (GPIOx_IDR) (x=A..G)

ア ド レ スオ フ セ ッ ト : 0x08h

リ セ ッ ト 値 : 0x0000 XXXX

30 29 28 27 26 25 22 21 24 23

予約済み

20 19 18 17 16

15 14 13 12 11 10 9

IDR15 IDR14 IDR13 IDR12 IDR11 IDR10 IDR9 r r r r r r r

8

IDR8 r

7

IDR7 r

6

IDR6 r

5

IDR5 r

4

IDR4 r

3

IDR3 r

2

IDR2 r

1

IDR1 r

0

IDR0 r

Bits 31:16 予約済み、 常に 0 が読出 さ れます。

Bits 15:0 IDRx[15:0]: ポー ト 入力デー タ (x = 0 .. 15)

こ れら のビ ッ ト は読出 し 専用で、 そのア ク セスはワー ド モー ド に限ら れます。 こ れら のビ ッ ト には

対応するポー ト の入力値が格納 さ れています。

7.2.4

31

ポー ト 出力デー タ ・ レ ジ ス タ (GPIOx_ODR) (x=A..G)

ア ド レ スオ フ セ ッ ト : 0x0C

リ セ ッ ト 値 : 0x0000 0000

30 29 28 27 26 25 22 21 24

予約済み

23 20 19 18 17 16

15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0

ODR15 ODR14 ODR13 ODR12 ODR11 ODR10 ODR9 ODR8 ODR7 ODR6 ODR5 ODR4 ODR3 ODR2 ODR1 ODR0 rw rw rw rw rw rw rw rw rw rw rw rw rw rw rw rw

Bits 31:16 予約済み、 常に 0 が読出 さ れます。

Bits 15:0 ODRx[15:0]: ポー ト 出力デー タ (x= 0 .. 15)

こ れら のビ ッ ト はソ フ ト ウ ェ アで読出 し ・ 書込みがで き、 そのア ク セスはワー ド モー ド に限 られ

ます。

注 : 個別のビ ッ ト セ ッ ト / リ セ ッ ト 時には、 GPIOx_BSRR (x= A .. G) レ ジ ス タ 書込みで、 ODR ビ ッ ト

が個々にセ ッ ト / リ セ ッ ト さ れます。

Rev 5 -日本語版 113/681

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汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

RM0008

7.2.5 ポー ト ビ ッ ト ・ セ ッ ト / リ セ ッ ト ・ レ ジ ス タ (GPIOx_BSRR) (x=A..G)

ア ド レ スオ フ セ ッ ト : 0x10

リ セ ッ ト 値 : 0x0000 0000

31

BR15 w

15

BS15 w

30

BR14

29

BR13 w

14 w

13

BS14 w

BS13 w

28

BR12 w

12

BS12 w

27

BR11 w

11

BS11 w

26

BR10 w

10

BS10 w

25

BR9 w

9

BS9 w

24

BR8 w

8

BS8 w

23

BR7 w

7

BS7 w

22

BR6 w

6

BS6 w

21

BR5 w

5

BS5 w

20

BR4 w

4

BS4 w

19

BR3 w

3

BS3 w

18

BR2 w

2

BS2 w

17

BR1 w

1

BS1 w

Bits 31:16 BRx:

ビ ッ ト x リ セ ッ ト (x = 0 .. 15)

こ れ らのビ ッ ト は書込み専用で、 そのア ク セスはワー ド モー ド に限 られます。

0: 対応する ODRx ビ ッ ト の値は変化 し ません。

1: 対応する ODRx ビ ッ ト を リ セ ッ ト (ク リ ア) し ます。

注 : BSx ビ ッ ト と BRx ビ ッ ト の両方が 1 の時には、 BSx ビ ッ ト の指定 (セ ッ ト ) が優先 し

ます。

Bits 15:0 BSx:

ビ ッ ト x セ ッ ト (x = 0 .. 15)

こ れ らのビ ッ ト は書込み専用で、 そのア ク セスはワー ド モー ド に限 られます。

0: 対応する ODRx ビ ッ ト の値は変化 し ません。

1: 対応する ODRx ビ ッ ト を セ ッ ト し ます。

16

BR0 w

0

BS0 w

7.2.6

31

ポー ト ビ ッ ト ・ リ セ ッ ト ・ レ ジ ス タ (GPIOx_BRR) (x=A..G)

ア ド レ スオ フ セ ッ ト : 0x14

リ セ ッ ト 値 : 0x0000 0000

30 29 28 27 26 25 22 21 20 24

予約済み

23 19 18 17 16

15

BR15 w

14

BR14 w

13

BR13 w

12

BR12 w

11

BR11 w

10

BR10 w

9

BR9 w

8

BR8 w

7

BR7 w

6

BR6 w

5

BR5 w

4

BR4 w

3

BR3 w

2

BR2 w

1

BR1 w

Bits 31:16 予約済み

Bits 15:0 BRx: ビ ッ ト x リ セ ッ ト (x = 0 .. 15)

こ れら のビ ッ ト は書込み専用で、 そのア ク セスはワー ド モー ド に限ら れます。

0: 対応する ODRx ビ ッ ト の値は変化 し ません。

1: 対応する ODRx ビ ッ ト を リ セ ッ ト ( ク リ ア) し ます。

注 : BSx ビ ッ ト と BRx ビ ッ ト の両方が 1 の時には、 BSx ビ ッ ト の指定 (セ ッ ト ) が優先 し ま

す。

0

BR0 w

114/681 Rev 5 -日本語版

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RM0008

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

7.2.7 ポー ト 構成ロ ッ ク レ ジ ス タ (GPIOx_LCKR) (x=A..G)

こ のレ ジ ス タ は、 ビ ッ ト 16 (LCKK) に正 し い手順で書込みを行い、 ポー ト の個々のビ ッ ト

の構成を ロ ッ ク する ために使用 さ れます。 ビ ッ ト [15:0] の値は GPIO の構成を ロ ッ ク する

ために使われ、 書込み手順の間は LCKR[15:0] の値は同 じ でなければな り ません。 ポー ト

ビ ッ ト に対する LOCK の手順が終了する と 、 次の リ セ ッ ト ま で、 ポー ト ビ ッ ト の値を変更

する こ と がで き ません。

個々のロ ッ ク ビ ッ ト は、 制御レ ジ ス タ (CRL、 CRH) の対応する 4bit の設定値を固定 し ます。

ア ド レ スオ フ セ ッ ト : 0x18

リ セ ッ ト 値 : 0x0000 0000

31 30 29 28 27 26 25 24

予約済み

23 22 21 20 19 18 17 16

LCKK

15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 rw

0

LCK15 LCK14 LCK13 LCK12 LCK11 LCK10 LCK9 LCK8 LCK7 LCK6 LCK5 LCK4 LCK3 LCK2 LCK1 LCK0 rw rw rw rw rw rw rw rw rw rw rw rw rw rw rw rw

Bits 31:17 予約済み

Bit 16 LCKK[15:0]: ロ ッ ク ・ キー

こ のビ ッ ト は常時読出 し がで き ます。 ビ ッ ト 値の変更はロ ッ ク キー書込み手順に従っ て行 う

必要があ り ます。

0: ポー ト 構成ロ ッ ク ・ キーは無効です。

1: ポー ト 構成ロ ッ ク ・ キーが有効です。 GPIOx_LCKR レ ジ ス タ は MCU リ セ ッ ト が発生する ま

で ロ ッ ク さ れます。

ロ ッ ク ・ キー書込み手順 :

1 を書込む

0 を書込む

1 を書込む

0 を読込む

1 を読込む ( こ の読出 し は必ず し も必要あ り ませんが、 ロ ッ ク さ れた こ と を確認する ために有

効です。)

注 :

ロ ッ ク キー書込み手順の間は、 LCK[15:0] の値を変更する こ と はで き ません。

ロ ッ ク手順中にエ ラ ーが発生する と 、 手順は無効 と な り ます。

Bits 15:0 LCKy: ロ ッ ク ビ ッ ト y (x = 0 .. 15)

こ れら のビ ッ ト は読出 し ・ 書込みがで き ますが、 書込み時の LCKK ビ ッ ト は 0 にする必要が

あ り ます。

0: ポー ト 構成はロ ッ ク さ れません。

1: ポー ト 構成がロ ッ ク さ れます。

Rev 5 -日本語版 115/681

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参考資料

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

RM0008

7.3 オル タ ネー ト 入出力機能 と デバ ッ グ構成 (AFIO)

64 ピ ン、 100 ピ ン及び 144 ピ ンのパ ッ ケージに搭載 さ れてい る ペ リ フ ェ ラル回路を必要数

にあ っ た もの と する ために、 い く つかの回路機能を別のピ ン に割当て る こ と がで き ます。

こ れは ソ フ ト ウ ェ ア で

オル タ ネー ト 機能の再割当て と デバ ッ グ入出力構成レ ジ ス タ

(AFIO_MAPR) (124 ページ)

の設定を行 う こ と がで き ます。 こ の場合、 オル タ ネー ト 機能

の、 標準のピ ン割当ては無効 と な り ます。

7.3.1 GPIO ポー ト PC14/PC15 を OSC32_IN/OSC32_OUT ピ ン と し て使用するには

LSE オシ レー タ のピ ン OSC32_IN と OSC32_OUT は、 LSE オシ レ ー タ がオ フの場合、 汎用入

出力 PC14 及び PC15 と し てそれぞれ使用する こ と がで き ます。 LSE は、 GPIO 機能よ り 高

い優先順位を持 っ ています。

注意 : 1 PC14/PC15 は、 1.8V ド メ イ ンの電源がオ フ (STANDBY 状態 と な る) の場合あるいは、

V

BAT

(V

DD

の供給が断たれる) によ り バ ッ ク ア ッ プ ・ ド メ イ ンに電力供給 さ れている場合、

その GPIO 機能は無効にな り ます。 この場合、 入出力はアナ ログ入力モー ド にセ ッ ト さ れ

ます。

2 I/O の使い方の制限に関 し ては、 セ ク シ ョ ン  4.1.2 (49 ページ) を参照 し て く だ さ い。

7.3.2

注意 :

GPIO ポー ト PD0/PD1 を OSC_IN/OSC_OUT ピ ン と し て使用するには

外部オシ レー タ のピ ン OSC_IN と OSC_OUT は、

オル タ ネー ト 機能の再割当て と デバ ッ グ

入出力構成レ ジ ス タ (AFIO_MAPR)

の PD01_REMAP ビ ッ ト の設定で、 汎用入出力 (GPIO) の

PD0/PD1 信号に割当て る こ と がで き ます。

こ の割当て変更は、 36 ピ ン、 48 ピ ン、 64 ピ ンのパ ッ ケージ でのみ有効です。 (100 ピ ン及

び 144 ピ ンのパ ッ ケージ では PD0/PD1 には専用のピ ンが備え ら れているので、 こ の割当

て変更の必要はあ り ません。)

外部割込み / イ ベン ト 機能は、 再割当てで き ません。 36、 48 及び 64 ピ ンのパ ッ ケージで

は、 PD0 と PD1 を外部割込み / イ ベン ト 生成に使用する こ と は出来ません。

7.3.3 CAN オル タ ネー ト 機能のピ ン再割当て

CAN 信号は、

表  16

のよ う に、 ポー ト A、 ポー ト B も し く はポー ト D のピ ン に割当て変更

する こ と がで き ます。 ポー ト D は、 36、 48 及び 64 ピ ンのパ ッ ケージのデバイ ス では再割

当て る こ と は出来ません。

表 16.

CAN オル タ ネー ト 機能のピ ン割当て変更

オル タ ネー ト 機能

CAN_REMAP[1:0] =

“00”

CAN_REMAP[1:0] =

“10”

(1)

CAN_REMAP[1:0] =

“11”

(2)

CANRX

CANTX

PA11

PA12

PB8

PB9

PD0

PD1

1. 36 ピ ンパ ッ ケージ ではピ ン割当ての変更はで き ません。

2. PD0 と PD1 が OSC_IN と OSC_OUT に再割当て さ れていない場合、 ピ ン割当ての変更は、 100

ピ ン及び 144 ピ ンパ ッ ケージの場合のみ可能です。

116/681 Rev 5 -日本語版

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参考資料

RM0008

7.3.4

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

JTAG/SWD オル タ ネー ト 機能のピ ン割当て

デバッグ ・ インタフェース信号は、 表  17

のように、 GPIO ポートのピンに割当てされています。

表 17.

デバ ッ グ ・ イ ン タ フ ェ ース信号

オル タ ネー ト 機能

JTMS / SWDIO

JTCK / SWCLK

JTDI

JTDO / TRACESWO

JNTRST

TRACECK

TRACED0

TRACED1

TRACED2

TRACED3

GPIO ポー ト

PA13

PA14

PA15

PB3

PB4

PE2

PE3

PE4

PE5

PE6

デバ ッ グ時に GPIO で使用で き る ピ ンの割当て を最適化する ため、 オル タ ネー ト 機能の再

割当て と デバ ッ グ入出力構成レ ジス タ (AFIO_MAPR)

の SWJ_CFG[1:0] ビ ッ ト の設定で、 複

数のピ ン割当てから 選ぶ こ と がで き ます。 表  18

を参照 し て く だ さ い。

表 18.

デバ ッ グ ・ ポー ト のピ ン割当て

SWJ I/O ピ ンの割当て

SWJ

_CFG

[2:0]

利用可能なデバ ッ グ ・ ポー ト

PA.13 /

JTMS/

SWDIO

PA.14 /

JTCK/S

WCLK

PA.15 /

JTDI

PB.3 /

JTDO/

TRACE

SWO

PB.4/

JNTRST

000

001

010

100

フル SWJ (JTAG-DP + SW-DP)

( リ セ ッ ト 時の状態)

フル SWJ (JTAG-DP + SW-DP)、

JNTRST な し

JTAG-DP デ ィ セーブル及び

SW-DP イ ネーブル

JTAG-DP デ ィ セーブル及び

SW-DP デ ィ セーブル

X

X

X

自由

X

X

X

自由

X

X

自由

自由

その他 設定で き ません

1. 非同期 ト レース を使用 し ていない と き にのみ、 GPIO で使用で き ます。

X x

自由

(1)

自由

X

自由

自由

自由

Rev 5 -日本語版 117/681

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汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

7.3.5

RM0008

ADC オル タ ネー ト 機能のピ ン割当て

オル タ ネー ト 機能の再割当て と デバ ッ グ入出力構成レ ジ ス タ (AFIO_MAPR)

を参照 し て く だ

さ い。

表 19.

ADC1 外部 ト リ ガ ・ イ ン ジ ェ ク ト 変換オル タ ネー ト 機能のピ ン割当て

(1)

オル タ ネー ト 機能

ADC1_ETRGINJ_REMAP = 0 ADC1_ETRGINJ_REMAP = 1

ADC1 外部 ト リ ガ ・ イ ン ジ ェ ク

ト 変換

ADC1 外部 ト リ ガ ・ イ ン ジ ェ ク

ト 変換は EXTI15 へ接続

ADC1 外部 ト リ ガ ・ イ ン ジ ェ ク

ト 変換は TIM8_CH4 へ接続

1. 割当て変更は、 大容量デバイ スに限 り 利用出来ます。

表 20.

ADC1 外部 ト リ ガ ・ レギ ュ ラ 変換オル タ ネー ト 機能のピ ン割当て

(1)

オル タ ネー ト 機能

ADC1_ETRGREG_REMAP = 0 ADC1_ETRGREG_REMAP = 1

ADC1 外部 ト リ ガ ・ レギ ュ ラ変

ADC1 外部 ト リ ガ ・ レギ ュ ラ

変換は EXTI11 へ接続

ADC1 外部 ト リ ガ ・ レギ ュ ラ

変換は TIM8_TRGO へ接続

1. 割当て変更は、 大容量デバイ スに限 り 利用出来ます。

表 21.

ADC2 外部 ト リ ガ ・ イ ン ジ ェ ク ト 変換オル タ ネー ト 機能のピ ン割当て

(1)

オル タ ネー ト 機能

ADC2_ETRGINJ_REMAP = 0 ADC2_ETRGINJ_REMAP = 1

ADC2 外部 ト リ ガ ・ イ ン ジ ェ ク

ト 変換

ADC2 外部 ト リ ガ ・ イ ン ジ ェ ク

ト 変換は EXTI15 へ接続

ADC2 外部 ト リ ガ ・ イ ン ジ ェ ク

ト 変換は TIM8_CH4 へ接続

1. 割当て変更は、 大容量デバイ スに限 り 利用出来ます。

表 22.

ADC2 外部 ト リ ガ ・ レギ ュ ラ 変換オル タ ネー ト 機能のピ ン割当て

(1)

オル タ ネー ト 機能 ADC2_ETRGREG_REG = 0 ADC2_ETRGREG_REG = 1

ADC2 外部 ト リ ガ ・ レギ ュ ラ

変換

ADC2 外部 ト リ ガ ・ レギ ュ ラ

変換は EXTI11 へ接続

1. 割当て変更は、 大容量デバイ スに限 り 利用出来ます。

ADC2 外部 ト リ ガ ・ レギ ュ ラ

変換は TIM8_TRGO へ接続

118/681 Rev 5 -日本語版

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RM0008

7.3.6

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

タ イ マ ・ オル タ ネー ト 機能のピ ン割当て

タ イ マ 4 のチ ャ ネル 1 ~ 4 は、 ポー ト B と ポー ト D のいずれかに割当て ら れます。 他の

タ イ マ で変更可能な ピ ン割当ては

表  25

ない し

表  27

に示 さ れています。 同時に

オル タ ネー

ト 機能の再割当て と デバ ッ グ入出力構成レ ジス タ (AFIO_MAPR)

を参照 し て く だ さ い。

表 23.

タ イ マ 5 オル タ ネー ト 機能のピ ン割当て

オル タ ネー ト 機能 TIM5CH4_IREMAP = 0

(1)

TIM5CH4_IREMAP = 1

TIM5_CH4

TIM5 チ ャ ネル 4 は PA3 へ

接続

LSI の内部ク ロ ッ クは TIM5_CH4 入力へ較正の

目的で接続

1. 割当て変更は、 大容量デバイ スに限 り 利用出来ます。

表 24.

タ イ マ 4 オル タ ネー ト 機能のピ ン割当て

オル タ ネー ト 機能 TIM4_REMAP = 0 TIM4_REMAP = 1

(1)

TIM4_CH1

TIM4_CH2

TIM4_CH3

TIM4_CH4

PB6

PB7

PB8

PB9

PD12

PD13

PD14

PD15

1. 割当て変更は、 100 ピ ン と 144 ピ ンパ ッ ケージに限 り 利用出来ます。

表 25.

タ イ マ 3 オル タ ネー ト 機能のピ ン割当て

オル タ ネー ト 機能

TIM3_REMAP[1:0] = “00”

( 再割当てな し )

TIM3_REMAP[1:0] = “10”

( 部分的な再割当て )

TIM3_REMAP[1:0] = “11”

( 完全な再割当て )

(1)

TIM3_CH1

TIM3_CH2

TIM3_CH3

TIM3_CH4

PA6

PA7

PB0

PB1

PB4

PB5

PC6

PC7

PC8

PC9

1. 割当て変更は、 64 ピ ン、 100 ピ ン と 144 ピ ンパ ッ ケージに限 り 利用出来ます。

表 26.

タ イ マ 2 オル タ ネー ト 機能のピ ン割当て

オル タ ネー ト 機能

TIM2_REMAP[1:0]

= “00”        

(再割当てな し )

TIM2_REMAP[1:0]

= “01” ( 部分的

な再割当て )

TIM2_REMAP[1:0]

= “10” (部分的

な再割当て )

(1)

TIM2_REMAP[1:0]

= “11” ( 完全な

再割当て )

(1)

TIM2_CH1_ETR

(2)

TIM2_CH2

TIM2_CH3

TIM2_CH4

PA0

PA1

PA2

PA3

PA15

PB3

PA0

PA1

PB10

PB11

PA15

PB3

1. 割当て変更は 36 ピ ンパ ッ ケージ ではで き ません。

2. TIM_CH と TIM_ETR は同 じ ピ ン を共有 し ますが、 同時に使用する こ と は出来ません。 (そのた

め TIM2_CH1_ETR と い う 名称が付け られています )

Rev 5 -日本語版 119/681

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

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ていない場合があ り ます。 この資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

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報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

RM0008

表 27.

タ イ マ 1 オル タ ネー ト 機能のピ ン割当て

オル タ ネー ト 機能

再割当て

TIM1_REMAP[1:0] =

“00” ( 再割当てな し )

TIM1_REMAP[1:0] =

“01” ( 部分的再割当て )

TIM1_REMAP[1:0] = “11”

( 完全な再割当て )

(1)

TIM1_ETR

TIM1_CH1

TIM1_CH2

TIM1_CH3

PA12

PA8

PA9

PA10

TIM1_CH4

TIM1_BKIN

TIM1_CH1N

TIM1_CH2N

PB12

(2)

PB13

(2)

PB14

(2)

PB15

(2)

PA11

PA6

PA7

PB0

TIM1_CH3N PB1

1. 割当て変更は、 100 ピ ン と 144 ピ ンパ ッ ケージに限 り 利用出来ます。

2. 割当て変更は、 36 ピ ン ではで き ません。

PE7

PE9

PE11

PE13

PE14

PE15

PE8

PE10

PE12

120/681 Rev 5 -日本語版

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RM0008

7.3.7

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

USART オル タ ネー ト 機能のピ ン割当て

オル タ ネー ト 機能の再割当て と デバ ッ グ入出力構成レ ジ ス タ (AFIO_MAPR)

の記述を参照し

てください。

表 28.

USART3 ピ ン割当て

オル タ ネー ト 機能

USART3_REMAP[1:0] =

“00” ( 再割当てな し )

USART3_REMAP[1:0] =

“01” ( 部分的再割当て )

(1)

USART3_REMAP[1:0] =

“11” ( 完全な再割当て )

(2)

USART3_TX

USART3_RX

USART3_CK

USART3_CTS

USART3_RTS

PB10

PB11

PB12

PB13

PB14

PC10

PC11

PC12

PD8

PD9

PD10

PD11

PD12

1. 割当て変更は、 64 ピ ン、 100 ピ ン と 144 ピ ンパ ッ ケージに限 り 利用出来ます。

2. 割当て変更は、 100 ピ ン と 144 ピ ンパ ッ ケージに限 り 利用出来ます。

表 29.

USART2 ピ ン割当て

オル タ ネー ト 機能 USART2_REMAP = 0 USART2_REMAP = 1

(1)

USART2_CTS

USART2_RTS

USART2_TX

USART2_RX

PA0

PA1

PA2

PA3

USART2_CK PA4

1. 割当て変更は、 100 ピ ン と 144 ピ ンパ ッ ケージに限 り 利用出来ます。

表 30.

USART1 ピ ン割当て

オル タ ネー ト 機能 USART1_REMAP = 0

USART1_TX

USART1_RX

PA9

PA10

PD3

PD4

PD5

PD6

PD7

USART1_REMAP = 1

PB6

PB7

Rev 5 -日本語版 121/681

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汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

7.3.8

7.3.9

RM0008

I2C 回路 1 オル タ ネー ト 機能のピ ン割当て

オル タ ネー ト 機能の再割当て と デバ ッ グ入出力構成レ ジ ス タ (AFIO_MAPR)

の記述を参照し

てください。

表 31.

I2C1 ピ ン割当て

オル タ ネー ト 機能

I2C1_SCL

I2C1_SDA

1. 割当て変更は、 36 ピ ン ではで き ません。

I2C1_REMAP = 0

PB6

PB7

I2C1_REMAP = 1

(1)

PB8

PB9

SPI 回路 1 オル タ ネー ト 機能のピ ン割当て

オル タ ネー ト 機能の再割当て と デバ ッ グ入出力構成レ ジ ス タ (AFIO_MAPR)

の記述を参照し

てください。

表 32.

SPI1 ピ ン割当て

オル タ ネー ト 機能

SPI1_NSS

SPI1_SCK

SPI1_MISO

SPI1_MOSI

SPI1_REMAP = 0

PA4

PA5

PA6

PA7

SPI1_REMAP = 1

PA15

PB3

PB4

PB5

122/681 Rev 5 -日本語版

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参考資料

RM0008

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

7.4 AFIO レ ジス タ

レ ジ ス タ の詳細記述で使用 さ れてい る略語については セ ク シ ョ ン  1.1 (32 ページ) を参照

し て く だ さ い。

7.4.1

31 30

イ ベン ト 制御レ ジ ス タ (AFIO_EVCR)

ア ド レ スオ フ セ ッ ト : 0x00

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23

予約済み

22 21 20 19 18 17 16

15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0

予約済み EVOE rw rw

PORT[2:0] rw rw rw rw

PIN[3:0] rw rw

Bits 31:8 予約済み

Bit 7 EVOE

イ ベン ト 出力イ ネーブル

こ のビ ッ ト は ソ フ ト ウ ェ アか ら セ ッ ト / ク リ アがで き ます。 こ のビ ッ ト がセ ッ ト さ れている と き

には、 Cortex の EVENT OUT 出力が、 PORT[2:0] 及び PIN[3:0] bit で選択 さ れた ピ ンに出力 さ れま

す。

Bits 6:4 PORT[2:0]:

ポー ト 選択

こ れ らのビ ッ ト は、 Cortex EVENT OUT 信号を出力するポー ト を指定する ため、 ソ フ ト ウ ェ アから

セ ッ ト / ク リ アがで き ます。

000: PA が選択 さ れます

001: PB が選択 さ れます

010: PC が選択 さ れます

011: PD が選択 さ れます

100: PE が選択 さ れます

Bits 3:0 PIN[3:0] ピ ン選択 (x = A .. E)

こ れ らのビ ッ ト は、 Cortex EVENT OUT 信号を出力する ピ ン を指定する ため、 ソ フ ト ウ ェ アから

セ ッ ト / ク リ アがで き ます。

0000: Px0 が選択 さ れます

0001: Px1 が選択 さ れます

0010: Px2 が選択 さ れます

0011: Px3 が選択 さ れます

...

1111: Px15 が選択 さ れます

Rev 5 -日本語版 123/681

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参考資料

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

RM0008

7.4.2

31 30

オル タ ネー ト 機能の再割当て と デバ ッ グ入出力構成レ ジ ス タ (AFIO_MAPR)

ア ド レ スオ フ セ ッ ト : 0x04

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22

予約済み

14 13

CAN_REMAP

[1:0] rw rw

12

TIM4_

REMAP rw

11 w

10

TIM3_REMAP

[1:0] rw rw

SWJ_

CFG[2:0] w

9 w

8

TIM2_REMAP

[1:0] rw rw

予約済み

7 6

TIM1_REMAP

[1:0] rw rw

21 20 19 18 17 16

ADC2_

ETRGR

EG_RE

MAP

ADC2_

ETRGIN

J_REM

AP

ADC1_

ETRGR

EG_RE

MAP

ADC1_

ETRGIN

J_REM

AP

TIM5CH

4_IREM

AP

5 rw

4

USART3_

REMAP[1:0] rw rw rw rw rw

3

USART

2_

REMAP rw

2

USART

1_

REMAP rw

1

I2C1_

REMAP rw rw

0

SPI1_

REMAP rw

15

PD01_

REMAP rw

Bits 31:27 予約済み

Bits 26:24 SWJ_CFG[2:0]:

シ リ アル ・ ワ イヤ JTAG 構成

こ れ らのビ ッ ト は書込みのみにな り ます。 ( 読込む場合は値は未定義にな り ます。) これ らのビ ッ

ト は SWJ (Serial Wire JTAG) と ト レース ・ オル タ ネー ト 機能入出力を設定 し ます。 SWJ は JTAG

も し く は SWD によ る Cortex デバ ッ グ出力へのア ク セス をサポー ト し ます。 リ セ ッ ト 直後のデ

フ ォル ト 値は SWJ オン で、 ト レースな し です。 こ の と き JTMS/JTCK ピ ン に特定のシーケ ン ス を

送る こ と で、 JTAG も し く は SW モー ド が有効 と な り ます。

000: フ ル SWJ (JTAG-DP + SW-DP) ( リ セ ッ ト 時の状態)

001: フ ル SWJ (JTAG-DP + SW-DP)、 JNTRST な し

010: JTAG-DP デ ィ セーブル及び SW-DP イ ネーブル

100: JTAG-DP デ ィ セーブル及び SW-DP デ ィ セーブル

他の値の設定はで き ません。

Bits 23:21 予約済み

Bits 20 ADC2_ETRGREG_REMAP ADC 2 外部 ト リ ガ ・ レギ ュ ラ ー変換割当て

ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。 こ のビ ッ ト は、 ADC2 外部 ト リ ガ ・ レギ ュ ラ ー変換

に接続 さ れている ト リ ガ入力を制御 し ます。 こ のビ ッ ト がセ ッ ト さ れる と 、 ADC2 外部 ト リ ガ ・

レギ ュ ラ ー変換は EXTI11 へ接続 さ れます。 こ のビ ッ ト が リ セ ッ ト さ れる と 、 ADC2 外部イ ベン ト

レギ ュ ラ ー変換は TIM8_TRGO へ接続 さ れます。

Bits 19 ADC2_ETRGINJ_REMAP

ADC 2 外部 ト リ ガ ・ イ ン ジ ェ ク ト 変換割当て

ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。 こ のビ ッ ト は、 ADC2 外部 ト リ ガ入力変換に接続 さ

れている ト リ ガ入力を制御 し ます。 こ のビ ッ ト がセ ッ ト さ れる と 、 ADC2 外部 ト リ ガ入力変換は

EXTI15 へ接続 さ れます。 こ のビ ッ ト が リ セ ッ ト さ れる と 、 ADC2 外部イ ベン ト 入力変換は

TIM8_Channel4 へ接続 さ れます。

Bits 18 ADC1_ETRGREG_REMAP ADC 1 外部 ト リ ガ ・ レギ ュ ラ ー変換割当て

ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。 こ のビ ッ ト は、 ADC1 外部 ト リ ガ ・ レギ ュ ラ ー変換

に接続 さ れている ト リ ガ入力を制御 し ます。 こ のビ ッ ト がセ ッ ト さ れる と 、 ADC1 外部 ト リ ガ ・

レギ ュ ラ ー変換は EXTI11 へ接続 さ れます。 こ のビ ッ ト が リ セ ッ ト さ れる と 、 ADC1 外部イ ベン ト

レギ ュ ラ ー変換は TIM8_TRGO へ接続 さ れます。

Bits 17 ADC1_ETRGINJ_REMAP

ADC 1 外部 ト リ ガ入力変換割当て

ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。 こ のビ ッ ト は、 ADC1 外部 ト リ ガ入力変換に接続 さ

れている ト リ ガ入力を制御 し ます。 こ のビ ッ ト がセ ッ ト さ れる と 、 ADC1 外部 ト リ ガ入力変換は

EXTI15 へ接続 さ れます。 こ のビ ッ ト が リ セ ッ ト さ れる と 、 ADC1 外部イ ベン ト 入力変換は

TIM8_Channel4 へ接続 さ れます。

124/681 Rev 5 -日本語版

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参考資料

RM0008

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

Bits 16 TIM5CH4_IREMAP

TIM5 チ ャ ネル 4 内部割当て

ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。 こ のビ ッ ト は、 TIM5_CH4 内部割当て を制御 し ます。

リ セ ッ ト さ れる と 、 TIM5_CH4 は PA3 へ接続 さ れます。 セ ッ ト さ れる と 、 LSI 内部 ク ロ ッ ク は較正

の目的で TIM5_CH4 へ接続 さ れます。

Bit 15 PD01_REMAP:

OSC_IN/OSC_OUT 上のポー ト D0/D1 のピ ン割当て

こ のビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。 こ のビ ッ ト は GPIO 機能の PD0 と PD1

のピ ン割当て を設定 し ます。 HSE オシ レー タ が使用 さ れない と き (ア プ リ ケーシ ョ ンが内部の 8

MHz RC で実行 さ れている と き) には、 OSC_IN と OSC_OUT ピ ンは PD0 及び PD1 と し て使用で き

ます。 こ の割当ては 36、 48、 64 ピ ンパ ッ ケージ で利用で き ます。 (100 ピ ン及び 144 ピ ンのパ ッ

ケージでは別に PD0、 PD1 ピ ンがある ため、 こ の割当ては使用 し ません。)

0: PD0、 PD1 は OSC_IN、 OSC_OUT ピ ンに割当てがで き ません。

1: OSC_IN ピ ンは PD0 と し て、 OSC_OUT ピ ンは PD1 と し て割当て ます。

Bits 14:13 CAN_REMAP[1:0]:

CAN オル タ ネー ト 機能のピ ン割当て

こ れ らのビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き、 オル タ ネー ト 機能 CANRX と CANTX の

ピ ン割当てがで き ます。

00: CANRX と し て PA11 ピ ンが、 CABTX と し て PA12 ピ ン を割当て ます。

01: 予約値

10: CANRX と し て PB8 ピ ンが、 CABTX と し て PB9 ピ ン を割当て ます。

(36 ピ ンパ ッ ケージ では使用で き ません。)

11: CANRX と し て PD0 ピ ンが、 CABTX と し て PD1 ピ ン を割当て ます。

Bit 12 TIM4_REMAP:

TIM4 機能のピ ン割当て

こ のビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き、 GPIO ポー ト の TIM4 のチ ャ ネル 1 ~ 4 のピ

ン割当てが設定 さ れます。

0: 割当て変更な し (TIM4_CH1/PB6、 TIM4_CH2/PB7、 TIM4_CH3/PB8、 TIM4_CH4/PB9)

1: 割当て変更あ り (TIM4_CH1/PD12、 TIM4_CH2/PD13、 TIM4_CH3/PD14、 TIM4_CH4/PD15)

注 : PE0 ピ ンに割当て さ れている TIM4_ETR は再割当で き ません。

Bits 11:10 TIM3_REMAP[1:0]:

TIM3 機能のピ ン割当て

こ れ らのビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き、 GPIO ポー ト の TIM3 のチ ャ ネル 1 ~ 4

のピ ン割当てが設定で き ます。

00: 割当て変更な し (CH1/PA6、 CH2/PA7、 CH3/PB0、 CH4/PB1)

01: こ の値は指定で き ません。

10: 部分的な割当て変更 (CH1/PB4、 CH2/PB5、 CH3/PB0、 CH4/PB1)

11: 全面的な割当て変更 (CH1/PC6、 CH2/PC7、 CH3/PC8、 CH4/PC9)

注 : PE0 ピ ンに割当て ら れている TIM3_ETR は変更で き ません。

Bits 9:8 TIM2_REMAP[1:0]:

TIM2 機能のピ ン割当て

こ れ らのビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き、 GPIO ポー ト の TIM2 のチ ャ ネル 1 ~ 4

と 外部 ト リ ガ (ETR) のピ ン割当てが設定で き ます。

00: 割当て変更な し (CH1/ETR/PA0、 CH2/PA1、 CH3/PA2、 CH4/PA3)

01: 部分的な割当て変更 (CH1/ETR/PA15、 CH2/PB3、 CH3/PA2、 CH4/PA3)

10: 部分的な割当て変更 (CH1/ETR/PA0、 CH2/PA1、 CH3/PB10、 CH4/PB11)

11: 全面的な割当て変更 (CH1/ETR/PA15、 CH2/PB3、 CH3/PB10、 CH4/PB11)

Rev 5 -日本語版 125/681

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参考資料

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

RM0008

Bits 7:6 TIM1_REMAP[1:0]:

TIM1 機能のピ ン割当て

こ れ らのビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き、 GPIO の TIM2 のチ ャ ネル 1 ~ 4、 1N ~

3N と 外部 ト リ ガ (ETR)、 ブ レー ク 入力 (BKIN) のピ ン割当てが設定で き ます。

00: 割当て変更な し (ETR/PA12、 CH1/PA8、 CH2/PA9、 CH3/PA10、 CH4/PA11、 BKIN/PB12、

CH1N/PB13、 CH2N/PB14、 CH3N/PB15)

01: 部分的な割当て変更 (ETR/PA12、 CH1/PA8、 CH2/PA9、 CH3/PA10、 CH4/PA11、 BKIN/PA6、

CH1N/PA7、 CH2N/PB0、 CH3N/PB1)

10: こ の値は指定で き ません。

11: 全面的な割当て変更 (ETR/PE7、 CH1/PE9、 CH2/PE11、 CH3/PE13、 CH4/PE14、 BKIN/PE15、

CH1N/PE8、 CH2N/PE10、 CH3N/PE12)

Bits 5:4 USART3_REMAP[1:0]:

USART3 機能のピ ン割当て

こ れ らのビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き、 UART3 の CTS、 RTS、 CK、 TX、 RX ピ ン

の割当てが設定で き ます。

00: 割当て変更な し (TX/PB10、 RX/PB11、 CK/PB12、 CTS/PB13、 RTS/PB14)

01: 部分的な割当て変更 (TX/PC10、 RX/PC11、 CK/PC12、 CTS/PB13、 RTS/PB14)

10: こ の値は設定で き ません。

11: 全面的な割当て変更 (TX/PD8、 RX/PD9、 CK/PD10、 CTS/PD11、 RTS/PD12)

Bit 3 USART2_REMAP: USART2 機能のピ ン割当て

こ れ らのビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き、 UART2 の CTS、 RTS、 CK、 TX、 RX ピ ン

の割当てが設定で き ます。

0: 割当て変更な し (CTS/PA0、 RTS/PA1、 TX/PA2、 RX/PA3、 CK/PA4)

1: 割当て変更あ り (CTS/PD3、 RTS/PD4、 TX/PD5、 RX/PD6、 CK/PD7)

Bit 2 USART1_REMAP:

USART1 機能のピ ン割当て

こ れ らのビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き、 UART1 の TX、 RX ピ ンの割当てが設定

で き ます。

0: 割当て変更な し (TX/PA9、 RX/PA10)

1: 割当て変更あ り (TX/PB6、 RX/PB7)

Bit 1 II2C1_REMAP:

I

2

C 1 機能のピ ン割当て

こ れ らのビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き、 I

2

C 1 の SCL と SDA ピ ンの割当てが設

定で き ます。

0: 割当て変更な し (SCL/PB6、 SDA/PB7)

  1: 割当て変更あ り (SCL/PB8、 SDA/PB9)

Bit 0

SPI1_REMAP: SPI 1 機能のピ ン割当て

こ れ らのビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き、 SPI 1 の NSS、 SCK、 MISO、 MOSI ピ ン

の割当てが設定で き ます。

0: 割当て変更な し (NSS/PA4、 SCK/PA5、 MISO/PA6、 MOSI/PA7)

1: 割当て変更あ り (NSS/PA15、 SCK/PB3、 MISO/PB3、 MOSI/PB5)

126/681 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

7.4.3

31 30

外部割込み構成レ ジ ス タ 1 (AFIO_EXTICR1)

ア ド レ スオ フ セ ッ ト : 0x08

リ セ ッ ト 値 : 0x0000

29 28 27 26 25 24 23

予約済み

22 21 20 19 18 17 16

15 14 13

EXTI3[3:0] rw rw

12 11 10 9

EXTI2[3:0] rw rw

8 7 6 5

EXTI1[3:0] rw rw

4 3 2 1

EXTI0[3:0] rw rw

0 rw rw rw rw rw rw rw rw

Bits 31:16

予約済み

Bits 15:0 EXTIx[3:0]: EXTI x 構成 (x= 0 ~ 3)

こ れ らのビ ッ ト には EXTIx 外部割込みのソ ース と な る信号の選択を、 ソ フ ト ウ ェ アで書込む こ と が

で き ます。 詳細は セ ク シ ョ ン 8.2.5: 外部割込み / イ ベン ト ラ イ ンの割当て (136 ページ)

を参照 し て

く だ さ い。

0000: PA[x] ピ ン

0001: PB[x] ピ ン

0010: PC[x] ピ ン

0011: PD[x] ピ ン

0100: PE[x] ピ ン

0101: PF[x] ピ ン

0110: PG[x] ピ ン

7.4.4

31 30

外部割込み構成レ ジ ス タ 2 (AFIO_EXTICR2)

ア ド レ スオ フ セ ッ ト : 0x0C

リ セ ッ ト 値 : 0x0000

29 28 27 26 25 24 23

予約済み

22 21 20 19 18 17 16

15 14 13

EXTI7[3:0]

12 11 10 9

EXTI6[3:0]

8 7 6 5

EXTI5[3:0]

4 3 2 1

EXTI4[3:0]

0 rw rw rw rw rw rw rw rw rw rw rw rw rw rw rw

Bits 31:16 予約済み

Bits 15:0 EXTIx[3:0]: EXTI x 構成 (x= 4 ~ 7)

これ らのビ ッ ト には EXTIx 外部割込みの ソ ース と な る信号の選択を、 ソ フ ト ウ ェ ア で書込む

こ と がで き ます。

0000: PA[x] ピ ン

0001: PB[x] ピ ン

0010: PC[x] ピ ン

0011: PD[x] ピ ン

0100: PE[x] ピ ン

0101: PF[x] ピ ン

0110: PG[x] ピ ン rw

Rev 5 -日本語版 127/681

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参考資料

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

RM0008

7.4.5

31 30

外部割込み構成レ ジ ス タ 3 (AFIO_EXTICR3)

ア ド レ スオ フ セ ッ ト : 0x10

リ セ ッ ト 値 : 0x0000

29 28 27 26 25 24 23

予約済み

22 21 20 19 18 17 16

15 14 13

EXTI11[3:0] rw rw

12 11 10 9

EXTI10[3:0] rw rw

8 7 6 5

EXTI9[3:0] rw rw

4 3 2 1

EXTI8[3:0] rw rw rw rw rw rw rw rw rw

Bits 31:16 予約済み

Bits 15:0

EXTIx[3:0]: EXTI x 構成 (x= 8 ~ 11)

こ れら のビ ッ ト には EXTIx 外部割込みのソ ース と な る信号の選択を、 ソ フ ト ウ ェ ア で書

込む こ と がで き ます。

0000: PA[x] ピ ン

0001: PB[x] ピ ン

0010: PC[x] ピ ン

0011: PD[x] ピ ン

0100: PE[x] ピ ン

0101: PF[x] ピ ン

0110: PG[x] ピ ン

7.4.6

31 30

外部割込み構成レ ジ ス タ 4 (AFIO_EXTICR4)

ア ド レ スオ フ セ ッ ト : 0x14

リ セ ッ ト 値 : 0x0000

29 28 27 26 25 24 23

予約済み

22 21 20 19 18 17

0 rw

16

15 14 13

EXTI15[3:0] rw rw

12 11 10 9

EXTI14[3:0] rw rw

8 7 6 5

EXTI13[3:0] rw rw

4 3 2 1

EXTI12[3:0] rw rw

0 rw rw rw rw rw rw rw rw

Bits 31:16 予約済み

Bits 15:0 EXTIx[3:0]: EXTI x 構成 (x= 12 ~ 15)

これ らのビ ッ ト には EXTIx 外部割込みの ソ ース と な る信号の選択を、 ソ フ ト ウ ェ ア で書込む こ と

がで き ます。

0000: PA[x] ピ ン

0001: PB[x] ピ ン

0010: PC[x] ピ ン

0011: PD[x] ピ ン

0100: PE[x] ピ ン

0101: PF[x] ピ ン

0110: PG[x] ピ ン

128/681 Rev 5 -日本語版

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参考資料

RM0008

汎用入出力 と オル タ ネー ト 機能入出力 (GPIO、 AFIO)

7.5 GPIO ・ AFIO レ ジス タ ・ マ ッ プ

レ ジ ス タ のア ド レ ス範囲に関 し ては 表  1 (36 ページ) を参照 し て く だ さ い。 次の表は、

GPIO と AFIO レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 値を示 し ています。

表 33.

オ フ

セ ッ ト

0x00

0x04

0x08

0x0C

0x10

0x14

0x18

表 34.

オ フ

セ ッ ト

GPIO -レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値

レ ジス タ

GPIOx_CRL

リ セ ッ ト 値

GPIOx_CRH

リ セ ッ ト 値

GPIOx_IDR

リ セ ッ ト 値

GPIOx_ODR

リ セ ッ ト 値

GPIOx_BSRR

リ セ ッ ト 値

GPIOx_BRR

リ セ ッ ト 値

GPIOx_LCKR

リ セ ッ ト 値

CNF

7

[1:0]

MODE

7

[1:0]

CNF

6

[1:0]

MODE

6

[1:0]

CNF

5

[1:0]

MODE

5

[1:0]

CNF

4

[1:0]

MODE

4

[1:0]

CNF

3

[1:0]

MODE

3

[1:0]

CNF

2

[1:0]

MODE

2

[1:0]

CNF

1

[1:0]

MODE

1

[1:0]

CNF

0

[1:0]

MODE

0

[1:0]

0 1 0 0 0 1 0 0 0 1 0 0 0 1 0 0 0 1 0 0 0 1 0 0 0 1 0 0 0 1 0 0

CNF

15

[1:0]

MODE

15

[1:0]

CNF

14

[1:0]

MODE

14

[1:0]

CNF

13

[1:0]

MODE

13

[1:0]

CNF

12

[1:0]

MODE

12

[1:0]

CNF

11

[1:0]

MODE

11

[1:0]

CNF

10

[1:0]

MODE

10

[1:0]

CNF

9

[1:0]

MODE

9

[1:0]

CNF

8

[1:0]

MODE

8

[1:0]

0 1 0 0 0 1 0 0 0 1 0 0 0 1 0 0 0 1 0 0 0 1 0 0 0 1 0 0 0 1 0 0

IDR[15:0]l

予約済み

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

ODR[15:0]

予約済み

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

BR[15:0] BSR[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

BR[15:0]

予約済み

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

LCK[15:0]

予約済み

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

AFIO -レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値

レ ジス タ

0x00

AFIO_EVCR

リ セ ッ ト 値

予約済み

PORT[2:0] PIN[3:0]

0 0 0 0 0 0 0

0x04

AFIO_MAPR

予約済み

予約済み

0x08

0x0C

0x10

0x14

リ セ ッ ト 値

AFIO_EXTICR1

リ セ ッ ト 値

AFIO_EXTICR2

リ セ ッ ト 値

AFIO_EXTICR3

リ セ ッ ト 値

AFIO_EXTICR4

リ セ ッ ト 値

0 0 0

予約済み

予約済み

予約済み

予約済み

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

EXTI3[3:0] EXTI2[3:0] EXTI1[3:0] EXTI0[3:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

EXTI7[3:0] EXTI6[3:0] EXTI5[3:0] EXTI4[3:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

EXTI11[3:0] EXTI10[3:0] EXTI9[3:0] EXTI8[3:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

EXTI15[3:0] EXTI14[3:0] EXTI13[3:0] EXTI12[3:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

Rev 5 -日本語版 129/681

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参考資料

割込み と イ ベン ト

8 割込み と イ ベン ト

RM0008

Flash メ モ リ 容量が 32 ~ 128 キロバイ ト の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン

ト ロー ラ は、 中容量デバイ ス です。

Flash メ モ リ 容量が 256 ~ 512 キロバイ ト の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン

ト ロー ラ は、 大容量デバイ ス です。

こ のセ ク シ ョ ンは、 注意書きがない限 り 、 STM32F10xxx フ ァ ミ リ 全てに適応 さ れます。

8.1

8.1.1

8.1.2

ネス ト 化 さ れたベ ク タ 割込み コ ン ト ロー ラ (NVIC)

主な機能

60 個のマ ス ク可能な割込みチ ャ ネル( Cortex ™ -M3 の 16 個の割込み ラ イ ンは数に含ま

れていません。)

プ ロ グ ラ ム可能な 16 の優先レ ベル (4bit の優先割込みを使用)

遅延時間の少ない例外及び割込みハン ド リ ン グ

電力管理制御

シ ス テム制御レ ジ ス タ の実装

NVIC と プ ロ セ ッ サ コ アのイ ン タ フ ェ ース と は密接に結びついてお り 、 割込み処理の遅延

時間を小 さ く し 、 遅れて リ ク エ ス ト さ れた割込みを効率的に処理で き る よ う に工夫 さ れて

います。

コ アの例外を含むすべての割込みは NVIC で管理 さ れます。 例外 と NVIC のプ ロ グ ラ ミ ン

グに関 し ては、 ARM

Cortex ™ -M3 テ ク ニ カル ・ リ フ ァ レ ン ス ・ マニ ュ アル

の 「5 章 例外」

と 「8 章 ネス ト 化 さ れた割込み コ ン ト ロー ラ」 の章を参照 し て く だ さ い。

SysTick 較正値レ ジ ス タ

SysTick 較正値は 9000 に固定 さ れてお り 、 SysTick ク ロ ッ ク が 9 MHz ( 最大値 HCLK/8) の

時に 1 ms の タ イ ムベースが生成 さ れます。

割込み ・ 例外ベ ク タ

表 35.

ベ ク タ テーブル

優先種別 項目 (略称)

-

-3

-

固定

-

Reset

詳細 ア ド レ ス

0x0000_0000

0x0000_0004

-2 固定 NMI

-1 固定 HardFault

0 設定可能 MemManage

予約済み

リ セ ッ ト

ノ ン マス カ ブル割込み。 RCC ク

ロ ッ ク ・ セキ ュ リ テ ィ ・ シ ス テム

(CSS) は こ こ に接続 さ れています。

すべての異常

メ モ リ 管理

0x0000_0008

0x0000_000C

0x0000_0010

130/681 Rev 5 -日本語版

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参考資料

RM0008

割込み と イ ベン ト

3 設定可能 SVCall

4 設定可能 Debug Monitor

-

5 設定可能 PendSV

0

1

2

6 設定可能 SysTick

7 設定可能 WWDG

8 設定可能 PVD

9 設定可能 TAMPER

3 10 設定可能 RTC

4 11 設定可能 FLASH

5 12 設定可能 RCC

6 13 設定可能 EXTI0

7 14 設定可能 EXTI1

8 15 設定可能 EXTI2

9 16 設定可能 EXTI3

10 17 設定可能 EXTI4

11 18 設定可能 DMA_Channel1

12 19 設定可能 DMA_Channel2

13 20 設定可能 DMA_Channel3

14 21 設定可能 DMA_Channel4

15 22 設定可能 DMA_Channel5

16 23 設定可能 DMA_Channel6

17 24 設定可能 DMA_Channel7

18 25 設定可能 ADC1_2

19 26 設定可能

USB_HP_CAN_

TX

20 27 設定可能

USB_LP_CAN_

RX0

21 28 設定可能 CAN_RX1

表 35.

ベ ク タ テーブル (続き)

優先種別 項目 (略称)

1 設定可能 BusFault

2 設定可能 UsageFault

-

詳細 ア ド レ ス

プ リ フ ェ ッ チ異常、 メ モ リ ・ ア ク セ

ス異常

未定義命令も し く は異常状態

予約済み

SWI 命令によ る シ ス テム ・ サービ ス

コ ール

デバ ッ グ ・ モ ニ タ

予約

ペンデ ィ ング可能なシ ス テムサービ

ス ・ リ ク エス ト

シ ス テム ・ テ ィ ッ ク ・ タ イ マ

Window 型ウ ォ ッ チ ド ッ グ割込み

PVD 検出割込み (EXTI 経由)

タ ンパ (改ざん) 割込み

RTC グローバル 割込み

Flash グローバル割込み

RCC グローバル割込み

EXTI ラ イ ン 0 割込み

EXTI ラ イ ン 1 割込み

EXTI ラ イ ン 2 割込み

EXTI ラ イ ン 3 割込み

EXTI ラ イ ン 4 割込み

DMA チ ャ ネル 1 グローバル割込み

DMA チ ャ ネル 2 グローバル割込み

DMA チ ャ ネル 3 グローバル割込み

DMA チ ャ ネル 4 グローバル割込み

DMA チ ャ ネル 5 グローバル割込み

DMA チ ャ ネル 6 グローバル割込み

DMA チ ャ ネル 7 グローバル割込み

ADC グローバル割込み

USB 優先割込み、 も し く は

CAN TX 割込み

USB 非優先割込み、 も し く は CAN

RX0 割込み

CAN RX1 割込み

0x0000_0014

0x0000_0018

0x0000_001C -

0x0000_002B

0x0000_002C

0x0000_0030

0x0000_0034

0x0000_0038

0x0000_003C

0x0000_0040

0x0000_0044

0x0000_0048

0x0000_004C

0x0000_0050

0x0000_0054

0x0000_0058

0x0000_005C

0x0000_0060

0x0000_0064

0x0000_0068

0x0000_006C

0x0000_0070

0x0000_0074

0x0000_0078

0x0000_007C

0x0000_0080

0x0000_0084

0x0000_0088

0x0000_008C

0x0000_0090

0x0000_0094

Rev 5 -日本語版 131/681

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参考資料

割込み と イ ベン ト

表 35.

ベ ク タ テーブル (続き)

優先種別 項目 (略称)

22 29 設定可能 CAN_SCE

23 30 設定可能 EXTI9_5

24 31 設定可能 TIM1_BRK

25 32 設定可能 TIM1_UP

26 33 設定可能 TIM1_TRG_COM

27 34 設定可能 TIM1_CC

28 35 設定可能 TIM2

29 36 設定可能 TIM3

30 37 設定可能 TIM4

31 38 設定可能 I2C1_EV

32 39 設定可能 I2C1_ER

33 40 設定可能 I2C2_EV

34 41 設定可能 I2C2_ER

35 42 設定可能 SPI1

36 43 設定可能 SPI2

37 44 設定可能 USART1

38 45 設定可能 USART2

39 46 設定可能 USART3

40 47 設定可能 EXTI15_10

41 48 設定可能 RTCAlarm

42 49 設定可能 USBWakeup

43 50 設定可能 TIM8_BRK

44 51 設定可能 TIM8_UP

45 52 設定可能 TIM8_TRG_COM

46 53 設定可能 TIM8_CC

47 54 設定可能 ADC3

48 55 設定可能 FSMC

49 56 設定可能 SDIO

50 57 設定可能 TIM5

51 58 設定可能 SPI3

詳細

CAN SCE 割込み

EXTI ラ イ ン [9:5] 割込み

TIM1 ブ レー ク 割込み

TIM1 更新割込み

TIM1 ト リ ガ と コ ミ ュ テーシ ョ ン

割込み

TIM1 キ ャ プ チ ャ /

比較割込み

TIM2 グローバル割込み

TIM3 グローバル割込み

TIM4 グローバル割込み

I

2

C1 イ ベン ト 割込み

I

2

C1 エ ラ ー割込み

I

2

C2 イ ベン ト 割込み

I

2

C2 エ ラ ー割込み

SPI1 グローバル割込み

SPI2 グローバル割込み

USART1 グローバル割込み

USART2 グローバル割込み

USART3 グローバル割込み

EXTI ラ イ ン [15:10] 割込み

RTC ア ラ ーム割込み (EXTI 経由 )

サスペン ド から の USB ウ ェ ー ク

ア ッ プ割込み (EXTI 経由 )

TIM8 ブ レー ク 割込み

TIM8 更新割込み

TIM8 ト リ ガ と コ ミ ュ テーシ ョ ン

割込み

TIM8 キ ャ プ チ ャ ・ 比較割込み

ADC3 グローバル割込み

FSMC グローバル割込み

SDIO グローバル割込み

TIM5 グローバル割込み

SPI3 グローバル割込み

RM0008

ア ド レ ス

0x0000_0098

0x0000_009C

0x0000_00A0

0x0000_00A4

0x0000_00A8

0x0000_00AC

0x0000_00B0

0x0000_00B4

0x0000_00B8

0x0000_00BC

0x0000_00C0

0x0000_00C4

0x0000_00C8

0x0000_00CC

0x0000_00D0

0x0000_00D4

0x0000_00D8

0x0000_00DC

0x0000_00E0

0x0000_00E4

0x0000_00E8

0x0000_00EC

0x0000_00F0

0x0000_00F4

0x0000_00F8

0x0000_00FC

0x0000_0100

0x0000_0104

0x0000_0108

0x0000_010C

132/681 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

割込み と イ ベン ト

表 35.

ベ ク タ テーブル (続き)

優先種別 項目 (略称)

52 59 設定可能 UART4

53 60 設定可能 UART5

54 61 設定可能 TIM6

55 62 設定可能 TIM7

56 63 設定可能 DMA2_Channel1

57 64 設定可能 DMA2_Channel2

58 65 設定可能 DMA2_Channel3

59 66 設定可能 DMA2_Channel4_5

詳細

UART4 グローバル割込み

UART5 グローバル割込み

TIM6 グローバル割込み

TIM7 グローバル割込み

DMA2 チ ャ ネル 1 グローバル割込み

DMA2 チ ャ ネル 2 グローバル割込み

DMA2 チ ャ ネル 3 グローバル割込み

DMA2 チ ャ ネル 4 と DMA2 チ ャ ネル

5 グローバル割込み

ア ド レ ス

0x0000_0110

0x0000_0114

0x0000_0118

0x0000_011C

0x0000_0120

0x0000_0124

0x0000_0128

0x0000_012C

Rev 5 -日本語版 133/681

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参考資料

割込み と イ ベン ト

8.2

8.2.1

8.2.2

RM0008

外部割込み / イ ベン ト コ ン ト ロー ラ (EXTI)

外部割込み / イ ベ ン ト コ ン ト ロー ラ は、 割込み リ ク エ ス ト / イ ベ ン ト を発生 さ せる 19 本

のエ ッ ジ検出回路を構成 し まいます。 入力 ラ イ ンは個別に割込み種別 (パルス、 ペンデ ィ

ン グ) 及び ト リ ガ種別 (立上 り 、 立下 り 、 両エ ッ ジ) を選択する こ と がで き ます。 また、

ラ イ ン ご と にマ ス ク をかける こ と も で き ます。 ペンデ ィ ン グ ・ レ ジ ス タ は割込み リ ク エ ス

ト ・ ラ イ ンの状態を保持 し ています。

主な機能

EXTI コ ン ト ロー ラは次のよ う な機能を持っ ています。

割込み / イ ベ ン ト ラ イ ン ご と に、 独立 し た ト リ ガ と マス ク 設定が可能

割込みラ イ ン ご と のス テー タ ス ・ ビ ッ ト を装備

最大 19 本 の ソ フ ト ウ ェ ア イ ベ ン ト / 割込み リ ク エ ス ト の生成

APB2 ク ロ ッ ク周期よ り 小 さ なパルス幅の外部信号の検出機能。 具体的な詳細はデー

タ シー ト の電気特性の項を参照 し て く だ さ い。

ブ ロ ッ ク図

ブ ロ ッ ク 構成は

図  16

に示 さ れています。

図 16.

外部割込み / イ ベ ン ト コ ン ト ロー ラ (EXTI) ブ ロ ッ ク図

AMBA APB バス

ペリフェラルインタフェース

PCLK2

19 19 19 19 19

NVIC 割込み

コントローラへ

19

割込み

マスク

レジスタ

ペンディング

リクエスト

レジスタ

ソフトウェア

割込み

イベント

レジスタ

立上り

トリガ

選択

レジスタ

19

19

19

19

立下り

トリガ

選択

レジスタ

19

エッジ検出回路

19

パルス

発生回路

19

入力

ラ イ ン

19

イベント

マスク

レジスタ

134/681 Rev 5 -日本語版

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参考資料

RM0008

8.2.3

8.2.4

割込み と イ ベン ト

ウ ェ ー ク ア ッ プ ・ イ ベン ト 管理

Cortex ™ -M3 は外部イ ベ ン ト や内部イ ベ ン ト に よ り コ ア (WFE) を ウ ェ ー ク ア ッ プ さ せる こ

と がで き ます。 外部 ラ イ ン を入力ポー ト と し て設定する こ と で、 RTC ア ラ ーム及び USB

ウ ェ ー ク ア ッ プ ・ イ ベ ン ト を CPU のウ ェ ー ク ア ッ プ (WFE か ら 終了) に利用する こ と が

で き ます。

EXTI ラ イ ン を ウ ェ ー ク ア ッ プ ・ イ ベン ト と し て利用する方法については

セ ク シ ョ ン  8.2.4:

機能詳細

を参照 し て く だ さ い。

機能詳細

割込みを生成する には、 割込み リ ク エ ス ト ・ ラ イ ン を設定 し 、 有効にする必要があ り ま

す。 こ れには 2 個の ト リ ガ ・ レ ジ ス タ で必要なエ ッ ジ方向を指定 し 、 割込みマ ス ク ・ レ ジ

ス タ の対応すビ ッ ト に 1 を書込み、 リ ク エ ス ト を受付可能に し ます。 外部割込みラ イ ン で

指定 さ れたエ ッ ジが生成 さ れる と 割込み リ ク エ ス ト が発生 し 、 ラ イ ン に対応する ペンデ ィ

ン グ ビ ッ ト がセ ッ ト さ れます。 リ ク エ ス ト はペンデ ィ ン グ ・ レ ジ ス タ の対応ビ ッ ト に 1 を

書込む こ と で リ セ ッ ト する こ と がで き ます。

イ ベ ン ト を生成 さ れる には、 イ ベン ト ラ イ ン を設定 し 、 有効にする必要があ り ます。 こ れ

には 2 個の ト リ ガ ・ レ ジ ス タ で必要な エ ッ ジ方向を指定 し 、 イ ベ ン ト マ ス ク ・ レ ジ ス タ の

対応すビ ッ ト に 1 を書込み、 リ ク エ ス ト を受付可能に し ます。 イ ベ ン ト ラ イ ン で指定 さ れ

たエ ッ ジが生成 さ れる と イ ベ ン ト パルスが発生 し ます。 こ の と き、 イ ベ ン ト に対応する ペ

ンデ ィ ン グ ビ ッ ト はセ ッ ト さ れません。

割込み / イ ベン ト ・ リ ク エ ス ト は、 ソ フ ト ウ ェ ア割込み / イ ベ ン ト ・ レ ジ ス タ の対応ビ ッ

ト に 1 を書込む こ と で、 ソ フ ト ウ ェ アか ら生成 さ せる こ と も で き ます。

ハー ド ウ ェ ア割込みの選択

19 本の入力 ラ イ ン を割込み リ ク エ ス ト と する設定は次のよ う に行います。

19 本の割込み ラ イ ンのマス ク ・ ビ ッ ト を設定 し ます。 (EXTI_IMR)

割込みラ イ ンの ト リ ガ選択ビ ッ ト の設定を行います。 (EXTI_RTSR 及び EXTI_FTSR)

NVIC IRQ チ ャ ネルが外部割込み コ ン ト ロー ラ (EXTI) に割当て さ れる よ う 、 イ ネーブ

ル ・ ビ ッ ト 、 マ ス ク ・ ビ ッ ト を設定 し 、 19 本の ラ イ ンか らの割込み リ ク エ ス ト が正

し く 受付け られる よ う に し ます。

ハー ド ウ ェ ア イ ベン ト の選択

19 本の入力 ラ イ ン を イ ベン ト 要因 と する設定は次のよ う に行います。

19 本のイ ベ ン ト ラ イ ンのマ ス ク ・ ビ ッ ト を設定 し ます。 (EXTI_EMR)

イ ベ ン ト ラ イ ンの ト リ ガ選択ビ ッ ト の設定を行います。 (EXTI_RTSR、 EXTI_FTSR)

ソ フ ト ウ ェ ア割込み / イ ベン ト の選択

19 本の入力 ラ イ ンは割込み / イ ベ ン ト ラ イ ンのいずれか と し て設定 し てお く こ と がで き ま

す。 ソ フ ト ウ ェ ア割込みは次の操作で生成 し ます。

割込み / イ ベ ン ト ラ イ ンのマ ス ク ・ ビ ッ ト を設定 し ます。 (EXTI_IMR、 EXTI_EMR)

ソ フ ト ウ ェ ア割込みレ ジ ス タ (EXTI_SWIER) の所定のビ ッ ト を セ ッ ト し ます。

Rev 5 -日本語版 135/681

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参考資料

割込み と イ ベン ト

8.2.5

RM0008

外部割込み / イ ベン ト ラ イ ンの割当て

112 本の GPIO 信号は、 次の図のように、 16 の外部割込み / イベントラインに割振られます。

図 17.

外部割込み / イ ベ ン ト の GPIO 割当て

AFIO_EXTICR1 レ ジ ス タ の EXTI0[3:0] bit

PA1

PB1

PC1

PD1

PE1

PF1

PG1

PA0

PB0

PC0

PD0

PE0

PF0

PG0

EXTI0

AFIO_EXTICR1 レ ジ ス タ EXTI1[3:0] bit

EXTI1

AFIO_EXTICR4 レ ジ ス タ の EXTI15[3:0] bit

PA15

PB15

PC15

PD15

PE15

PF15

PG15

EXTI15

他の 3 本の EXTI ラ イ ンは次のよ う に接続 さ れています。

EXTI ラ イ ン 16 は PVD 出力 と 接続 さ れています。

EXTI ラ イ ン 17 は RTC ア ラ ーム イ ベ ン ト と 接続 さ れています。

EXTI ラ イ ン 18 は USB ウ ェ ー ク ア ッ プ ・ イ ベ ン ト と 接続 さ れています。

136/681 Rev 5 -日本語版

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参考資料

RM0008

割込み と イ ベン ト

8.3 EXTI レ ジ ス タ

レ ジ ス タ の詳細記述で使用 さ れてい る略語については、

照 し て く だ さ い。

セ ク シ ョ ン  1.1 (32 ページ) を参

8.3.1

31

割込みマス ク ・ レ ジ ス タ (EXTI_IMR)

ア ド レ スオ フ セ ッ ト : 0x00

リ セ ッ ト 値 : 0x0000 0000

30 29 28 27 26 25

予約済み

24 23

15 14 13 12 11 10

MR15 MR14 MR13 MR12 MR11 MR10 rw rw rw rw rw rw

9

MR9 rw

8

MR8 rw

22 21

7

MR7 rw

6

MR6 rw

5

MR5 rw

20

4

MR4 rw

19

3

MR3 rw

18 17 16

MR18 MR17 MR16 rw

2 rw

1 rw

0

MR2 rw

MR1 rw

MR0 rw

Bits 31:19 予約済み、 常に リ セ ッ ト 時の値 (0) を保持 し て く だ さ い。

Bits 18:0 MRx:

割込みマス ク (ラ イ ン x)

0: ラ イ ン x の割込み リ ク エ ス ト は禁止 (マス ク) さ れています。

1: ラ イ ン x の割込み リ ク エ ス ト は許可 さ れています。

8.3.2

31

イ ベン ト マス ク ・ レ ジ ス タ (EXTI_EMR)

ア ド レ スオ フ セ ッ ト : 0x04

リ セ ッ ト 値 : 0x0000 0000

30 29 28 27 26 25

予約済み

24 23 22 21

15 14 13 12 11 10

MR15 MR14 MR13 MR12 MR11 MR10 rw rw rw rw rw rw

9

MR9 rw

8

MR8 rw

7

MR7 rw

6

MR6 rw

5

MR5 rw

Bits 31:19 予約済み、 常に リ セ ッ ト 時の値 (0) を保持 し て く だ さ い。

Bits 18:0 MRx: ラ イ ン x 上のイ ベン ト ・ マス ク

0: ラ イ ン x のイ ベン ト ・ リ ク エ ス ト は禁止 (マス ク) さ れています。

1: ラ イ ン x のイ ベン ト ・ リ ク エ ス ト は許可 さ れています。

20

4

MR4 rw

19

3

MR3 rw

18 17 16

MR18 MR17 MR16 rw rw rw

2 1 0

MR2 rw

MR1 rw

MR0 rw

Rev 5 -日本語版 137/681

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参考資料

割込み と イ ベン ト

RM0008

8.3.3

31

立上 り ト リ ガ選択レ ジ ス タ (EXTI_RTSR)

ア ド レ スオ フ セ ッ ト : 0x08

リ セ ッ ト 値 : 0x0000 0000

30 29 28 27 26 25

予約済み

24 23 22

15 14 13 12 11

TR15 TR14 TR13 TR12 TR11 rw rw rw rw rw

10

TR10 rw

9

TR9 rw

8

TR8 rw

7

TR7 rw

6

TR6 rw

21

5

TR5 rw

20

4

TR4 rw

19

3

TR3 rw

18

TR18 rw

2

TR2 rw

17

TR17 rw

1

TR1 rw

16

TR16 rw

0

TR0 rw

Bits 31:19 予約済み、 常に リ セ ッ ト 時の値 (0) を保持 し て く だ さ い。

Bits 18:0 TRx:

ラ イ ン x 上の立上 り エ ッ ジ ・ ト リ ガ

0: 入力ラインの ( イベントと割込みについて) 立上りエッジはトリガとして有効ではありません。

1: 入力 ラ イ ンの ( イ ベン ト と 割込みについて) 立上 り エ ッ ジは ト リ ガ と し て有効です。

注意 : 外部ウ ェ ー ク ア ッ プ ・ ラ イ ンはエ ッ ジ ・ ト リ ガです。 グ リ ッ チが無いよ う にする必要があ

り ます。 EXTI_RTSR レ ジス タ への書込み中に外部割込みラ イ ンの立上 り エ ッ ジが発生 し た

と き には、 ペンデ ィ ング ビ ッ ト はセ ッ ト さ れません。

同 じ 割込みラ イ ン で、 立上 り エ ッ ジ と 立下 り エ ッ ジの双方を セ ッ ト する こ と がで き ます。

この と き には、 いずれのエ ッ ジであ っ て も ト リ ガ条件 と な り ます。

8.3.4

31

立下 り ト リ ガ選択レ ジ ス タ (EXTI_FTSR)

ア ド レ スオ フ セ ッ ト : 0x0C

リ セ ッ ト 値 : 0x0000 0000

30 29 28 27 26 25

予約済み

24 23 22

15 14 13 12 11

TR15 TR14 TR13 TR12 TR11 rw rw rw rw rw

10

TR10 rw

9

TR9 rw

8

TR8 rw

7

TR7 rw

6

TR6 rw

21

5

TR5 rw

20

4

TR4 rw

19

3

TR3 rw

18

TR18 rw

2

TR2 rw

17

TR17 rw

1

TR1 rw

16

TR16 rw

0

TR0 rw

Bits 31:19 予約済み、 常に リ セ ッ ト 時の値 (0) を保持 し て く だ さ い。

Bits 18:0 TRx:

立下 り エ ッ ジ ト リ ガ (ラ イ ン x)

0: 入力ラインの ( イベントと割込みについて) 立下りエッジはトリガとして有効ではありません。

1: 入力ラ イ ンの ( イ ベン ト と 割込みについて) 立下 り エ ッ ジは ト リ ガ と し て有効です。

注意 : 外部ウ ェ ー ク ア ッ プ ・ ラ イ ンはエ ッ ジ ・ ト リ ガです。 グ リ ッ チが無いよ う にする必要があ

り ます。 EXTI_FTSR レ ジス タ への書込み中に外部割込みラ イ ンの立下 り エ ッ ジが発生 し た

と き には、 ペンデ ィ ング ビ ッ ト はセ ッ ト さ れません。

同 じ 割込みラ イ ン で、 立上 り エ ッ ジ と 立下 り エ ッ ジの双方を セ ッ ト する こ と がで き ます。

この と き には、 いずれのエ ッ ジであ っ て も ト リ ガ条件 と な り ます。

138/681 Rev 5 -日本語版

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ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

割込み と イ ベン ト

8.3.5 ソ フ ト ウ ェ ア割込みイ ベン ト ・ レ ジ ス タ (EXTI_SWIER)

ア ド レ スオ フ セ ッ ト : 0x10

リ セ ッ ト 値 : 0x0000 0000

31 30 29 28 27 26 25

予約済み

24 23 22 21 20 19 18 17 16

SWIER

18

SWIER

17

SWIER

16 rw rw rw

15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0

SWIER

15

SWIER

14

SWIER

13

SWIER

12

SWIER

11

SWIER

10

SWIER

9

SWIER

8

SWIER

7

SWIER

6

SWIER

5

SWIER

4

SWIER

3

SWIER

2

SWIER

1

SWIER

0 rw rw rw rw rw rw rw rw rw rw rw rw rw rw rw rw

Bits 31:19 予約済み、 常に リ セ ッ ト 時の値 (0) を保持 し て く だ さ い。

Bits 18:0 SWIERx:

ラ イ ン x 上のソ フ ト ウ ェ ア割込み

こ のビ ッ ト が 0 の時に 1 を書込む と 、 EXTI_PR レ ジ ス タ の対応するペ ンデ ィ ングビ ッ ト がセ ッ ト

さ れます。 EXTI_IMR 及び EXTI_EMR レ ジス タ で、 こ のラ イ ンの割込み リ ク エス ト が許可 さ れてい

れば、 割込み リ ク エス ト が発生 し ます。

EXTI_PR レ ジ ス タ の対応する ビ ッ ト を ク リ アする (対応ビ ッ ト に 1 を書込む) と 、 こ のビ ッ ト は

ク リ ア さ れます。

8.3.6

31

ペンデ ィ ン グ ・ レ ジ ス タ (EXTI_PR)

ア ド レ スオ フ セ ッ ト : 0x14

リ セ ッ ト 値 : 0xxxxx xxxx

30 29 28 27 26 25

予約済み

24 23 22 21 20 19 18 17

PR18 PR17

16

PR16

15 14 13 12 11 10

PR15 PR14 PR13 PR12 PR11 PR10

9

PR9

8

PR8

7

PR7

6

PR6

5

PR5

4

PR4

3

PR3 rc_w1 rc_w1 rc_w1

2 1

PR2 PR1 rc_w1 rc_w1 rc_w1 rc_w1 rc_w1 rc_w1 rc_w1 rc_w1 rc_w1 rc_w1 rc_w1 rc_w1 rc_w1 rc_w1 rc_w1

0

PR0 rc_w1

Bits 31:19 予約済み、 常に リ セ ッ ト 時の値 (0) を保持 し て く だ さ い。

Bits 18:0 PRx:

ペンデ ィ ングビ ッ ト

0: ト リ ガ リ ク エ ス ト は発生 し ていません。

1: ト リ ガ リ ク エ ス ト が発生 し ま し た。

外部割込み ラ イ ン で指定 さ れている ト リ ガ条件が発生 し た と き、 こ のビ ッ ト がセ ッ ト さ れます。

このビ ッ ト に 1 を書込んだ と き、 も し く はエ ッ ジ検出回路の設定を変更 し た と き、 こ のビ ッ ト は

ク リ ア さ れます。

注 : STOP モー ド に入る 1 サイ クル前に割込み リ ク エ ス ト が発生 し た時には、 STOP モー ド か ら終了

し た時点で EXTI_PR レ ジス タ が更新 さ れ、 EXTI_IMR レ ジ ス タ の対応ビ ッ ト で許可 さ れていれば割込

み リ ク エス ト が発生 し ます。

Rev 5 -日本語版 139/681

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 この資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

割込み と イ ベン ト

RM0008

8.3.7

表 36.

オ フ

セ ッ ト

EXTI レ ジ ス タ ・ マ ッ プ

次の表は EXTI レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 値を示 し ています。

外部割込み / イ ベ ン ト コ ン ト ロー ラ (EXTI) レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値

レ ジス タ

0x00

0x04

0x08

0x0C

0x10

0x14

EXTI_IMR

リ セ ッ ト 値

EXTI_EMR

リ セ ッ ト 値

EXTI_RTSR

リ セ ッ ト 値

EXTI_FTSR

リ セ ッ ト 値

EXTI_SWIER

リ セ ッ ト 値

予約済み

予約済み

予約済み

予約済み

予約済み

MR[18:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

MR[18:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

TR[18:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

TR[18:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

SWIER[18:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

EXTI_PR

PR[18:0]

予約済み

リ セ ッ ト 値 x x x x x x x x x x x x x x x x x x x

レ ジ ス タ のア ド レ ス範囲に関 し ては

表  1 (36 ページ)

を参照 し て く だ さ い。

140/681 Rev 5 -日本語版

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参考資料

RM0008

9 DMA コ ン ト ロー ラ (DMA)

DMA コ ン ト ロー ラ (DMA)

Flash メ モ リ 容量が 32 ~ 128Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト ロー

ラは、 中容量デバイ ス です。

Flash メ モ リ 容量が 256 ~ 512Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト

ロー ラ は、 大容量デバイ スです。

こ のセ ク シ ョ ンは、 注意書きがない限 り 、 STM32F10xxx フ ァ ミ リ 全てに適応 さ れます。

9.1 概要

DMA (Direct Memory Access) は、 ペ リ フ ェ ラ ル と メ モ リ 間、 及び メ モ リ 内で高速のデー タ

転送を行 う ために利用 さ れます。 DMA を利用する こ と で CPU の動作を要せずデー タ をす

ばや く 移動する こ と がで き ます。 こ れに よ り 、 CPU の能力を他の動作のためにあけてお く

こ と がで き ます。

DMA コ ン ト ロー ラ は合計 12 チ ャ ネル (7 つの DMA1、 5 つの DMA2) を搭載 し 、 それぞれ

がペ リ フ ェ ラ ルから の メ モ リ ・ ア ク セス を管理 し ます。 また、 コ ン ト ロー ラ は DMA リ ク

エ ス ト 間のア ク セス順序を管理する アービ タ を内蔵 し ています。

9.2 DMA の主な機能

個別に設定可能な 12 チ ャ ネル ( リ ク エ ス ト ) : 7 つの DMA1 及び 5 つの DMA2

12 チ ャ ネルはそれぞれに固有のハー ド ウ ェ ア DMA リ ク エ ス ト と 接続 さ れています。

また、 ソ フ ト ウ ェ ア ・ ト リ ガは各チ ャ ネルでサポー ト さ れています。 設定は ソ フ ト

ウ ェ ア で行われます。

1 つの DMA のチ ャ ネル間の リ ク エ ス ト の優先度は、 ソ フ ト ウ ェ ア で指定で き ます。

(4 レ ベル、 最高、 高、 中、 低) ま た、 ハー ド ウ ェ アに よ り チ ャ ネル番号の順 と する

こ と も可能です。 ( リ ク エ ス ト 1 が リ ク エ ス ト 2 に優先、 な ど)

転送元 と 転送先で転送幅 (バイ ト 、 ハー フ ワー ド 、 ワー ド ) を個別に指定で き、 こ の

際にデー タ のパ ッ キン グ、 ア ンパ ッ キン グが行われます。

サーキ ュ ラ ・ バ ッ フ ァ 管理のサポー ト

3 個のイ ベン ト フ ラ グ (DMA 1/2 転送終了、 DMA 転送完了、 DMA 転送エ ラ ー)、 こ れ

ら の論理和はチ ャ ネルご と に割込み リ ク エ ス ト を発生

メ モ リ 間転送機能

ペ リ フ ェ ラ ルか ら メ モ リ 、 メ モ リ か ら ペ リ フ ェ ラ ル、 及びペ リ フ ェ ラ ル相互間の転送

機能

Flash メ モ リ 、 SRAM、 ペ リ フ ェ ラ ル SRAM、 APB1、 APB2 及び AHB ペ リ フ ェ ラルへの

ア ク セス (転送元 / 転送先 と し て)

最大 65536 ま で、 転送デー タ 数の設定が可能

ブ ロ ッ ク 構成は

図  18

に示 さ れています。

Rev 5 -日本語版 141/681

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参考資料

DMA コ ン ト ロー ラ (DMA)

RM0008

図 18.

DMA ブ ロ ッ ク 構成

DCode

IC ode

Co rtex-M3

システム

DMA1

アービタ

DMA2

Ch.1

Ch.2

Ch.7

AHB

スレーブ

Ch.1

Ch.2

Ch.5

FLI TF

Fl as h

SRAM

FS MC

AHB

システム

SDI O

ブリッジ

ブリッジ

2

1

DMA

リクエスト

DMA

リクエスト

APB 2

APB1

USA R T2

USA R T3

UART4

SP I/I2S2

SP I/I2S3

I2C1

I2C2

TIM2

TIM3

TIM 4

TIM5

TIM6

TIM7

USA R T1

SP I1

ADC1

ADC3

TIM1

TIM8

DMA

リクエスト

アービタ

AHB

スレーブ ai14801

1.

DMA2 コ ン ト ロー ラ は大容量デバイ スにのみ搭載 さ れています。

2.

ADC3、 SPI/I2S3、 UART4、 SDIO、 TIM5、 TIM6、 DAC、 TIM7、 TIM8 DMA リ ク エ ス ト は大容量デバイ スで

のみ備え ら れています。

9.3

9.3.1

DMA の機能詳細

DMA コ ン ト ロー ラ はシ ス テム ・ バス を Cortex

TM

-M3 コ ア と 共用 し なが ら DMA 転送を実行

し ます。 CPU と DMA が同 じ 転送先 (RAM も し く はペ リ フ ェ ラ ル) のア ク セス を試みた と

き、 CPU か ら シ ス テム ・ バスへのア ク セス動作が 1 バスサイ ク ルの間、 DMA に よ っ て停

止 さ せ ら れる こ と があ り ます。 バス ・ マ ト リ ッ ク スは ラ ウ ン ド ロ ビ ン方式で競合を解決 し

ていますので、 (RAM 及びペ リ フ ェ ラ ルの両方への) シ ス テム ・ バス帯域の少な く と も

1/2 が CPU のために確保 さ れます。

DMA ト ラ ンザク シ ョ ン

所定のイ ベ ン ト 後、 ペ リ フ ェ ラ ルは DMA コ ン ト ロー ラ に リ ク エ ス ト 信号を送 り ます。

DMA コ ン ト ロー ラ はチ ャ ネル間の優先順位に従 っ て、 こ れ らの リ ク エ ス ト を処理 し ます。

DMA コ ン ト ロー ラ がペ リ フ ェ ラ ルにア ク セスする と 、 ア ク ノ レ ッ ジ信号がペ リ フ ェ ラ ルに

送 ら れます。 ペ リ フ ェ ラ ルは DMA コ ン ト ロー ラ か ら のア ク ノ レ ッ ジ を受け取る と 、 DMA

リ ク エ ス ト 信号を解除 し ます。 ペ リ フ ェ ラ ルか ら の DMA リ ク エ ス ト が解除 さ れる と 、

DMA コ ン ト ロー ラ はア ク ノ レ ッ ジ信号を解除 し ます。 別の DMA 転送が必要であれば、 ペ

リ フ ェ ラ ルは次の ト ラ ンザ ク シ ョ ン を開始する こ と がで き ます。

142/681 Rev 5 -日本語版

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参考資料

RM0008

9.3.2

注意 :

9.3.3

DMA コ ン ト ロー ラ (DMA)

個々の DMA 転送は次の 3 動作か ら構成 さ れています。

ペ リ フ ェ ラ ル ・ デー タ ・ レ ジ ス タ 、 も し く は メ モ リ 上の所定の位置か ら 、

DMA_CMARx レ ジ ス タ にデー タ を ロー ド し ます。

ロー ド さ れたデー タ を DMA_CMARx レ ジ ス タ から ペ リ フ ェ ラルのデー タ ・ レ ジ ス タ 、

も し く は メ モ リ 上の所定の位置に格納 し ます。

こ のあ と 予定 さ れる DMA ト ラ ンザ ク シ ョ ンの数を保持 し ている DMA_CNDTRx レ ジ ス

タ を カ ウ ン ト ダウ ン し ます。

アービ タ

アービ タ はア ク セス リ ク エ ス ト を チ ャ ネルの優先順位に応 じ て管理 し 、 ペ リ フ ェ ラ ルや メ

モ リ に対する ア ク セス動作を開始 さ せます。

優先順位は 2 段階で管理 さ れます。

ソ フ ト ウ ェ ア : 優先順位は DMA_CCRx レ ジ ス タ で 4 段階のいずれかを チ ャ ネルご と に

設定で き ます。

- 最優先

- 高優先度

- 中優先度

- 低優先度

ハー ド ウ ェ ア : ソ フ ト ウ ェ ア優先度が同 じ レ ベルの リ ク エ ス ト が複数あ る場合、 番号

の小 さ なチ ャ ネルが優先 し ます。 た と えばチ ャ ネル 2 はチ ャ ネル 4 よ り 優先 さ れる こ

と にな り ます。

大容量デバイ スでは、 DMA1 コ ン ト ロー ラは DMA2 コ ン ト ロー ラ よ り 高い優先順位を持っ

ています。

DMA チ ャ ネル

各チ ャ ネルは固定 さ れたア ド レ スのペ リ フ ェ ラ ルレ ジ ス タ と メ モ リ と の間の DMA 転送を

扱 う こ と がで き ます。 転送 さ れるデー タ の総量 (最大 65535) はプ ロ グ ラ ムで設定可能で

す。 こ の数を保持 し てい る レ ジ ス タ は、 転送 ト ラ ンザ ク シ ョ ン ご と に カ ウ ン ト ダウ ン さ れ

ます。

デー タ ・ サイ ズの設定

ペ リ フ ェ ラ ルや メ モ リ と の転送時のデー タ ・ サイ ズは MDA_CCRx の PSIZE 及び MSIZE

フ ィ ール ド で任意に設定で き ます。

ポ イ ン タ の加算

ペ リ フ ェ ラ ルや メ モ リ のポ イ ン タ は、 各転送動作のあ と に カ ウ ン ト さ れる よ う 、

MDA_CCRx の PINC 及び MINC で指定する こ と がで き ます。 カ ウ ン ト ア ッ プが行われる場

合、 設定 さ れてい るデー タ ・ サイ ズに応 じ て、 1、 2、 4 のいずれかが加算 さ れます。 最初の

転送のア ド レ ス と し てはソ フ ト ウ ェ ア で DMA_CPARx/DMA_CMARx に設定 さ れた値が使用

さ れます。

チ ャ ネルの設定がサーキ ュ ラ ・ モー ド で ない と き には、 転送終了後 (転送デー タ 数が 0 ま

で カ ウ ン ト ダウ ン さ れた後) は DMA リ ク エ ス ト に対する転送動作は行われません。

Rev 5 -日本語版 143/681

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参考資料

DMA コ ン ト ロー ラ (DMA)

9.3.4

RM0008

チ ャ ネル設定手順

DMA チ ャ ネルの設定は、 次の手順で行います。 (x はチ ャ ネル番号です。)

1.

DMA_CPARx レ ジ ス タ にペ リ フ ェ ラ ルレ ジ ス タ のア ド レ ス を設定 し ます。 ペ リ フ ェ ラ

ルイ ベ ン ト ご と に、 こ のレ ジ ス タ と メ モ リ の間でデー タ が転送 さ れる こ と にな り ま

す。

2. DMA_CPARx レ ジ ス タ に メ モ リ のア ド レ ス を設定 し ます。 ペ リ フ ェ ラルイ ベ ン ト ご と

に、 こ の メ モ リ に書込み、 も し く は こ の メ モ リ か ら 読み出 さ れる こ と にな り ます。

3. 転送 さ れるデー タ の数を DMA_CNDTRx レ ジ ス タ に設定 し ます。 個々のペ リ フ ェ ラ ル

イ ベ ン ト 後に こ の値がカ ウ ン ト ダウ ン さ れます。

4. DMA_CCRx レ ジ ス タ の PL[1:0] フ ィ ール ド でチ ャ ネルの優先度を指定 し ます。

5. デー タ 転送の方向、 サーキ ュ ラ ・ モー ド の有無、 ペ リ フ ェ ラル と メ モ リ のア ド レ ス カ

ウ ン ト の有無、 ア ク セス時のデー タ ・ サイ ズ、 1/2 終了 も し く は全終了後の割込みの

有無を DMA_CCRx レ ジ ス タ に設定 し ます。

6. DMA_CCRx レ ジ ス タ の ENABLE ビ ッ ト を セ ッ ト し 、 チ ャ ネルの動作を有効 と し ます。

チ ャ ネル動作が有効にな る と 、 そのチ ャ ネルに接続 さ れている ペ リ フ ェ ラ ルか らの DMA

リ ク エ ス ト に こ たえ る こ と がで き ます。

1/2 転送終了割込み許可ビ ッ ト (HTIE) がセ ッ ト さ れてい る と き、 転送バイ ト 数の半分が転

送 さ れる と 1/2 転送終了割込み フ ラ グ (HTIF) がセ ッ ト さ れ、 割込み リ ク エ ス ト が発生 し ま

す。 すべての転送が完了 し た と き には、 転送完了割込み許可ビ ッ ト (TCIE) がセ ッ ト さ れて

いれば 転送完了 フ ラ グ (TCIF) がセ ッ ト さ れ、 割込み リ ク エ ス ト が発生 し ます。

サーキ ュ ラ ・ モー ド

サーキ ュ ラ ・ モー ド を指定する こ と で、 サーキ ュ ラ ・ バ ッ フ ァ を管理 し 、 連続的なデー タ

の流れ (ADC スキ ャ ン ・ モー ド な ど) を扱 う こ と がで き ます。 こ の機能は DMA_CCRx レ

ジ ス タ の CIRC ビ ッ ト を セ ッ ト する こ と で有効 と な り ます。 サーキ ュ ラ ・ モー ド が指定 さ

れる と 、 チ ャ ネル設定時に指定 さ れた転送デー タ 数は自動的にデー タ 数レ ジ ス タ に再ロー

ド さ れ、 DMA リ ク エ ス ト は続けて処理 さ れます。

メ モ リ 間転送モー ド

DMA チ ャ ネルはペ リ フ ェ ラルか らの リ ク エ ス ト に よ る ト リ ガがな く と も 動作 さ せる こ と が

で き ます。 こ のモー ド は メ モ リ 間転送 と 称 さ れます。

DMA_CCRx レ ジ ス タ の MEM2MEM ビ ッ ト がセ ッ ト さ れる と 、 ソ フ ト ウ ェ ア で DMA_CCRx

レ ジ ス タ のイ ネーブル ・ ビ ッ ト (EN) がセ ッ ト さ れる と 同時にチ ャ ネルの動作が開始 さ れま

す。 転送は DMA_CNDTRx レ ジ ス タ の値が 0 に カ ウ ン ト ダウ ン さ れる と 停止 し ます。 メ モ

リ 間転送モー ド と サーキ ュ ラ ・ モー ド と を同時に指定する こ と はで き ません。

エ ラ ー管理

DMA に よ る読込み も し く は書込みア ク セスでバス エ ラ ーが発生 し た と き、 ハー ド ウ ェ ア で

対応する チ ャ ネル構成レ ジ ス タ (DMA_CCRx) の EN ビ ッ ト を ク リ アする ため、 エ ラ ーを生

じ たチ ャ ネルは自動的にデ ィ セーブル状態 と な り ます。 DMA_CCRx レ ジ ス タ の 転送エ ラ ー

割込み許可ビ ッ ト (TEIE) がセ ッ ト さ れていれば、 DMA_IFR レ ジ ス タ のチ ャ ネルに対応する

転送エ ラ ー割込みフ ラ グ (TEIF) がセ ッ ト さ れ、 割込み リ ク エ ス ト が発生 し ます。

144/681 Rev 5 -日本語版

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参考資料

RM0008

9.3.5

注意 :

9.3.6

DMA コ ン ト ロー ラ (DMA)

割込み

割込みは各 DMA チ ャ ネル毎に、 ハー フ ト ラ ン ス フ ァ 、 ト ラ ン ス フ ァ 完了ま たは ト ラ ン ス

フ ァ エ ラ ーに よ り 発生 し ます。 高い融通性のために、 別々の割込みを備えています。

表 37.

DMA 割込み リ ク エ ス ト

割込みイ ベ ン ト

1/2 転送

転送完了

転送エ ラ ー

イ ベン ト ・ フ ラ グ

HTIF

TCIF

TEIF

イ ネーブル制御ビ ッ ト

HTIE

TCIE

TEIE

大容量デバイ スでは、 DMA2 チ ャ ネル 4 と DMA2 チ ャ ネル 5 は、 同 じ 割込みベ ク タ へ割 り

当て られます。 DMA1 と DMA2 の他の全ての割込みは、 それぞれの割込みベ ク タ を持っ て

います。

DMA リ ク エ ス ト のマ ッ ピ ング

DMA1 コ ン ト ロー ラ

ペ リ フ ェ ラ ル (TIMx[1,2,3,4]、 ADC1、 SPI1、 SPI/I2S2、I2Cx[1,2] 及び USARTx[1,2,3]) か ら の 7

種の リ ク エ ス ト は DMA1 コ ン ト ロー ラ に渡 さ れる前に論理和が と ら れます。 こ のため、 同

時には 1 種類の リ ク エ ス ト のみが有効 と さ れなければな り ません

図  19: DMA1 リ ク エス ト

のマ ッ ピ ング

を参照 し て く だ さ い。

ペ リ フ ェ ラ ルか らの DMA リ ク エ ス ト は、 独自に、 個々のペ リ フ ェ ラルのレ ジ ス タ の DMA

制御ビ ッ ト の設定で、 許可 / 禁止する こ と がで き ます。

Rev 5 -日本語版 145/681

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参考資料

DMA コ ン ト ロー ラ (DMA)

RM0008

図 19.

DMA1 リ ク エ ス ト のマ ッ ピ ン グ

ペリフェラル

リクエスト信号

HW リクエスト 1

ADC1

TIM2_CH3

TIM4_CH1

SW トリガ (MEM2MEM bit)

固定優先順位ハードウェア

優先度 高

チャネル 1

チャネル 1EN ビット

HW リクエスト 2

チャネル 2

SW トリガ (MEM2MEM bit)

USART3_TX

TIM1_CH1

TIM2_UP

TIM3_CH3

SPI1_RX

USART3_RX

TIM1_CH2

TIM3_CH4

TIM3_UP

SPI1_TX

USART1_TX

TIM1_CH4

TIM1_TRIG

TIM1_COM

TIM4_CH2

SPI/I2S2_RX

I2C2_TX

USART1_RX

TIM1_UP

SPI/I2S2_TX

TIM2_CH1

TIM4_CH3

I2C2_RX

チャネル 2EN ビット

HW リクエスト 3

チャネル 3

SW トリガ (MEM2MEM bit)

チャネル 3EN ビット

HW リクエスト 4

チャネル 4

SW トリガ (MEM2MEM bit)

チャネル 4EN ビット

HW リクエスト 5

SW トリガ (MEM2MEM bit)

チャネル 5

内部

DMA1

リクエスト

チャネル 5EN ビット

USART2_RX

TIM1_CH3

TIM3_CH1

TIM3_TRIG

I2C1_TX

HW リクエスト 6

SW トリガ (MEM2MEM bit)

チャネル 6

USART2_TX

TIM2_CH2

TIM2_CH4

TIM4_UP

I2C1_RX

チャネル 6EN ビット

HW リクエスト 7

チャネル 7

SW トリガ (MEM2MEM bit)

優先度 低

チャネル 7EN ビット

表  38

には各チ ャ ネルに対する DMA リ ク エ ス ト が表示 さ れています。

146/681 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

DMA コ ン ト ロー ラ (DMA)

表 38.

ペ リ フ ェ ラル

ADC1

SPI/I

2

S

USART

I

2

C

TIM1

TIM2

TIM3

TIM4

チ ャ ネルに対する DMA1 リ ク エ ス ト の一覧

チ ャ ネル 1 チ ャ ネル 2 チ ャ ネル 3 チ ャ ネル 4 チ ャ ネル 5 チ ャ ネル 6 チ ャ ネル 7

ADC1

TIM2_CH3

TIM4_CH1

SPI1_RX SPI1_TX SPI/I2S2_RX SPI/I2S2_TX

USART3_TX USART3_RX USART1_TX USART1_RX USART2_RX USART2_TX

I2C2_RX I2C1_TX I2C1_RX

TIM1_CH1 TIM1_CH2

I2C2_TX

TIM1_CH4

TIM1_TRIG

TIM1_COM

TIM1_UP TIM1_CH3

TIM2_UP TIM2_CH1

TIM2_CH2

TIM2_CH4

TIM3_CH3

TIM3_CH4

TIM3_UP

TIM3_CH1

TIM3_TRIG

TIM4_CH2 TIM4_CH3 TIM4_UP

注意 :

DMA2 コ ン ト ロー ラ

ペ リ フ ェ ラ ルか らの 5 種の リ ク エ ス ト (TIMx[5,6,7,8]、 ADC3、 SPI/I2S3、 UART4、

DAC_Channel[1,2] と SDIO) は、 DMA2 へ渡 さ れる前に論理和が と られます。 こ のため、 同

時には 1 種類の リ ク エ ス ト のみが有効 と さ れなければな り ません

図  20: DMA2 リ ク エス ト

のマ ッ ピ ング

を参照 し て く だ さ い。

ペ リ フ ェ ラ ルか らの DMA リ ク エ ス ト は、 独自に、 個々のペ リ フ ェ ラルのレ ジ ス タ の DMA

制御ビ ッ ト の設定で、 許可 / 禁止する こ と がで き ます。

DMA2 と 関連 リ ク エス ト は、 大容量デバイ スでのみ利用で き ます。

Rev 5 -日本語版 147/681

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参考資料

DMA コ ン ト ロー ラ (DMA)

RM0008

図 20.

DMA2 リ ク エ ス ト のマ ッ ピ ン グ

ペリフェラルリクエスト信号

固定優先順位ハードウェア

TIM5_CH4

TIM5_TRIG

TIM8_CH3

TIM8_UP

SPI/I2S3_RX

TIM8_CH4

TIM8_TRIG

TIM8_COM

TIM5_CH3

TIM5_UP

SPI/I2S3_TX

TIM8_CH1

UART4_RX

TIM6_UP/DAC_Channel1

TIM5_CH2

SDIO

TIM7_UP/DAC_Channel2

HW リクエスト 1

チャネル 1

SW トリガ (MEM2MEM bit)

チャネル 1EN ビット

HW リクエスト 2

チャネル 2

SW トリガ (MEM2MEM bit)

チャネル 2EN ビット

HW リクエスト 3

チャネル 3

SW トリガ (MEM2MEM bit)

チャネル 3EN ビット

HW リクエスト 4

チャネル 4

SW トリガ (MEM2MEM bit)

優先度 高

内部

DMA2

リクエスト

チャネル 4EN ビット

ADC3

TIM8_CH2

TIM5_CH1

UART4_TX

HW リクエスト 5

SW トリガ (MEM2MEM bit)

チャネル 5

優先度 低

チャネル 5EN ビット

表  39

には各チ ャ ネルに対する DMA2 リ ク エ ス ト が表示 さ れています。

表 39.

チ ャ ネルに対する DMA2 リ ク エ ス ト の一覧

ペ リ フ ェ ラル チ ャ ネル 1 チ ャ ネル 2 チ ャ ネル 3

ADC3

SPI/I2S3

UART4

SDIO

TIM5

SPI/I2S3_RX SPI/I2S3_TX

TIM5_CH4

TIM5_TRIG

TIM5_CH3

TIM5_UP

UART4_RX

TIM6/

DAC_Channel1

TIM7/

DAC_Channel2

TIM6_UP/

DAC_Channel1

TIM8

TIM8_CH3

TIM8_UP

TIM8_CH4

TIM8_TRIG

TIM8_COM

TIM8_CH1

チ ャ ネル 4

SDIO

TIM5_CH2

TIM7_UP/

DAC_Channel2

チ ャ ネル 5

ADC3

UART4_TX

TIM5_CH1

TIM8_CH2

148/681 Rev 5 -日本語版

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参考資料

RM0008

DMA コ ン ト ロー ラ (DMA)

9.4

注意 :

DMA レ ジ ス タ

レ ジ ス タ の詳細記述で使用 さ れてい る略語については、

照 し て く だ さ い。

セ ク シ ョ ン  1.1 (32 ページ)

を参

DMA2 は 5 つのチ ャ ネル し か持たないので、 次に示すレ ジ ス タ では、 チ ャ ネル 6 と チ ャ ネ

ル 7 関連の全ビ ッ ト は、 DMA2 には適応 さ れません。

9.4.1

31

15

DMA 割込みス テー タ ス ・ レ ジ ス タ (DMA_ISR)

ア ド レ スオ フ セ ッ ト : 0x00

リ セ ッ ト 値 : 0x0000 0000

30 29 28 27 26 25

TEIF7 HTIF7 TCIF7

24

GIF7

23 22 21

TEIF6 HTIF6 TCIF6

20

GIF6

19 18 17

TEIF5 HTIF5 TCIF5

予約済み

14 13 12 r

11 r

10 r

9 r

8 r

7 r

6 r

5 r

4 r

3 r

2 r

1

16

GIF5 r

0

TEIF4 HTIF4 TCIF4 GIF4 TEIF3 HTIF3 TCIF3 r r r r r r r

GIF3 TEIF2 HTIF2 TCIF2 r r r r

GIF2 TEIF1 HTIF1 TCIF1 r r r r

GIF1 r

Bits 31:28 予約済み、 常に 0 が読み出 さ れます。

Bits 27, 23,

19, 15, 11,

7, 3

TEIFx: チ ャ ネル x 転送エ ラ ー ・ フ ラ グ (x = 1 ..7)

こ のビ ッ ト はハー ド ウ ェ アでセ ッ ト さ れます。 DMA_IFCR レ ジス タ の対応する ビ ッ ト に 1 を書込む

こ と で、 こ のビ ッ ト を ク リ アする こ と がで き ます。

0: チ ャ ネル x で、 転送エ ラ ー (TE) は生 じ ていません。

1: チ ャ ネル x で、 転送エ ラ ー (TE) が発生 し ま し た。

Bits 26, 22,

18, 14, 10,

6, 2

HTIFx:

チ ャ ネル x 1/2 転送終了フ ラ グ (x = 1 ..7)

こ のビ ッ ト はハー ド ウ ェ アでセ ッ ト さ れます。 DMA_IFCR レ ジス タ の対応する ビ ッ ト に 1 を書込む

こ と で、 こ のビ ッ ト を ク リ アする こ と がで き ます。

0: チ ャ ネル x で、 1/2 転送終了 (HT) イ ベン ト は発生 し ていません。

1: チ ャ ネル x で、 1/2 転送終了 (HT) イ ベン ト が発生 し ま し た。

Bits 25, 21,

17, 13, 9, 5,

1

TCIFx: チ ャ ネル x 転送完了フ ラ グ (x = 1 ..7)

こ のビ ッ ト はハー ド ウ ェ アでセ ッ ト さ れます。 DMA_IFCR レ ジス タ の対応する ビ ッ ト に 1 を書込む

こ と で、 こ のビ ッ ト を ク リ アする こ と がで き ます。

0: チ ャ ネル x で、 転送完了 (TC) イ ベン ト は発生 し ていません。

1: チ ャ ネル x で、 転送完了 (TC) イ ベン ト が発生 し ま し た。

Bits 24, 20,

16, 12, 8, 4,

0

GIFx:

チ ャ ネル x 割込み リ ク エス ト ・ フ ラ グ (x = 1 ..7)

こ のビ ッ ト はハー ド ウ ェ アでセ ッ ト さ れます。 DMA_IFCR レ ジス タ の対応する ビ ッ ト に 1 を書込む

こ と で、 こ のビ ッ ト を ク リ アする こ と がで き ます。

0: チ ャ ネル x で、 TE、 HT、 TC イ ベン ト はいずれも 発生 し ていません。

1: チ ャ ネル x で、 TE、 HT、 TC イ ベン ト のいずれかが発生 し ま し た。

Rev 5 -日本語版 149/681

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参考資料

DMA コ ン ト ロー ラ (DMA)

RM0008

9.4.2 DMA 割込みフ ラ グ ・ ク リ ア ・ レ ジ ス タ (DMA_IFCR)

ア ド レ スオ フ セ ッ ト : 0x04

リ セ ッ ト 値 : 0x0000 0000

31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16

予約済み

CTEIF

7

CHTIF

7

CTCIF

7

CGIF

7

CTEIF

6

CHTIF

6

CTCIF

6

CGIF

6

CTEIF

5

CHTIF

5

CTCIF

5

CGIF

5 w

11 w

10 w

9 w

8 w

7 w

6 w

5 w

4 w

3 w

2 w

1 w

0 15 14 13 12

CTEIF

4

CHTIF

4

CTCIF

4

CGIF

4

CTEIF

3

CHTIF

3

CTCIF

3

CGIF

3

CTEIF

2

CHTIF

2

CTCIF

2

CGIF

2

CTEIF

1

CHTIF

1

CTCIF

1

CGIF

1 w w w w w w w w w w w w w w w w

Bits 31:28 予約済み、 常に 0 が読み出 さ れます。

Bits 27, 23,

19, 15, 11, 7,

3

CTEIFx:

チ ャ ネル x 転送エ ラ ー ク リ ア (x = 1 ..7)

こ のビ ッ ト はソ フ ト ウ ェ ア でセ ッ ト / ク リ アがで き ます。

0: 影響な し

1: DMA_ISR レ ジ ス タ の対応する TEIF フ ラ グを ク リ ア し ます。

Bits 26, 22,

18, 14, 10, 6,

2

CHTIFx:

チ ャ ネル x 1/2 転送終了ク リ ア (x = 1 ..7)

こ のビ ッ ト はソ フ ト ウ ェ ア でセ ッ ト / ク リ アがで き ます。

0: 影響な し

1: DMA_ISR レ ジ ス タ の対応する HTIF フ ラ グ を ク リ ア し ます。

Bits 25, 21,

17, 13, 9, 5, 1

CTCIFx:

チ ャ ネル x 転送完了ク リ ア (x = 1 ..7)

こ のビ ッ ト はソ フ ト ウ ェ ア でセ ッ ト / ク リ アがで き ます。

0: 影響な し

1: DMA_ISR レ ジ ス タ の対応する TCIF フ ラ グを ク リ ア し ます。

Bits 24, 20,

16, 12, 8, 4, 0

CGIFx:

チ ャ ネル x 割込み リ ク エス ト ク リ ア (x = 1 ..7)

こ のビ ッ ト はソ フ ト ウ ェ ア でセ ッ ト / ク リ アがで き ます。

0: 影響な し

1: DMA_ISR レ ジ ス タ の、 対応する チ ャ ネルの GIF、 TEIF、 HTIF、 TCIF フ ラ グ を ク リ ア し ます。

150/681 Rev 5 -日本語版

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参考資料

RM0008

DMA コ ン ト ロー ラ (DMA)

9.4.3

31

DMA チ ャ ネル x 構成レ ジス タ (DMA_CCRx) (x = 1 ..7)

ア ド レ スオ フ セ ッ ト : 0x08 + 20d × チ ャ ネル番号

リ セ ッ ト 値 : 0x0000 0000

30 29 28 27 26 25 22 21 20 24 23

予約済み

19 18 17 16

15 14

予約

済み

MEM2

MEM rw

13

PL[1:0]

12 11 10

MSIZE[1:0]

9 8

PSIZE[1:0]

7 6 5

MINC PINC CIRC

4

DIR rw rw rw rw rw rw rw rw rw rw

Bits 31:15 予約済み、 常に 0 が読み出 さ れます。

Bit 14 MEM2MEM:

メ モ リ 間転送モー ド

こ のビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。

0: メ モ リ 間転送モー ド は指定 さ れていません。

1: メ モ リ 間転送モー ド が有効です。

Bits 13:12 PL[1:0]:

チ ャ ネル優先レベル

こ のビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。

00: 低

01: 中

10: 高

11: 最優先

Bits 11:10 MSIZE[1:0]:

メ モ リ ・ サイズ

こ のビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。

00: 8 ビ ッ ト

01: 16 ビ ッ ト

10: 32 ビ ッ ト

11: 予約値

Bits 9:8 PSIZE[1:0]:

ペ リ フ ェ ラル ・ サイ ズ

こ のビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。

00: 8 ビ ッ ト

01: 16 ビ ッ ト

10: 32 ビ ッ ト

11: 予約値

Bit 7 MINC:

メ モ リ ・ イ ン ク リ メ ン ト ・ モー ド

こ のビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。

0: メ モ リ ・ イ ン ク リ メ ン ト ・ モー ド は指定 さ れていません。

1: メ モ リ ・ イ ン ク リ メ ン ト ・ モー ド は有効です。

Bit 6 PINC:

ペ リ フ ェ ラル ・ イ ン ク リ メ ン ト ・ モー ド

こ のビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。

0: ペ リ フ ェ ラル ・ イ ン ク リ メ ン ト ・ モー ド は指定 さ れていません。

1: ペ リ フ ェ ラル ・ イ ン ク リ メ ン ト ・ モー ド は有効です。

3

TEIE HTIE TCIE rw

2 rw

1 rw

0

EN rw

Rev 5 -日本語版 151/681

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参考資料

DMA コ ン ト ロー ラ (DMA)

RM0008

Bit 5 CIRC:

サーキ ュ ラ ・ モー ド

こ のビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。

0: サーキ ュ ラ ・ モー ド は指定 さ れていません。

1: サーキ ュ ラ ・ モー ド は有効です。

Bit 4 DIR:

デー タ 転送方向

こ のビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。

0: ペ リ フ ェ ラルか ら読出 さ れます。 (ペ リ フ ェ ラル→ メ モ リ )

1: メ モ リ か ら読出 さ れます。 ( メ モ リ →ペ リ フ ェ ラル)

Bit 3 TEIE:

転送エ ラ ー (TE) 割込み リ ク エス ト 許可

こ のビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。

0: TE 割込み リ ク エス ト 禁止

1: TE 割込み リ ク エス ト 許可

Bit 2 HTIE:

1/2 転送終了 (HT) 割込み リ ク エス ト 許可

こ のビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。

0: HT 割込み リ ク エ ス ト 禁止

1: HT 割込み リ ク エ ス ト 許可

Bit 1 TCIE:

転送完了割込み (TC) リ ク エス ト 許可

こ のビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。

0: TC 割込み リ ク エ ス ト 禁止

1: TC 割込み リ ク エ ス ト 許可

Bit 0 EN:

チ ャ ネル ・ イ ネーブル

こ のビ ッ ト は ソ フ ト ウ ェ アでセ ッ ト / ク リ アがで き ます。

0: チ ャ ネルはデ ィ セーブル状態です。

1: チ ャ ネルはイ ネーブル状態です。

9.4.4 DMA チ ャ ネル x デー タ 数レ ジス タ (DMA_CNDTRx) (x = 1 ..7)

ア ド レ スオ フ セ ッ ト t: 0x0C + 20d × チ ャ ネル番号

リ セ ッ ト 値 : 0x0000 0000

Bits 31:16 予約済み、 常に 0 が読み出 さ れます。

Bits 15:0 NDT[15:0]:

転送 さ れるデー タ 数

転送 さ れるデー タ の数 (0 か ら 最大 65535 バイ ト )。 こ のチ ャ ネルへの書込みは、 チ ャ ネルがデ ィ

セーブル時に限ら れます。 一旦チ ャ ネルが有効 (イ ネーブル) と な る と 、 こ のレ ジス タ は読出 し 専

用 と な り 、 まだ転送 さ れていないバイ ト 数を示 し ます。 こ のレ ジス タ の値は個々の DMA 転送動作

後に カ ウン ト ダウン さ れます。

すべての転送が終了する と 、 通常は、 こ のレ ジス タ の値は 0 に と ど ま り ます。 ただ し 、 自動再ロー

ド ・ モー ド が設定 さ れている時には、 先に ソ フ ト ウ ェ アで設定 し た値が再びロー ド さ れます。

こ のレ ジ ス タ の値が 0 の と き には、 チ ャ ネルがイ ネーブルか否かにかかわ ら ず、 DMA リ ク エス ト

に応え る こ と はあ り ません。

152/681 Rev 5 -日本語版

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RM0008

DMA コ ン ト ロー ラ (DMA)

9.4.5 DMA チ ャ ネル x ぺ リ フ ェ ラル ・ ア ド レ ス ・ レ ジス タ (DMA_CPARx) (x = 1 ..7)

ア ド レ スオ フ セ ッ ト : 0x10 + 20d × チ ャ ネル番号

リ セ ッ ト 値 : 0x0000 0000

Bits 31:0 PA[31:0]: ペ リ フ ェ ラル ・ ア ド レ ス

デー タ が読出 さ れ、 も し く は書込まれるペ リ フ ェ ラルレ ジス タ のア ド レ ス。 (ア ド レ スがカ ウ

ン ト ア ッ プ さ れる場合は、 先頭ア ド レ ス)

9.4.6 DMA チ ャ ネル x メ モ リ ・ ア ド レ ス ・ レ ジス タ (DMA_CMARx) (x = 1 ..7)

ア ド レ スオ フ セ ッ ト : 0x14 + 20d × チ ャ ネル番号

リ セ ッ ト 値 : 0x0000 0000

Bits 31:0 MA[31:0]:

メ モ リ ・ ア ド レ ス

デー タ が読出 さ れ、 も し く は書込まれる メ モ リ 領域のベース ・ ア ド レ ス。

9.4.7

表 40.

オ フ

セ ッ ト

DMA レ ジ ス タ ・ マ ッ プ

次の表は DMA レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 値の一覧です。

DMA - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値

レ ジス タ

0x000

DMA_ISR

リ セ ッ ト 値

予約済み

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

0x004

0x008

0x00C

DMA_CNDTR1

リ セ ッ ト 値

0x010

0x014

0x018

0x01C

DMA_IFCR

リ セ ッ ト 値

DMA_CCR1

リ セ ッ ト 値

DMA_CPAR1

リ セ ッ ト 値

DMA_CMAR1

リ セ ッ ト 値

DMA_CCR2

リ セ ッ ト 値

0x020

DMA_CNDTR2

リ セ ッ ト 値

予約済み

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

予約済み

PL

[1:0]

M

SIZE

[1:0]

PSIZE

[1:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

予約済み

NDT[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

PA[31:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

MA[31:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

予約済み

予約済み

PL

[1:0]

M

SIZE

[1:0]

PSIZE

[1:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

予約済み

NDT[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

Rev 5 -日本語版 153/681

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

DMA コ ン ト ロー ラ (DMA)

RM0008

表 40.

オ フ

セ ッ ト

DMA - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 (続き)

レ ジス タ

0x024

0x028

DMA_CPAR2

リ セ ッ ト 値

DMA_CMAR2

リ セ ッ ト 値

PA[31:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

MA[31:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

予約済み

0x02C

0x030

0x034

DMA_CNDTR3

リ セ ッ ト 値

0x038

DMA_CCR3

リ セ ッ ト 値

DMA_CPAR3

リ セ ッ ト 値

予約済み

予約済み

PL

[1:0]

M

SIZE

[1:0]

PSIZE

[1:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

NDT[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

PA[31:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

0x03C

0x040

0x044

0x048

0x04C

DMA_CMAR3

リ セ ッ ト 値

MA[31:0]

DMA_CCR4

リ セ ッ ト 値

DMA_CNDTR4

リ セ ッ ト 値

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

予約済み

予約済み

PL

[1:0]

M

SIZE

[1:0]

PSIZE

[1:0]

予約済み

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

NDT[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

DMA_CPAR4

リ セ ッ ト 値

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

PA[31:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

0x050

0x054

0x058

DMA_CMAR4

リ セ ッ ト 値

DMA_CCR5

リ セ ッ ト 値

MA[31:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

予約済み

予約済み

PL

[1:0]

M

SIZE

[1:0]

PSIZE

[1:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

0x05C

DMA_CNDTR5

リ セ ッ ト 値

0x060

DMA_CPAR5

リ セ ッ ト 値

予約済み

NDT[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

PA[31:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

0x064

0x068

DMA_CMAR5

リ セ ッ ト 値

MA[31:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

予約済み

154/681 Rev 5 -日本語版

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参考資料

RM0008

DMA コ ン ト ロー ラ (DMA)

表 40.

オ フ

セ ッ ト

DMA - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 (続き)

レ ジス タ

0x06C

0x070

DMA_CNDTR6

リ セ ッ ト 値

0x074

DMA_CCR6

リ セ ッ ト 値

DMA_CPAR6

リ セ ッ ト 値

予約済み

予約済み

PL

[1:0]

M

SIZE

[1:0]

PSIZE

[1:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

NDT[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

PA[31:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

0x078

0x07C

0x080

0x08C

0x090

DMA_CMAR6

リ セ ッ ト 値

DMA_CCR7

リ セ ッ ト 値

MA[31:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

予約済み

予約済み

PL

[1:0]

M

SIZE

[1:0]

PSIZE

[1:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

0x084

DMA_CNDTR7

リ セ ッ ト 値

0x088

DMA_CPAR7

リ セ ッ ト 値

予約済み

NDT[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

PA[31:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

DMA_CMAR7

リ セ ッ ト 値

MA[31:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

予約済み

レ ジ ス タ のア ド レ ス範囲に関 し ては

表  1 (36 ページ)

を参照 し て く だ さ い。

Rev 5 -日本語版 155/681

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参考資料

A/D コ ンバー タ (ADC)

10 A/D コ ンバー タ (ADC)

RM0008

Flash メ モ リ 容量が 32 ~ 128Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト ロー

ラは、 中容量デバイ ス です。

Flash メ モ リ 容量が 256 ~ 512Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト

ロー ラ は、 大容量デバイ スです。

こ のセ ク シ ョ ンは、 注意書きがない限 り 、 STM32F10xxx フ ァ ミ リ 全てに適応 さ れます。

10.1 概要

ADC ペ リ フ ェ ラ ル回路の A/D コ ンバー タ は 12bit 逐次比較方式で、 マルチ プ レ ク サで切 り

替え ら れる最大 18 チ ャ ネルの入力は、 16 個の外部信号 と 2 個の内部 ソ ースの測定を行 う

こ と がで き ます。 複数のチ ャ ネルに対する測定は、 ワ ン スキ ャ ン ・ 連続スキ ャ ン及び分割

モー ド で行 う こ と がで き ます。 変換結果は、 16bit デー タ ・ レ ジ ス タ の上位 も し く は下位

に格納 さ れます。

アナ ロ グ ・ ウ ォ ッ チ ド ッ グ機能では、 ユーザが指定 し た上限 も し く は下限か ら、 入力が逸

脱 し ていないかを検出する こ と がで き ます。

10.2

注意 :

ADC の主な機能

精度 12bit

変換終了時、 イ ン ジ ェ ク ト 変換終了時、 及びアナ ロ グ ・ ウ ォ ッ チ ド ッ グ ・ イ ベン ト 終

了時に割込みを生成

ワ ン スキ ャ ン、 及び連続変換モー ド

チ ャ ネル 0 か ら チ ャ ネル n を自動変換する ためのスキ ャ ン ・ モー ド

自己較正

変換デー タ の性格に応 じ た ビ ッ ト 寄せの選択

チ ャ ネルご と のサン プ リ ン グ タ イ ムの設定

レ ギ ュ ラ 及び イ ン ジ ェ ク ト 変換の両方についての外部 ト リ ガ ・ オプ シ ョ ン

分割モー ド

デ ュ アル ・ モー ド (2 個の ADC の協調動作)

ADC 変換レー ト 1 MHz

- STM32F103xx パ フ ォ ーマ ン ス ・ ラ イ ン ・ デバイ ス : 56MHz 時 1μs (72MHz 時

1.17μs)

- STM32F101xx ア ク セス ・ ラ イ ン ・ デバイ ス : 28MHz 時 1μs (36MHz 時 1.55μs)

ADC 電源供給 : 2.4V ~ 3.6V

ADC 入力電圧 : V

REF-

≦ V

IN

≦ V

REF+

レ ギ ュ ラ 変換におけ る DMA リ ク エ ス ト の生成

ADC 回路のブ ロ ッ ク構成は

図  21

に示 さ れています。

V

REF-

ピ ンが用意 さ れているパ ッ ケージでは、 こ のピ ン を V

SSA

に接続 し て く だ さ い。

156/720 Rev 5 -日本語版

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参考資料

RM0008

10.3

A/D コ ンバー タ (ADC)

ADC の機能詳細

図  21

は、 1 回路分の ADC ブ ロ ッ ク図を、 表  41

は ADC ピ ン配列を示 し ています。

図 21.

シ ン グル ADC ブ ロ ッ ク図

変換終了

インジェクト変換終了

アナログ・ウォッチドッグ・イベント

フラグ

EOC

JEOC

AWD

割込み要求

許可ビット

EOCI E

JEOCIE

AWDIE

アナログウォッチドッグ

比較結果

上限スレッショルド

下限スレッショルド

(12 bits)

(12 bits)

ADC

割込み要求、

NVIC

V

V

V

RE F+

RE F-

V

DDA

SSA

アナログ

マルチブレクサ

ADCx_IN0

ADCx_IN1

ADC x_IN15

GPIO

ポート

最大 4

最大16

インジェクト

チャネル

レギュラ

チャネル

温度センサ

V

RE FINT

JEXTSE L[2:0] bits

TIM1_TRGO

TIM1_CH4

TIM2_TRGO

TIM2_CH1

TIM3_CH4

TIM4_TRG O

JE XTR IG bit

スタート・トリガ

(インジェクト・グループ)

E XTI_15

TIM8_CH4

(2)

ADCx-ETRGINJ_REMAP bit

EX TRI G bit

インジェクト・データ・レジスタ

(4 x 16 bits)

レギュラ・データ・レジスタ

(16 bits)

DMA

リクエスト

アナログ/デジタル

コンバータ

ADCCLK

ADC

プリスケーラから

E XTS E L[2:0] bits

TIM1_CH1

TIM1_CH2

TIM1_CH3

TIM2_CH2

TIM3_TRG O

TIM4_CH4

スタート・トリガ

(レギュラ・グループ)

EXTI_11

TIM8_TRGO

(2)

ADCx_ETRGREG_REMAP bit

JEXTSE L[2:0] bits

TIM1_TRGO

TIM1_CH4

TIM4_CH3

TIM8_CH2

TIM8_C H4

TIM5_TRG O

TIM5_CH4

JE XT R IG bit

スタート・トリガ

(インジェクト・グループ)

E XTS E L[2:0] bits

TIM3_CH 1

TIM2_CH 3

TIM1_CH3

TIM8_CH1

TIM8_TRG O

TIM5_C H1

TIM5_CH3

EX TRIG bit

スタート・トリガ

(レギュラ・グループ)

ADC3のトリガ

(1) ai14802d

1.

ADC3 は、 ADC1 と ADC2 と は異な る レギ ュ ラ と イ ン ジ ェ ク ト 変換 ト リ ガ を持 っ ています。

2.

TIM8_CH4 と TIM8_TRGO に対応 し た ビ ッ ト 寄せは、 大容量デバイ スに限 り 存在 し ます。

Rev 5 -日本語版 157/720

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参考資料

A/D コ ンバー タ (ADC)

10.3.1

10.3.2

10.3.3

RM0008

表 41.

V

REF+

V

DDA

V

REF-

名称

V

SSA

ADCx_IN[15:0]

ADC ピ ン

信号種別

入力、

アナログ参照電圧 +

入力、

アナログ電源供給

入力、

アナログ参照電圧 -

入力、

アナロググ ラ ン ド

アナログ入力信号

摘要

ADC の参照電圧、 ハイ レ ベル / 正電圧

2.4V ≦ V

REF+

≦ V

DDA

アナログ回路電源、

2.4V ≦ V

DDA

V

DD

(3.6V)

ADC の参照電圧、 ローレ ベル / 負電圧

V

REF-

= V

SSA

V

SS

と 等 し いアナログ回路電源のグ ラ ン ド

16 チ ャ ネルのアナログ入力

ADC 電源の制御

ADC 回路は ADC_CR1 レ ジ ス タ の ADON ビ ッ ト を セ ッ ト する こ と で、 電源オ ンの状態 と な

り ます。 ADON ビ ッ ト が最初にセ ッ ト さ れた と き には、 ADC はパワー ・ ダウ ン ・ モー ド か

らの立上げ と な り ます。

二度目に ADON ビ ッ ト が ソ フ ト ウ ェ ア でセ ッ ト さ れる と 、 ADC パワー ・ ア ッ プ ・ タ イ ム

(t

STAB

) 後に変換動作が開始 さ れます。

変換動作を停止 し ADC をパワー ・ ダウ ン ・ モー ド と する には、 ADON ビ ッ ト を ク リ ア し ま

す。 こ の状態では ADC 回路は電源をほ と んど消費 し ません。 (数 μA 程度)

ADC ク ロ ッ ク

PCLK2 (APB2 ク ロ ッ ク ) に同期 し た ADCCLK ク ロ ッ ク は ク ロ ッ ク ・ コ ン ト ロー ラ か ら 供

給 さ れます。 RCC コ ン ト ロー ラ は、 ADC ク ロ ッ ク 専用のプ リ スケー ラ を持 っ ています。

詳細は、

リ セ ッ ト と ク ロ ッ クの制御 (RCC) (72 ページ)

ク ロ ッ ク (CLK) の章を参照 し て く

だ さ い。

チ ャ ネル選択

ADC は 16 の多重化 さ れた入力チ ャ ネルを搭載 し ています。 こ れ らの入力の変換動作は、

レギ ュ ラ (regular) と イ ン ジ ェ ク ト (injected) の 2 グループに構成する こ と がで き ます。 各

グループは変換チ ャ ネルの順序を定める も ので、 任意のチ ャ ネルを任意の順序で指定する

こ と がで き ます。 た と えば、 Ch3、 Ch8、 Ch2、 Ch2、 Ch0、 Ch2、 Ch2、 Ch15 のよ う なチ ャ ネ

ルの選び方が可能です。

レ ギ ュ ラ ・ グループ (regular group) には、 最大 16 個の変換動作を指定する こ と がで き

ます。 レギ ャ ラ ・ グループのチ ャ ネル と 順序は ADC_SQRx レ ジ ス タ で指定 し 、 グルー

プに含まれる変換の数は ADC_SQR1 レ ジ ス タ の L[3:0] フ ィ ール ド で与え ます。

イ ン ジ ェ ク ト ・ グループ (injected group) には、 最大 4 個の変換動作を指定する こ と が

で き ます。 イ ン ジ ェ ク ト ・ グループのチ ャ ネル と 順序は ADC_JSQR レ ジ ス タ で指定

し 、 グループに含まれる変換の数は同 じ ADC_JSQR レ ジ ス タ の JL[1:0] フ ィ ール ド で

与え ます。

変換動作中に ADC_SQRx も し く は ADC_JSQR レ ジ ス タ が変更 さ れた時には、 その時点で

行われてい る変換は リ セ ッ ト さ れ、 新たに設定 さ れたグループの変換を開始する ス タ ー ト

パルスが ADC に送 られます。

158/720 Rev 5 -日本語版

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頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

注意 :

10.3.4

10.3.5

A/D コ ンバー タ (ADC)

温度セ ンサ /V

REFINT

内部チ ャ ネル

温度セ ンサは ADCx_IN16 へ、 内部の参照電圧 V

REFINT

は ADCx_IN17 へ、 チ ッ プ内部で ADC

に接続 さ れています。 こ の両内部チ ャ ネルは、 レ ギ ュ ラ ・ グループ、 イ ン ジ ェ ク ト ・ グ

ループのいずれにおいて も 、 一般の入力チ ャ ネル と 同様に選択する こ と がで き ます。

温度セ ンサ と V

REFINT

はマス タ ADC1 のみで利用で き ます。

シ ン グル変換モー ド (Single conversion mode)

シ ン グル変換モー ド では ADC は一回の変換を行います。 こ のモー ド は CONT ビ ッ ト が 0

の と き、 ADC_CR2 レ ジ ス タ の ADON ビ ッ ト を セ ッ ト する (レギ ュ ラ ・ チ ャ ネルのみ) か、

も し く は外部 ト リ ガに よ っ て (レギ ュ ラ も し く はイ ン ジ ェ ク ト ・ チ ャ ネルの場合) 変換が

行われます。

指定 さ れたチ ャ ネルの変換が終了する と 、

レ ギ ュ ラ ・ チ ャ ネルが変換 し た場合 :

- 変換 さ れたデー タ は 16bit の ADC_DR レ ジ ス タ に格納 さ れます。

- EOC (End Of Conversion) フ ラ グがセ ッ ト さ れます。

- EOCIE ビ ッ ト がセ ッ ト さ れていれば、 割込み リ ク エ ス ト を発生 し ます。

イ ン ジ ェ ク ト ・ チ ャ ネルが変換 し た場合 :

- 変換 さ れたデー タ は 16bit の ADC_DRJ1 レ ジ ス タ に格納 さ れます。

- JEOC (End Of Conversion Injected) フ ラ グがセ ッ ト さ れます。

- JEOCIE ビ ッ ト がセ ッ ト さ れていれば、 割込み リ ク エ ス ト が発生 し ます。

こ の後、 ADC の変換動作は停止 し ます。

連続変換モー ド (Continuous conversion mode)

連続変換モー ド では、 ADC は一回の変換が終わる と 次の変換に移 り ます。 こ のモー ド は

CONT ビ ッ ト が 1 の と き、 外部 ト リ ガか、 も し く は ADC_CR2 レ ジ ス タ の ADON ビ ッ ト を

セ ッ ト する こ と でス タ ー ト し ます。

グループの各入力チ ャ ネルの変換の後に、

レ ギ ュ ラ ・ チ ャ ネルが変換 し た場合 :

- 変換 さ れたデー タ は 16bit の ADC_DR レ ジ ス タ に格納 さ れます。

- EOC (End Of Conversion) フ ラ グがセ ッ ト さ れます。

- EOCIE ビ ッ ト がセ ッ ト さ れていれば、 割込み リ ク エ ス ト を発生 し ます。

イ ン ジ ェ ク ト ・ チ ャ ネルが変換 し た場合 :

- 変換 さ れたデー タ は 16bit の ADC_DRJ1 レ ジ ス タ に格納 さ れます。

- JEOC (End Of Conversion Injected) フ ラ グがセ ッ ト さ れます。

- JEOCIE ビ ッ ト がセ ッ ト さ れていれば、 割込み リ ク エ ス ト が発生 し ます。

Rev 5 -日本語版 159/720

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れ製

品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の正

規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料情報に

基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

A/D コ ンバー タ (ADC)

10.3.6

RM0008

タ イ ミ ン グ図

図  22

に見 られる よ う に、 ADC は高精度の変換動作を開始する前に安定時間 t

STAB

を必要

と し ます。 ADC 変換の開始後 14 ク ロ ッ ク ・ サイ クルで EOC フ ラ グがセ ッ ト さ れ、 変換 さ

れたデー タ は 16bit の ADC デー タ ・ レ ジ ス タ に格納 さ れます。

図 22.

タ イ ミ ン グ図

ADC_CLK

SET ADON

1 番目の変換の開始

ADC パワー・オン

次の変換の開始

次の ADC 変換

ADC t

STAB

ADC 変換

変換時間

(トータル変換時間)

EOC

10.3.7

ソフトウェアが EOC ビットをリセット

アナロ グ ・ ウ ォ ッ チ ド ッ グ

アナ ロ グ ・ ウ ォ ッ チ ド ッ グ (AWD) ス テー タ ス ・ ビ ッ ト は、 ADC で変換 さ れた値が下限ス

レ ッ シ ョ ル ド を下回るか、 も し く は上限ス レ ッ シ ョ ル ド を超えた時にセ ッ ト さ れます。 こ

の上下限の値は、 16bit レ ジ ス タ ADC_HTR 及び ADC_LTR レ ジ ス タ の下位 12bit に設定 し ま

す。 ADC_CR1 レ ジ ス タ の AWDIE ビ ッ ト の設定で、 割込み リ ク エ ス ト を発生 さ せる こ と も

で き ます。

上下限の値は ADC_CR2 レ ジ ス タ の ALIGN ビ ッ ト の設定の影響を受けません。 上下限 と の

比較はデー タ を 16bit 化する前に行われます。 (

セ ク シ ョ ン  10.5

を参照)

アナ ロ グ ・ ウ ォ ッ チ ド ッ グ機能は

表 42.

のよ う に、 ADC_CR1 レ ジ ス タ の設定に応 じ て、 一

変換 も し く は一連の変換を チ ェ ッ ク 対象 と する こ と がで き ます。

図 23.

アナ ロ グ ・ ウ ォ ッ チ ド ッ グの保護 ド メ イ ン

アナログ電圧

上限スレッショルド

保護ドメイン

下限スレッショルド

HTR

LTR

160/720 Rev 5 -日本語版

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参考資料

RM0008

10.3.8

10.3.9

A/D コ ンバー タ (ADC)

表 42.

アナ ロ グ ・ ウ ォ ッ チ ド ッ グ ・ チ ャ ネル選択

ADC_CR1 レ ジ ス タ 制御ビ ッ ト (x = 無視 )

アナログ ・ ウ ォ ッ チ ド ッ グで監視 さ れ

る チ ャ ネル

AWDSGL ビ ッ ト AWDEN ビ ッ ト JAWDEN ビ ッ ト

な し

すべてのイ ン ジ ェ ク ト ・ チ ャ ネル

すべてのレギ ュ ラ ・ チ ャ ネル

すべてのレギ ュ ラ と イ ン ジ ェ ク ト ・

チ ャ ネル

シ ングル

(1)

イ ン ジ ェ ク ト ・ チ ャ ネル

シ ングル

(1)

レギ ュ ラ ・ チ ャ ネル

シ ングル

(1)

レギ ュ ラ または

イ ン ジ ェ ク ト ・ チ ャ ネル

1. AWDCH[4:0] フ ィ ール ド で指定 さ れます。 x

0

0

0

1

1

1

1

0

1

0

0

1

1

1

0

0

1

0

1

1

スキ ャ ン ・ モー ド (Scan mode)

こ のモー ド はアナ ロ グ入力のグループ を スキ ャ ンする際に使用 さ れます。

スキ ャ ン ・ モー ド は ADC_CR1 レ ジ ス タ の SCAN ビ ッ ト を セ ッ ト し た と き に選択 さ れます。

こ のビ ッ ト がセ ッ ト さ れる と 、 ADC は ADC_SQRx レ ジ ス タ (レ ギ ュ ラ ・ チ ャ ネル時) も し

く は ADC_JSQR レ ジ ス タ (イ ン ジ ェ ク ト ・ チ ャ ネル時) で選択 さ れているすべてのチ ャ ネ

ルを スキ ャ ン し ます。 グループ内の各チ ャ ネルに対 し ては、 1 回の変換が行われます。 各

変換が終了する と 、 グループ内の次の変換が自動的に行われます。 CONT ビ ッ ト がセ ッ ト

さ れていれば、 グループの最後のチ ャ ネルのあ と も変換動作は終了せず、 そのグループの

最初の項目か ら 変換が続け ら れます。

DMA ビ ッ ト がセ ッ ト さ れていれば、 各 EOC 時に、 レ ギ ャ ラ ・ グループの変換デー タ を

SRAM に転送する ために DMA コ ン ト ロー ラ を利用する こ と がで き ます。

イ ン ジ ェ ク ト ・ チ ャ ネルの変換デー タ は、 常に ADC_JDRx レ ジ ス タ に格納 さ れます。

イ ン ジ ェ ク ト ・ チ ャ ネルの管理

ト リ ガ ・ イ ン ジ ェ ク シ ョ ン (Triggered injection)

ト リ ガ ・ イ ン ジ ェ ク シ ョ ン を行 う には、 ADC_CR1 レ ジ ス タ で JAUTO ビ ッ ト が ク リ ア さ れ

てお り 、 SCAN ビ ッ ト がセ ッ ト さ れていなければな り ません。

1.

外部 ト リ ガか、 ADC_CR2 レ ジ ス タ の ADON ビ ッ ト を セ ッ ト する こ と に よ り 、 レギ ャ

ラ ・ グループのチ ャ ネルの変換を開始 し ます。

2. レ ギ ャ ラ ・ グループの変換中に、 外部イ ン ジ ェ ク ト ・ ト リ ガが発生する と 、 その時点

で行われてい る変換は リ セ ッ ト さ れ、 イ ン ジ ェ ク ト ・ チ ャ ネル ・ シーケ ン スは、 ス

キ ャ ン ・ ワ ン ス ・ モー ド で変換 さ れます。

3. その後、 レギ ュ ラ ・ グループ ・ チ ャ ネル変換は、 最後の割込みレ ギ ュ ラ 変換か ら再開

さ れます。 レギ ュ ラ ・ イ ベ ン ト はイ ン ジ ェ ク ト 変換の間に発生 し 、 割込みはあ り ませ

んが、 イ ン ジ ェ ク ト ・ シーケ ン スの終了時に、 レギ ュ ラ ・ シーケ ン スが実行 さ れま

す。

図  24

は、 タ イ ミ ン グ図を示 し ています。

Rev 5 -日本語版 161/720

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参考資料

A/D コ ンバー タ (ADC)

注意 :

注意 :

RM0008

ト リ ガ ・ イ ン ジ ェ ク シ ョ ン を使用する場合は、 ト リ ガ ・ イ ベン ト の間隔はイ ン ジ ェ ク シ ョ

ン ・ シーケ ン ス よ り 長 く なければな り ません。 例えば、 シーケ ン スの長 さ が 28 ADC ク

ロ ッ ク ・ サイ クル (それぞれの 1.5 ク ロ ッ ク周期のサン プ リ ング時間を持つ 2 つの 変換)

の場合、 最小の ト リ ガ間隔は 29ADC ク ロ ッ ク ・ サイ クルにする必要があ り ます。

自動イ ン ジ ェ ク シ ョ ン (Auto injection)

JAUTO ビ ッ ト がセ ッ ト さ れている と き、 イ ン ジ ェ ク ト ・ グループ ・ チ ャ ネルはレギ ュ ラ ・

グループ ・ チ ャ ネルの後に自動的に変換 さ れます。 こ れに よ り 、 ADC_SQRx レ ジ ス タ と

ADC_JSQR レ ジ ス タ を使用 し て最大 20 個の変換順序を設定で き ます。

こ のモー ド ではイ ン ジ ェ ク ト ・ チ ャ ネルの外部 ト リ ガは無効にする必要があ り ます。

JAUTO ビ ッ ト と と も に CONT ビ ッ ト がセ ッ ト さ れてい る場合は、 レギ ュ ラ ・ チ ャ ネルの

変換 と イ ン ジ ェ ク ト ・ チ ャ ネルの変換が交互に行われます。

範囲 4 か ら 8 ま での ADC ク ロ ッ ク ・ プ リ スケー ラ 用には、 レギ ュ ラ か ら イ ン ジ ェ ク ト ・

シーケ ン ス (同様に イ ン ジ ェ ク ト か ら レギ ュ ラ ) への切 り 替え時に、 1ADC ク ロ ッ ク周期

の遅延時間が自動的に挿入 さ れます。 ADC ク ロ ッ ク ・ プ リ スケー ラが 2 に設定 さ れた場

合、 遅延時間は 2ADC ク ロ ッ ク 周期です。

自動イ ン ジ ェ ク ト ・ モー ド と 分割モー ド を同時に有効 と する こ と はで き ません。

図 24.

イ ン ジ ェ ク ト 変換の遅延時間

ADC クロック

インジェクト・イベント

ADC リセット

SOC

最大遅延時間

(1)

1. 最大遅延時間は、 STM32F101 及び STM32F103xx の電気特性の資料 に 記 さ れ て い ま す。

10.3.10 分割モー ド (Discontinuous mode)

レギ ュ ラ ・ グループ

こ のモー ド は ADC_CR1 レ ジ ス タ の DISCEN ビ ッ ト を セ ッ ト する こ と で有効 と な り ます。

こ のモー ド では、 ADC_SQRx レ ジ ス タ で指定 さ れてい る変換対象の う ちの n (n <=8) 項目を

一連の変換の対象 と し ます。 変換数 n は ADC_CR1 レ ジ ス タ の DISCNUM[2:0] フ ィ ール ド で

指定 し ます。

外部 ト リ ガが生 じ る と 、 ADC_SQRx レ ジ ス タ で選択 さ れてい る項目がすべて終了する ま

で、 こ の内の次の n 項目の変換が開始 さ れます。 ADC_SQRx の有効な設定の総数は

ADC_SQR1 レ ジ ス タ の L[3:0] で指定 さ れています。

162/720 Rev 5 -日本語版

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RM0008

A/D コ ンバー タ (ADC)

注意 :

例 : n = 3

変換対象 と な る チ ャ ネル = 0、 1、 2、 3、 6、 7、 9、 10

最初の ト リ ガに よ る変換の対象は、 0、 1、 2

2 番目の ト リ ガに よ る変換の対象は、 3、 6、 7

3 番目の ト リ ガに よ る変換の対象は、 9、 10、 次に EOC イ ベン ト が生 じ ます。

4 番目の ト リ ガに よ る変換の対象は、 0、 1、 2

レギ ュ ラ変換グループが分割モー ド で変換 さ れる と き には、 指定項目の最後から直ちに最

初の項目に戻る こ と はあ り ません。

グループのすべての分割スキ ャ ンが終了する と 、 次の ト リ ガではグループの最初から ス

キ ャ ンが行われます。 上の例では、 4 番目の ト リ ガで最初のサブグループ 0 、 1 、 2 が変換 さ

れます。

イ ン ジ ェ ク ト ・ グループ

こ のモー ド は ADC_CR1 レ ジ ス タ の JDISCEN ビ ッ ト を セ ッ ト する こ と で有効 と な り ます。

こ のモー ド では、 ADC_JSQR レ ジ ス タ で指定 さ れている変換対象を、 外部 ト リ ガご と に 1

チ ャ ネルずつ変換 し ます。

外部 ト リ ガが生 じ る と 、 ADC_JSQR レ ジ ス タ で選択 さ れている項目がすべて終了する ま

で、 こ の内の次の変換が開始 さ れます。 ADC_JSQR の有効な設定の総数は ADC_JSQR レ ジ

ス タ の JL[1:0] で指定 さ れています。

例 : n = 1、 変換対象 と な る チ ャ ネル = 1

2

3

最初の ト リ ガではチ ャ ネル 1 が変換 さ れ、

2 番目の ト リ ガではチ ャ ネル 2 が変換 さ れ、

3 番目の ト リ ガではチ ャ ネル 3 が変換 さ れ、 EOC 及び JEOC イ ベン ト が生 じ ます。

4 番目の ト リ ガではチ ャ ネル 1 が変換 さ れます。

注意 : 1 すべてのイ ン ジ ェ ク ト ・ チ ャ ネルが変換 さ れる と 、 次の ト リ ガではグループの最初から変

換が行われます。 上の例では、 4 番目の ト リ ガで最初の項目、 チ ャ ネル 1 が変換 さ れます。

2 自動イ ン ジ ェ ク ト ・ モー ド と 分割モー ド を同時に有効 と する こ と はで き ません。

3 レギ ュ ラ と イ ン ジ ェ ク ト ・ グループの両方で分割モー ド を設定 し てはいけません。 この

モー ド の設定は、 いずれか一方のグループのみに限られます。

10.4 較正機能

ADC には、 自己較正機能が備え られています。 こ の較正機能で、 内部の複数のキ ャパシ タ

のば ら つ き に よ る誤差を大幅に低減する こ と がで き ます。 較正時に誤差の補正値 (デジ タ

ル値) が個々のキ ャ パシ タ に対 し て計算 さ れ、 変換動作時に こ の補正値を利用する こ と で

キ ャパシ タ に よ る誤差を取 り 除き ます。

較正は ADC_CR2 レ ジ ス タ の CAL ビ ッ ト を セ ッ ト する こ と で開始 さ れます。 較正が終了す

る と 、 CAL ビ ッ ト はハー ド ウ ェ ア で ク リ ア さ れ、 通常の変換動作が行われます。 パワー ・

オ ン後に一度、 ADC の較正を行 う こ と が推奨 さ れます。 較正動作が終了する と 、 補正値が

ADC_DR レ ジ ス タ に格納 さ れます。

注意 : 1 パワー ・ ア ッ プ後には、 毎回、 較正を実行する こ と を お勧め し ます。

2 較正動作を開始する前に、 ADC は少な く と も 2 ADC ク ロ ッ ク ・ サイ クルの間、 パワー ・

オ フの状態 (ADON ビ ッ ト = 0) になければな り ません。

Rev 5 -日本語版 163/720

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参考資料

A/D コ ンバー タ (ADC)

図 25.

較正動作の タ イ ミ ン グ図

CLK

CAL

ADC

変換

較正動作進行中 t

CAL

較正動作がハー ド ウエ アに よ り リ セ ッ ト さ れる

通常の ADC 変換

RM0008

10.5 デー タ の配置

ADC_CR2 レ ジ ス タ の ALIGN ビ ッ ト は、

図 26.

及び

図 27.

のよ う に、 変換デー タ をデー タ ・

レ ジ ス タ に格納する際に左寄せするか、 も し く は右寄せするかを指定 し ます。

イ ン ジ ェ ク ト ・ グループ ・ チ ャ ネルのデー タ の場合には、 ADC_JOFRx レ ジ ス タ に ソ フ ト

ウ ェ ア で任意に設定 し た値を引き算する こ と がで き、 負の値を含む変換結果 と する こ と が

で き ます。 SEXT は符号が拡張 さ れた ビ ッ ト です。

レギ ュ ラ ・ グループ ・ チ ャ ネルの変換結果ではオ フ セ ッ ト の引き算は行われませんので、

12bit のみが有効です。

図 26.

デー タ の右寄せ

イ ン ジ ェ ク ト ・グループ

SEXT SEXT SEXT SEXT D11 D10 D9 D8 D7 D6 D5 D4 D3 D2 D1 D0

レギ ャ ラ ・グループ

0 0 0 0 D11 D10 D9 D8 D7 D6 D5 D4 D3 D2 D1 D0

図 27.

デー タ の左寄せ

イ ン ジ ェ ク ト ・グループ

SEXT D11 D10 D9 D8 D7 D6 D5

レギ ャ ラ ・グループ

D11 D10 D9

D4 D3 D2 D1 D0 0

D8 D7 D6 D5 D4 D3 D2 D1 D0 0 0

0 0

0 0

164/720 Rev 5 -日本語版

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参考資料

RM0008

10.6

A/D コ ンバー タ (ADC)

入力チ ャ ネルご と のサン プ リ ング タ イムの設定

ADC は入力電圧を読込む際に、 サン プル ・ タ イ ム と し て、 ADCCLK サイ ク ルを単位 と し て

ADC_SMPR1 及び ADC_SMPR2 の SMP[2:0] で指定 さ れたサン プ リ ン グ タ イ ムを使用 し ます。

個々の入力チ ャ ネルには、 個々に異な っ たサン プ リ ン グ タ イ ムを設定 し てお く こ と がで き

ます。

チ ャ ネルの変換に要する時間は次の式で計算 さ れます。

Tconv = サン プ リ ン グ タ イ ム + 12.5 サイ クル

例 :

ADCCLK = 14 MHz で、 サン プ リ ン グ タ イムが 1.5 サイ ク ルの と き、

Tconv = 1.5 + 12.5 = 14 サイ クル = 1μs

10.7

注意 :

外部 ト リ ガに よ る変換

タ イ マキ ャ プ チ ャ、 外部割込みな どの外部イ ベ ン ト を変換の ト リ ガ と する こ と がで き ます。

EXTTRIG 制御ビ ッ ト がセ ッ ト さ れていれば、 外部イ ベ ン ト は変換動作を ト リ ガする こ と が

で き ます。EXTSEL[2:0] 及び JEXTSEL[2:0] フ ィ ール ド はレ ギ ュ ラ 及び イ ン ジ ェ ク ト ・グルー

プのそれぞれについて、 8 種の イ ベ ン ト か ら ト リ ガ と し て使用 さ れる イ ベ ン ト を選択 し ま

す。

ADC のレギ ュ ラ及び イ ン ジ ェ ク ト 変換 と し て外部 ト リ ガが選択 さ れている と き、 ト リ ガ信

号の立上が り エ ッ ジのみが変換動作の ト リ ガ と な り ます。

表 43.

ADC1 と ADC2 のレ ギ ュ ラ ・ チ ャ ネルのための外部 ト リ ガ

ト リ ガ ・ ソ ース 信号種別 EXTSEL[2:0]

タ イ マ 1 CC1 出力

タ イ マ 1 CC2 出力

タ イ マ 1 CC3 出力

タ イ マ 2 CC2 出力

000

001

オ ン チ ッ プ ・ タ イ マから の信号

010

011

タ イ マ 3 TRGO 出力

タ イ マ 4 CC4 出力

100

101

外部割込み 11

/TIM8_TRGO イ ベン ト

(1)(2)

SWSTART

外部ピ ン / オ ン チ ッ プ ・ タ イ マ

か らの内部信号

110

ソ フ ト ウ ェ ア制御ビ ッ ト 111

1.

TIM8_TRGO イ ベン ト は、 大容量デバイ スにのみ搭載 さ れています。

2.

外部 ト リ ガ EXTI line11 やレギ ュ ラ ・ チ ャ ネルのための TIM8_TRGO イ ベン ト の選択は、  ADC1 と ADC2 の

それぞれについて、 構成ビ ッ ト ADC1_ETRGREG_REMAP 及び ADC2_ETRGREG_REMAP によ り 行われます。

Rev 5 -日本語版 165/720

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参考資料

A/D コ ンバー タ (ADC)

RM0008

表 44.

ADC1 と ADC2 のイ ン ジ ェ ク ト ・ チ ャ ネルのための外部 ト リ ガ

ト リ ガ ・ ソ ース 信号種別 JEXTSEL[2:0]

タ イ マ 1 TRGO 出力

タ イ マ 1 CC4 出力

タ イ マ 2 TRGO 出力

タ イ マ 2 CC1 出力

タ イ マ 3 CC4 出力

タ イ マ 4 TRGO 出力

外部割込み 15

/TIM8_CC4 イ ベン ト

(1)(2)

JSWSTART

000

001

オン チ ッ プ ・ タ イ マから の信号

010

011

100

101

外部ピ ン / オン チ ッ プ ・ タ イ マ

か らの内部信号

110

ソ フ ト ウ ェ ア制御ビ ッ ト 111

1.

TIM8_CC4 イ ベン ト は、 大容量デバイ スにのみ搭載 さ れています。

2.

外部 ト リ ガ EXTI line15 やイ ン ジ ェ ク ト ・ チ ャ ネルの TIM8_CC4 イ ベン ト は、 ADC1 と ADC2 のそれぞれに

ついて、 構成ビ ッ ト ADC1_ETRGINJ_REMAP 及び ADC2_ETRGINJ_REMAP によ り 行われます。

表 45.

ADC3 のレ ギ ュ ラ ・ チ ャ ネルのための外部 ト リ ガ

ト リ ガ ・ ソ ース 信号種別 EXTSEL[2:0]

タ イ マ 3   CC1 イ ベン ト

タ イ マ 2   CC3 イ ベン ト

タ イ マ 1   CC3 イ ベン ト

タ イ マ 8   CC1 イ ベン ト

タ イ マ 8   TRGO イ ベン ト

タ イ マ 5   CC1 イ ベン ト

タ イ マ 5   CC3 イ ベン ト

SWSTART

オ ン チ ッ プ ・ タ イ マか らの

内部信号

ソ フ ト ウ ェ ア制御ビ ッ ト

100

101

110

111

000

001

010

011

そふ と う え

表 46.

ADC3 のイ ン ジ ェ ク ト ・ チ ャ ネルのための外部 ト リ ガ

ト リ ガ ・ ソ ース 信号種別

タ イ マ 1   TRGO イ ベン ト

タ イ マ 1   CC4 イ ベン ト

タ イ マ 4   CC3 イ ベン ト

タ イ マ 8   CC2 イ ベン ト

タ イ マ 8   CC4 イ ベン ト

タ イ マ 5   TRGO イ ベン ト

タ イ マ 5   CC4 イ ベン ト

JSWSTART

オン チ ッ プ ・ タ イ マか らの

内部信号

ソ フ ト ウ ェ ア制御ビ ッ ト

100

101

110

111

000

001

010

011

JEXTSEL[2:0]

ソ フ ト ウ ェ ア ・ ト リ ガ ・ イ ベ ン ト は、 レ ジ ス タ のビ ッ ト (SWSTART 及び ADC_CR2 の

JSWSTART) を設定する こ と で行え ます。

レギ ャ ラ ・ グループ変換は、 イ ン ジ ェ ク ト ・ ト リ ガに よ り 割込まれる こ と が可能です。

166/720 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

10.8 DMA リ ク エ ス ト

注意 :

10.9

注意 :

注意 :

A/D コ ンバー タ (ADC)

レギ ュ ラ ・ チ ャ ネルの変換では変換結果は 1 個のレ ジ ス タ に格納 さ れます。 こ のため、 複

数のチ ャ ネルを変換する際にすでに ADC_DR レ ジ ス タ に格納 さ れてい るデー タ が失われる

のを防ぐ ため、 DMA の使用が必要 と さ れる場合があ り ます。

レギ ュ ラ ・ チ ャ ネルの変換終了時にのみ DMA リ ク エ ス ト が発生 し 、 こ れに よ り ADC_DR

レ ジ ス タ から ソ フ ト ウ ェ ア で指定 し た場所に変換デー タ を移動する こ と がで き ます。

この DMA 機能は、 ADC1 と ADC3 だけが持っ ています。 ADC2 によ り 変換 さ れたデー タ は、

マ ス タ であ る ADC1 に よ っ て、 DMA を使いデ ュ アル ADC モー ド で転送可能です。

デ ュ アル ADC モー ド

ADC を 2 回路搭載 し たデバイ ス では、 デ ュ アル ADC モー ド を使用する こ と がで き ます。

図  28

を参照)

デ ュ アル ADC モー ド では、 ADC1 (マ ス タ ) と ADC2 (ス レ ーブ) に、 交互に、 も し く は

同時に変換開始 ト リ ガが与え られます。 こ れは ADC_CR1 レ ジ ス タ の DUALMOD[2:0] ビ ッ

ト で選択 さ れます。

デ ュ アル ADC モー ド では、 外部イ ベン ト によ る変換動作の設定はマス タ ADC のみに行い

ます。 ス レーブ で ソ フ ト ウ ェ ア ・ ト リ ガ を セ ッ ト する と 、 ス レーブ ADC で誤っ た変換動

作が行われて し まいます。 但 し 、 外部 ト リ ガ を有効 と する設定は、 マス タ と ス レーブの両

方の ADC に対 し て行われねばな り ません。

デ ュ アル ADC には、 次の 6 種の動作モー ド があ り ます。

- 同時イ ン ジ ェ ク ト ・ モー ド (Injected simultaneous mode)

- 同時レギ ュ ラ ・ モー ド (Regular simultaneous mode)

- 高速イ ン タ リ ーブ ・ モー ド (Fast interleaved mode)

- 低速イ ン タ リ ーブ ・ モー ド (Slow interleaved mode)

- オル タ ネー ト ・ ト リ ガ ・ モー ド (Alternate trigger mode)

- 独立モー ド (Independent mode)

こ れ ら のモー ド が次のよ う に組合わ さ れる場合があ り ます。

- 同時イ ン ジ ェ ク ト ・ モー ド + 同時レギ ュ ラ ・ モー ド

- 同時レギ ュ ラ ・ モー ド + オル タ ネー ト ・ ト リ ガ ・ モー ド

- 同時イ ン ジ ェ ク ト ・ モー ド + イ ン タ リ ーブ ・ モー ド

デ ュ アル ADC モー ド では、 マス タ のデー タ ・ レ ジス タ から ス レーブの変換デー タ を読出

すには、 変換 さ れた レギ ュ ラ ・ チ ャ ネル ・ デー タ の転送に使用 さ れるか否かにかかわら

ず、 DMA ビ ッ ト がセ ッ ト さ れていなければな り ません。

Rev 5 -日本語版 167/720

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基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

A/D コ ンバー タ (ADC)

図 28.

デ ュ アル ADC ブ ロ ッ ク図

レギュラ・データ・レジスタ

インジェクト・データ・レジスタ

(4 x 16 bits)

レギュラ

チャネル

インジェクト

チャネル

内部トリガ

レギュラ・データ・レジスタ

(16 bits)*

インジェクト・データ・レジスタ

(4 x 16 bits)

ADCx_IN0

ADCx_IN1

ADCx_IN15

GPIO

ポート

 温度センサ

V

REFINT

EXTI_11

スタート・トリガ・

マルチプレクサ

(レギュラ・グループ)

EXTI_15

スタート・トリガ・

マルチプレクサ

(インジェクト・グループ)

レギュラ

チャネル

インジェクト

チャネル

デュアル・モード

制御

RM0008

: 外部 ト リ ガは ADC2 上にあ り ますが、こ のブ ロ ッ ク図には記載 さ れていません。

* 幾つかのデ ュ アル ADC モー ド では、ADC1 デー タ ・レ ジ ス タ (ADC1_DR)は ADC1 と ADC2 の両方の

レギ ュ ラ 変換デー タ を、32 ビ ッ ト 全体の中に含みます。

168/720 Rev 5 -日本語版

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参考資料

RM0008

10.9.1

注意 :

注意 :

A/D コ ンバー タ (ADC)

同時イ ン ジ ェ ク ト ・ モー ド (Injected simultaneous mode)

こ のモー ド ではイ ン ジ ェ ク ト ・ チ ャ ネル ・ グループの変換を行います。 外部 ト リ ガ信号は

(ADC1_CR2 レ ジ ス タ の JEXTSEL[2:0] に よ っ て選択 さ れた) ADC1 のイ ン ジ ェ ク ト ・ グ

ループ ・ マルチ プ レ ク サか ら 来ます。 同時 ト リ ガは ADC2 へ送 られます。

同 じ 入力チ ャ ネルを両方の ADC で変換 し てはいけません。 (同 じ チ ャ ネルを両方の ADC

で変換する時には、 サン プ リ ング タ イムが重な っ てはいけません。)

ADC1 も し く は ADC2 におけ る変換終了イ ベ ン ト 時に、

変換 さ れたデー タ は、 各 ADC の ADC_JDRx レ ジ ス タ に格納 さ れています。

ADC1/ADC2 のイ ン ジ ェ ク ト ・ チ ャ ネルがすべて変換 さ れた と き、 いずれかの ADC で

割込み リ ク エ ス ト が許可 さ れていれば、 JEOC 割込み リ ク エ ス ト が発生 し ます。

同時モー ド では、 変換グループの長 さ が同一で、 両方の変換グループ で必要な ト リ ガ間隔

よ り 、 実際の ト リ ガ間隔が長い こ と が確実でなければな り ません。 変換グループの長 さ が

異な る と き には、 長いほ う の ADC で変換が終了する までに、 短い方の ADC で設定の最初

に戻っ ての変換が行われる こ と があ り ます。

図 29.

4 チ ャ ネルの同時イ ン ジ ェ ク ト ・ モー ド

ADC2

ADC1

ト リ ガ

CH0

CH3

CH1

CH2

CH2

CH1

サン プ リ ン グ

変換

CH3

CH0

ADC1 と ADC2 上の イ ン ジ ェ ク ト 変換の終わ り

10.9.2

注意 :

注意 :

同時レギ ュ ラ ・ モー ド (Regular simultaneous mode)

こ のモー ド ではレギ ュ ラ ・ チ ャ ネル ・ グループの AD 変換を行います。 外部 ト リ ガ信号は

ADC1 のレギ ュ ラ変換 ト リ ガ ・ ス イ ッ チで、 ADC1_CR2 レ ジ ス タ の EXTSEL[2:0] に よ っ て

選択 さ れます。 ト リ ガ信号は ADC2 に同時に送 ら れます。

同 じ 入力チ ャ ネルを両方の ADC で変換 し てはいけません。 (同 じ チ ャ ネルを両方の ADC

で変換する時には、 サン プ リ ング タ イムが重な っ てはいけません。)

ADC1 も し く は ADC2 におけ る変換終了イ ベ ン ト 時に、

DMA ビ ッ ト がセ ッ ト さ れてい る と き には、 32bit の ADC1_DR レ ジ ス タ の内容を SRAM

に転送する ため、 DMA 転送 リ ク エ ス ト が発生 し ます。 ADC1_DR レ ジ ス タ には、 上位

16bit に ADC2 の変換デー タ が、 下位 16bit に ADC1 の変換デー タ が格納 さ れていま

す。

ADC1/ADC2 のレギ ュ ラ 変換チ ャ ネルがすべて変換 さ れた と き、 いずれかの ADC で割

込み リ ク エ ス ト が許可 さ れていれば、 EOC 割込み リ ク エ ス ト が発生 し ます。

同時モー ド では、 変換グループの長 さ が同一で、 両方の変換グループ で必要な ト リ ガ間隔

よ り 、 実際の ト リ ガ間隔が長い こ と が確実でなければな り ません。 変換グループの長 さ が

異な る と き には、 長いほ う の ADC で変換が終了する までに、 短い方の ADC で設定の最初

に戻っ ての変換が行われる こ と があ り ます。

Rev 5 -日本語版 169/720

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参考資料

A/D コ ンバー タ (ADC)

図 30.

RM0008

16 チ ャ ネルの同時レギ ュ ラ 変換モー ド

ADC1

ADC2

ト リ ガ

CH0

CH15

CH1

CH14

CH2

CH13

CH3

CH12

...

...

サン プ リ ン グ

変換

CH15

CH0

ADC1 と ADC2 上の変換の終わ り

10.9.3

注意 :

10.9.4

注意 :

高速イ ン タ リ ーブ ・ モー ド (Fast interleaved mode)

こ のモー ド はレギ ュ ラ 変換グループ (通常は一入力チ ャ ネル) でのみ実行 さ れます。 外部

ト リ ガ信号は ADC1 のレギ ュ ラ 変換 ト リ ガか ら 来ます。 外部 ト リ ガ時には、

ADC2 は直ち にス タ ー ト し ます。

ADC1 は 7 ADC ク ロ ッ ク ・ サイ クル遅れて変換がス タ ー ト し ます。

ADC1 と ADC2 の両方で CONT ビ ッ ト がセ ッ ト さ れていれば、 それぞれのレ ギ ャ ラ ・ グ

ループは連続的に変換 さ れます。

ADC1 で EOCIE ビ ッ ト がセ ッ ト さ れてお り EOC 割込み リ ク エ ス ト が発生 し た後、 DMA

ビ ッ ト がセ ッ ト さ れてい る と き には、 32bit の ADC1_DR レ ジ ス タ の内容を SRAM に転送す

る ために DMA 転送 リ ク エ ス ト が発生 し ます。 ADC1_DR レ ジ ス タ には、 上位 16bit に ADC2

の変換デー タ が、 下位 16bit に ADC1 の変換デー タ が格納 さ れています。

同 じ 入力チ ャ ネルを変換する場合、 ADC1 と ADC2 のサン プ リ ング タ イムがオーバラ ッ プ

する こ と を防ぐ ため、 使用可能な最大サン プ リ ン グ タ イムは 7 ADCCLK サイ クル未満で

す。

図 31.

連続変換モー ド におけ る 1 チ ャ ネルの高速イ ン タ リ ーブ ・ モー ド

サン プ リ ン グ

変換

ADC2

ADC1

ト リ ガ

ADC2 上の変換の終わ り

CH0

CH0

...

...

CH0

CH0

ADC1 上の変換の終わ り

7 ADCCLK

サイ ク ル

低速イ ン タ リ ーブ ・ モー ド (Slow interleaved mode)

こ のモー ド はレギ ュ ラ 変換グループ (一入力チ ャ ネルのみ) で実行 さ れます。 外部 ト リ ガ

信号は ADC1 のレギ ュ ラ 変換 ト リ ガか ら 来ます。 外部 ト リ ガ時には、

ADC2 は直ち にス タ ー ト し ます。

ADC1 は 14 ADC ク ロ ッ ク ・ サイ クル遅れて変換がス タ ー ト し ます。

ADC2 は、 更に 14 ク ロ ッ ク遅れて、 二番目の変換を開始 し ます。 以降、 こ の要領で変

換が続き ます。

ADC1 と ADC2 のサン プ リ ング タ イムがオーバラ ッ プする こ と を防ぐ ため、 使用可能な最

大サン プ リ ング タ イムは 14 ADCCLK サイ クル未満です。

170/720 Rev 5 -日本語版

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RM0008

注意 :

10.9.5

A/D コ ンバー タ (ADC)

ADC1 で EOCIE ビ ッ ト がセ ッ ト さ れてお り EOC 割込み リ ク エ ス ト が発生 し た後、 DMA

ビ ッ ト がセ ッ ト さ れてい る と き には、 32bit の ADC1_DR レ ジ ス タ の内容を SRAM に転送す

る ために DMA 転送 リ ク エ ス ト が発生 し ます。 ADC1_DR レ ジ ス タ には、 上位 16bit に ADC2

の変換デー タ が、 下位 16bit に ADC1 の変換デー タ が格納 さ れています。

28 ADC ク ロ ッ ク ・ サイ クル後には、 ADC2 は自動的に新たな変換を開始 し ます。

こ のモー ド では指定 さ れた レギ ュ ラ 変換チ ャ ネルを連続的に変換する ため、 CONT ビ ッ ト

を セ ッ ト する こ と はで き ません。

ア プ リ ケーシ ョ ン では、 イ ン タ リ ーブ ・ モー ド がイ ネーブル状態の と き、 イ ン ジ ェ ク ト ・

チ ャ ネルの ト リ ガが発生 し ないよ う 、 注意する こ と が必要 と さ れます。

図 32.

1 チ ャ ネルの低速イ ン タ リ ーブ ・ モー ド

ADC2 上の変換の終わ り

サン プ リ ン グ

変換

ADC2

ADC1

ト リ ガ

CH0

CH0

CH0

CH0

ADC1 上の変換の終わ り

14 ADCCLK

サイ ク ル

28 ADCCLK

サイ ク ル

オル タ ネー ト ・ ト リ ガ ・ モー ド (Alternate trigger mode)

こ のモー ド はイ ン ジ ェ ク ト ・ チ ャ ネル ・ グループ でのみ実行 さ れます。 外部 ト リ ガ信号は

ADC1 のイ ン ジ ェ ク ト ・ グループ ・ マルチ プ レ ク サか ら 供給 さ れます。

最初の ト リ ガが発生 し た と き、 ADC1 すべてのイ ン ジ ェ ク ト ・ グループ ・ チ ャ ネルの

変換が開始 さ れます。

二番目の ト リ ガ発生で、 ADC2 のすべてのイ ン ジ ェ ク ト ・ グループ ・ チ ャ ネルの変換

が開始 さ れます。

以上の動作が繰返 さ れます。

ADC1 ですべてのイ ン ジ ェ ク ト ・ グループ ・ チ ャ ネルの変換が完了する と 、 (割込み リ ク エ

ス ト が許可 さ れている と き) JEOC 割込み リ ク エ ス ト が発生 し ます。

ADC2 ですべてのイ ン ジ ェ ク ト ・ グループ ・ チ ャ ネルの変換が完了する と 、 (割込み リ ク エ

ス ト が許可 さ れている と き) JEOC 割込み リ ク エ ス ト が発生 し ます。

すべてのイ ン ジ ェ ク ト ・ グループ ・ チ ャ ネルの変換 さ れた後に他の外部 ト リ ガが発生する

場合、 オル タ ネー ト ・ ト リ ガ ・ プ ロ セスは ADC1 イ ン ジ ェ ク ト ・ グループ ・ チ ャ ネルの変

換に よ り 再ス タ ー ト し ます。

Rev 5 -日本語版 171/720

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参考資料

A/D コ ンバー タ (ADC)

RM0008

図 33.

オル タ ネー ト ・ ト リ ガ : 各 ADC のイ ン ジ ェ ク ト ・ チ ャ ネル ・ グループ

1 番目の ト リ ガ

ADC1 上の

EOC, JEOC

3 番目の ト リ ガ

ADC1 上の

EOC, JEOC

(n) 番目の ト リ ガ

サン プ リ ング

変換

ADC1

ADC2

EOC, JEOC on ADC2

2 番目の ト リ ガ

ADC2 上の

EOC, JO

4 番目の ト リ ガ

. . .

(n+1) 番目の ト リ ガ

ADC1、 ADC2 の両方で、 イ ン ジ ェ ク ト 分割モー ド が有効にな っ ている と き には、

最初の ト リ ガが発生 し た と き、 ADC1 のイ ン ジ ェ ク ト ・ チ ャ ネルが変換 さ れます。

二番目の ト リ ガが発生 し た と き、 ADC2 のイ ン ジ ェ ク ト ・ チ ャ ネルが変換 さ れます。

以上の動作が繰返 さ れます。

ADC1 ですべてのイ ン ジ ェ ク ト ・ グループ ・ チ ャ ネルの変換が完了する と 、 (割込み リ ク エ

ス ト が許可 さ れている と き) JEOC 割込み リ ク エ ス ト が発生 し ます。

ADC2 ですべてのイ ン ジ ェ ク ト ・ グループ ・ チ ャ ネルの変換が完了する と 、 (割込み リ ク エ

ス ト が許可 さ れている と き) JEOC 割込み リ ク エ ス ト が発生 し ます。

すべてのイ ン ジ ェ ク ト ・ グループ ・ チ ャ ネルが変換 さ れた後に他の外部 ト リ ガが発生する

場合、 オル タ ネー ト ・ ト リ ガ ・ プ ロ セスは再ス タ ー ト し ます。

図 34.

オル タ ネー ト ・ ト リ ガ : 分割モデルの (各 ADC ご と の) 4 イ ン ジ ェ ク ト ・

チ ャ ネル

1 番目の ト リ ガ 3 番目の ト リ ガ 5 番目の ト リ ガ 7 番目の ト リ ガ

ADC1 上の JEOC

サン プ リ ング

変換

ADC1

ADC2

2 番目の ト リ ガ 4 番目の ト リ ガ 6 番目の ト リ ガ

ADC2 上の JEOC

8 番目の ト リ ガ

10.9.6

10.9.7

注意 :

独立モー ド (Independent mode)

ADC 間の同期を行わず、 各 ADC 回路を独立 し て動作 し ます。

同時レギ ュ ラ ・ モー ド + 同時イ ン ジ ェ ク ト ・ モー ド

レギ ュ ラ ・ グループの同時変換を中断中に、 イ ン ジ ェ ク ト ・ グループの同時変換を開始す

る こ と がで き ます。

同時レギ ュ ラ / イ ン ジ ェ ク ト ・ モー ド の結合において、 1 つは、 同 じ 長 さ でシーケ ン ス を

変換 し なければな り ません。 も し く は、 2 シーケ ン ス以上の長 さ の ト リ ガ間隔が必要です。

変換グループの長 さ が異な る場合には、 シーケ ン スが長い方の ADC が以前の変換が完了

する ま でに、 短いシーケ ン スの ADC が再ス タ ー ト する こ と があ り ます。

172/720 Rev 5 -日本語版

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参考資料

RM0008

10.9.8

注意 :

A/D コ ンバー タ (ADC)

並列レギ ュ ラ ・ モー ド + オル タ ネー ト ・ ト リ ガ ・ モー ド

レギ ュ ラ ・ グループの同時変換中断中に、 イ ン ジ ェ ク ト ・ グループのオル タ ネー ト ・ ト リ

ガ変換を開始する こ と がで き ます。 図  35

は、 オル タ ネー ト ・ ト リ ガが同時レ ギ ュ ラ 変換

の割込み動作を示 し ています。

イ ン ジ ェ ク ト ・ オル タ ネー ト 変換は、 イ ン ジ ェ ク ト ・ イ ベ ン ト が発生する と 直ち に開始 さ

れます。 すでに レギ ュ ラ 変換が動作 し ている場合、 イ ン ジ ェ ク ト 変換後に同時性を維持す

る ために、 両 ADC (マ ス タ ・ ス レ ーブ) における レギ ュ ラ 変換は停止 し 、 イ ン ジ ェ ク ト 変

換の終了後に再開 さ れます。

同時レギ ュ ラ+オル タ ネー ト ・ ト リ ガ ・ モー ド の結合において、 1 つは、 同 じ 長 さ でシー

ケ ン ス を変換 し なければな り ません。 も し く は、 2 シーケ ン ス以上の長 さ の ト リ ガ間隔が

必要です。 変換グループの長 さ が異な る場合には、 シーケ ン スが長い方の ADC が以前の

変換が完了する までに、 短いシーケ ン スの ADC が再ス タ ー ト する こ と があ り ます。

図 35.

オル タ ネー ト + 同時レギ ュ ラ

最初のトリガ

ADC1 reg

ADC1 inj

ADC2 reg

ADC2 inj

CH0

CH3

CH1

CH5

CH2

CH0

CH6

CH2

CH6

CH3

CH7

CH0

CH3

CH7

CH4

CH8

同時性は失われません

イ ン ジ ェ ク ト 変換がレギ ュ ラ 変換へ割込みを し てい る間に ト リ ガが発生する場合、 こ の ト

リ ガは無視 さ れます。

図  36

は こ の状況を図示 し ています。 (2 番目の ト リ ガが無視 さ れて

います。)

図 36.

2 番目のトリガ

イ ン ジ ェ ク ト 変換中に ト リ ガが発生 し た場合

最初のトリガ

3 番目のトリガ

10.9.9

ADC1 reg

ADC1 inj

ADC2 reg

ADC2 inj

CH0

CH3

CH1

CH5

CH2

CH0

CH6

CH2

CH6

CH3

CH7

CH0

CH3

CH7

CH4

CH0

CH8

2 番目のトリガ

4 番目のトリガ

同時イ ン ジ ェ ク ト + イ ン タ リ ーブ

イ ン タ リ ーブ ・ モー ド の変換を行 っ ている際に、 イ ン ジ ェ ク ト ・ イ ベン ト で、 こ れを中断

する こ と がで き ます。 こ の場合、 イ ン タ リ ーブ ・ モー ド の変換は中断 さ れ、 イ ン ジ ェ ク ト

変換動作がス タ ー ト し ます。 イ ン ジ ェ ク ト 変換の終了後は、 イ ン タ リ ーブ変換が再開 さ れ

ます。

図  37

には、 こ の使用例の動作が示 さ れています。

Rev 5 -日本語版 173/720

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れ製

品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の正

規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料情報に

基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

A/D コ ンバー タ (ADC)

注意 :

RM0008

ADC ク ロ ッ ク ・ プ リ スケー ラが 4 に設定 さ れている場合、 イ ン タ リ ーブ ・ モー ド は等間隔

のサン プル期間では リ カバー し ません : サン プ リ ング間隔は、 7 ク ロ ッ ク周期に続 く 7 ク

ロ ッ ク周期ではな く 、 6ADC ク ロ ッ ク周期に続き 8ADC ク ロ ッ ク周期 と な り ます。

図 37.

イ ン ジ ェ ク ト ・ シーケ ン ス CH11

CH12 でのイ ン タ リ ーブ ・ シ ン グル ・ チ ャ ネル

サンプリング

ADC1 CH0 CH0 CH0 変換

ADC2

CH0 CH0 CH0

トリガ

CH11

CH12

CH12

CH11

CH0 CH0

CH0 CH0

10.10 温度セ ンサ

注意 :

温度センサは、 デバイスの周辺空気温度 (T

A

) の測定を行うために利用することができます。

温度センサは内部で ADCx_IN16 入力チャネルに接続されており、 センサの出力電圧をデジタル

値に変換することができます。 この入力のサンプリングタイムの推奨値は、 17.1μs です。

温度センサのブロック図は

図  38

にあります。

センサが使用されないときには、 この回路をパワー ・ ダウン状態としておくことができます。

内部チ ャ ネル ADCx_IN16 (温度セ ンサ) と ADCx_IN17 (V

REFINT

TSVREFE ビ ッ ト を セ ッ ト し ておかねばな り ません。

) の変換を可能 と するには、

主な機能

温度範囲 : -40 ~ 125 ℃

精度 : +/- 1.5 ℃

図 38.

温度セ ンサ及び V

REFINT

チ ャ ネル ・ ブ ロ ッ ク 図

TSVREFE 制御ビット

温度センサ

V

SENSE

ADCx_IN16

変換された

 データ

内部

電源ブロック

V

REFINT

ADC1

ADCx_IN17

174/720 Rev 5 -日本語版

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参考資料

RM0008

注意 :

A/D コ ンバー タ (ADC)

温度デー タ の読込み

温度セ ンサを使用する には、

1.

ADCx_IN16 入力チ ャ ネルを選択 し ます。

2. サン プ リ ン グ タ イムを 17.1μs に設定 し ます。

3. 温度セ ンサをパワー ・ ダウ ン ・ モー ド か ら起動する ため、

ADC 制御レ ジ ス タ 2

(ADC_CR2) レ ジ ス タ の TSVREFE ビ ッ ト を セ ッ ト し ます。

4. V

SENSE

デー タ の変換結果を ADC デー タ ・ レ ジ ス タ か ら読出 し ます。

5. 次の式を適用 し 、 温度の値を得ます。

温度 ( ℃ ) = { (V

25

- V

SENSE

) / Avg_Slope } + 25

こ こ で、

V

25

= 25 ℃における V

SENSE

の値

Avg_Slope = 温度 ・ V

SENSE

(mV/ ℃ も し く は μV/ ℃ ) カ ーブの平均傾斜

6. V

25

及び Avg_Slope の実際の値に関 し ては、 デー タ シー ト のデバイ スの電気特性を参

照 し て く だ さ い。

セ ンサがパワー ・ ダウン状態から起動 し 、 その時点の有効な V

SENSE

を出力するには、 ス

タ ー ト ア ッ プ タ イムが必要 と さ れます。 ADC 自体もパワー ・ ダウン ・ モー ド からのス タ ー

ト ア ッ プ タ イムを必要 と し ていますので、 これらの遅延時間を最小 と する ため、 ADON

ビ ッ ト と TSVREFE ビ ッ ト は同時のセ ッ ト さ れる こ と が効果的です。

10.11 ADC 割込み リ ク エ ス ト

注意 :

レギ ュ ラ ・ グループ と イ ン ジ ェ ク ト ・ グループの変換終了時、 及びアナ ロ グ ・ ウ ォ ッ チ

ド ッ グ ・ ス テー タ ス ・ ビ ッ ト がセ ッ ト さ れた と き、 割込み リ ク エ ス ト を発生 さ せる こ と が

で き ます。 こ れ ら には、 個別に割込み リ ク エ ス ト 許可ビ ッ ト が備え ら れています。

ADC1 と ADC2 割込みは、 同 じ 割込みベ ク タ へ配置 さ れます。 ADC3 割込みは別の割込みベ

ク タ へ配置 さ れます。

ADC_SR レ ジ ス タ には他に 2 個の フ ラ グが備わ っ ていますが、 こ れ らは割込み リ ク エ ス ト

にはかかわ り ません。

JSTRT (イ ン ジ ェ ク ト ・ グループ ・ チ ャ ネルの変換開始)

STRT (レギ ュ ラ ・ グループ ・ チ ャ ネルの変換開始)

表 47.

ADC 割込み

割込みイ ベ ン ト

レギ ュ ラ ・ グループの変換終了

イ ン ジ ェ ク ト ・ グループの変換終了

アナログ ・ ウ ォ ッ チ ド ッ グ ・ ス テー タ ス ・ ビ ッ ト のセ ッ ト

イ ベ ン ト フ ラ グ

EOC

JEOC

AWD

イ ネーブル制御

ビ ッ ト

EOCIE

JEOCIE

AWDIE

Rev 5 -日本語版 175/720

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参考資料

A/D コ ンバー タ (ADC)

RM0008

10.12 ADC レ ジス タ

レ ジ ス タ の詳細記述で使用 さ れてい る略語については

セ ク シ ョ ン  1.1 (32 ページ)

を参照

し て く だ さ い。

10.12.1 ADC ス テー タ ス ・ レ ジス タ (ADC_SR)

ア ド レ スオ フ セ ッ ト : 00h

リ セ ッ ト 値 : 00000000h

31 30 29 28 27 26 25 24 23

予約済み

22 21 20 19 18 17 16

15 14 13 12 11 10

予約済み

9 8 7 6 5 4 3 2 1 0

STRT JSTRT JEOC EOC AWD rc_w0 rc_w0 rc_w0 rc_w0 rc_w0

Bits 31:5 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bit 4 STRT: レギ ュ ラ変換チ ャ ネル ・ ス タ ー ト ・ フ ラ グ

こ のビ ッ ト はレギ ュ ラ ・ チ ャ ネルの変換が開始 さ れた と き、 ハー ド ウ ェ アによ っ てセ ッ ト さ れま

す。 フ ラ グのク リ アはソ フ ト ウ ェ ア で行います。

0: レギ ュ ラ ・ チ ャ ネルの変換は開始 さ れていません。

1: レギ ュ ラ ・ チ ャ ネルの変換が開始 さ れま し た。

Bit 3 JSTRT: イ ン ジ ェ ク ト ・ チ ャ ネル ・ ス タ ー ト ・ フ ラ グ

こ のビ ッ ト はイ ン ジ ェ ク ト ・ チ ャ ネルの変換が開始 さ れた と き、 ハー ド ウ ェ アによ っ てセ ッ ト さ

れます。 フ ラ グのク リ アはソ フ ト ウ ェ ア で行います。

0: イ ン ジ ェ ク ト ・ グループの変換は開始 さ れていません。

1: イ ン ジ ェ ク ト ・ グループの変換が開始 さ れま し た。

Bit 2

JEOC: イ ン ジ ェ ク ト ・ チ ャ ネル変換終了

こ のビ ッ ト はイ ン ジ ェ ク ト ・ グループ ・ チ ャ ネル変換がすべて終了 し た と き に、 ハー ド ウ ェ ア で

セ ッ ト さ れます。 フ ラ グのク リ アはソ フ ト ウ ェ ア で行います。

0: 変換は完了 し ていません。

1: 変換が完了 し ま し た。

Bit 1 EOC: 変換終了フ ラ グ

こ のビ ッ ト は、 グループ ・ チ ャ ネル変換 (レギ ュ ラ も し く はイ ン ジ ェ ク ト ) が終了 し た と き に、

ハー ド ウ ェ アによ っ てセ ッ ト さ れます。 フ ラ グは ADC_DR レ ジ ス タ を読出 し た と き、 も し く は ソ

フ ト ウ ェ アによ る ス テー タ ス ・ レ ジ ス タ への書込みで行います。

0: 変換は完了 し ていません。

1: 変換が完了 し ま し た。

Bit 0 AWD: アナログ ・ ウ ォ ッ チ ド ッ グ ・ フ ラ グ

こ のビ ッ ト は、 変換 さ れた電圧が、 あ ら か じ め ADC_HTR レ ジス タ 及び ADC_LTR レ ジ ス タ で設定

さ れている上下限を超えた と き に、 ハー ド ウ ェ ア でセ ッ ト さ れます。 フ ラ グのク リ アはソ フ ト

ウ ェ ア で行います。

0: アナログ ・ ウ ォ ッ チ ド ッ グ ・ イ ベン ト は発生 し ていません。

1: アナログ ・ ウ ォ ッ チ ド ッ グ ・ イ ベン ト が発生 し ま し た。

176/720 Rev 5 -日本語版

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参考資料

RM0008

A/D コ ンバー タ (ADC)

10.12.2 ADC 制御レ ジス タ 1 (ADC_CR1)

ア ド レ スオ フ セ ッ ト : 04h

リ セ ッ ト 値 : 0000 0000h

31 30 29

15 rw

14

DISCNUM[2:0] rw

13 rw

28 27 26 25 24 23 22 21 20

予約済み

12 11 10

JDISC

EN

DISC

EN

JAUT

O

AWDE

N

JAWD

EN rw

7 rw

6

予約済み

9 8 5

AWD

SGL

SCAN

JEOC

IE

AWDIE EOCIE

4 rw rw rw rw rw rw rw rw rw

19 rw

3

18 17

DUALMOD[3:0] rw

2

AWDCH[4:0] rw

1

16 rw

0 rw rw rw rw

Bits 31:24 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bit 23 AWDEN: アナログ ・ ウ ォ ッ チ ド ッ グ有効 (レギ ュ ラ ・ チ ャ ネル)

こ のビ ッ ト はソ フ ト ウ ェ ア でセ ッ ト / ク リ ア し ます。

0: レギ ュ ラ ・ チ ャ ネルに対するウ ォ ッ チ ド ッ グ機能は無効です。

1: レギ ュ ラ ・ チ ャ ネルに対するウ ォ ッ チ ド ッ グ機能は有効です。

Bit 22 JAWDEN: アナロ グ ・ ウ ォ ッ チ ド ッ グ有効 (イ ン ジ ェ ク ト ・ チ ャ ネル)

こ のビ ッ ト はソ フ ト ウ ェ ア でセ ッ ト / ク リ ア し ます。

0: イ ン ジ ェ ク ト ・ チ ャ ネルに対するウ ォ ッ チ ド ッ グ機能は無効です。

1: イ ン ジ ェ ク ト ・ チ ャ ネルに対するウ ォ ッ チ ド ッ グ機能は有効です

Bits 21:20 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bits 19:16 DUALMOD[3:0]: デ ュ アル ADC モー ド の選択

こ れら のビ ッ ト はソ フ ト ウ ェ ア で動作モー ド を選択する ため、 ソ フ ト ウ ェ ア で書込みます。

0000: 独立モー ド

0001: 組合わせ動作 : 同時レギ ュ ラ + 同時イ ン ジ ェ ク ト ・ モー ド

0010: 組合わせ動作 : 同時レギ ュ ラ + オル タ ネー ト ・ ト リ ガ ・ モー ド

0011: 組合わせ動作 : 同時イ ン ジ ェ ク ト + 高速イ ン タ リ ーブ ・ モー ド

0100: 組合わせ動作 : 同時イ ン ジ ェ ク ト + 低速イ ン タ リ ーブ ・ モー ド

0101: 同時イ ン ジ ェ ク ト ・ モー ド のみ

0110: 同時レギ ュ ラ ・ モー ド のみ

0111: 高速イ ン タ リ ーブ ・ モー ド のみ

1000: 低速イ ン タ リ ーブ ・ モー ド のみ

1001: オル タ ネー ト ・ ト リ ガ ・ モー ド のみ

注 :

- これ らのビ ッ ト は ADC2 及び ADC3 では使用 さ れません。 (予約ビ ッ ト です)

– チ ャ ネル選択の変更の際、 動作の再ス タ ー ト が行われ、 デ ュ アル ADC モー ド では同期状態が崩

れる こ と があ り ます。 チ ャ ネル選択を変更する前に、 デ ュ アル ADC モー ド を無効 と し てお く こ

と が勧め られます。

Rev 5 -日本語版 177/720

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参考資料

A/D コ ンバー タ (ADC)

RM0008

Bits 15:13 DISCNUM[2:0]: 分割モー ド ・ チ ャ ネル数

こ れら のビ ッ ト には、 レギ ュ ラ変換グループ で分割スキ ャ ン を行 う 際の、 個々 ト リ ガで変換 さ れ

る チ ャ ネルの数を ソ フ ト ウ ェ ア で設定 し ます。

000: 1 チ ャ ネル

001: 2 チ ャ ネル

.......

111: 8 チ ャ ネル

Bit 12 JDISCEN: イ ン ジ ェ ク ト ・ チ ャ ネル上の分割モー ド

こ のビ ッ ト は、 イ ン ジ ェ ク ト ・ グループ ・ チ ャ ネルの分割モー ド を有効 / 無効にする ために、 ソ

フ ト ウ ェ アによ り セ ッ ト / ク リ ア し ます。

0: イ ン ジ ェ ク ト ・ チ ャ ネルの分割モー ド は無効です。

1: イ ン ジ ェ ク ト ・ チ ャ ネルの分割モー ド は有効です。

Bit 11 DISCEN: レギ ュ ラ ・ チ ャ ネル上の分割モー ド

こ のビ ッ ト は、 レギ ュ ラ ・ チ ャ ネルの分割モー ド を有効 / 無効にする ために、 ソ フ ト ウ ェ アによ

り セ ッ ト / ク リ ア し ます。

0: レギ ュ ラ ・ チ ャ ネルの分割モー ド は無効です。

1: レギ ュ ラ ・ チ ャ ネルの分割モー ド は有効です。

Bit 10 JAUTO: 自動イ ン ジ ェ ク ト ・ グループ変換

こ のビ ッ ト は、 レギ ュ ラ ・ グループ変換後の自動イ ン ジ ェ ク ト ・ グループ変換を有効 / 無効にす

る ために、 ソ フ ト ウ ェ アによ り セ ッ ト / ク リ ア し ます。

0: 自動イ ン ジ ェ ク ト ・ グループ変換は無効です。

1: 自動イ ン ジ ェ ク ト ・ グループ変換は有効です。

Bit 9 AWDSGL: スキ ャ ン ・ モー ド でのシ ングル ・ チ ャ ネル上でのウ ォ ッ チ ド ッ グ ・ イ ネーブル

こ のビ ッ ト は、 AWDCH[4:0] ビ ッ ト によ り で指定 さ れたチ ャ ネル上のアナログ ・ ウ ォ ッ チ ド ッ グ を

有効 / 無効にする ために、 ソ フ ト ウ ェ ア でセ ッ ト / ク リ ア し ます。

0: アナログ ・ ウ ォ ッ チ ド ッ グ機能はすべてのチ ャ ネルで有効です。

1: アナログ ・ ウ ォ ッ チ ド ッ グ機能はシ ングル ・ チ ャ ネルでのみ有効です。

Bit 8 SCAN: スキ ャ ン ・ モー ド

こ のビ ッ ト はスキ ャ ン ・ モー ド の有効 / 無効を切替え る ため、 ソ フ ト ウ ェ ア でセ ッ ト / ク リ ア し

ます。 スキ ャ ン ・ モー ド では、 ADC_SQRx 及び ADC_JSEQR レ ジ ス タ で指定 し た入力の変換が行わ

れます。

0: スキ ャ ン ・ モー ド は無効です。

1: スキ ャ ン ・ モー ド は有効です。

注 : EOCIE も し く は JEOCIE ビ ッ ト がセ ッ ト さ れていれば、 指定 さ れている最後の変換が終了 し た と

き、 EOC も し く は JEOC 割込み リ ク エ ス ト が発生 し ます。

Bit 7 JEOCIE: イ ン ジ ェ ク ト ・ チ ャ ネルの割込み許可

こ のビ ッ ト はイ ン ジ ェ ク ト ・ チ ャ ネルについての変換割込み終了を有効 / 無効にする ために、 ソ

フ ト ウ ェ ア でセ ッ ト / ク リ ア し ます。

0: JEOC 割込み無効。

1: JEOC 割込み有効。 JEOC ビ ッ ト がセ ッ ト さ れる と 割込みが発生 し ます。

178/720 Rev 5 -日本語版

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参考資料

RM0008

A/D コ ンバー タ (ADC)

Bit 6 AWDIE: アナログ ・ ウ ォ ッ チ ド ッ グ割込み許可

こ のビ ッ ト はアナログ ・ ウ ォ ッ チ ド ッ グ割込みの有効 / 無効を切替え る ため、 ソ フ ト ウ ェ ア で

セ ッ ト / ク リ ア し ます。 スキ ャ ン ・ モー ド で、 ウ ォ ッ チ ド ッ グの上下限が逆転 し ている ケースで

は、 こ のビ ッ ト がセ ッ ト さ れている場合に限っ てスキ ャ ンがアボー ト さ れます。

0: アナログ ・ ウ ォ ッ チ ド ッ グ割込み無効。

1: アナログ ・ ウ ォ ッ チ ド ッ グ割込み有効。

Bit 5 EOCIE: EOC 割込み有効

こ のビ ッ ト は、 変換終了時の割込みの有効 / 無効を切替え る ため、 ソ フ ト ウ ェ ア でセ ッ ト / ク リ

ア し ます。

0: EOC 割込み無効。

1: EOC 割込み有効。 JEOC ビ ッ ト がセ ッ ト さ れる と 割込みが発生 し ます。

Bits 4:0 AWDCH[4:0]: アナログ ・ ウ ォ ッ チ ド ッ グ ・ チ ャ ネル選択ビ ッ ト

こ れら のビ ッ ト はソ フ ト ウ ェ アによ り セ ッ ト / ク リ ア さ れます。 こ れら は、 アナログ ・ ウ ォ ッ チ

ド ッ グによ り 保護 さ れる入力チ ャ ネルを選択 し ます。

00000: ADC アナログ入力チ ャ ネル 0

00001: ADC アナログ入力チ ャ ネル 1

....

01111: ADC アナログ入力チ ャ ネル 15

10000: ADC アナログ入力チ ャ ネル 16

10001: ADC アナログ入力チ ャ ネル 17

他の値は予約 さ れてお り 、 設定で き ません。

注 :

– ADC1 アナログ入力チ ャ ネル 16 と チ ャ ネル 17 は、 内部で温度セ ンサ と V

REFINT

れています。

にそれぞれ接続 さ

– ADC2 アナログ入力チ ャ ネル 16 と チ ャ ネル 17 は、 内部で V

SS

へ接続 さ れています。

– ADC3 アナログ入力チ ャ ネル 9、 チ ャ ネル 14、 チ ャ ネル 15、 チ ャ ネル 16 と チ ャ ネル 17 は、 V

SS

接続 さ れています。

Rev 5 -日本語版 179/720

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参考資料

A/D コ ンバー タ (ADC)

RM0008

10.12.3 ADC 制御レ ジス タ 2 (ADC_CR2)

ア ド レ スオ フ セ ッ ト : 0x08

リ セ ッ ト 値 : 0x0000 0000

31 30 29 28 27 26 25

15

JEXTT

RIG rw

予約済み

14 13 12 rw

JEXTSEL[2:0] rw rw

11

ALIGN rw

10

予約済み

9

24

8

DMA rw

23 22 rw

6

21

予約済み rw

5

20

TSVRE

FE

SWST

ART

JSWST

ART

EXTT

RIG rw

7 rw

4

19 rw

3

RST

CAL rw

18

EXTSEL[2:0] rw

2

CAL rw

17 rw

1

16

予約

済み

0

CONT ADON rw rw

Bits 31:24 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bit 23 TSVREFE: 温度セ ンサ と V

REFINT

有効

こ のビ ッ ト は、 温度セ ンサ及び V

REFINT

チ ャ ネルを有効 と するか否かを許可 ・ 禁止を切替え る た

め、 ソ フ ト ウ ェ ア でセ ッ ト / ク リ ア し ます。 2 回路の ADC を有するデバイ スでは、 こ のビ ッ ト は

ADC1 に対 し てのみ有効です。

0: 温度セ ンサ及び V

REFINT

チ ャ ネルは機能 し ません。

1: 温度セ ンサ及び V

REFINT

チ ャ ネル有効です。

Bit 22 SWSTART: レギ ュ ラ ・ チ ャ ネルの変換開始

こ のビ ッ ト は、 ソ フ ト ウ ェ ア でセ ッ ト する こ と によ り 変換が開始 さ れ、 変換開始直後にハー ド

ウ ェ アによ っ て ク リ ア さ れます。 EXTSEL[2:0] で外部 ト リ ガ と し て SWSTART が選択 さ れていれ

ば、 レギ ュ ラ ・ グループの変換が開始 さ れます。

0: リ セ ッ ト 状態

1: レギ ュ ラ ・ チ ャ ネルの変換が開始 さ れます。

Bit 21 JSWSTART: イ ン ジ ェ ク ト ・ チ ャ ネルの変換開始

こ のビ ッ ト は、 ソ フ ト ウ ェ ア でセ ッ ト する こ と によ り 変換が開始 さ れ、 変換開始直後にハー ド

ウ ェ アによ っ て ク リ ア さ れます。 JEXTSEL[2:0] で外部 ト リ ガ と し て SWSTART が選択 さ れていれ

ば、 イ ン ジ ェ ク ト ・ チ ャ ネルのグループの変換が開始 さ れます。

0: リ セ ッ ト 状態

1: イ ン ジ ェ ク ト ・ チ ャ ネルの変換が開始 さ れます。

Bit 20 EXTTRIG: レギ ュ ラ ・ チ ャ ネルについての外部 ト リ ガ変換モー ド

こ のビ ッ ト は、 レギ ュ ラ ・ チ ャ ネルの変換を開始する外部 ト リ ガ機能の有効 / 無効を切替え る た

め、 ソ フ ト ウ ェ ア でセ ッ ト / ク リ ア し ます。

0: 外部イ ベン ト によ る変換は行われません。

1: 外部イ ベン ト によ る変換が行われます。

180/720 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

A/D コ ンバー タ (ADC)

Bits 19:17 EXTSEL[2:0]: レギ ュ ラ ・ チ ャ ネルについての外部イ ベン ト 選択

こ れら のビ ッ ト は、 レギ ュ ラ ・ グループの変換を開始する ト リ ガ を使用する ための外部イ ベン ト

を選択 し ます。

ADC1 及び ADC2 関連の ト リ ガは、

000: タ イ マ 1 CC1 イ ベン ト

001: タ イ マ 1 CC2 イ ベン ト

010: タ イ マ 1 CC3 イ ベン ト

011: タ イ マ 2 CC2 イ ベン ト

100: タ イ マ 3 TRGO イ ベン ト

101: タ イ マ 4 CC4 イ ベン ト

110: EXTI ラ イ ン 11/TIM8_TRGO イ ベン ト (TIM8_TRGO は大容量デバイ スのみで利用可能)

111: SWSTART

ADC3 関連の ト リ ガは、

000: タ イ マ 3 CC1 イ ベン ト

001: タ イ マ 2 CC3 イ ベン ト

010: タ イ マ 1 CC3 イ ベン ト

011: タ イ マ 8 CC1 イ ベン ト

100: タ イ マ 8 TRGO イ ベン ト

101: タ イ マ 5 CC1 イ ベン ト

110: タ イ マ 5 CC3 イ ベン ト

111: SWSTART

Bit 16 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bit 15 JEXTTRIG: イ ン ジ ェ ク ト ・ チ ャ ネルの外部 ト リ ガ変換モー ド

こ のビ ッ ト は、 イ ン ジ ェ ク ト ・ チ ャ ネル ・ グループの変換を開始する外部 ト リ ガ機能の有効 / 無

効を切替え る ため、 ソ フ ト ウ ェ ア でセ ッ ト / ク リ ア し ます。

0: 外部イ ベン ト によ る変換は行われません。

1: 外部イ ベン ト によ る変換が行われます。

Bits 14:12 JEXTSEL[2:0]: イ ン ジ ェ ク ト ・ グループについての外部イ ベン ト 選択

こ れら のビ ッ ト は、 イ ン ジ ェ ク ト ・ グループの変換を開始する ト リ ガ を使用する ための外部イ ベ

ン ト を選択 し ます。

ADC1 及び ADC2 関連の ト リ ガは、

000: タ イ マ 1 TRGO イ ベン ト

001: タ イ マ 1 CC4 イ ベン ト

010: タ イ マ 2 TRGO イ ベン ト

011: タ イ マ 2 CC1 イ ベン ト

100: タ イ マ 3 CC4 イ ベン ト

101: タ イ マ 4 TRGO イ ベン ト

110: EXTI ラ イ ン 15/TIM8_CC4 イ ベン ト (TIM8_CC4 は大容量デバイ スのみで利用可能)

111: JSWSTART

ADC3 関連の ト リ ガは、

000: タ イ マ 1 TRGO イ ベン ト

001: タ イ マ 1 CC4 イ ベン ト

010: タ イ マ 4 CC3 イ ベン ト

011: タ イ マ 8 CC2 イ ベン ト

100: タ イ マ 8 CC4 イ ベン ト

101: タ イ マ 5 TRGO イ ベン ト

110: タ イ マ 5 CC4 イ ベン ト

111: JSWSTART

Rev 5 -日本語版 181/720

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参考資料

A/D コ ンバー タ (ADC)

RM0008

Bit 11 ALIGN: デー タ ・ ア ラ イ メ ン ト

こ のビ ッ ト はソ フ ト ウ ェ ア でセ ッ ト / ク リ ア さ れます。 図 26.

及び

図 27.

を参照 し て く だ さ い。

0: 右 (下位) 寄せ

1: 左 (上位) 寄せ

Bits 10:9 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bit 8 DMA: DMA モー ド

こ のビ ッ ト はソ フ ト ウ ェ ア でセ ッ ト / ク リ ア さ れます。 詳細は DMA コ ン ト ロー ラの章を参照 し て

く だ さ い。

0: DMA モー ド は無効です。

1: DMA モー ド は有効です。

注 :ADC1 と ADC3 のみで DMA リ ク エ ス ト を生成する こ と がで き ます。

Bits 7:4 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bit 3 RSTCAL: 較正値 リ セ ッ ト

こ のビ ッ ト はソ フ ト ウ ェ ア で リ セ ッ ト し ますが、 ハー ド ウ ェ ア で ク リ ア さ れる こ と も あ り ます。

較正値レ ジ ス タ がク リ ア さ れる と 、 こ のビ ッ ト はク リ ア さ れます。

0: 較正値レ ジ ス タ はすでに初期化 さ れています。

1: 較正値レ ジ ス タ の初期化を行います。

注 : 変換の実行中に RSTCAL ビ ッ ト を セ ッ ト し た場合は、 較正レ ジ ス タ を ク リ アする ために、 よ

り 多 く のサイ ク ルが必要 と さ れます。

Bit 2 CAL: A/D 較正

こ のビ ッ ト を ソ フ ト ウ ェ ア でセ ッ ト する と 、 較正が開始 さ れます。 較正が終了する と 、 ハー ド

ウ ェ アによ っ て こ のビ ッ ト が リ セ ッ ト さ れます。

0: 較正は終了 し ま し た。

1: 較正を開始 し ます。

Bit 1 CONT: 連続変換

こ のビ ッ ト は、 ソ フ ト ウ ェ アによ り セ ッ ト / ク リ ア さ れます。 ビ ッ ト を リ セ ッ ト する ま で連続変

換が行われます。

0: シ ングル変換モー ド

1: 連続変換モー ド

Bit 0 ADON: A/D コ ンバー タ ・ オン / オ フ

こ のビ ッ ト はソ フ ト ウ ェ アによ り セ ッ ト / ク リ ア さ れます。 こ のビ ッ ト が 0 である と き に 1 を書

込む と 、 ADC をパワー ・ ダウン状態から 起動 し ます。

こ のビ ッ ト が 1 の状態で、 さ ら に 1 を書込む と 、 変換動作が開始 さ れます。 ア プ リ ケーシ ョ ン で

は、 起動から 変換ま でに t

STAB

の遅延が発生 し ます。 図 22.

を参照 し て く だ さ い。

0: ADC の変換 / 較正を中断 し 、 パワー ・ ダウン状態に移行 し ます。

1: ADC を有効 と し 、 変換動作を開始 し ます。

注 : このレ ジ ス タ の ADON 以外のビ ッ ト が 変更 さ れた と き には、 この書込みによ っ て変換が開始 さ

れる こ と はあ り ません。 こ れによ り 、 設定時に誤 っ て変換が開始 さ れる こ と を防いでいます。

182/720 Rev 5 -日本語版

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RM0008

A/D コ ンバー タ (ADC)

10.12.4 ADC サン プル ・ タ イ ム ・ レ ジス タ 1 (ADC_SMPR1)

31 30

ア ド レ スオ フ セ ッ ト : 0x0C

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20

予約済み

SMP17[2:0]

19

SMP16[2:0]

18

14 13 12

Res.

11 10 9 8 rw

7 rw

6 rw

5 rw

4 rw

3 rw

2 15

SMP

15_0 rw rw

SMP14[2:0] rw rw rw

SMP13[2:0] rw rw rw

SMP12[2:0] rw rw rw

SMP11[2:0] rw rw rw

17 16

SMP15[2:1] rw

1 rw

0

SMP10[2:0] rw rw

Bits 31:24 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bits 23:0 SMPx[2:0]: チ ャ ネル x サン プル ・ タ イム選択

こ れら のビ ッ ト は、 個々のチ ャ ネルご と にサン プル ・ タ イムを選択する ために、 ソ フ ト ウ ェ ア で

設定 し ます。 変換動作のサン プル ・ タ イムの間は、 こ れら のビ ッ ト は変更する こ と はで き ません。

000: 1.5 サイ クル

001: 7.5 サイ クル

010: 13.5 サイ クル

011: 28.5 サイ クル

100: 41.5 サイ クル

101: 55.5 サイ クル

110: 71.5 サイ クル

111: 239.5 サイ クル

注 :

– ADC1 アナログ入力チ ャ ネル 16 と チ ャ ネル 17 は、 内部的に温度セ ンサ と V

REFINT

さ れています。

にそれぞれ接続

– ADC2 アナログ入力チ ャ ネル 16 と チ ャ ネル 17 は、 内部で V

SS

と 接続 さ れています。

– ADC3 アナログ入力チ ャ ネル 14、 チ ャ ネル 15、 チ ャ ネル 16 と チ ャ ネル 17 は、 V

SS

います。

へ接続 さ れて

Rev 5 -日本語版 183/720

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A/D コ ンバー タ (ADC)

RM0008

10.12.5 ADC サン プル ・ タ イ ム ・ レ ジス タ 2 (ADC_SMPR2)

31 30

ア ド レ スオ フ セ ッ ト : 0x10

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20

予約済み

SMP9[2:0] SMP8[2:0] SMP7[2:0]

19

SMP6[2:0]

18

14 rw

13 rw

12 rw

11 rw

10 rw

9 rw

8 rw

7 rw

6 rw

5 rw

4 rw

3 rw

2 15

SMP

5_0 rw rw

SMP4[2:0] rw rw rw

SMP3[2:0] rw rw rw

SMP2[2:0] rw rw rw

SMP1[2:0] rw rw rw

17 16

SMP5[2:1] rw

1 rw

0

SMP0[2:0] rw rw

Bits 31:30 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bits 29:0 SMPx[2:0]: チ ャ ネル x サン プル ・ タ イム選択

こ れら のビ ッ ト は、 個々のチ ャ ネルご と にサン プル ・ タ イムを選択する ために、 ソ フ ト ウ ェ ア で

設定 し ます。 変換動作のサン プル ・ タ イムの間は、 こ れら のビ ッ ト は変更する こ と はで き ません。

000: 1.5 サイ クル

001: 7.5 サイ クル

010: 13.5 サイ クル

011: 28.5 サイ クル

100: 41.5 サイ クル

101: 55.5 サイ クル

110: 71.5 サイ クル

111: 239.5 サイ クル

注 :   ADC3 アナログ入力チ ャ ネル 9 は、 V

SS

へ接続 さ れています。

10.12.6 ADC イ ン ジ ェ ク ト ・ チ ャ ネル ・ デー タ ・ オ フ セ ッ ト ・ レ ジス タ x

(ADC_JOFRx)(x=1..4)

31 30

ア ド レ スオ フ セ ッ ト : 0x14-0x20

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20 19 18 17

予約済み

16

15 14 13

予約済み

12 11 10 9 8 7 6 5

JOFFSETx[11:0] rw rw

4 rw

3 2 1 0 rw rw rw rw rw rw rw rw rw

Bits 31:12 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bits 11:0 JOFFSETx[11:0]: イ ン ジ ェ ク ト ・ チ ャ ネル x のデー タ ・ オ フ セ ッ ト

こ れら のビ ッ ト は、 イ ン ジ ェ ク ト ・ チ ャ ネルを変換する場合に、 生変換デー タ から 引かれたオ フ

セ ッ ト を定義する ために、 ソ フ ト ウ ェ アによ り 設定 さ れます。 引き算後の変換結果は ADC_JDRx

レ ジ ス タ から 読出 さ れます。

184/720 Rev 5 -日本語版

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RM0008

A/D コ ンバー タ (ADC)

10.12.7 ADC ウ ォ ッ チ ド ッ グ上限ス レ ッ シ ョ ル ド ・ レ ジス タ (ADC_HTR)

31 30

ア ド レ スオ フ セ ッ ト : 0x24

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20 19 18

予約済み

17 16

15 14 13

予約済み

12 11 10 9 8 7 6

HT[11:0]

5 rw rw

4 3 2 1 0 rw rw rw rw rw rw rw rw rw rw

Bits 31:12 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bits 11:0 HT[11:0] アナログ ・ ウ ォ ッ チ ド ッ グ上限ス レ ッ シ ョ ル ド

こ れら のビ ッ ト にはソ フ ト ウ ェ アで、 アナログ ・ ウ ォ ッ チ ド ッ グ機能の上限ス レ ッ シ ョ ル ド 値を設定

し ます。

10.12.8 ADC ウ ォ ッ チ ド ッ グ下限ス レ ッ シ ョ ル ド ・ レ ジス タ (ADC_LTR)

31 30

ア ド レ スオ フ セ ッ ト : 0x28

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20 19 18

予約済み

17 16

15 14 13

予約済み

12 11 10 9 8 7 6

LT[11:0]

5 rw rw

4 3 2 1 0 rw rw rw rw rw rw rw rw rw rw

Bits 31:12 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bits 11:0 LT[11:0] アナログ ・ ウ ォ ッ チ ド ッ グ下限ス レ ッ シ ョ ル ド

こ れら のビ ッ ト にはソ フ ト ウ ェ ア で、 アナログ ・ ウ ォ ッ チ ド ッ グ機能の下限ス レ ッ シ ョ ル ド 値を

設定 し ます。

10.12.9 ADC レギ ュ ラ ・ シーケ ン ス ・ レ ジス タ 1 (ADC_SQR1)

31 30

ア ド レ スオ フ セ ッ ト : 0x2C

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20

予約済み

L[3:0]

15

SQ16_0 rw

14 rw

13 12

Res.

11 rw

SQ15[4:0] rw rw

10 rw

9 rw

8 rw

7 rw

6 rw

SQ14[4:0] rw rw rw

5 rw rw

4 rw

19 rw

3

18 17

SQ16[4:1] rw

2 rw

1 rw

SQ13[4:0] rw rw

16 rw

0 rw

Rev 5 -日本語版 185/720

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A/D コ ンバー タ (ADC)

RM0008

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Bits 23:20 L[3:0]: レギ ュ ラ ・ チ ャ ネル ・ シーケ ン ス長

こ れら のビ ッ ト は、 レギ ュ ラ ・ チ ャ ネル変換シーケ ン スの変換合計数を定義する ために、 ソ フ ト

ウ ェ ア で設定 し ます。

0000: 1 変換

0001: 2 変換

.....

1111: 16 変換

Bits 19:15 SQ16[4:0]: 16 番目のレギ ュ ラ ・ シーケ ン ス

こ れら のビ ッ ト は、 16 番目の変換シーケ ン ス と し てチ ャ ネル番号 (0..17) を割当て る ために、 ソ

フ ト ウ ェ アによ り 設定 さ れます。

Bits 14:10 SQ15[4:0]: 15 番目のレギ ュ ラ ・ シーケ ン ス

Bits 9:5 SQ14[4:0]: 14 番目のレギ ュ ラ ・ シーケ ン ス

Bits 4:0 SQ13[4:0]: 13 番目のレギ ュ ラ ・ シーケ ン ス

10.12.10 ADC レギ ュ ラ ・ シーケ ン ス ・ レ ジス タ 2 (ADC_SQR2)

31 30

ア ド レ スオ フ セ ッ ト : 0x30

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20

予約済み

15

SQ10_

0 rw

14 rw rw

13 rw rw

12

SQ9[4:0] rw

SQ12[4:0] rw

11 rw rw

10 rw rw

9 rw rw

8 rw rw

7

SQ8[4:0] rw

SQ11[4:0] rw

6 rw rw

5 rw rw

4 rw

19 rw

3

18 17

SQ10[4:1] rw

2 rw

1

SQ7[4:0] rw rw rw

16 rw

0 rw

Bits 31:30 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bits 29:26 SQ12[4:0]: 12 番目のレギ ュ ラ ・ シーケ ン ス

これ らのビ ッ ト は、 12 番目の変換シーケ ン ス と し てチ ャ ネル番号 (0..17) を割当て る ために、 ソ フ

ト ウ ェ アによ り 設定 さ れます。

Bits 24:20 SQ11[4:0]: 11 番目のレギ ュ ラ ・ シーケ ン ス

Bits 19:15 SQ10[4:0]: 10 番目のレギ ュ ラ ・ シーケ ン ス

Bits 14:10 SQ9[4:0]: 9 番目のレギ ュ ラ ・ シーケ ン ス

Bits 9:5 SQ8[4:0]: 8 番目のレギ ュ ラ ・ シーケ ン ス

Bits 4:0

SQ7[4:0]: 7 番目のレギ ュ ラ ・ シーケ ン ス

186/720 Rev 5 -日本語版

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正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

A/D コ ンバー タ (ADC)

10.12.11 ADC レギ ュ ラ ・ シーケ ン ス ・ レ ジス タ 3 (ADC_SQR3)

31 30

ア ド レ スオ フ セ ッ ト : 0x34

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20

予約済み

15

SQ4_0 rw

14 rw

SQ6[4:0] rw

13 rw rw

12

SQ3[4:0] rw rw

11 rw rw

10 rw rw

9 rw rw

8 rw rw

7

SQ2[4:0] rw

SQ5[4:0] rw

6 rw rw

5 rw rw

4 rw

19 rw

3 rw

18 17

SQ4[4:1] rw

2 rw

1

SQ1[4:0] rw rw

16 rw

0 rw

Bits 31:30 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bits 29:25 SQ6[4:0]: 6 番目のレギ ュ ラ ・ シーケ ン ス

こ れら のビ ッ ト は、 6 番目の変換シーケ ン ス と し てチ ャ ネル番号 (0..17) を割当て る ために、 ソ

フ ト ウ ェ アによ り 設定 さ れます。

Bits 24:20 SQ5[4:0]: 5 番目のレギ ュ ラ ・ シーケ ン ス

Bits 19:15 SQ4[4:0]: 4 番目のレギ ュ ラ ・ シーケ ン ス

Bits 14:10 SQ3[4:0]: 3 番目のレギ ュ ラ ・ シーケ ン ス

Bits 9:5 SQ2[4:0]: 2 番目のレギ ュ ラ ・ シーケ ン ス

Bits 4:0 SQ1[4:0]: 1 番目のレギ ュ ラ ・ シーケ ン ス

10.12.12 ADC イ ン ジ ェ ク ト ・ シーケ ン ス ・ レ ジス タ (ADC_JSQR)

31 30

ア ド レ スオ フ セ ッ ト : 0x38

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20 19

予約済み

JL[1:0]

15 14 13 12 11 10 9 8 7 6 rw

5 rw

4 rw

3

18 17

JSQ4[4:1] rw

2 rw

1

16 rw

0

JSQ3[4:0] JSQ2[4:0] JSQ1[4:0] rw rw rw rw rw rw rw rw rw rw rw rw rw rw rw rw

Rev 5 -日本語版 187/720

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れ製

品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の正

規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料情報に

基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

A/D コ ンバー タ (ADC)

RM0008

Bits 31:22 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bits 21:20 JL[1:0]: イ ン ジ ェ ク ト ・ シーケ ン ス長

こ れ らのビ ッ ト は、 イ ン ジ ェ ク ト ・ チ ャ ネル変換シーケ ン スの変換合計数を定義する ために、 ソ フ

ト ウ ェ アで設定 し ます。

00: 1 変換

01: 2 変換

10: 3 変換

11: 4 変換

Bits 19:15 JSQ4[4:0]: 4 番目のイ ン ジ ェ ク ト ・ シーケ ン ス

こ れ らのビ ッ ト は、 4 番目の変換シーケ ン ス と し てチ ャ ネル番号 (0..17) を割当て る ために、 ソ フ

ト ウ ェ アによ り 設定 さ れます。

注 : レギ ュ ラ変換シーケ ン ス と 異な り 、 JL[1:0] が 4 よ り 小 さ な と き には変換は (4-JL) 番目の項目

か ら開始 さ れます。

例 : ADC_JSQR[21:0] = 10 00011 00011 00111 00010 の と き には、 7、 3、 3 の順序で変換が行われます。

(2、 7、 3 ではあ り ません。)

Bits 14:10 JSQ3[4:0]: 3 番目のイ ン ジ ェ ク ト ・ シーケ ン ス

Bits 9:5 JSQ2[4:0]: 2 番目のイ ン ジ ェ ク ト ・ シーケ ン ス

Bits 4:0 JSQ1[4:0]: 1 番目のイ ン ジ ェ ク ト ・ シーケ ン ス

10.12.13 ADC イ ン ジ ェ ク ト ・ デー タ ・ レ ジス タ x (ADC_JDRx) (x= 1..4)

31 30

ア ド レ スオ フ セ ッ ト : 0x3C - 0x48

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23

予約済み

22 21 20 19 18 17 16

15 14 13 12 11 10 9 8 7

JDATA[15:0] r r

6 5 4 3 2 1 0 r r r r r r r r r r r r r r

Bits 31:16 予約済み、 書込み時は常に 0 と し て く だ さ い。

Bits 15:0 JDATA[15:0]: イ ン ジ ェ ク ト ・ デー タ

こ れ らのビ ッ ト は読出 し 専用です。 こ れ らのビ ッ ト には、 イ ン ジ ェ ク ト ・ チ ャ ネル x かの変換結果

が格納 さ れます。 デー タ は、

す。

図  26

及び

図  27

で示 さ れる よ う に、 左 も し く は右に寄せ られていま

188/720 Rev 5 -日本語版

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参考資料

RM0008

A/D コ ンバー タ (ADC)

10.12.14 ADC レギ ュ ラ ・ デー タ ・ レ ジス タ (ADC_DR)

31 30

ア ド レ スオ フ セ ッ ト : 0x4C

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 r

15 r r

14 r r

13 r r

12 r r

11 r r

10 r r

9 r

ADC2DATA[15:0] r

8 r

7 r

DATA[15:0] r r

6 r r r

5

20 r

4

19 r

3

18 r

2

17 r

1

16 r

0 r r r r r

Bits 31:16 ADC2DATA[15:0]: ADC2 デー タ

– ADC1 では、 デ ュ アル ・ モー ド の と き、 こ れ らのビ ッ ト には ADC2 のレギ ュ ラ ・ デー タ が格納 さ れ

ます。

セ ク シ ョ ン  10.9: デ ュ アル ADC モー ド

を参照 し て く だ さ い。

– ADC2 及び ADC3 では、 こ れ らのビ ッ ト は使用 さ れません。

Bits 15:0 DATA[15:0]: レギ ュ ラ ・ デー タ

こ れ らのビ ッ ト は読出 し 専用です。 こ れ らのビ ッ ト には、 イ ン ジ ェ ク ト ・ チ ャ ネル x かの変換結果

が格納 さ れます。 デー タ は、

す。

図  26

及び

図  27

で示 さ れる よ う に、 左 も し く は右に寄せ られていま

10.12.15

ADC レ ジス タ ・ マ ッ プ

次の表は ADC レ ジ ス タ の一覧です。

表 48.

オ フ

セ ッ ト

ADC - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値

レ ジス タ

0x00

ADC_SR

リ セ ッ ト 値

0x04

ADC_CR1

リ セ ッ ト 値

予約済み

0 0

予約済み

0 0 0 0 0

DUALMOD

[3:0]

DISC

NUM [2:0]

AWDCH[4:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

0x08

0x0C

0x10

0x14

0x18

ADC_CR2

予約済み

EXTSEL

[2:0]

JEXTSEL

[2:0]

予約済み

リ セ ッ ト 値

ADC_SMPR1

リ セ ッ ト 値

ADC_SMPR2

リ セ ッ ト 値

ADC_JOFR1

リ セ ッ ト 値

ADC_JOFR2

リ セ ッ ト 値

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

Sample time bits SMPx_x

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

Sample time bits SMPx_x

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

予約済み

JOFFSET1[11:0]

0 0 0 0 0 0 0 0 0 0 0 0

予約済み

JOFFSET2[11:0]

0 0 0 0 0 0 0 0 0 0 0 0

Rev 5 -日本語版 189/720

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参考資料

A/D コ ンバー タ (ADC)

RM0008

表 48.

オ フ

セ ッ ト

ADC - レ ジ ス タ ・ マ ッ プ と リ セ ッ ト 時の値 (続き)

レ ジス タ

0x1C

0x20

0x24

0x28

0x2C

0x30

0x34

0x38

0x3C

0x40

0x44

0x48

0x4C

ADC_JOFR3

リ セ ッ ト 値

ADC_JOFR4

リ セ ッ ト 値

ADC_HTR

リ セ ッ ト 値

ADC_LTR

リ セ ッ ト 値

ADC_JDR1

リ セ ッ ト 値

ADC_JDR2

リ セ ッ ト 値

ADC_JDR3

リ セ ッ ト 値

ADC_JDR4

リ セ ッ ト 値

ADC_SQR1

リ セ ッ ト 値

ADC_SQR2

リ セ ッ ト 値

ADC_SQR3

リ セ ッ ト 値

ADC_JSQR

リ セ ッ ト 値

ADC_DR

リ セ ッ ト 値

予約済み

予約済み

予約済み

JOFFSET3[11:0]

0 0 0 0 0 0 0 0 0 0 0 0

JOFFSET4[11:0]

0 0 0 0 0 0 0 0 0 0 0 0

予約済み

HT[11:0]

0 0 0 0 0 0 0 0 0 0 0 0

予約済み

LT[11:0]

0 0 0 0 0 0 0 0 0 0 0 0

レギ ュ ラ ・ チ ャ ネル ・ シーケ ン ス SQx_x bits

L[3:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

レギ ュ ラ ・ チ ャ ネル ・ シーケ ン ス SQx_x bits

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

レギ ュ ラ ・ チ ャ ネル ・ シーケ ン ス SQx_x bits

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

予約済み

JL[1:0]

イ ン ジ ェ ク ト ・ チ ャ ネル ・ シーケ ン ス JSQx_x bits

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

予約済み

JDATA[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

JDATA[15:0]

予約済み

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

JDATA[15:0]

予約済み

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

JDATA[15:0]

予約済み

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

Regular DATA[15:0] ADC2DATA[15:0]

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

レ ジ ス タ のア ド レ ス範囲に関 し ては、 表  1 (36 ページ)

を参照 し て く だ さ い。

190/720 Rev 5 -日本語版

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RM0008

11 D/A コ ンバー タ (DAC)

D/A コ ンバー タ (DAC)

Flash メ モ リ 容量が 32 ~ 128Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト ロー

ラは、 中容量デバイ ス です。

Flash メ モ リ 容量が 256 ~ 512Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト

ロー ラ は、 大容量デバイ スです。

こ のセ ク シ ョ ンは、 大容量デバイ スにのみ適応 さ れます。

11.1

11.2

概要

DAC モ ジ ュ ールは 12bit、 電圧出力デジ タ ル-アナ ロ グ ・ コ ンバー タ です。 DAC は 8 また

は 12bit モー ド に設定 さ れ、 DMA コ ン ト ロー ラ と 共に使用する こ と も出来ます。 12bit モー

ド では、 デー タ は左または右寄せにする こ と が出来ます。 DAC は 2 つの出力チ ャ ネルを

持 っ てお り 、 それぞれが コ ンバー タ を搭載 し ています。 デ ュ アル DAC チ ャ ネル ・ モー ド

においては、 同期ア ッ プデー ト ・ オペ レーシ ョ ンのために両チ ャ ネルがグループ化 さ れて

いれば、 変換は独立あ る いは同時に行 う こ と が可能です。 高分解能用に、 入力基準ピ ン

V

REF+

が用意 さ れています。

DAC の主な機能

2 つの DAC コ ンバー タ : それぞれ 1 つの出力チ ャ ネル

8bit または 12bit の単調出力

12bit モー ド の左または右デー タ 寄せ

同期ア ッ プデー ト 機能

ノ イ ズ波形生成

三角波生成

デ ュ アル DAC チ ャ ネル独立または同時変換

両チ ャ ネル用 DMA

変換用外部 ト リ ガ

入力基準電圧

V

REF+

DAC チ ャ ネルのブ ロ ッ ク 図は

図  39

に、 ピ ン記述は

表  49

に示 さ れています。

Rev 5 -日本語版 191/720

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参考資料

D/A コ ンバー タ (DAC)

図 39.

DAC チ ャ ネル ・ ブ ロ ッ ク 図

RM0008

注意 :

DAC

制御レジスタ

SWTRIGx

TIM2_TRGO

TIM4_TRGO

TIM5_TRGO

TIM6_TRGO

TIM7_TRGO

TIM8_TRGO

TSELx[2:0] bits

DMAENx

EXTI_9

DHRx

12bit

コントロールロジック x

LFSRx

三角波形x

TENx

MAMPx[3:0] bits

WAVENx[1:0] bits

12bit

DORx

12bit

V

DDA

V

SSA

V

REF+

デジタル/アナログ

コンバータ x

DAC_OUTx ai14708b

表 49.

名称

V

REF+

V

DDA

V

SSA

DAC_OUTx

DAC ピ ン

信号種別

入力、

アナログ基準電圧 +

入力、

アナログ電源供給

入力、

アナロググ ラ ン ド

アナログ出力信号

摘要

DAC の基準電圧、 ハイ レ ベル / 正電圧

2.4 V ≦ V

REF

+ ≦ V

DDA

(3.3 V)

アナログ回路電源

アナログ回路電源のグ ラ ン ド

DAC チ ャ ネル x アナログ出力

一度 DAC チ ャ ネルがイ ネーブル さ れる と 、 対応する GPIO ピ ン (PA4 または PA5) が自動

的にアナログ ・ コ ンバー タ 出力 (DAC_OUTx) に接続 さ れます。 寄生消費電力を防ぐ ため

に、 PA4 または PA5 ピ ンはまずアナロ グ (AIN) と し て設定 し て く だ さ い。

192/720 Rev 5 -日本語版

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参考資料

RM0008

11.3

11.3.1

注意 :

11.3.2

11.3.3

D/A コ ンバー タ (DAC)

DAC 機能詳細

DAC チ ャ ネル ・ イ ネーブル

各 DAC チ ャ ネルは、 DAC_CR レ ジ ス タ の対応する ENx ビ ッ ト を設定する事に よ り 起動す

る こ と が出来ます。 そ し て DAC チ ャ ネルは、 t

WAKEUP

後に イ ネーブル さ れます。

ENx ビ ッ ト は、 アナロ グ DAC チ ャ ネルのマ ク ロ セルのみを イ ネーブル し ます。 DAC チ ャ

ネル x デジ タ ル ・ イ ン タ フ ェ ースは、 ENx ビ ッ ト が リ セ ッ ト さ れた場合で も イ ネーブル さ

れます。

DAC 出力バ ッ フ ァ ・ イ ネーブル

DAC は、 出力イ ン ピーダ ン ス を減ら す こ と がで き、 外部動作ア ン プ な し に負荷を駆動で き

る 2 つの出力バ ッ フ ァ を内蔵 し ています。 各 DAC チ ャ ネル出力バ ッ フ ァ は、 DAC_CR レ ジ

ス タ の対応する BOFFx ビ ッ ト に よ り イ ネーブル / デ ィ セーブルする こ と が出来ます。

DAC デー タ ・ フ ォ ーマ ッ ト

次のよ う に、 選択 さ れた構成モー ド に よ り 、 デー タ は指定 さ れた レ ジ ス タ へ書込む必要が

あ り ます。

シ ン グル DAC チ ャ ネル x では、 3 つの状況が考え られます :

– 8bit 右寄せ : ユーザは、 デー タ を DAC_DHR8Rx[7:0] ビ ッ ト (DHRx[11 : 4] ビ ッ ト

へ保存) へロー ド し なければな り ません。

– 12bit 左寄せ : ユーザは、 デー タ を DAC_DHR12L x[15:4] ビ ッ ト (DHRx[11 : 0]

ビ ッ ト へ保存) へロー ド し なければな り ません。

– 12bit 右寄せ : ユーザは、 デー タ を DAC_DHR12Rx[11:0] ビ ッ ト (DHRx[11 : 0]

ビ ッ ト へ保存) へロー ド し なければな り ません。

ロー ド さ れた DAC_DHRyyyx レ ジ ス タ の内容に よ り 、 ユーザが書込んだデー タ はシ フ ト さ

れ、 DHRx ( メ モ リ へ配置 さ れない内部レ ジ ス タ であ るデー タ 保持レ ジ ス タ x) へ保存 さ れ

ます。 そ し て DHRx レ ジ ス タ は、 自動的または外部イ ベン ト に よ る ソ フ ト ウ ェ ア ・ ト リ ガ

に よ り 、 DORx レ ジ ス タ へロー ド さ れます。

Rev 5 -日本語版 193/720

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参考資料

D/A コ ンバー タ (DAC)

RM0008

図 40.

シ ン グル DAC チ ャ ネル ・ モー ド のデー タ ・ レ ジ ス タ

31 24 15 7 0

8-bit

右寄せ

12-bit

左寄せ

12-bit

右寄せ ai14710

デ ュ アル DAC チ ャ ネルでは、 3 つの状況が考え られます。

– 8bit 右寄せ : DAC チ ャ ネル 1 へのデー タ は、 デー タ を DAC_DHR8RD[7:0] ビ ッ ト

(DHR1[11 : 4] ビ ッ ト へ保存) へ、 DAC チ ャ ネル 2 へのデー タ は、

DAC_DHR8RD[15:8] ビ ッ ト (DHR2[11 : 4] ビ ッ ト へ保存) へロー ド さ れます。

– 12bit 左寄せ : DAC チ ャ ネル 1 へのデー タ は、 デー タ を DAC_DHR12LD[15:4] ビ ッ

ト (DHR1[11 : 0] ビ ッ ト へ保存) へ、 DAC チ ャ ネル 2 へのデー タ は、

DAC_DHR12LD[31:20] ビ ッ ト (DHR2[11 : 0] ビ ッ ト へ保存) へロー ド さ れます。

– 12bit 右寄せ : DAC チ ャ ネル 1 へのデー タ は、 デー タ を DAC_DHR12RD[11:0] ビ ッ

ト (DHR1[11 : 0] ビ ッ ト へ保存) へ、 DAC チ ャ ネル 2 へのデー タ は、

DAC_DHR12LD[27:16] ビ ッ ト (DHR2[11 : 0] ビ ッ ト へ保存) へロー ド さ れます。

ロー ド さ れた DAC_DHRyyyD レ ジ ス タ の内容に よ り 、 ユーザが書込んだデー タ はシ フ ト さ

れ、 DHR1 と DHR2 ( メ モ リ へ配置 さ れない内部レ ジ ス タ であ るデー タ 保持レ ジ ス タ ) へ

保存 さ れます。 そ し て DHR1 及び DHR2 レ ジ ス タ は、 自動的または外部イ ベン ト に よ る ソ

フ ト ウ ェ ア ・ ト リ ガに よ り 、 DOR1 と DOR2 レ ジ ス タ へロー ド さ れます。

図 41.

デ ュ アル DAC チ ャ ネル ・ モー ド のデー タ ・ レ ジ ス タ

31 24 15 7 0

8-bit

右寄せ

12-bit 左寄せ

12-bit

右寄せ ai14709

11.3.4 DAC 変換

DAC_DORx へは、 直接書込む こ と は出来ません。 し たが っ て、 DAC チ ャ ネル x へのデー タ

転送は DAC_DHRx レ ジ ス タ (DAC_DHR8Rx、 DAC_DHR12Lx、 DAC_DHR12Rx、

DAC_DHR8RD、 DAC_DHR12LD または DAC_DHR12LD への書込み) へのロー ド に よ り 行 う 必

要があ り ます。

DAC_DHRx レ ジ ス タ へ保存 さ れたデー タ は、 ハー ド ウ ェ ア ト リ ガが選択 さ れていなければ、

1APB1 ク ロ ッ ク ・ サイ ク ル後に DAC_DORx レ ジ ス タ へ自動的に転送 さ れます。 し か し なが

ら、 ハー ド ウ ェ ア ト リ ガが選択 さ れてお り (DAC_CR レ ジ ス タ の TENx がセ ッ ト さ れてい

る)、 尚且つ ト リ ガが発生する と 、 転送は 3APB1 ク ロ ッ ク ・ サイ ク ル後に行われます。

DAC_DORx に DAC_DHRx の内容がロー ド さ れる と 、 出力電圧は、 電源電圧 と アナ ロ グ出力

負荷に応 じ て決定 さ れる t

SETTLING

時間後に利用可能 と な り ます。

194/720 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

D/A コ ンバー タ (DAC)

図 42.

ト リ ガ ・ デ ィ セーブル時 (TEN = 0) の変換 タ イ ミ ン グ図

APB1_CLK

DHR 0x1AC

DOR

0x1AC t

SETTLING

出力電圧 ai14711b

11.3.5

11.3.6

DAC 出力電圧

デジ タ ル入力は、 0 か ら V

REF+

の リ ニ ア変換に よ り 出力電圧へ変換 さ れます。

各 DAC チ ャ ネルピ ンのアナ ロ グ出力電圧は、 次の式に よ り 決定 さ れます。

REF

×

4095

DAC ト リ ガ選択

TENx 制御ビ ッ ト が外部イ ベ ン ト ( タ イ マ ・ カ ウ ン タ 、 外部割込みピ ン) に よ り セ ッ ト さ れ

る と 、 TSELx[2 : 0] 制御ビ ッ ト は、

表  50

に示す 8 つの中のどのイ ベン ト が変換を ト リ ガす

るか決定 し ます。

表 50.

外部 ト リ ガ

発生元

タ イ マ 6 TRGO イ ベン ト

タ イ マ 8 TRGO イ ベン ト

タ イ マ 7 TRGO イ ベン ト

タ イ マ 5 TRGO イ ベン ト

タ イ マ 2 TRGO イ ベン ト

タ イ マ 4 TRGO イ ベン ト

EXTI line9

SWTRIG

種別

オ ン チ ッ プ ・ タ イ マか らの

内部信号

TSEL[2:0]

000

001

010

011

100

101

110

111

外部ピ ン

ソ フ ト ウ ェ ア制御ビ ッ ト

DAC イ ン タ フ ェ ースが、 選択 さ れた TRGO タ イ マ出力、 あ る いは選択 さ れた外部割込み ラ

イ ン 9 上に立上 り エ ッ ジ を検出する度に、 DAC_DHRx レ ジ ス タ に最後に保存 さ れたデー タ

は、 DAC_DORx レ ジ ス タ へ転送 さ れます。 DAC_DORx レ ジ ス タ は、 ト リ ガが発生 し てか ら

3APB1 サイ ク ル後にア ッ プデー ト さ れます。

ソ フ ト ウ ェ ア ・ ト リ ガが選択 さ れてい る場合、 変換は SWTRIG ビ ッ ト がセ ッ ト さ れる と 開

始 さ れます。 SWTRIG ビ ッ ト は、 DAC_DHRx レ ジ ス タ の内容が DAC_DORx レ ジ ス タ へロー

ド さ れる と リ セ ッ ト さ れます。

注意 : 1 ENx ビ ッ ト がセ ッ ト さ れている と 、 TSELx[2:0] ビ ッ ト は変更する こ と が出来ません。

2 ソ フ ト ウ ェ ア ・ ト リ ガが選択 さ れている と 、 DAC_DHRx から DAC_DORx レ ジス タ への転送

は僅か 1APB1 ク ロ ッ ク ・ サイ クルで行われます。

Rev 5 -日本語版 195/720

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参考資料

D/A コ ンバー タ (DAC)

11.3.7

11.3.8

RM0008

DMA リ ク エ ス ト

各 DAC チ ャ ネルは、 DMA を持 っ ています。 DAC チ ャ ネルの DMA リ ク エ ス ト は、 2 つの

DMA チ ャ ネルに よ り 処理 さ れます。

DAC DMA リ ク エ ス ト は、 DMAENx ビ ッ ト がセ ッ ト さ れてお り 外部 ト リ ガ ( ソ フ ト ウ ェ ア ・

ト リ ガで な く ) が起き た時に発生 し ます。 その後 DAC_DHRx レ ジ ス タ の値は、 DAC_DORx

レ ジ ス タ へ転送 さ れます。

デ ュ アル ・ モー ド では、 両方の DMAENx ビ ッ ト がセ ッ ト さ れている と 、 2 つの DMA リ ク

エ ス ト が発生 し ます。 も し 1 つの DMA リ ク エ ス ト のみ必要な ら ば、 対応する 1 つの

DMAENx ビ ッ ト を セ ッ ト し ます。 こ れに よ り 、 ア プ リ ケーシ ョ ンは各 DMA リ ク エ ス ト に

対 し て個別の DMA チ ャ ネルを使 う 事で、 両方の DAC チ ャ ネルをデ ュ アル ・ モー ド で管理

する こ と が出来ます。

DAC DMA リ ク エ ス ト はキ ュ ー さ れないので、 最後の DMA リ ク エ ス ト への応答の前に 2 つ

目の外部 ト リ ガが発生する と 、 新たな リ ク エ ス ト は無視 さ れエ ラ ー も 報告 さ れません。

ノ イ ズ生成

可変振幅の擬似 ノ イ ズの生成には、 リ ニア ・ フ ィ ー ド バ ッ ク ・ シ フ ト ・ レ ジ ス タ (LFSR)

が利用で き ます。 DAC ノ イ ズ生成は、 WAVEx[1:0] を 01 にセ ッ ト する こ と で選択 さ れます。

LFSR にプ リ ロー ド さ れる値は 0xAAA です。 こ のレ ジ ス タ は、 各 ト リ ガ ・ イ ベン ト の

3APB1 ク ロ ッ ク ・ サイ ク ル後に、 特定のアルゴ リ ズムに従 っ て ア ッ プデー ト さ れます。

図 43.

DAC LFSR レ ジ ス タ 計算アルゴ リ ズム

XOR

X

12

11 10 9

X

6

8 7 6

X

4

5 4 3 2 1

X

0

X

0

12

NOR ai14713b

DAC_CR レ ジ ス タ の MAMPx[3 : 0] ビ ッ ト に よ り 、 部分的あ る いは全体がマス ク さ れる

LFSR 値は、 オーバ フ ローな し に DAC_DHRx の内容に加算 さ れます。 そ し て、 こ の値は

DAC_DORx レ ジ ス タ へ保存 さ れます。

LFSR が 0x0000 の場合、 1 が入れ られます。 (ア ン チ ロ ッ ク ア ッ プ ・ メ カ ニズム)

WAVEx[1 : 0] ビ ッ ト を リ セ ッ ト する事で、 LFSR 波形生成の リ セ ッ ト が可能です。

196/720 Rev 5 -日本語版

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RM0008

図 44.

D/A コ ンバー タ (DAC)

LFSR 波形生成に よ る DAC 変換 (SW ト リ ガ ・ イ ネーブル)

APB1_CLK

DHR 0x00

DOR

0xAAA

0xD55

SWTRIG ai14714

注意 :

11.3.9

ノ イ ズ生成のためには、 DAC_CR レ ジス タ の TENx ビ ッ ト を セ ッ ト し 、 DAC ト リ ガ を イ

ネーブル し なければな り ません。

三角波生成

DC または低周波上に、 小 さ な振幅の三角波を追加する こ と が可能です。 DAC 三角波生成

は、 WAVEx[1 : 0] を 10 にセ ッ ト する こ と で選択 さ れます。 振幅は DAC_CR レ ジ ス タ の

MAMPx[3 : 0] ビ ッ ト を通 じ て設定 さ れます。 内部のカ ウ ン タ は、 各イ ベ ン ト の 3APB1 ク

ロ ッ ク ・ サイ ク ル後に イ ン ク リ メ ン ト さ れます。 こ のカ ウ ン タ の値は、 オーバ フ ローな し

に DAC_DHRx レ ジ ス タ へ加え ら れ、 合計は DAC_DORx レ ジ ス タ へ保存 さ れます。 こ のカ ウ

ン タ は、 MAMPx[3 : 0] ビ ッ ト に よ り 定義 さ れた最大振幅よ り 、 転送 さ れた値が小 さ か っ た

場合に イ ン ク リ メ ン ト さ れます。 設定 さ れた振幅に達する と 、 カ ウ ン タ は 0 にデ ク リ メ ン

ト さ れ、 再び イ ン ク リ メ ン ト を行います。

三角波生成は WAVEx[1 : 0] ビ ッ ト を リ セ ッ ト する事で、 リ セ ッ ト 可能です。

図 45.

DAC 三角波生成

MAMPx[3:0]

最大振幅

減少

増加 ai14715b

Rev 5 -日本語版 197/720

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D/A コ ンバー タ (DAC)

図 46.

三角波生成に よ る DAC 変換 (SW ト リ ガ ・ イ ネーブル)

APB1_CLK

DHR 0xABE

RM0008

DOR

0xABE 0xABF 0xAC0

SWTRIG ai14714

注意 : 1 ノ イ ズ生成には、 DAC_CR レ ジス タ の TENx ビ ッ ト を セ ッ ト し DAC ト リ ガ を イ ネーブル し

なければな り ません。

2 DAC を イ ネーブルする前に MAMPx[3:0] ビ ッ ト を設定 し なければ、 それら を変更する こ と

は出来ません。

198/720 Rev 5 -日本語版

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RM0008

11.4

11.4.1

11.4.2

D/A コ ンバー タ (DAC)

デ ュ アル DAC チ ャ ネル変換

同時に 2 つの DAC チ ャ ネルを必要 と する ア プ リ ケーシ ョ ン で、 バスバン ド 幅を有効に使

う ために、 DHR8RD、 DHR12RD と DHR12LD の 3 つのデ ュ アル ・ レ ジ ス タ が搭載 さ れてい

ます。 2 つの DAC チ ャ ネルを同時に使 う には、 特別な レ ジ ス タ ・ ア ク セスが必要です。

2 つの DAC チ ャ ネル と 3 つのデ ュ アル ・ レ ジ ス タ を使 う こ と で、 11 の変換モー ド が利用

可能です。 全ての変換モー ド は、 必要な場合には、 別の DHRx レ ジ ス タ を使 っ て も 利用で

き ます。

全てのモー ド は、 次の節に記載 さ れています。

波形生成な し の独立 ト リ ガ

DAC を こ の変換モー ド に設定する には、 次の手順が必要です。

TEN1 と TEN2 の 2 つの DAC チ ャ ネル ・ ト リ ガ ・ イ ネーブル ・ ビ ッ ト を セ ッ ト

TSEL1[2:0] と TSEL2[2 : 0] ビ ッ ト に異な る値を セ ッ ト し 、 異な る ト リ ガ ソ ース を設定

希望する DHR レ ジ ス タ (DAC_DHR12RD、 DAC_DHR12LD または DAC_DHR8RD) へ、

デ ュ アル DAC チ ャ ネル ・ デー タ を ロー ド

DAC チ ャ ネル 1 ト リ ガが発生する と 、 DHR1 レ ジ ス タ は DAC_DOR1 へ転送 さ れます。

(3APB1 ク ロ ッ ク ・ サイ クル後)

DAC チ ャ ネル 2 ト リ ガが発生する と 、 DHR2 レ ジ ス タ は DAC_DOR2 へ転送 さ れます。

(3APB1 ク ロ ッ ク ・ サイ クル後)

同 じ LFSR 生成によ る独立 ト リ ガ

DAC を こ の変換モー ド に設定する には、 次の手順が必要です。

TEN1 と TEN2 の 2 つの DAC チ ャ ネル ・ ト リ ガ ・ イ ネーブル ・ ビ ッ ト を セ ッ ト

TSEL1[2:0] と TSEL2[2 : 0] ビ ッ ト に異な る値を セ ッ ト し 、 異な る ト リ ガ ソ ース を設定

2 つの DAC チャネル WAVEx[1 : 0] ビットを 01 に、 同じ LFSR マスクを MAMPx[3 : 0] に設定

希望する DHR レ ジ ス タ (DAC_DHR12RD、 DAC_DHR12LD または DAC_DHR8RD) へ、

デ ュ アル DAC チ ャ ネル ・ デー タ を ロー ド

DAC チ ャ ネル 1 ト リ ガが発生する と 、 同 じ マ ス ク で LFSR1 カ ウ ン タ が DHR1 レ ジ ス タ に

加算 さ れ、 合計は DAC_DOR1 へ転送 さ れます。 (3APB1 ク ロ ッ ク ・ サイ クル後) その後

LFSR1 カ ウ ン タ がア ッ プデー ト さ れます。

DAC チ ャ ネル 2 ト リ ガが発生する と 、 同 じ マ ス ク で LFSR2 カ ウ ン タ が DHR2 レ ジ ス タ に

加算 さ れ、 合計は DAC_DOR2 へ転送 さ れます。 (3APB1 ク ロ ッ ク ・ サイ クル後) その後

LFSR2 カ ウ ン タ がア ッ プデー ト さ れます。

Rev 5 -日本語版 199/720

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D/A コ ンバー タ (DAC)

11.4.3

11.4.4

11.4.5

RM0008

異な る LFSR 生成によ る独立 ト リ ガ

DAC を こ の変換モー ド に設定する には、 次の手順が必要です。

TEN1 と TEN2 の 2 つの DAC チ ャ ネル ・ ト リ ガ ・ イ ネーブル ・ ビ ッ ト を セ ッ ト

TSEL1[2:0] と TSEL2[2 : 0] ビ ッ ト に異な る値を セ ッ ト し 、 異な る ト リ ガ ソ ース を設定

2 つの DAC チ ャ ネル WAVEx[1:0] ビ ッ ト を 01 に、異な る LFSR マス ク を MAMP1[3:0] と

MAMP2[3 : 0] に設定

希望する DHR レ ジ ス タ (DAC_DHR12RD、 DAC_DHR12LD または DAC_DHR8RD) へ、

デ ュ アル DAC チ ャ ネル ・ デー タ を ロー ド

DAC チ ャ ネル 1 ト リ ガが発生する と 、 MAMP1[3 : 0] に よ り 設定 さ れたマス ク で LFSR1 カ

ウ ン タ が DHR1 レ ジ ス タ に加算 さ れ、 合計は DAC_DOR1 へ転送 さ れます。 (3APB1 ク ロ ッ

ク ・ サイ クル後) その後 LFSR1 カ ウ ン タ がア ッ プデー ト さ れます。

DAC チ ャ ネル 2 ト リ ガが発生する と 、 MAMP2[3 : 0] に よ り 設定 さ れたマス ク で LFSR2 カ

ウ ン タ が DHR2 レ ジ ス タ に加算 さ れ、 合計は DAC_DOR2 へ転送 さ れます。 (3APB1 ク ロ ッ

ク ・ サイ クル後) その後 LFSR2 カ ウ ン タ がア ッ プデー ト さ れます。

同 じ 三角波生成によ る独立 ト リ ガ

DAC を こ の変換モー ド に設定する には、 次の手順が必要です。

TEN1 と TEN2 の 2 つの DAC チ ャ ネル ・ ト リ ガ ・ イ ネーブル ・ ビ ッ ト を セ ッ ト

TSEL1[2:0] と TSEL2[2 : 0] ビ ッ ト に異な る値を セ ッ ト し 、 異な る ト リ ガ ソ ース を設定

2 つの DAC チ ャ ネル WAVEx[1:0] ビ ッ ト を 1x に、同 じ 最大振幅値を MAMPx[3:0] に設定

希望する DHR レ ジ ス タ (DAC_DHR12RD、 DAC_DHR12LD または DAC_DHR8RD) へ、

デ ュ アル DAC チ ャ ネル ・ デー タ を ロー ド

DAC チ ャ ネル 1 ト リ ガが発生する と 、 DAC チ ャ ネル 1 三角カ ウ ン タ が同 じ 三角振幅で

DHR1 レ ジ ス タ に加算 さ れ、 合計は DAC_DOR1 へ転送 さ れます。 (3APB1 ク ロ ッ ク ・ サイ

クル後) その後 DAC チ ャ ネル 1 三角カ ウ ン タ がア ッ プデー ト さ れます。

DAC チ ャ ネル 2 ト リ ガが発生する と 、 DAC チ ャ ネル 2 三角カ ウ ン タ が同 じ 三角振幅で

DHR2 レ ジ ス タ に加算 さ れ、 合計は DAC_DOR2 へ転送 さ れます。 (3APB1 ク ロ ッ ク ・ サイ

クル後) その後 DAC チ ャ ネル 2 三角カ ウ ン タ がア ッ プデー ト さ れます。

異な る三角波生成によ る独立 ト リ ガ

DAC を こ の変換モー ド に設定する には、 次の手順が必要です。

TEN1 と TEN2 の 2 つの DAC チ ャ ネル ・ ト リ ガ ・ イ ネーブル ・ ビ ッ ト を セ ッ ト

TSEL1[2:0] と TSEL2[2 : 0] ビ ッ ト に異な る値を セ ッ ト し 、 異な る ト リ ガ ソ ース を設定

2 つの DAC チ ャ ネル WAVEx[1:0] ビ ッ ト を 1x に、異な る最大振幅値マ ス ク を MAMP1[3:

0] と MAMP2[3 : 0] に設定

希望する DHR レ ジ ス タ (DAC_DHR12RD、 DAC_DHR12LD または DAC_DHR8RD) へ、

デ ュ アル DAC チ ャ ネル ・ デー タ を ロー ド

DAC チャネル 1 トリガが発生すると、 MAMP1[3 : 0] により設定されたマスクで DAC チャネル 1

三角カウンタが DHR1 レジスタに加算され、 合計は DAC_DOR1 へ転送されます。 (3APB1 ク

ロック ・ サイクル後) その後 DAC チャネル 1 三角カウンタがアップデートされます。

DAC チ ャ ネル 2 ト リ ガが発生する と 、 MAMP2[3 : 0] に よ り 設定 さ れたマス ク で DAC チ ャ

ネル 2 三角カ ウ ン タ が DHR2 レ ジ ス タ に加算 さ れ、 合計は DAC_DOR2 へ転送 さ れます。

(3APB1 ク ロ ッ ク ・ サイ クル後) その後 DAC チ ャ ネル 2 三角カ ウ ン タ カ ウ ン タ がア ッ プ

デー ト さ れます。

200/720 Rev 5 -日本語版

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製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

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RM0008

11.4.6

11.4.7

D/A コ ンバー タ (DAC)

同時ソ フ ト ウ ェ ア ス タ ー ト

DAC を こ の変換モー ド に設定する には、 次の手順が必要です。

希望する DHR レ ジ ス タ (DAC_DHR12RD、 DAC_DHR12LD または DAC_DHR8RD) へ、

デ ュ アル DAC チ ャ ネル ・ デー タ を ロー ド

こ の コ ン フ ィ グ レーシ ョ ン では、 DHR1 と DHR2 レ ジ ス タ は、 1APB1 ク ロ ッ ク ・ サイ ク ル

後に DAC_DOR1 と DAC_DOR2 へそれぞれ転送 さ れます。

波形生成な し によ る同時 ト リ ガ

DAC を こ の変換モー ド に設定する には、 次の手順が必要です。

TEN1 と TEN2 の 2 つの DAC チ ャ ネル ・ ト リ ガ ・ イ ネーブル ・ ビ ッ ト を セ ッ ト

TSEL1[2:0] と TSEL2[2 : 0] ビ ッ ト に同 じ 値を セ ッ ト し 、 同 じ ト リ ガ ソ ース を設定

希望する DHR レ ジ ス タ (DAC_DHR12RD、 DAC_DHR12LD または DAC_DHR8RD) へ、

デ ュ アル DAC チ ャ ネル ・ デー タ を ロー ド

ト リ ガが発生する と 、 DHR1 と DHR2 レ ジ ス タ は、 DAC_DOR1 と DAC_DOR2 へそれぞれ転

送 さ れます。 (3APB1 ク ロ ッ ク ・ サイ クル後)

Rev 5 -日本語版 201/720

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

D/A コ ンバー タ (DAC)

RM0008

11.4.8 同 じ LFSR 生成によ る同時 ト リ ガ

DAC を こ の変換モー ド に設定する には、 次の手順が必要です。

TEN1 と TEN2 の 2 つの DAC チ ャ ネル ・ ト リ ガ ・ イ ネーブル ・ ビ ッ ト を セ ッ ト

TSEL1[2:0] と TSEL2[2 : 0] ビ ッ ト に同 じ 値を セ ッ ト し 、 同 じ ト リ ガ ソ ース を設定

2 つの DAC チャネル WAVEx[1 : 0] ビットを 01 に、 同じ LFSR マスクを MAMPx[3 : 0] に設定

希望する DHR レ ジ ス タ (DAC_DHR12RD、 DAC_DHR12LD または DAC_DHR8RD) へ、

デ ュ アル DAC チ ャ ネル ・ デー タ を ロー ド

ト リ ガが発生する と 、 同 じ マ ス ク で LFSR1 カ ウ ン タ が DHR1 レ ジ ス タ に加算 さ れ、 合計は

DAC_DOR1 へ転送 さ れます。 (3APB1 ク ロ ッ ク ・ サイ クル後) その後 LFSR1 カ ウ ン タ が

ア ッ プデー ト さ れます。 同時に、 同 じ マ ス ク で LFSR2 カ ウ ン タ が DHR2 レ ジ ス タ に加算 さ

れ、 合計は DAC_DOR2 へ転送 さ れます。 (3APB1 ク ロ ッ ク ・ サイ クル後) その後 LFSR2 カ

ウ ン タ がア ッ プデー ト さ れます。

11.4.9 異な る LFSR 生成によ る同時 ト リ ガ

DAC を こ の変換モー ド に設定する には、 次の手順が必要です。

TEN1 と TEN2 の 2 つの DAC チ ャ ネル ・ ト リ ガ ・ イ ネーブル ・ ビ ッ ト を セ ッ ト

TSEL1[2:0] と TSEL2[2 : 0] ビ ッ ト に同 じ 値を セ ッ ト し 、 同 じ ト リ ガ ソ ース を設定

2 つの DAC チ ャ ネル WAVEx[1:0] ビ ッ ト を 01 に、異な る LFSR マス ク を MAMP1[3:0] と

MAMP2[3 : 0] に設定

希望する DHR レ ジ ス タ (DAC_DHR12RD、 DAC_DHR12LD または DAC_DHR8RD) へ、

デ ュ アル DAC チ ャ ネル ・ デー タ を ロー ド

ト リ ガが発生する と 、 MAMP1[3 : 0] で設定 さ れたマ ス ク で LFSR1 カ ウ ン タ が DHR1 レ ジ ス

タ に加算 さ れ、 合計は DAC_DOR1 へ転送 さ れます。 (3APB1 ク ロ ッ ク ・ サイ ク ル後) その

後 LFSR1 カ ウ ン タ がア ッ プデー ト さ れます。

同時に、 MAMP2[3 : 0] で設定 さ れたマ ス ク で LFSR2 カ ウ ン タ が DHR2 レ ジ ス タ に加算 さ

れ、 合計は DAC_DOR2 へ転送 さ れます。 (3APB1 ク ロ ッ ク ・ サイ クル後) その後 LFSR2 カ

ウ ン タ がア ッ プデー ト さ れます。

11.4.10 同 じ 三角生成によ る同時 ト リ ガ

DAC を こ の変換モー ド に設定する には、 次の手順が必要です。

TEN1 と TEN2 の 2 つの DAC チ ャ ネル ・ ト リ ガ ・ イ ネーブル ・ ビ ッ ト を セ ッ ト

TSEL1[2:0] と TSEL2[2 : 0] ビ ッ ト に同 じ 値を セ ッ ト し 、 同 じ ト リ ガ ソ ース を設定

2 つの DAC チ ャ ネル WAVEx[1:0] ビ ッ ト を 1x に、同 じ 最大振幅値を MAMPx[3:0] に設定

希望する DHR レ ジ ス タ (DAC_DHR12RD、 DAC_DHR12LD または DAC_DHR8RD) へ、

デ ュ アル DAC チ ャ ネル ・ デー タ を ロー ド

DAC チ ャ ネル 1 ト リ ガが発生する と 、 DAC チ ャ ネル 1 三角カ ウ ン タ が同 じ 三角振幅で

DHR1 レ ジ ス タ に加算 さ れ、 合計は DAC_DOR1 へ転送 さ れます。 (3APB1 ク ロ ッ ク ・ サイ

クル後) その後 DAC チ ャ ネル 1 三角カ ウ ン タ がア ッ プデー ト さ れます。

同時に、 DAC チ ャ ネル 2 三角カ ウ ン タ が同 じ 三角振幅で DHR2 レ ジ ス タ に加算 さ れ、 合計

は DAC_DOR2 へ転送 さ れます。 (3APB1 ク ロ ッ ク ・ サイ ク ル後) その後 DAC チ ャ ネル 2 三

角カ ウ ン タ がア ッ プデー ト さ れます。

202/720 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

D/A コ ンバー タ (DAC)

11.4.11 異な る三角生成によ る同時 ト リ ガ

DAC を こ の変換モー ド に設定する には、 次の手順が必要です。

TEN1 と TEN2 の 2 つの DAC チ ャ ネル ・ ト リ ガ ・ イ ネーブル ・ ビ ッ ト を セ ッ ト

TSEL1[2:0] と TSEL2[2 : 0] ビ ッ ト に同 じ 値を セ ッ ト し 、 同 じ ト リ ガ ソ ース を設定

2 つの DAC チ ャ ネル WAVEx[1:0] ビ ッ ト を 1x に、異な る最大振幅値マ ス ク を MAMP1[3:

0] と MAMP2[3 : 0] に設定

希望する DHR レ ジ ス タ (DAC_DHR12RD、 DAC_DHR12LD または DAC_DHR8RD) へ、

デ ュ アル DAC チ ャ ネル ・ デー タ を ロー ド

ト リ ガが発生する と 、 MAMP1[3 : 0] で設定 さ れた三角振幅で DAC チ ャ ネル 1 三角カ ウ ン

タ が DHR1 レ ジ ス タ に加算 さ れ、 合計は DAC_DOR1 へ転送 さ れます。 (3APB1 ク ロ ッ ク ・

サイ ク ル後) その後 DAC チ ャ ネル 1 三角カ ウ ン タ がア ッ プデー ト さ れます。 同時に、

MAMP2[3 : 0] で設定 さ れた三角振幅で DAC チ ャ ネル 2 三角カ ウ ン タ が DHR2 レ ジ ス タ に

加算 さ れ、 合計は DAC_DOR2 へ転送 さ れます。 (3APB1 ク ロ ッ ク ・ サイ クル後) その後

DAC チ ャ ネル 2 三角カ ウ ン タ がア ッ プデー ト さ れます。

Rev 5 -日本語版 203/720

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参考資料

D/A コ ンバー タ (DAC)

RM0008

11.5 DAC レ ジス タ

11.5.1

31 30

予約済み

DAC 制御レ ジ ス タ (DAC_CR)

ア ド レ スオ フ セ ッ ト : 0x00

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24

DMA

EN2

MAMP2[3:0]

15 14

予約済み

13 rw

12

DMA

EN1 rw rw

11 rw rw

10 rw

9

MAMP1[3:0] rw rw rw

8 rw

23

WAVE2[1:0] rw

7

22 rw

6

WAVE1[1:0]

21 rw

5

20

TSEL2[2:0] rw

4

TSEL1[2:0]

19 rw

3

18

TEN2 BOFF2 EN2 rw

2

17 rw

1

16 rw

0

TEN1 BOFF1 EN1 rw rw rw rw rw rw rw rw

Bits 31:29 予約済み

Bit 28 DMAEN2:

DAC チ ャ ネル 2DMA イ ネーブル

こ のビ ッ ト は ソ フ ト ウ ェ アに よ り セ ッ ト / ク リ ア さ れます。

0: DAC チ ャ ネル 2DMA モー ド はデ ィ セーブルです。

1: DAC チ ャ ネル 2DMA モー ド はイ ネーブルです。

Bit 27:24 MAMP2[3:0]:

DAC チ ャ ネル 2 マス ク / 振幅セ レ ク タ

こ れ らのビ ッ ト は、 波形生成モー ド のマス ク、 または三角生成モー ド の振幅を選択する ために、

ソ フ ト ウ ェ アによ り 書込まれます。

0000: LFSR のマス ク し ない ビ ッ ト 0/ 三角振幅は 1 と 等 し い

0001: LFSR のマス ク し ない ビ ッ ト [1:0]/ 三角振幅は 3 と 等 し い

0010: LFSR のマス ク し ない ビ ッ ト [2:0]/ 三角振幅は 7 と 等 し い

0011: LFSR のマス ク し ない ビ ッ ト [3:0]/ 三角振幅は 15 と 等 し い

0100: LFSR のマス ク し ない ビ ッ ト [4:0]/ 三角振幅は 31 と 等 し い

0101: LFSR のマス ク し ない ビ ッ ト [5:0]/ 三角振幅は 63 と 等 し い

0110: LFSR のマス ク し ない ビ ッ ト [6:0]/ 三角振幅は 127 と 等 し い

0111: LFSR のマス ク し ない ビ ッ ト [7:0]/ 三角振幅は 255 と 等 し い

1000: LFSR のマス ク し ない ビ ッ ト [8:0]/ 三角振幅は 511 と 等 し い

1001: LFSR のマス ク し ない ビ ッ ト [9:0]/ 三角振幅は 1023 と 等 し い

1010: LFSR のマス ク し ない ビ ッ ト [10:0]/ 三角振幅は 2047 と 等 し い

1011: LFSR のマス ク し ない ビ ッ ト [11:0]/ 三角振幅は 4095 と 等 し い

Bit 23:22 WAVE2[1:0]: DAC チ ャ ネル 2 ノ イ ズ / 三角波生成イ ネーブル

こ れ らのビ ッ ト は、 ソ フ ト ウ ェ アによ り セ ッ ト / ク リ ア さ れます。

00: 波形生成はデ ィ セーブルです。

01: ノ イ ズ波生成はイ ネーブルです。

1x: 三角波生成はイ ネーブルです。

注 : ビ ッ ト TEN2 = 1 の場合に限 り 使われます。 (DAC チ ャ ネル 2 ト リ ガ ・ イ ネーブル)

204/720 Rev 5 -日本語版

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正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

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参考資料

RM0008

D/A コ ンバー タ (DAC)

Bits 21:19 TSEL2[2:0]:

DAC チ ャ ネル 2 ト リ ガ選択

こ れ らのビ ッ ト は、 DAC チ ャ ネル 2 を ト リ ガする ための外部イ ベン ト を選択 し ます。

000: タ イ マ 6 TRGO イ ベン ト

001: タ イ マ 8 TRGO イ ベン ト

010: タ イ マ 7 TRGO イ ベン ト

011: タ イ マ 5 TRGO イ ベン ト

100: タ イ マ 2 TRGO イ ベン ト

101: タ イ マ 4 TRGO イ ベン ト

110: 外部ラ イ ン 9

111: ソ フ ト ウ ェ ア ・ ト リ ガ

注 : ビ ッ ト TEN2 = 1 の場合に限 り 使われます。 (DAC チ ャ ネル 2 ト リ ガ ・ イ ネーブル)

Bit 18 TEN2:

DAC チ ャ ネル 2 ト リ ガ ・ イ ネーブル

こ のビ ッ ト は、 DAC チ ャ ネル 2 ト リ ガ を イ ネーブル / デ ィ セーブルする ために ソ フ ト ウ ェ アに よ

り セ ッ ト / リ セ ッ ト さ れます。

0: DAC チ ャ ネル 2 ト リ ガはデ ィ セーブルで、 DAC_DHRx レ ジス タ か ら転送 さ れたデー タ は 1APB1

ク ロ ッ ク ・ サイ クル後に DAC_DOR2 レ ジ ス タ へ転送 さ れます。

1: DAC チ ャ ネル 2 ト リ ガはイ ネーブルで、 DAC_DHRx レ ジス タ か ら転送 さ れたデー タ は、 3APB1

ク ロ ッ ク ・ サイ クル後に DAC_DOR2 レ ジ ス タ へ転送 さ れます。

注 : ソ フ ト ウ ェ ア ・ ト リ ガがイ ネーブルな場合、 DAC_DHRx から DAC_DOR2 レ ジ ス タ への転送に

は、 1APB1 ク ロ ッ ク ・ サイ クル し かかか り ません。

Bit 17 BOFF2:

DAC チ ャ ネル 2 出力バ ッ フ ァ ・ デ ィ セーブル

こ のビ ッ ト は、 DAC チ ャ ネル 2 出力バ ッ フ ァ を イ ネーブル / デ ィ セーブルする ために ソ フ ト ウ ェ

アによ り セ ッ ト / リ セ ッ ト さ れます。

0: DAC チ ャ ネル 2 出力バ ッ フ ァ はイ ネーブルです。

1: DAC チ ャ ネル 2 出力バ ッ フ ァ はデ ィ セーブルです。

Bit 16 EN2:

DAC チ ャ ネル 2 イ ネーブル

こ のビ ッ ト は、 DAC チ ャ ネル 2 を イ ネーブル / デ ィ セーブルする ために ソ フ ト ウ ェ アによ り セ ッ

ト / リ セ ッ ト さ れます。

0: DAC チ ャ ネル 2 はデ ィ セーブルです。

1: DAC チ ャ ネル 2 はイ ネーブルです。

Bits 15:13 予約済み

Bit 12 DMAEN1: DAC

チ ャ ネル 1DMA イ ネーブル

こ のビ ッ ト は、 ソ フ ト ウ ェ アによ り セ ッ ト / リ セ ッ ト さ れます。

0: DAC チ ャ ネル 1DMA モー ド はデ ィ セーブルです。

1: DAC チ ャ ネル 1DMA モー ド はイ ネーブルです。

Rev 5 -日本語版 205/720

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参考資料

D/A コ ンバー タ (DAC)

RM0008

Bits 11:8 MAMP1[3:0]: DAC

チ ャ ネル 1 マス ク / 振幅セ レ ク タ

こ れ らのビ ッ ト は、 波形生成モー ド のマス ク、 または三角生成モー ド の振幅を選択する ために、

ソ フ ト ウ ェ アによ り 書込まれます。

0000: LFSR のマス ク し ない ビ ッ ト 0/ 三角振幅は 1 と 等 し い

0001: LFSR のマス ク し ない ビ ッ ト [1:0]/ 三角振幅は 3 と 等 し い

0010: LFSR のマス ク し ない ビ ッ ト [2:0]/ 三角振幅は 7 と 等 し い

0011: LFSR のマス ク し ない ビ ッ ト [3:0]/ 三角振幅は 15 と 等 し い

0100: LFSR のマス ク し ない ビ ッ ト [4:0]/ 三角振幅は 31 と 等 し い

0101: LFSR のマス ク し ない ビ ッ ト [5:0]/ 三角振幅は 63 と 等 し い

0110: LFSR のマス ク し ない ビ ッ ト [6:0]/ 三角振幅は 127 と 等 し い

0111: LFSR のマス ク し ない ビ ッ ト [7:0]/ 三角振幅は 255 と 等 し い

1000: LFSR のマス ク し ない ビ ッ ト [8:0]/ 三角振幅は 511 と 等 し い

1001: LFSR のマス ク し ない ビ ッ ト [9:0]/ 三角振幅は 1023 と 等 し い

1010: LFSR のマス ク し ない ビ ッ ト [10:0]/ 三角振幅は 2047 と 等 し い

1011: LFSR のマス ク し ない ビ ッ ト [11:0]/ 三角振幅は 4095 と 等 し い

Bits 7:6 WAVE1[1:0]: DAC

チ ャ ネル 1 ノ イズ / 三角波生成イ ネーブル

こ れ らのビ ッ ト は ソ、 フ ト ウ ェ アによ り セ ッ ト / ク リ ア さ れます。

00: 波形生成はデ ィ セーブルです。

01: ノ イ ズ波生成はイ ネーブルです。

1x: 三角波生成はイ ネーブルです。

注 : ビ ッ ト TEN1 = 1 の場合に限 り 使われます。 (DAC チ ャ ネル 1 ト リ ガ ・ イ ネーブル)

Bits 5:3 TSEL1[2:0]: DAC

チ ャ ネル 1 ト リ ガ選択

こ れ らのビ ッ ト は、 DAC チ ャ ネル 1 を ト リ ガする ための外部イ ベン ト を選択 し ます。

000: タ イ マ 6 TRGO イ ベ ン ト

001: タ イ マ 8 TRGO イ ベ ン ト

010: タ イ マ 7 TRGO イ ベ ン ト

011: タ イ マ 5 TRGO イ ベ ン ト

100: タ イ マ 2 TRGO イ ベ ン ト

101: タ イ マ 4 TRGO イ ベ ン ト

110: 外部 ラ イ ン 9

111: ソ フ ト ウ ェ ア ・ ト リ ガ

注 : ビ ッ ト TEN1 = 1 の場合に限 り 使われます。 (DAC チ ャ ネル 1 ト リ ガ ・ イ ネーブル)

206/720 Rev 5 -日本語版

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製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

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参考資料

RM0008

D/A コ ンバー タ (DAC)

Bit 2 TEN1: DAC

チ ャ ネル 1 ト リ ガ ・ イ ネーブル

こ のビ ッ ト は、 DAC チ ャ ネル 1 ト リ ガ を イ ネーブル / デ ィ セーブルする ために ソ フ ト ウ ェ アに よ

り セ ッ ト / リ セ ッ ト さ れます。

0: DAC チ ャ ネル 1 ト リ ガはデ ィ セーブルで、DAC_DHRx レ ジ ス タ か ら 転送 さ れたデー タ は 1APB1 ク

ロ ッ ク ・ サイ クル後に DAC_DOR1 レ ジ ス タ へ転送 さ れます。

1: DAC チ ャ ネル 1 ト リ ガはイ ネーブルで、 DAC_DHRx レ ジ ス タ か ら 転送 さ れたデー タ は、 3APB1 ク

ロ ッ ク ・ サイ クル後に DAC_DOR1 レ ジ ス タ へ転送 さ れます。

注 : ソ フ ト ウ ェ ア ・ ト リ ガがイ ネーブルな場合、 DAC_DHRx から DAC_DOR1 レ ジス タ への転送に

は、 1APB1 ク ロ ッ ク ・ サイ クル し かかか り ません。

Bit 1 BOFF1: DAC

チ ャ ネル 1 出力バ ッ フ ァ ・ デ ィ セーブル

こ のビ ッ ト は、 DAC チ ャ ネル 1 出力バ ッ フ ァ を イ ネーブル / デ ィ セーブルする ために ソ フ ト ウ ェ

アによ り セ ッ ト / リ セ ッ ト さ れます。

0: DAC チ ャ ネル 1 出力バ ッ フ ァ はイ ネーブルです。

1: DAC チ ャ ネル 1 出力バ ッ フ ァ はデ ィ セーブルです。

Bit 0 EN1: DAC

チ ャ ネル 1 イ ネーブル

こ のビ ッ ト は、 DAC チ ャ ネル 1 を イ ネーブル / デ ィ セーブルする ために ソ フ ト ウ ェ アによ り セ ッ

ト / リ セ ッ ト さ れます。

0: DAC チ ャ ネル 1 はデ ィ セーブルです。

1: DAC チ ャ ネル 1 はイ ネーブルです。

Rev 5 -日本語版 207/720

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参考資料

D/A コ ンバー タ (DAC)

RM0008

11.5.2

31 30

DAC ソ フ ト ウ ェ ア ・ ト リ ガ ・ レ ジ ス タ (DAC_SWTRIGR)

ア ド レ スオ フ セ ッ ト : 0x04

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20 19

予約済み

18 17 16

15 14 13 12 11 10 9 8

予約済み

7 6 5 4 3 2 1 0

SWTRI

G2 w

SWTRI

G1 w

Bits 31:2 予約済み

Bit 1 SWTRIG2:

DAC チ ャ ネル 2 ソ フ ト ウ ェ ア ・ ト リ ガ

このビ ッ ト は、 ソ フ ト ウ ェ ア ・ ト リ ガ を イ ネーブル / デ ィ セーブルする ために ソ フ ト ウ ェ アによ

り セ ッ ト / リ セ ッ ト さ れます。

0: ソ フ ト ウ ェ ア ・ ト リ ガはデ ィ セーブルです。

1: ソ フ ト ウ ェ ア ・ ト リ ガはイ ネーブルです。

注 : こ のビ ッ ト は DAC_DHR2 レ ジ ス タ 値が DAC_DOR2 レ ジス タ へロー ド さ れる と 、 ハー ド ウ ェ ア

によ り リ セ ッ ト さ れます。 (1APB1 ク ロ ッ ク ・ サイ クル後)

Bit 0 SWTRIG1:

DAC チ ャ ネル 1 ソ フ ト ウ ェ ア ・ ト リ ガ

このビ ッ ト は、 ソ フ ト ウ ェ ア ・ ト リ ガ を イ ネーブル / デ ィ セーブルする ために ソ フ ト ウ ェ アによ

り セ ッ ト / リ セ ッ ト さ れます。

0: ソ フ ト ウ ェ ア ・ ト リ ガはデ ィ セーブルです。

1: ソ フ ト ウ ェ ア ・ ト リ ガはイ ネーブルです。

注 : こ のビ ッ ト は DAC_DHR1 レ ジ ス タ 値が DAC_DOR1 レ ジス タ へロー ド さ れる と 、 ハー ド ウ ェ ア

によ り リ セ ッ ト さ れます。 (1APB1 ク ロ ッ ク ・ サイ クル後)

11.5.3 DAC チ ャ ネル 1   12bit 右寄せデー タ 保持レ ジ ス タ

(DAC_DHR12R1)

ア ド レ スオ フ セ ッ ト : 0x08

リ セ ッ ト 値 : 0x0000 0000

31 30 29 28 27 26 25 24 23

予約済み

22 21 20 19 18 17 16

15 14 13

予約済み

12 11 10 9 8 7 rw

6 5

DACC1DHR[11:0] rw rw

4 rw

3 2 1 rw rw rw rw rw rw rw

Bits 31:12

予約済み

Bit 11:0 DACC1DHR[11:0]:

DAC チ ャ ネル 1   12bit 右寄せデー タ

こ れら のビ ッ ト は、 DAC チ ャ ネル 1 用の 12bit デー タ を示す ソ フ ト ウ ェ アによ り 書込まれます。

0 rw

208/720 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

D/A コ ンバー タ (DAC)

11.5.4

31 30

DAC チ ャ ネル 1   12bit 左寄せデー タ 保持レ ジ ス タ

(DAC_DHR12L1)

ア ド レ スオ フ セ ッ ト : 0x0C

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20

予約済み

19 18 17 16

15 14 13 12 11 10 9

DACC1DHR[11:0] rw rw

8 rw

7 6 5 4 3 2

予約済み

1 rw rw rw rw rw rw rw rw rw

Bits 31:16 予約済み

Bit 15:4 DACC1DHR[11:0]:

DAC チ ャ ネル 1   12bit 左寄せデー タ

こ れ らのビ ッ ト は、 DAC チ ャ ネル 1 用の 12bit デー タ を示す ソ フ ト ウ ェ アによ り 書込まれます。

Bits 3:0 予約済み

0

11.5.5

31 30

DAC チ ャ ネル 1   8bit 右寄せデー タ 保持レ ジ ス タ

(DAC_DHR8R1)

ア ド レ スオ フ セ ッ ト : 0x10

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20

予約済み

19 18 17 16

15 14 13 12 11

予約済み

10 9 8 7 6 5 4 3

DACC1DHR[7:0] rw rw

2 1 rw rw rw rw rw

Bits 31:8 予約済み

Bits 7:0 DACC1DHR[7:0]: DAC チ ャ ネル 1   8bit 右寄せデー タ

こ れ らのビ ッ ト は、 DAC チ ャ ネル 1 用の 8bit デー タ を示す ソ フ ト ウ ェ アによ り 書込まれます。

0 rw

Rev 5 -日本語版 209/720

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

D/A コ ンバー タ (DAC)

RM0008

11.5.6

31 30

DAC チ ャ ネル 2   12bit 右寄せデー タ 保持レ ジ ス タ

(DAC_DHR12R2)

ア ド レ スオ フ セ ッ ト : 0x14

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20

予約済み

19 18 17 16

15 14 13

予約済み

12 11 10 9 8 7 rw

6 5

DACC2DHR[11:0] rw rw

4 rw

3 2 1 rw rw rw rw rw rw rw

Bits 31:12 予約済み

Bits 11:0 DACC2DHR[11:0]:

DAC チ ャ ネル 2   12bit 右寄せデー タ

こ れ らのビ ッ ト は、 DAC チ ャ ネル 2 用の 12bit デー タ を示す ソ フ ト ウ ェ アによ り 書込まれます。

0 rw

11.5.7

31 30

DAC チ ャ ネル 2   12bit 左寄せデー タ 保持レ ジ ス タ

(DAC_DHR12L2)

ア ド レ スオ フ セ ッ ト : 0x18

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20

予約済み

19 18 17 16

15 14 13 12 11 10 9

DACC2DHR[11:0] rw rw

8 rw

7 6 5 4 3 2

予約済み

1 rw rw rw rw rw rw rw rw rw

Bits 31:16 予約済み

Bits 15:4 DACC2DHR[11:0]:

DAC チ ャ ネル 2   12bit 左寄せデー タ

こ れ らのビ ッ ト は、 DAC チ ャ ネル 2 用の 12bit デー タ を示す ソ フ ト ウ ェ アによ り 書込まれます。

Bits 3:0 予約済み

0

210/720 Rev 5 -日本語版

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

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参考資料

RM0008

D/A コ ンバー タ (DAC)

11.5.8

31 30

DAC チ ャ ネル 2   8bit 右寄せデー タ 保持レ ジ ス タ

(DAC_DHR8R2)

ア ド レ スオ フ セ ッ ト : 0x1C

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20

予約済み

19 18 17 16

15 14 13 12 11

予約済み

10 9 8 7 6 5 4 3

DACC2DHR[7:0] rw rw

2 rw

1 rw rw rw rw

Bits 31:8 予約済み

Bits 7:0 DACC2DHR[7:0]:

DAC チ ャ ネル 2   8bit 右寄せデー タ

こ れら のビ ッ ト は、 DAC チ ャ ネル 2 用の 8bit デー タ を示す ソ フ ト ウ ェ アによ り 書込まれます。

0 rw

11.5.9

31

デ ュ アル DAC   12bit 右寄せデー タ 保持レ ジ ス タ

(DAC_DHR12RD)

ア ド レ スオ フ セ ッ ト : 0x20

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 30

予約済み DACC2DHR[11:0]

15 12 rw

11 rw

10 rw

9 rw

8 14 13

予約済み rw rw rw rw rw

7 rw rw

6 rw

5

DACC1DHR[11:0] rw rw

20 rw

4 rw

19 rw

3

18 rw

2

17 rw

1 rw rw rw

Bits 31:28 予約済み

Bits 27:16 DACC2DHR[11:0]:

DAC チ ャ ネル 2   12bit 右寄せデー タ

こ れら のビ ッ ト は、 DAC チ ャ ネル 2 用の 12bit デー タ を示す ソ フ ト ウ ェ アによ り 書込まれます。

Bits 15:12 予約済み

Bits 11:0 DACC1DHR[11:0]: DAC チ ャ ネル 1   12bit 右寄せデー タ

こ れら のビ ッ ト は、 DAC チ ャ ネル 1 用の 12bit デー タ を示す ソ フ ト ウ ェ アによ り 書込まれます。

16 rw

0 rw

Rev 5 -日本語版 211/720

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

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製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し てい る に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない こ の資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

D/A コ ンバー タ (DAC)

RM0008

11.5.10 デ ュ アル DAC   12bit 左寄せデー タ 保持レ ジ ス タ

(DAC_DHR12LD)

31 30

ア ド レ スオ フ セ ッ ト : 0x24

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21

DACC2DHR[11:0] rw

15 rw rw

14 rw rw

13 rw rw

12 rw rw

11 rw rw

10 rw

9

DACC1DHR[11:0] rw rw rw

8 rw rw

7 rw rw

6 rw rw

5 rw

20 rw

4

19

3

18 17

予約済み

2

予約済み

1

16 rw

Bits 31:20 DACC2DHR[11:0]: DAC チ ャ ネル 2   12bit 左寄せデー タ

これ らのビ ッ ト は、 DAC チ ャ ネル 2 用の 12bit デー タ を示す ソ フ ト ウ ェ アによ り 書込まれます。

Bits 19:16 予約済み

Bits 15:4 DACC1DHR[11:0]:

DAC チ ャ ネル 1   12bit 左寄せデー タ

これ らのビ ッ ト は、 DAC チ ャ ネル 1 用の 12bit デー タ を示す ソ フ ト ウ ェ アによ り 書込まれます。

Bits 3:0 予約済み

0

11.5.11 デ ュ アル DAC   8bit 右寄せデー タ 保持レ ジス タ

(DAC_DHR8RD)

31 30

ア ド レ スオ フ セ ッ ト : 0x28

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21

予約済み

20 19 18 17 16

15 14 13 12 11

DACC2DHR[7:0] rw rw

10 rw

9 8 7 6 5 4 3

DACC1DHR[7:0] rw rw

2 1 rw rw rw rw rw rw rw rw rw rw

Bits 31:16 予約済み

Bits 15:8 DACC2DHR[7:0]: DAC チ ャ ネル 2   8bit 右寄せデー タ

こ れら のビ ッ ト は、 DAC チ ャ ネル 2 用の 8bit デー タ を示す ソ フ ト ウ ェ アによ り 書込まれます。

Bits 7:0 DACC1DHR[7:0]: DAC チ ャ ネル 1   8bit 右寄せデー タ

こ れら のビ ッ ト は、 DAC チ ャ ネル 1 用の 8bit デー タ を示す ソ フ ト ウ ェ アによ り 書込まれます。

0 rw

212/720 Rev 5 -日本語版

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ていない場合があ り ます。 こ の資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

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参考資料

RM0008

D/A コ ンバー タ (DAC)

11.5.12 DAC チ ャ ネル 1 デー タ 出力レ ジス タ (DAC_DOR1)

31 30

ア ド レ スオ フ セ ッ ト : 0x2C

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20

予約済み

19 18 17 16

15 14 13

予約済み

12 11 10 9 8 7 r

6 5

DACC1DOR[11:0] r r

4 3 r r r r r r

Bits 31:12 予約済み

Bits 11:0 DACC1DOR[11:0]:

DAC チ ャ ネル 1 デー タ 出力

こ れ らのビ ッ ト は、 読み取 り 専用で DAC チ ャ ネル 1 のデー タ 出力を保持 し ます。

2 r

11.5.13 DAC チ ャ ネル 2 デー タ 出力レ ジス タ (DAC_DOR2)

31 30

ア ド レ スオ フ セ ッ ト : 0x30

リ セ ッ ト 値 : 0x0000 0000

29 28 27 26 25 24 23 22 21 20

予約済み

19 18

1 r

17

0 r

16

15 14 13

予約済み

12 11 10 9 8 7 r

6 5

DACC2DOR[11:0] r r

4 3 r r r r r r

Bits 31:12 予約済み

Bits 11:0 DACC2DOR[11:0]:

DAC チ ャ ネル 2 デー タ 出力

こ れ らのビ ッ ト は、 読み取 り 専用で DAC チ ャ ネル 2 のデー タ 出力を保持 し ます。

2 r

1 r

0 r

Rev 5 -日本語版 213/720

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参考資料

D/A コ ンバー タ (DAC)

RM0008

11.5.14 DAC レ ジ ス タ ・ マ ッ プ

次の表は DAC レ ジ ス タ の一覧です。

表 51.

ア ド レ

スオ フ

セ ッ ト

DAC -レ ジ ス タ ・ マ ッ プ

名称

0x00 DAC_CR

予約済み

MAMP2[3:0]

WAV

E2[2:

0]

TSEL2[2:

0]

予約済み

MAMP1[3:0]

WAV

E1[2:

0]

TSEL1[2:

0]

0x04

DAC_SWTRI

GR

予約済み

0x08

0x0C

0x10

0x14

0x18

0x1C

0x20

0x24

0x28

0x2C

0x30

DAC_DHR12

R1

DAC_DHR12

L1

DAC_DHR8R

1

DAC_DHR12

R2

DAC_DHR12

L2

DAC_DHR8R

2

DAC_DHR12

RD

DAC_DHR12

LD

DAC_DHR8R

D

DAC_DOR1

DAC_DOR2

注意 :

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

予約済み

DACC2DHR[11:0]

予約済み DACC2DHR[11:0]

予約済み

予約済み

予約済み

DACC1DHR[11:0]

DACC1DHR[11:0] 予約済み

DACC1DHR[7:0]

予約済み

DACC2DHR[11:0]

DACC2DHR[11:0] 予約済み

DACC2DHR[7:0]

DACC1DHR[11:0]

DACC1DHR[11:0]

DACC2DHR[7:0]

予約済み

DACC1DHR[7:0]

DACC1DOR[11:0]

DACC2DOR[11:0]

レ ジ ス タ のア ド レ ス範囲に関 し ては、

表 1 (36 ページ)

を参照 し て く だ さ い。

214/720 Rev 5 -日本語版

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製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

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参考資料

RM0008

12 高機能制御 タ イ マ (TIM1 及び TIM8)

高機能制御 タ イ マ (TIM1 及び TIM8)

Flash メ モ リ 容量が 32 ~ 128Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト ロー

ラは、 中容量デバイ ス です。

Flash メ モ リ 容量が 256 ~ 512Kbyte の STM32F101xx 及び STM32F103xx マ イ ク ロ コ ン ト

ロー ラ は、 大容量デバイ ス です。

こ のセ ク シ ョ ンは、 注意書きがない限 り 、 STM32F10xxx フ ァ ミ リ 全てに適用 さ れます。

12.1 TIM1 及び TIM8 の概要

中容量デバイ スは TIM1 を持ち、 大容量デバイ スは TIM1 と TIM8 の両方を持 っ ています。

高性能制御 タ イ マ (TIM1 及び TIM8) は、 プ ロ グ ラ マ ブル ・ プ リ スケー ラ に よ る 16bit 自動再

ロー ド ・ カ ウ ン タ を持 っ ています。

こ の タ イ マは、 入力信号のパルス幅の測定 (入力キ ャ プ チ ャ) や出力波形の生成 (出力比

較、 PWM、 デ ッ ド タ イ ムを挿入 し た相補 PWM) な ど、 様々な目的に使用で き ます。

パルス幅 と 波形の周期は、 タ イ マ プ リ スケー ラ と RCC ク ロ ッ ク ・ コ ン ト ロー ラ ・ プ リ ス

ケー ラ を使用 し て、 数マ イ ク ロ秒か ら数 ミ リ 秒ま での範囲で変化 さ せる こ と がで き ます。

高機能 タ イ マ (TIM1 及び TIM8) と 汎用 タ イ マ (TIMx) は互いに独立 し てお り 、 リ ソ ースの一

部を共有 し てい る こ と はあ り ません。 また

セ ク シ ョ ン  12.3.20

に記 さ れてい る よ う に、 相

互に同期 さ せる こ と も で き ます。

Rev 5 -日本語版 215/720

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参考資料

高機能制御 タ イ マ (TIM1 及び TIM8)

12.2

RM0008

TIM1 及び TIM8 の主な機能

TIM1 及び TIM8 タ イ マの主な機能は :

16bit ア ッ プ、 ダウ ン自動再ロー ド ・ カ ウ ン タ

16bit プ ロ グ ラ マ ブル ・ プ リ スケー ラ 。 カ ウ ン タ ・ ク ロ ッ ク周波数を 1 か ら 65535 の間

で分周で き、 分周比を動作中に変更する こ と も で き ます。

次の機能を持つ、 独立 し た最大 4 チ ャ ネル。

- 入力キ ャ プ チ ャ

- 出力比較

- PWM 生成 (エ ッ ジ ア ラ イ ン ・ モー ド と セ ン タ ーア ラ イ ン ・ モー ド )

- 単パルス モー ド 出力

設定可能なデ ッ ド タ イ ムを有する相補出力

外部信号で タ イ マ を制御する同期回路 と 複数 タ イ マ間の相互接続。

所定の回数だけ タ イ マ レ ジ ス タ を更新する繰返 し カ ウ ン タ 。

タ イ マの出力信号を リ セ ッ ト 状態、 も し く は指定 し た状態 と する プ レー ク入力。

以下のイ ベ ン ト に よ る、 割込み /DMA リ ク エ ス ト の発生。

- 更新 : カ ウ ン タ ・ オーバ フ ロー / ア ン ダ フ ロー、 カ ウ ン タ の初期化 (ソ フ ト ウ ェ

ア指示、 及び内部 / 外部 ト リ ガ)

- ト リ ガ ・ イ ベ ン ト (カ ウ ン タ ・ ス タ ー ト 、 ス ト ッ プ、 初期化、 及び内部 / 外部 ト

リ ガに よ る カ ウ ン ト 動作)

- 入力キ ャ プ チ ャ

- 出力比較

- ブ レ ー ク入力

216/720 Rev 5 -日本語版

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頂 く ために ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱が英文か ら 和文へ翻訳 し て作成 し た も のです。 こ の資料は現行の正規英語版資料の近時の更新に対応 し

ていない場合があ り ます。 この資料は、 あ く ま で も 正規英語版資料を ご理解頂 く ための補助的参考資料のみにご利用下 さ い。 こ の資料で説明 さ れる

製品のご検討及びご採用にあた り ま し ては、 必ず最新の正規英語版資料を事前にご確認下 さ い。 ST 及び ST マ イ ク ロ エ レ ク ト ロ ニ ク ス㈱は、 現行の

正規英語版資料の更新に よ り 製品に関する最新の情報を提供 し ている に も 関わ ら ず、 当該英語版資料に対応 し た更新がな さ れていない この資料の情

報に基づいて発生 し た問題や障害な どにつ き ま し ては如何な る責任 も 負いません。

参考資料

RM0008

高機能制御 タ イ マ (TIM1 及び TIM8)

TIMx_ETR

図 47.

高機能制御 タ イ マ ・ ブ ロ ッ ク図

内部クロック (CK_INT)

RCC からの CK_TIM18

ETR

エッジ検出

プリスケーラ

ETRP

入力フィルタ

ITR0

ITR1

ITR2

ITR3

ITR

TRC

TI1F_ED

ETRF

TRGI

TGI

トリガ

コントローラ

TRGO

他のタイマへ

DAC/ADC へ

スレーブ

モード

コントローラ

Reset, Enable, Up/Down, Count

TIMx_CH1

TIMx_CH2

TIMx_CH3

TIMx_CH4

TIMx_BKIN

XOR

TI1

TI2

TI3

TI4

TI1FP1

TI2FP2

エンコーダ

インタフェース

REP レジスタ

U

自動再ロード・レジスタ

入力フィルタ、

エッジ検出回路

TI1FP1

TI1FP2

CK_PSC

IC1

PSC

プリスケーラ

CK_CNT

プリスケーラ

CC1I

IC1PS

U

Stop, Clear or

Up/Down

+/-

CNT

カウンタ

キャプチャ/ 比較1レジスタ

TRC

入力フィルタ、

エッジ検出回路

TI2FP1

TI2FP2

TRC

CC2I

IC2

プリスケーラ

IC2PS

U

キャプチャ/ 比較2レジスタ

入力フィルタ、

エッジ検出回路

TI3FP3

TI3FP4

TRC

IC3

CC3I

プリスケーラ

IC3PS

U

キャプチャ/ 比較3レジスタ

入力フィルタ、

エッジ検出回路

TI4FP3

TI4FP4

TRC

IC4

CC4I

プリスケーラ

IC4PS

U

キャプチャ/ 比較4レジスタ

ETRF

繰返し

カウンタ

UI

U

CC1I

DTG レジスタ

OC1REF

DTG

CC2I

OC2REF

CC3I

OC3REF

DTG

DTG

TIMx_CH1

出力

 制御

OC1

OC1N

TIMx_CH1N

TIMx_CH2

出力

 制御

OC2

OC2N

TIMx_CH2N

TIMx_CH3

出力

 制御

OC3

OC3N

TIMx_CH3N

CC4I

OC4REF

出力

 制御

OC4

TIMx_CH4

BRK

極性選択回路

クロック・コントローラ CSS (Clock Security system)

からのクロック異常イベント

BI

凡例:

Reg

プリロード・レジスタの内容は、

アクティブレジスタにロードされます

イベント

割込み・DMA リクエスト

Rev 5 -日本語版 217/720

こ の資料は、 STMicroelectronics NV 並びにその子会社 ( 以下 ST) が英文で記述 し た資料 (以下、 「正規英語版資料」) を、 皆様のご理解の一助 と し て

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参考資料

高機能制御 タ イ マ (TIM1 及び TIM8)

12.3

12.3.1

RM0008

TIM1 及び TIM8 機能詳細

タ イ ムベース ・ ユニ ッ ト

プ ロ グ ラ マ ブル高機能制御 タ イ マの主要な ブ ロ ッ クは自動再ロー ド ・ レ ジ ス タ を持 っ た

16bit カ ウ ン タ です。 カ ウ ン タ はカ ウ ン ト ア ッ プ、 カ ウ ン ト ダウ ン、 及びア ッ プ ・ ダウ ンの

動作が可能です。 カ ウ ン タ の ク ロ ッ クはプ リ スケー ラ に よ っ て分周 さ れます。

カ ウ ン タ 、 自動再ロー ド ・ レ ジ ス タ 、 及びプ リ スケー ラ ・ レ ジ ス タ は、 カ ウ ン タ が動作中

であ っ て も、 ソ フ ト ウ ェ アに よ る読書きがで き ます。

タ イ ムベース ・ ユニ ッ ト には次の要素が含まれます。

カ ウ ン タ ・ レ ジ ス タ (TIMx_CNT)

プ リ スケー ラ ・ レ ジ ス タ (TIMx_PSC)

自動再ロー ド ・ レ ジ ス タ (TIMx_ARR)

繰返 し カ ウ ン タ ・ レ ジ ス タ (TIMx_RCR)

自動再ロー ド ・ レ ジ ス タ はプ リ ロー ド 機能を持 っ ています。 自動再ロー ド ・ レ ジ ス タ の読

書きはプ リ ロー ド ・ レ ジ ス タ へのア ク セス と な り ます。 プ リ ロー ド ・ レ ジ ス タ の内容が、

TIMx_CR1 レ ジ ス タ のプ リ ロー ド ・ イ ネーブル ・ ビ ッ ト (ARPE) の設定に応 じ て、 常時 も し

く は更新イ ベン ト UEV ご と に、 シ ャ ド ウ ・ レ ジ ス タ に移 さ れます。 TIMx_CR1 レ ジ ス タ の

UDIS ビ ッ ト が 0 であれば、 更新イ ベ ン ト はカ ウ ン タ がオーバ フ ロー (ダウ ン カ ウ ン ト 時

はア ン ダ フ ロー) に達 し た と き に発生 し ます。 また、 ソ フ ト ウ ェ ア で更新イ ベ ン ト を発生

さ せる こ と も 可能です。 こ の方法は、 それぞれの タ イ マ構成のセ ク シ ョ ン に記 さ れていま

す。

カ ウ ン タ のク ロ ッ ク は、 TIMx_CR1 レ ジ ス タ のカ ウ ン タ ・ イ ネーブル ・ ビ ッ ト (CEN) が

セ ッ ト さ れてい る と き にのみ、 プ リ スケー ラ出力 CK_CNT か ら供給 さ れます。 (カ ウ ン タ

を イ ネーブル と する方法の詳細に関 し ては、 ス レ ーブ ・ モー ド ・ コ ン ト ロー ラの記述を合

わせてお読み く だ さ い。)

なお、 実際のカ ウ ン タ ・ イ ネーブル信号 CNT_EN は CEN ビ ッ ト が セ ッ ト さ れてか ら 1 ク

ロ ッ ク 遅れてセ ッ ト さ れる こ と に留意 し て く だ さ い。

218/720 Rev 5 -日本語版

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RM0008

高機能制御 タ イ マ (TIM1 及び TIM8)

プ リ スケー ラ

プ リ スケー ラ はカ ウ ン タ ・ ク ロ ッ ク 周波数を 1 か ら 65536 の間の値で分周する こ と がで き

ます。 プ リ スケー ラ は 16bit レ ジ ス タ (TIMx_PSC) を通 し て制御 さ れる 16bit カ ウ ン タ を

ベース と し ています。 制御レ ジ ス タ にはバ ッ フ ァ が備わ っ ているので、 プ リ スケー ラが動

作中であ っ て も、 レ ジ ス タ 内容を変更する こ と がで き ます。 新たに指定 さ れた分周比は次

の更新イ ベ ン ト で効果があ り ます。

図  49

図  50

は動作中に分周比を変化 さ せた と きのカ ウ ン タ の動作の例を示 し ています。

図 48.

プ リ スケー ラ 分周比が 1 か ら 2 に変化 し た時のカ ウ ン タ ・ タ イ ミ ン グ図

CK_PSC

CEN

タイマ・クロック = CK_CNT

カウンタ・レジスタ

F7 F8 F9 FA FB FC 00

更新イベント (UEV)

プリスケーラ制御レジスタ

プリスケーラカウンタ

0

TIMx_PSC への新しい値の書込み

プリスケーラバッファ

0

0 0

01

1

1

02 03

1 0 1 0 1 0 1

図 49.

プ リ スケー ラ 分周比が 1 か ら 4 に変化 し た時のカ ウ ン タ ・ タ イ ミ ン グ図

CK_PSC

CEN

タイマ・クロック = CK_CNT

カウンタ・レジスタ

F7 F8 F9 FA FB FC

更新イベント (UEV)

プリスケーラ制御レジスタ

プリスケーラカウンタ

0

TIMx_PSC への新しい値の書込み

プリスケーラバッファ

0

0

00

3

3

01

0 1 2 3 0 1 2 3

Rev 5 -日本語版 219/720

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高機能制御 タ イ マ (TIM1 及び TIM8)

12.3.2

RM0008

カ ウン タ ・ モー ド

ア ッ プ カ ウン ト ・ モー ド

ア ッ プ カ ウ ン ト ・ モー ド では、 カ ウ ン タ は 0 か ら自動再ロー ド ・ レ ジ ス タ の値 (TIMx_ARR

レ ジ ス タ の内容) ま で カ ウ ン ト を行い、 その後 0 か らのカ ウ ン ト を再開 し 、 同時に カ ウ ン

タ ・ オーバフ ロー ・ イ ベ ン ト を発生 さ せます。

繰返 し カ ウ ン タ が使用 さ れてい る場合には、 繰返 し カ ウ ン タ ・ レ ジ ス タ (TIMx_RCR) に設

定 さ れてい る回数ま で ア ッ プ カ ウ ン ト 動作が繰返 さ れ、 その後に更新イ ベン ト (UEV) が発

生 し ます。 繰返 し カ ウ ン タ が使用 さ れていない と き には、 カ ウ ン タ のオーバ フ ローご と に

更新イ ベ ン ト が発生 し ます。

ソ フ ト ウ ェ アに よ る レ ジ ス タ 書込みで、 も し く はス レーブ ・ モー ド ・ コ ン ト ロー ラ に よ っ

て TIMx_EGR レ ジ ス タ の UG ビ ッ ト を セ ッ ト する こ と で も更新イ ベン ト を発生 さ せる こ と

がで き ます。

UEV イ ベ ン ト は ソ フ ト ウ ェ ア で TIMx_CR1 レ ジ ス タ の UDIS ビ ッ ト を セ ッ ト する こ と で、

デ ィ セーブル と する こ と がで き ます。 こ れはプ リ ロー ド ・ レ ジ ス タ に新 し い値を書込んで

い る と き にシ ャ ド ウ ・ レ ジ ス タ が更新 さ れるのを防止 し ます。 こ の後 UDIS ビ ッ ト に 0 が

書込まれる ま で、 更新イ ベン ト は発生 し ません。 し か し 、 プ リ スケー ラのカ ウ ン タ と 同 じ

く (ただ し プ リ スケー ラ の比は変化 し ません)、 カ ウ ン タ は 0 から カ ウ ン ト を再開 し ます。

さ ら に、 TIMx_CR1 レ ジ ス タ の URS ビ ッ ト (更新 リ ク エ ス ト 選択) がセ ッ ト さ れている場

合は、 UG ビ ッ ト のセ ッ ト が更新イ ベン ト UEV を引起 こ し ますが、 UIF フ ラ グはセ ッ ト さ

れず、 割込みや DMA リ ク エ ス ト は発生 し ません。 こ れは、 キ ャ プ チ ャ イ ベ ン ト の際に カ

ウ ン タ を ク リ アする こ と で、 更新 と キ ャ プ チ ャ割込みが と も に発生する こ と を防ぎ ます。

更新イ ベ ン ト が発生 し た と き、 すべてのレ ジ ス タ が更新 さ れ、 URS ビ ッ ト の設定に応 じ て

更新 フ ラ グ (TIMx_SR レ ジ ス タ の UIF ビ ッ ト ) がセ ッ ト さ れます。

繰返 し カ ウ ン タ には TIMx_RCR レ ジ ス タ の内容が再びロー ド さ れます。

自動再ロー ド ・ シ ャ ド ウ ・ レ ジ ス タ はプ リ ロー ド ・ レ ジ ス タ (TIMx_ARR) の値に更新

さ れます。

プ リ スケー ラ のバ ッ フ ァ にはプ リ ロー ド 値 (TIMx_PSC レ ジ ス タ の値) が再びロー ド

さ れます。

以下の図は、 自動再ロー ド ・ レ ジ ス タ TIMx_ARR = 0x36 の場合の、 異な る ク ロ ッ ク 周波数

における カ ウ ン タ の挙動の例を示 し ています。

図 50.

内部 ク ロ ッ ク 分周比が 1 の場合のカ ウ ン タ ・ タ イ ミ ン グ図

CK_PSC

CNT_EN

タイマ・クロック = CK_CNT

カウンタ・レジスタ

31 32 33 34 35 36 00 01 02 03 04 05 06 07

カウンタ・オーバフロー

更新イベント (UEV)

更新割込みリクエスト・フラグ (UIF)

220/720 Rev 5 -日本語版

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参考資料

RM0008

図 51.

高機能制御 タ イ マ (TIM1 及び TIM8)

内部 ク ロ ッ ク 分周比が 2 の場合のカ ウ ン タ ・ タ イ ミ ン グ図

CK_PSC

CNT_EN

タイマ・クロック = CK_CNT

カウンタ・レジスタ

カウンタ・オーバフロー

更新イベント (UEV)

0034

0035 0036 0000 0001 0002 0003

更新割込みリクエスト・フラグ (UIF)

図 52.

内部 ク ロ ッ ク 分周比が 4 の場合のカ ウ ン タ ・ タ イ ミ ン グ図

CK_PSC

CNT_EN

タイマ・クロック = CK_CNT

カウンタ・レジスタ

カウンタ・オーバフロー

更新イベント (UEV)

0035 0036 0000

更新割込みリクエスト・フラグ (UIF)

0001

図 53.

内部 ク ロ ッ ク 分周比が N の場合のカ ウ ン タ ・ タ イ ミ ン グ図

CK_PSC

タイマ・クロック = CK_CNT

カウンタ・レジスタ

1F

カウンタ・オーバフロー

更新イベント (UEV)

更新割込みリクエスト・フラグ (UIF)

20 00

Rev 5 -日本語版 221/720

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参考資料

高機能制御 タ イ マ (TIM1 及び TIM8)

図 54.

RM0008

ARPE=0 時 (TIMx_ARR はプ リ ロー ド な し )、 更新イ ベン ト 時の タ イ ミ ン グ図

CK_PSC

CEN

タイマ・クロック = CK_CNT

カウンタ・レジスタ

31 32 33 34 35 36 00 01 02 03 04 05 06 07

カウンタ・オーバフロー

更新イベント (UEV)

更新割込みリクエスト・フラグ (UIF)

自動再ロード・レジスタ

FF

TIMx_ARR への新しい値の書込み

36

図 55.

ARPE=1 時 (TIMx_ARR はプ リ ロー ド )、 更新イ ベ ン ト の タ イ ミ ン グ図

CK_PSC

CEN

タイマ・クロック = CK_CNT

カウンタ・レジスタ

F0 F1 F2 F3 F4 F5 00 01 02 03 04 05 06 07

カウンタ・オーバフロー

更新イベント (UEV)

更新割込みリクエスト・フ