Bank (2) VREF Pin Name/Function

Bank (2) VREF Pin Name/Function
Pin Information for the Arria®10 10AS048 Device
Version 1.3
Note (1)
Bank
Number
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PT-10AS048-1.3
Copyright © 2015 Altera Corp
Index within I/O Bank (2)
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VREF
Pin Name/Function
VREFB2LN0
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GXBL1D_TX_CH1n
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GXBL1D_RX_CH1n,GXBL1D_REFCLK1n
GXBL1D_RX_CH1p,GXBL1D_REFCLK1p
GXBL1D_TX_CH0n
GXBL1D_TX_CH0p
GXBL1D_RX_CH0n,GXBL1D_REFCLK0n
GXBL1D_RX_CH0p,GXBL1D_REFCLK0p
REFCLK_GXBL1D_CHBp
REFCLK_GXBL1D_CHBn
REFCLK_GXBL1C_CHTp
REFCLK_GXBL1C_CHTn
GXBL1C_TX_CH5n
GXBL1C_TX_CH5p
GXBL1C_RX_CH5n,GXBL1C_REFCLK5n
GXBL1C_RX_CH5p,GXBL1C_REFCLK5p
GXBL1C_TX_CH4n
GXBL1C_TX_CH4p
GXBL1C_RX_CH4n,GXBL1C_REFCLK4n
GXBL1C_RX_CH4p,GXBL1C_REFCLK4p
GXBL1C_TX_CH3n
GXBL1C_TX_CH3p
GXBL1C_RX_CH3n,GXBL1C_REFCLK3n
GXBL1C_RX_CH3p,GXBL1C_REFCLK3p
GXBL1C_TX_CH2n
GXBL1C_TX_CH2p
GXBL1C_RX_CH2n,GXBL1C_REFCLK2n
GXBL1C_RX_CH2p,GXBL1C_REFCLK2p
GXBL1C_TX_CH1n
GXBL1C_TX_CH1p
GXBL1C_RX_CH1n,GXBL1C_REFCLK1n
GXBL1C_RX_CH1p,GXBL1C_REFCLK1p
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GXBL1C_TX_CH0p
GXBL1C_RX_CH0n,GXBL1C_REFCLK0n
GXBL1C_RX_CH0p,GXBL1C_REFCLK0p
REFCLK_GXBL1C_CHBp
REFCLK_GXBL1C_CHBn
IO
IO
IO
IO
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IO
IO
IO
IO
IO
IO
IO
IO
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IO
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IO
IO
IO
IO
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IO
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IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
Optional Function(s)
Configuration Function
GPIO1_IO23,NAND_ADQ15,Trace_D3,EMAC2_RXD3,SPIM0_SS0_N,SPIS1_MISO,EMAC0_MDC,I2C_EMAC0_SCL
GPIO1_IO22,NAND_ADQ14,Trace_D2,EMAC2_RXD2,SPIM0_MISO,SPIS1_SS0_N,EMAC0_MDIO,I2C_EMAC0_SDA
GPIO1_IO21,NAND_ADQ13,Trace_D1,EMAC2_TXD3,SDMMC_DATA7,SPIM0_MOSI,SPIS1_MOSI,I2C_EMAC2_SCL
GPIO1_IO20,NAND_ADQ12,Trace_D0,EMAC2_TXD2,SDMMC_DATA6,SPIM0_CLK,SPIS1_CLK,I2C_EMAC2_SDA
GPIO1_IO19,NAND_ADQ11,Trace_CLK,EMAC2_RXD1,SDMMC_DATA5,SPIM0_SS0_N,EMAC1_MDC,I2C_EMAC1_SCL
GPIO1_IO18,NAND_ADQ10,EMAC2_RXD0,SDMMC_DATA4,SPIM0_MISO,EMAC1_MDIO,I2C_EMAC1_SDA
GPIO1_IO17,NAND_ADQ9,UART1_RTS_N,QSPI_SS3,EMAC2_TXD1,SDMMC_DATA3,SPIM0_SS1_N
GPIO1_IO16,NAND_ADQ8,UART1_CTS_N,QSPI_SS2,EMAC2_TXD0,SDMMC_DATA2
GPIO1_IO15,UART1_RX,Trace_CLK,EMAC2_RX_CTL,SDMMC_DATA1
GPIO1_IO14,NAND_CE_N,UART1_TX,EMAC2_RX_CLK,SDMMC_CCLK
GPIO1_IO13,NAND_RB,EMAC2_TX_CTL,SDMMC_CMD,I2C1_SCL
GPIO1_IO12,NAND_ALE,EMAC2_TX_CLK,SDMMC_DATA0,I2C1_SDA
GPIO1_IO11,NAND_ADQ7,EMAC1_RXD3,SPIS0_MISO,EMAC0_MDC,I2C_EMAC0_SCL
GPIO1_IO10,NAND_ADQ6,EMAC1_RXD2,SPIS0_SS0_N,EMAC0_MDIO,I2C_EMAC0_SDA
GPIO1_IO9,NAND_ADQ5,EMAC1_TXD3,SPIS0_MOSI,EMAC2_MDC,I2C_EMAC2_SCL
GPIO1_IO8,NAND_ADQ4,EMAC1_TXD2,SPIS0_CLK,EMAC2_MDIO,I2C_EMAC2_SDA
GPIO1_IO7,NAND_CLE,UART1_RX,EMAC1_RXD1,SPIS1_MISO,I2C1_SCL
GPIO1_IO6,NAND_ADQ3,UART1_TX,EMAC1_RXD0,SPIS1_SS0_N,I2C1_SDA
PLL_2L_CLKOUT1n,GPIO1_IO5,NAND_ADQ2,UART1_RTS_N,EMAC1_TXD1,SPIS1_MOSI
PLL_2L_CLKOUT1p,PLL_2L_CLKOUT1,PLL_2L_FB1,GPIO1_IO4,NAND_WP_N,UART1_CTS_N,EMAC1_TXD0,SPIM1_SS1_N,SPIS1_CLK
GPIO1_IO3,NAND_RE_N,UART0_RX,EMAC1_RX_CTL,SPIM1_SS0_N,I2C0_SCL
RZQ_2L,GPIO1_IO2,NAND_WE_N,UART0_TX,EMAC1_RX_CLK,SPIM1_MISO,I2C0_SDA
CLK_2L_1n,GPIO1_IO1,NAND_ADQ1,UART0_RTS_N,EMAC1_TX_CTL,SPIM1_MOSI
CLK_2L_1p,GPIO1_IO0,NAND_ADQ0,UART0_CTS_N,EMAC1_TX_CLK,SPIM1_CLK
CLK_2L_0n,GPIO0_IO23,NAND_ADQ15,UART0_RX,USB1_DATA7,EMAC0_RXD3,SPIM1_SS0_N,SPIS0_MISO,I2C0_SCL
CLK_2L_0p,GPIO0_IO22,NAND_ADQ14,UART0_TX,USB1_DATA6,EMAC0_RXD2,SPIM1_MISO,SPIS0_SS0_N,I2C0_SDA
GPIO0_IO21,NAND_ADQ13,UART0_RTS_N,USB1_DATA5,EMAC0_TXD3,SPIM1_MOSI,SPIS0_MOSI,I2C1_SCL
GPIO0_IO20,NAND_ADQ12,UART0_CTS_N,USB1_DATA4,EMAC0_TXD2,SPIM1_CLK,SPIS0_CLK,I2C1_SDA
PLL_2L_CLKOUT0n,GPIO0_IO19,NAND_ADQ11,USB1_DATA3,EMAC0_RXD1,SPIM1_SS1_N
PLL_2L_CLKOUT0p,PLL_2L_CLKOUT0,PLL_2L_FB0,GPIO0_IO18,NAND_ADQ10,USB1_DATA2,EMAC0_RXD0
GPIO0_IO17,NAND_ADQ9,USB1_NXT,EMAC0_TXD1
GPIO0_IO16,NAND_ADQ8,USB1_DATA1,EMAC0_TXD0
GPIO0_IO15,USB1_DATA0,EMAC0_RX_CTL
GPIO0_IO14,NAND_CE_N,USB1_DIR,EMAC0_RX_CLK
GPIO0_IO13,NAND_RB,USB1_STP,EMAC0_TX_CTL
GPIO0_IO12,NAND_ALE,USB1_CLK,EMAC0_TX_CLK
GPIO0_IO11,NAND_ADQ7,USB0_DATA7,SPIM1_SS0_N,SPIS1_MISO,EMAC0_MDC,I2C_EMAC0_SCL
GPIO0_IO10,NAND_ADQ6,USB0_DATA6,SPIM1_MISO,SPIS1_SS0_N,EMAC0_MDIO,I2C_EMAC0_SDA
GPIO0_IO9,NAND_ADQ5,USB0_DATA5,SDMMC_DATA7,SPIM1_MOSI,SPIS1_MOSI,EMAC1_MDC,I2C_EMAC1_SCL
GPIO0_IO8,NAND_ADQ4,USB0_DATA4,SDMMC_DATA6,SPIM1_CLK,SPIS1_CLK,EMAC1_MDIO,I2C_EMAC1_SDA
GPIO0_IO7,NAND_CLE,UART1_RX,USB0_DATA3,SDMMC_DATA5,SPIM0_SS0_N,EMAC2_MDC,I2C_EMAC2_SCL
GPIO0_IO6,NAND_ADQ3,UART1_TX,USB0_DATA2,SDMMC_DATA4,SPIM0_MISO,EMAC2_MDIO,I2C_EMAC2_SDA
GPIO0_IO5,NAND_ADQ2,UART1_RTS_N,QSPI_SS3,USB0_NXT,SDMMC_DATA3,SPIM0_MOSI,I2C0_SCL
GPIO0_IO4,NAND_WP_N,UART1_CTS_N,QSPI_SS2,USB0_DATA1,SDMMC_DATA2,SPIM0_CLK,I2C0_SDA
GPIO0_IO3,NAND_RE_N,UART0_RX,USB0_DATA0,SDMMC_DATA1,SPIS0_MISO,I2C1_SCL
GPIO0_IO2,NAND_WE_N,UART0_TX,USB0_DIR,SDMMC_CCLK,SPIS0_SS0_N,I2C1_SDA
GPIO0_IO1,NAND_ADQ1,UART0_RTS_N,USB0_STP,SDMMC_CMD,SPIM1_SS1_N,SPIS0_MOSI
GPIO0_IO0,NAND_ADQ0,UART0_CTS_N,USB0_CLK,SDMMC_DATA0,SPIM0_SS1_N,SPIS0_CLK
PLL_2K_CLKOUT1n
PLL_2K_CLKOUT1p,PLL_2K_CLKOUT1,PLL_2K_FB1
RZQ_2K
CLK_2K_1n
CLK_2K_1p
CLK_2K_0n
CLK_2K_0p
PLL_2K_CLKOUT0n
PLL_2K_CLKOUT0p,PLL_2K_CLKOUT0,PLL_2K_FB0
Pin List F29
HPS Function (3)
HPS_DIRECT_SHARED_Q4_12
HPS_DIRECT_SHARED_Q4_11
HPS_DIRECT_SHARED_Q4_10
HPS_DIRECT_SHARED_Q4_9
HPS_DIRECT_SHARED_Q4_8
HPS_DIRECT_SHARED_Q4_7
HPS_DIRECT_SHARED_Q4_6
HPS_DIRECT_SHARED_Q4_5
HPS_DIRECT_SHARED_Q4_4
HPS_DIRECT_SHARED_Q4_3
HPS_DIRECT_SHARED_Q4_2
HPS_DIRECT_SHARED_Q4_1
HPS_DIRECT_SHARED_Q3_12
HPS_DIRECT_SHARED_Q3_11
HPS_DIRECT_SHARED_Q3_10
HPS_DIRECT_SHARED_Q3_9
HPS_DIRECT_SHARED_Q3_8
HPS_DIRECT_SHARED_Q3_7
HPS_DIRECT_SHARED_Q3_6
HPS_DIRECT_SHARED_Q3_5
HPS_DIRECT_SHARED_Q3_4
HPS_DIRECT_SHARED_Q3_3
HPS_DIRECT_SHARED_Q3_2
HPS_DIRECT_SHARED_Q3_1
HPS_DIRECT_SHARED_Q2_12
HPS_DIRECT_SHARED_Q2_11
HPS_DIRECT_SHARED_Q2_10
HPS_DIRECT_SHARED_Q2_9
HPS_DIRECT_SHARED_Q2_8
HPS_DIRECT_SHARED_Q2_7
HPS_DIRECT_SHARED_Q2_6
HPS_DIRECT_SHARED_Q2_5
HPS_DIRECT_SHARED_Q2_4
HPS_DIRECT_SHARED_Q2_3
HPS_DIRECT_SHARED_Q2_2
HPS_DIRECT_SHARED_Q2_1
HPS_DIRECT_SHARED_Q1_12
HPS_DIRECT_SHARED_Q1_11
HPS_DIRECT_SHARED_Q1_10
HPS_DIRECT_SHARED_Q1_9
HPS_DIRECT_SHARED_Q1_8
HPS_DIRECT_SHARED_Q1_7
HPS_DIRECT_SHARED_Q1_6
HPS_DIRECT_SHARED_Q1_5
HPS_DIRECT_SHARED_Q1_4
HPS_DIRECT_SHARED_Q1_3
HPS_DIRECT_SHARED_Q1_2
HPS_DIRECT_SHARED_Q1_1
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
Non-Dedicated Tx/Rx Channel
Dedicated Tx/Rx
Channel
DIFFIO2L_1n
DIFFIO2L_1p
DIFFIO2L_2n
DIFFIO2L_2p
DIFFIO2L_3n
DIFFIO2L_3p
DIFFIO2L_4n
DIFFIO2L_4p
DIFFIO2L_5n
DIFFIO2L_5p
DIFFIO2L_6n
DIFFIO2L_6p
DIFFIO2L_7n
DIFFIO2L_7p
DIFFIO2L_8n
DIFFIO2L_8p
DIFFIO2L_9n
DIFFIO2L_9p
DIFFIO2L_10n
DIFFIO2L_10p
DIFFIO2L_11n
DIFFIO2L_11p
DIFFIO2L_12n
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DIFFIO2L_13n
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DIFFIO2L_16n
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DIFFIO2L_17p
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DIFFIO2L_18p
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DIFFIO2L_19p
DIFFIO2L_20n
DIFFIO2L_20p
DIFFIO2L_21n
DIFFIO2L_21p
DIFFIO2L_22n
DIFFIO2L_22p
DIFFIO2L_23n
DIFFIO2L_23p
DIFFIO2L_24n
DIFFIO2L_24p
LVDS2K_1n
LVDS2K_1p
LVDS2K_2n
LVDS2K_2p
LVDS2K_3n
LVDS2K_3p
LVDS2K_4n
LVDS2K_4p
LVDS2K_5n
LVDS2K_5p
LVDS2K_6n
LVDS2K_6p
LVDS2K_7n
LVDS2K_7p
LVDS2K_8n
LVDS2K_8p
LVDS2K_9n
LVDS2K_9p
LVDS2K_10n
LVDS2K_10p
LVDS2K_11n
LVDS2K_11p
LVDS2K_12n
LVDS2K_12p
LVDS2K_13n
LVDS2K_13p
LVDS2K_14n
LVDS2K_14p
LVDS2K_15n
LVDS2K_15p
LVDS2K_16n
LVDS2K_16p
LVDS2K_17n
LVDS2K_17p
LVDS2K_18n
LVDS2K_18p
LVDS2K_19n
LVDS2K_19p
LVDS2K_20n
LVDS2K_20p
LVDS2K_21n
LVDS2K_21p
LVDS2K_22n
LVDS2K_22p
LVDS2K_23n
LVDS2K_23p
LVDS2K_24n
LVDS2K_24p
LVDS2J_1n
LVDS2J_1p
LVDS2J_2n
LVDS2J_2p
LVDS2J_3n
LVDS2J_3p
LVDS2J_4n
LVDS2J_4p
LVDS2J_5n
LVDS2J_5p
LVDS2J_6n
LVDS2J_6p
Soft CDR Support
F29
DQS for X4
DQS for X8/X9
DQS for X16/X18
DQS for X32/X36
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
Yes
Yes
No
No
Yes
Yes
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Copyright © 2015 Altera Corp
Index within I/O Bank (2)
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Pin List F29
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ADCGND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
Optional Function(s)
Configuration Function
HPS Function (3)
PLL_3B_CLKOUT1n
PLL_3B_CLKOUT1p,PLL_3B_CLKOUT1,PLL_3B_FB1
RZQ_3B
CLK_3B_1n
CLK_3B_1p
CLK_3B_0n
CLK_3B_0p
PLL_3B_CLKOUT0n
PLL_3B_CLKOUT0p,PLL_3B_CLKOUT0,PLL_3B_FB0
PLL_3A_CLKOUT1n
PLL_3A_CLKOUT1p,PLL_3A_CLKOUT1,PLL_3A_FB1
RZQ_3A
CLK_3A_1n
CLK_3A_1p
CLK_3A_0n
CLK_3A_0p
PLL_3A_CLKOUT0n
PLL_3A_CLKOUT0p,PLL_3A_CLKOUT0,PLL_3A_FB0
TDO
TMS
TRST
TCK
TDI
MSEL0
MSEL1
MSEL2
nIO_PULLUP
nSTATUS
CONF_DONE
nCONFIG
nCE
nCSO0
nCSO1
nCSO2
AS_DATA0,ASDO
AS_DATA1
AS_DATA2
AS_DATA3
DCLK
HPS_CLK1
HPS_nPOR
HPS_nRST
HPS_DEDICATED_4
HPS_DEDICATED_5
BOOTSEL2/HPS_DEDICATED_6
HPS_DEDICATED_7
HPS_DEDICATED_8
HPS_DEDICATED_9
BOOTSEL1/HPS_DEDICATED_10
BOOTSEL0/HPS_DEDICATED_11
HPS_DEDICATED_12
HPS_DEDICATED_13
HPS_DEDICATED_14
HPS_DEDICATED_15
HPS_DEDICATED_16
HPS_DEDICATED_17
Pin List F29
Non-Dedicated Tx/Rx Channel
Dedicated Tx/Rx
Channel
LVDS3B_5n
LVDS3B_5p
LVDS3B_6n
LVDS3B_6p
LVDS3B_7n
LVDS3B_7p
LVDS3B_8n
LVDS3B_8p
LVDS3B_9n
LVDS3B_9p
LVDS3B_10n
LVDS3B_10p
LVDS3B_11n
LVDS3B_11p
LVDS3B_12n
LVDS3B_12p
LVDS3B_13n
LVDS3B_13p
LVDS3B_14n
LVDS3B_14p
LVDS3B_15n
LVDS3B_15p
LVDS3B_16n
LVDS3B_16p
LVDS3B_17n
LVDS3B_17p
LVDS3B_18n
LVDS3B_18p
LVDS3B_19n
LVDS3B_19p
LVDS3B_20n
LVDS3B_20p
LVDS3B_21n
LVDS3B_21p
LVDS3B_22n
LVDS3B_22p
LVDS3B_23n
LVDS3B_23p
LVDS3B_24n
LVDS3B_24p
LVDS3A_1n
LVDS3A_1p
LVDS3A_2n
LVDS3A_2p
LVDS3A_3n
LVDS3A_3p
LVDS3A_4n
LVDS3A_4p
LVDS3A_5n
LVDS3A_5p
LVDS3A_6n
LVDS3A_6p
LVDS3A_7n
LVDS3A_7p
LVDS3A_8n
LVDS3A_8p
LVDS3A_9n
LVDS3A_9p
LVDS3A_10n
LVDS3A_10p
LVDS3A_11n
LVDS3A_11p
LVDS3A_12n
LVDS3A_12p
LVDS3A_13n
LVDS3A_13p
LVDS3A_14n
LVDS3A_14p
LVDS3A_15n
LVDS3A_15p
LVDS3A_16n
LVDS3A_16p
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LVDS3A_17p
LVDS3A_18n
LVDS3A_18p
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LVDS3A_19p
LVDS3A_20n
LVDS3A_20p
LVDS3A_21n
LVDS3A_21p
LVDS3A_22n
LVDS3A_22p
LVDS3A_23n
LVDS3A_23p
LVDS3A_24n
LVDS3A_24p
Soft CDR Support
F29
DQS for X4
DQS for X8/X9
DQS for X16/X18
DQS for X32/X36
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
U5
T4
V8
U8
M4
M3
L4
K4
N3
N2
J3
H2
J2
K2
L3
L2
M1
N1
G1
H1
P2
R2
T3
T2
K1
L1
R1
T1
U4
U3
U1
V1
V7
U6
V6
V5
V2
W2
V3
W3
Y4
W4
W7
W8
Y6
Y7
Y5
W5
Y2
Y1
AA8
AA9
AB4
AC5
AA1
AB1
AB5
AB6
AB3
AA2
AA4
AA3
AA7
AA6
AC3
AD3
AF2
AE1
AC2
AC1
AD2
AE2
AF1
AG1
AF3
AG3
AH3
AH2
AD4
AE4
AC7
AC6
AE6
AF6
AF4
AG4
AD5
AE5
AB10
W10
AH6
AF8
Y9
AC10
AE7
AD7
AB8
AD8
AF7
AG8
AD10
AC8
AB9
AH8
AH7
AF9
AE9
AG6
AG5
AH5
AD9
G14
K11
K12
F12
G16
D12
J12
H12
F14
G13
J15
H15
F16
E12
G15
K15
F13
G10
A10
A15
A20
A25
A5
AA10
AA24
AA25
AA26
AB17
AB2
AB22
AB24
AB27
AB28
AB7
AC24
AC25
AC26
AC4
AC9
AD1
AD11
AD16
AD21
AD24
AD27
AD28
AD6
AE13
AE18
AE24
AE25
AE26
AE3
DQ81
DQ81
DQ81
DQ81
DQ82
DQ82
DQSn82
DQS82
DQ82
DQ82
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DQS83
DQ83
DQ83
DQ83
DQ83
DQ84
DQ84
DQSn84
DQS84
DQ84
DQ84
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DQS85
DQ85
DQ85
DQ85
DQ85
DQ86
DQ86
DQSn86
DQS86
DQ86
DQ86
DQSn87
DQS87
DQ87
DQ87
DQ87
DQ87
DQ88
DQ88
DQSn88
DQS88
DQ88
DQ88
DQSn89
DQS89
DQ89
DQ89
DQ89
DQ89
DQ90
DQ90
DQSn90
DQS90
DQ90
DQ90
DQSn91
DQS91
DQ91
DQ91
DQ91
DQ91
DQ92
DQ92
DQSn92
DQS92
DQ92
DQ92
DQSn93
DQS93
DQ93
DQ93
DQ93
DQ93
DQ94
DQ94
DQSn94
DQS94
DQ94
DQ94
DQSn95
DQS95
DQ95
DQ95
DQ95
DQ95
DQ40
DQ40
DQ40
DQ40
DQ41
DQ41
DQ41
DQ41
DQ41
DQ41
DQSn41/CQn41
DQS41/CQ41
DQ41
DQ41
DQ41
DQ41
DQ42
DQ42
DQ42
DQ42
DQ42
DQ42
DQSn42/CQn42
DQS42/CQ42
DQ42
DQ42
DQ42
DQ42
DQ43
DQ43
DQ43
DQ43
DQ43
DQ43
DQSn43/CQn43
DQS43/CQ43
DQ43
DQ43
DQ43
DQ43
DQ44
DQ44
DQ44
DQ44
DQ44
DQ44
DQSn44/CQn44
DQS44/CQ44
DQ44
DQ44
DQ44
DQ44
DQ45
DQ45
DQ45
DQ45
DQ45
DQ45
DQSn45/CQn45
DQS45/CQ45
DQ45
DQ45
DQ45
DQ45
DQ46
DQ46
DQ46
DQ46
DQ46
DQ46
DQSn46/CQn46
DQS46/CQ46
DQ46
DQ46
DQ46
DQ46
DQ47
DQ47
DQ47
DQ47
DQ47
DQ47
DQSn47/CQn47
DQS47/CQ47
DQ47
DQ47
DQ47
DQ47
DQ20
DQ20
DQSn20/CQn20
DQS20/CQ20
DQ20
DQ20
DQ20
DQ20
DQ20
DQ20
DQ20
DQ20
DQ20
DQ20
DQ20
DQ20
DQ21
DQ21
DQ21
DQ21
DQ21
DQ21
DQ21
DQ21
DQ21
DQ21
DQSn21/CQn21
DQS21/CQ21
DQ21
DQ21
DQ21
DQ21
DQ21
DQ21
DQ21
DQ21
DQ21
DQ21
DQ21
DQ21
DQ22
DQ22
DQ22
DQ22
DQ22
DQ22
DQ22
DQ22
DQ22
DQ22
DQSn22/CQn22
DQS22/CQ22
DQ22
DQ22
DQ22
DQ22
DQ22
DQ22
DQ22
DQ22
DQ22
DQ22
DQ22
DQ22
DQ23
DQ23
DQ23
DQ23
DQ23
DQ23
DQ23
DQ23
DQ23
DQ23
DQSn23/CQn23
DQS23/CQ23
DQ23
DQ23
DQ23
DQ23
DQ23
DQ23
DQ23
DQ23
DQ23
DQ23
DQ23
DQ23
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQSn10/CQn10
DQS10/CQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ10
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQSn11/CQn11
DQS11/CQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
Page 3 of 24
Pin Information for the Arria®10 10AS048 Device
Version 1.3
Note (1)
Bank
Number
Index within I/O Bank (2)
VREF
Pin Name/Function
Optional Function(s)
Configuration Function
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GNDSENSE
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
PT-10AS048-1.3
Copyright © 2015 Altera Corp
HPS Function (3)
Non-Dedicated Tx/Rx Channel
Dedicated Tx/Rx
Channel
Soft CDR Support
F29
DQS for X4
DQS for X8/X9
DQS for X16/X18
DQS for X32/X36
AE8
AF10
AF15
AF20
AF24
AF27
AF28
AF5
AG12
AG17
AG2
AG22
AG24
AG25
AG26
AG7
AH14
AH19
AH26
AH27
AH4
AH9
B17
B2
B22
B27
B28
B7
C19
C24
C25
C26
C27
C4
C9
D1
D11
D16
D21
D24
D27
D28
D6
E13
E24
E25
E26
E3
E8
F10
F20
F24
F27
F28
F5
G12
G17
G2
G22
G24
G25
G26
H14
H24
H27
H28
H4
J1
J11
J16
J21
J24
J25
J26
J6
K13
K24
K27
K28
K3
L10
L15
L20
L21
L22
L23
L24
L25
L26
M12
M17
M2
M21
M27
M28
N14
N19
N21
N22
N25
N26
N4
N9
P1
P11
P16
P21
P22
P27
P28
R13
R18
R21
R22
R25
R26
R3
R8
T10
T15
T20
T21
T27
T28
U12
U17
U2
U21
U22
U25
U26
V14
V19
V21
V22
V27
V28
V9
W1
W11
W16
W22
W25
W26
Y13
Y22
Y23
Y24
Y27
Y28
Y3
T12
L11
L12
L16
L17
L18
L19
M10
M11
M15
M16
M19
M20
Pin List F29
Page 4 of 24
Pin Information for the Arria®10 10AS048 Device
Version 1.3
Note (1)
Bank
Number
Index within I/O Bank (2)
2A
2J
2K
2L
3A
3B
3C
3D
VREF
VREFB2AN0
VREFB2JN0
VREFB2KN0
VREFB2LN0
VREFB3AN0
VREFB3BN0
VREFB3CN0
VREFB3DN0
Pin Name/Function
Optional Function(s)
Configuration Function
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCCPT
VCCPT
VCCPT
VCCPT
DNU
DNU
DNU
DNU
DNU
VCCPGM
VCCPGM
TEMPDIODEn
TEMPDIODEp
VCCBAT
VCCA_PLL
VCCA_PLL
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2J
VCCIO2J
VCCIO2J
VCCIO2K
VCCIO2K
VCCIO2K
VCCIO2L
VCCIO2L
VCCIO2L
VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3B
VCCIO3B
VCCIO3B
VCCIO3C
VCCIO3C
VCCIO3C
VCCIO3D
VCCIO3D
VCCIO3D
VCCIOREF_HPS
VCCIO_HPS
VREFB2AN0
VREFB2JN0
VREFB2KN0
VREFB2LN0
VREFB3AN0
VREFB3BN0
VREFB3CN0
VREFB3DN0
VREFN_ADC
VREFP_ADC
VCCH_GXBL
VCCH_GXBL
VCCR_GXBL1C
VCCR_GXBL1C
VCCR_GXBL1D
VCCR_GXBL1D
VCCT_GXBL1C
VCCT_GXBL1C
VCCT_GXBL1D
VCCT_GXBL1D
RREF_BL
RREF_TL
VCCERAM
VCCERAM
VCCLSENSE
VCCL_HPS
VCCL_HPS
VCCL_HPS
VCCL_HPS
VCCP
VCCP
VCCP
VCCP
VCCP
VCCPLL_HPS
VSIGN_0
VSIGN_1
VSIGP_0
VSIGP_1
HPS Function (3)
Non-Dedicated Tx/Rx Channel
Dedicated Tx/Rx
Channel
Soft CDR Support
F29
DQS for X4
DQS for X8/X9
DQS for X16/X18
DQS for X32/X36
N10
N12
N13
N15
N16
N18
N20
P10
P12
P14
P17
P18
P19
P20
R10
R11
R14
R15
R16
R19
R20
T11
T14
T16
T17
T18
T19
U10
U14
U15
U18
U19
U20
V10
V11
V13
V15
V16
V17
V20
W12
W18
W19
M14
M18
V12
V18
AH23
AH24
Y11
Y12
Y10
W14
Y14
H10
H11
W13
P13
P15
AA15
AB12
AC14
AA20
AC19
Y18
B12
C14
F15
E18
H19
K18
AA5
W6
Y8
T5
U7
V4
L5
M7
P6
G7
H9
K8
J13
H13
W15
W17
E9
K16
W9
U9
R9
M9
J10
K10
M22
T22
V23
V24
P23
P24
T23
T24
M23
M24
AH25
C28
R12
R17
T13
K14
L13
L14
M13
N11
N17
U11
U13
U16
J14
E11
G11
E10
F11
Notes:
(1) For more information about pin definition and pin connection guidelines, refer to the
Arria 10 GT, GX, and SX Device Family Pin Connection Guidelines.
(2) For more information about the external memory interface schemes of the pins with indices, refer to the
Arria10EMIF.xls
(3) For more information about the Hard Processor System functions of the corresponding pins, refer to the
Arria10HPS.xls
PT-10AS048-1.3
Copyright © 2015 Altera Corp
Pin List F29
Page 5 of 24
Pin Information for the Arria®10 10AS048 Device
Version 1.3
Note (1)
Bank
Number
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
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18
17
16
15
14
PT-10AS048-1.3
Copyright © 2015 Altera Corp
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GPIO1_IO9,NAND_ADQ5,EMAC1_TXD3,SPIS0_MOSI,EMAC2_MDC,I2C_EMAC2_SCL
GPIO1_IO8,NAND_ADQ4,EMAC1_TXD2,SPIS0_CLK,EMAC2_MDIO,I2C_EMAC2_SDA
GPIO1_IO7,NAND_CLE,UART1_RX,EMAC1_RXD1,SPIS1_MISO,I2C1_SCL
GPIO1_IO6,NAND_ADQ3,UART1_TX,EMAC1_RXD0,SPIS1_SS0_N,I2C1_SDA
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CLK_2L_0n,GPIO0_IO23,NAND_ADQ15,UART0_RX,USB1_DATA7,EMAC0_RXD3,SPIM1_SS0_N,SPIS0_MISO,I2C0_SCL
CLK_2L_0p,GPIO0_IO22,NAND_ADQ14,UART0_TX,USB1_DATA6,EMAC0_RXD2,SPIM1_MISO,SPIS0_SS0_N,I2C0_SDA
GPIO0_IO21,NAND_ADQ13,UART0_RTS_N,USB1_DATA5,EMAC0_TXD3,SPIM1_MOSI,SPIS0_MOSI,I2C1_SCL
GPIO0_IO20,NAND_ADQ12,UART0_CTS_N,USB1_DATA4,EMAC0_TXD2,SPIM1_CLK,SPIS0_CLK,I2C1_SDA
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PLL_2L_CLKOUT0p,PLL_2L_CLKOUT0,PLL_2L_FB0,GPIO0_IO18,NAND_ADQ10,USB1_DATA2,EMAC0_RXD0
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GPIO0_IO16,NAND_ADQ8,USB1_DATA1,EMAC0_TXD0
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HPS_DIRECT_SHARED_Q3_6
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DIFFIO2L_17p
Dedicated Tx/Rx Channel Soft CDR Support
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No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
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Page 6 of 24
Pin Information for the Arria®10 10AS048 Device
Version 1.3
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Bank
Number
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2L
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IO
IO
IO
IO
GPIO0_IO13,NAND_RB,USB1_STP,EMAC0_TX_CTL
GPIO0_IO12,NAND_ALE,USB1_CLK,EMAC0_TX_CLK
GPIO0_IO11,NAND_ADQ7,USB0_DATA7,SPIM1_SS0_N,SPIS1_MISO,EMAC0_MDC,I2C_EMAC0_SCL
GPIO0_IO10,NAND_ADQ6,USB0_DATA6,SPIM1_MISO,SPIS1_SS0_N,EMAC0_MDIO,I2C_EMAC0_SDA
GPIO0_IO9,NAND_ADQ5,USB0_DATA5,SDMMC_DATA7,SPIM1_MOSI,SPIS1_MOSI,EMAC1_MDC,I2C_EMAC1_SCL
GPIO0_IO8,NAND_ADQ4,USB0_DATA4,SDMMC_DATA6,SPIM1_CLK,SPIS1_CLK,EMAC1_MDIO,I2C_EMAC1_SDA
GPIO0_IO7,NAND_CLE,UART1_RX,USB0_DATA3,SDMMC_DATA5,SPIM0_SS0_N,EMAC2_MDC,I2C_EMAC2_SCL
GPIO0_IO6,NAND_ADQ3,UART1_TX,USB0_DATA2,SDMMC_DATA4,SPIM0_MISO,EMAC2_MDIO,I2C_EMAC2_SDA
GPIO0_IO5,NAND_ADQ2,UART1_RTS_N,QSPI_SS3,USB0_NXT,SDMMC_DATA3,SPIM0_MOSI,I2C0_SCL
GPIO0_IO4,NAND_WP_N,UART1_CTS_N,QSPI_SS2,USB0_DATA1,SDMMC_DATA2,SPIM0_CLK,I2C0_SDA
GPIO0_IO3,NAND_RE_N,UART0_RX,USB0_DATA0,SDMMC_DATA1,SPIS0_MISO,I2C1_SCL
GPIO0_IO2,NAND_WE_N,UART0_TX,USB0_DIR,SDMMC_CCLK,SPIS0_SS0_N,I2C1_SDA
GPIO0_IO1,NAND_ADQ1,UART0_RTS_N,USB0_STP,SDMMC_CMD,SPIM1_SS1_N,SPIS0_MOSI
GPIO0_IO0,NAND_ADQ0,UART0_CTS_N,USB0_CLK,SDMMC_DATA0,SPIM0_SS1_N,SPIS0_CLK
PT-10AS048-1.3
Copyright © 2015 Altera Corp
Configuration Function
PLL_2K_CLKOUT1n
PLL_2K_CLKOUT1p,PLL_2K_CLKOUT1,PLL_2K_FB1
RZQ_2K
CLK_2K_1n
CLK_2K_1p
CLK_2K_0n
CLK_2K_0p
PLL_2K_CLKOUT0n
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RZQ_2J
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DATA16
DATA17
DATA18
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nCEO
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RZQ_2A
CLK_2A_1n
CLK_2A_1p
DATA20
DATA21
Pin List F34
HPS Function (3)
Non-Dedicated Tx/Rx Channel
HPS_DIRECT_SHARED_Q2_2
HPS_DIRECT_SHARED_Q2_1
HPS_DIRECT_SHARED_Q1_12
HPS_DIRECT_SHARED_Q1_11
HPS_DIRECT_SHARED_Q1_10
HPS_DIRECT_SHARED_Q1_9
HPS_DIRECT_SHARED_Q1_8
HPS_DIRECT_SHARED_Q1_7
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HPS_DIRECT_SHARED_Q1_5
HPS_DIRECT_SHARED_Q1_4
HPS_DIRECT_SHARED_Q1_3
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HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
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HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
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HPS_DDR
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HPS_DDR
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F34
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G22
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H27
K22
K23
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DQ16
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DQ16
DQ16
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DQ19
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DQ20
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DQ40
DQ40
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DQ5
DQ5
DQ5
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DQ5
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DQ5
DQ5
DQ5
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DQS5/CQ5
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Page 7 of 24
Pin Information for the Arria®10 10AS048 Device
Version 1.3
Note (1)
Bank
Number
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2A
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2A
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2A
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3D
Index within I/O Bank (2)
VREF
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Optional Function(s)
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DATA29
DATA30
DATA31
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PR_READY
nPERSTL0
PR_DONE
nPERSTL1
PR_ERROR
PT-10AS048-1.3
Copyright © 2015 Altera Corp
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DEV_OE
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RZQ_3D
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CLK_3D_1p
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Pin List F34
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F34
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Pin Information for the Arria®10 10AS048 Device
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Copyright © 2015 Altera Corp
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Yes
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Yes
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Pin Information for the Arria®10 10AS048 Device
Version 1.3
Note (1)
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Number
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3A
3A
3A
3A
3A
3A
3A
3A
3A
3A
3A
3A
3A
3A
3A
3A
3A
3A
3A
Index within I/O Bank (2)
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19
18
17
16
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14
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1
0
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IO
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GPIO2_IO5,NAND_ADQ3,SDMMC_DATA3,QSPI_IO3_HOLD
GPIO2_IO6,NAND_CLE,SDMMC_PWR_ENA,SPIM0_SS1_N,SPIS0_MISO,BOOTSEL1
GPIO2_IO7,NAND_ALE,QSPI_SS1,SPIM0_CLK,BOOTSEL0
GPIO2_IO8,NAND_RB,UART1_TX,SDMMC_DATA4,SPIM0_MOSI,EMAC1_MDIO,I2C_EMAC1_SDA
GPIO2_IO9,NAND_CE_N,UART1_RTS_N,SDMMC_DATA5,SPIM0_MISO,EMAC1_MDC,I2C_EMAC1_SCL
GPIO2_IO10,NAND_ADQ4,UART1_CTS_N,SDMMC_DATA6,SPIM0_SS0_N,EMAC2_MDIO,I2C_EMAC2_SDA
GPIO2_IO11,NAND_ADQ5,UART1_RX,SDMMC_DATA7,SPIS0_CLK,EMAC2_MDC,I2C_EMAC2_SCL
GPIO2_IO12,NAND_ADQ6,UART1_TX,QSPI_SS2,SPIS0_MOSI,EMAC0_MDIO,I2C_EMAC0_SDA
GPIO2_IO13,NAND_ADQ7,UART1_RX,QSPI_SS3,SPIS0_SS0_N,EMAC0_MDC,I2C_EMAC0_SCL
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CSS
CSS
CSS
CSS
CSS
CSS
CSS
CSS
CSS
CSS
CSS
CSS
CSS
CSS
CSS
CSS
CSS
CSS
CSS
CSS
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HPS
HPS
HPS
HPS
HPS
HPS
HPS
HPS
HPS
HPS
HPS
HPS
HPS
HPS
HPS
HPS
PT-10AS048-1.3
Copyright © 2015 Altera Corp
Configuration Function
HPS Function (3)
TDO
TMS
TRST
TCK
TDI
MSEL0
MSEL1
MSEL2
nIO_PULLUP
nSTATUS
CONF_DONE
nCONFIG
nCE
nCSO0
nCSO1
nCSO2
AS_DATA0,ASDO
AS_DATA1
AS_DATA2
AS_DATA3
DCLK
HPS_CLK1
HPS_nPOR
HPS_nRST
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HPS_DEDICATED_5
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HPS_DEDICATED_12
HPS_DEDICATED_13
HPS_DEDICATED_14
HPS_DEDICATED_15
HPS_DEDICATED_16
HPS_DEDICATED_17
Pin List F34
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F34
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LVDS3A_19p
LVDS3A_20n
LVDS3A_20p
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LVDS3A_22p
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G16
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DQ92
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DQ94
DQ94
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DQ95
DQ95
DQ95
DQ95
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DQ46
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DQS46/CQ46
DQ46
DQ46
DQ46
DQ46
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DQS47/CQ47
DQ47
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DQ23
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Yes
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Pin Information for the Arria®10 10AS048 Device
Version 1.3
Note (1)
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Number
Index within I/O Bank (2)
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PT-10AS048-1.3
Copyright © 2015 Altera Corp
HPS Function (3)
Non-Dedicated Tx/Rx Channel
Dedicated Tx/Rx Channel Soft CDR Support
F34
DQS for X4
DQS for X8/X9
DQS for X16/X18
DQS for X32/X36
AL12
AL17
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AL22
AL28
AL31
AL32
AL7
AM14
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AM24
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AM29
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P33
P34
R10
R15
R20
R25
Pin List F34
Page 11 of 24
Pin Information for the Arria®10 10AS048 Device
Version 1.3
Note (1)
Bank
Number
Index within I/O Bank (2)
VREF
Pin Name/Function
Optional Function(s)
Configuration Function
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GND
GNDSENSE
VCC
VCC
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VCCPT
VCCPT
PT-10AS048-1.3
Copyright © 2015 Altera Corp
HPS Function (3)
Non-Dedicated Tx/Rx Channel
Dedicated Tx/Rx Channel Soft CDR Support
F34
DQS for X4
DQS for X8/X9
DQS for X16/X18
DQS for X32/X36
R31
R32
R5
T12
T17
T2
T22
T26
T29
T30
T33
T34
U14
U19
U24
U26
U31
U32
U4
V1
V11
V16
V21
V25
V26
V29
V30
V33
V34
V6
W13
W18
W23
W25
W3
W31
W32
Y10
Y15
Y20
Y25
Y26
Y29
Y30
Y33
Y34
Y18
AA11
AA13
AA16
AA18
AA19
AA23
AA24
AB12
AB13
AB14
AB17
AB18
AB21
AB23
AB24
AB25
AC18
AC21
N12
N13
N16
N17
N18
N23
N24
N25
P11
P12
P14
P17
P22
P24
P25
R11
R12
R13
R14
R16
R17
R18
R19
R21
R22
R23
R24
T11
T13
T19
T20
T21
T23
T24
T25
U11
U12
U15
U16
U20
U21
U25
V12
V13
V14
V15
V17
V18
V19
V20
V22
V23
V24
W11
W12
W14
W15
W16
W17
W19
W20
W21
W22
W24
Y11
Y12
Y13
Y14
Y16
Y19
Y21
Y22
Y23
Y24
AA14
AA15
AA20
AA21
P15
P16
P19
Pin List F34
Page 12 of 24
Pin Information for the Arria®10 10AS048 Device
Version 1.3
Note (1)
Bank
Number
Index within I/O Bank (2)
2A
2I
2J
2K
2L
3A
3B
3C
3D
3E
3F
VREF
VREFB2AN0
VREFB2IN0
VREFB2JN0
VREFB2KN0
VREFB2LN0
VREFB3AN0
VREFB3BN0
VREFB3CN0
VREFB3DN0
VREFB3EN0
VREFB3FN0
Pin Name/Function
Optional Function(s)
Configuration Function
VCCPT
VCCPT
DNU
DNU
DNU
DNU
DNU
VCCPGM
VCCPGM
TEMPDIODEn
TEMPDIODEp
VCCBAT
VCCA_PLL
VCCA_PLL
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2I
VCCIO2I
VCCIO2I
VCCIO2J
VCCIO2J
VCCIO2J
VCCIO2K
VCCIO2K
VCCIO2K
VCCIO2L
VCCIO2L
VCCIO2L
VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3B
VCCIO3B
VCCIO3B
VCCIO3C
VCCIO3C
VCCIO3C
VCCIO3D
VCCIO3D
VCCIO3D
VCCIO3E
VCCIO3E
VCCIO3E
VCCIO3F
VCCIO3F
VCCIO3F
VCCIOREF_HPS
VCCIO_HPS
VREFB2AN0
VREFB2IN0
VREFB2JN0
VREFB2KN0
VREFB2LN0
VREFB3AN0
VREFB3BN0
VREFB3CN0
VREFB3DN0
VREFB3EN0
VREFB3FN0
VREFN_ADC
VREFP_ADC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
VCCH_GXBL
VCCH_GXBL
VCCH_GXBL
VCCH_GXBL
VCCR_GXBL1C
VCCR_GXBL1C
VCCR_GXBL1D
VCCR_GXBL1D
VCCR_GXBL1E
VCCR_GXBL1E
VCCR_GXBL1F
VCCR_GXBL1F
VCCT_GXBL1C
VCCT_GXBL1C
VCCT_GXBL1D
VCCT_GXBL1D
VCCT_GXBL1E
VCCT_GXBL1E
VCCT_GXBL1F
VCCT_GXBL1F
RREF_BL
RREF_TL
VCCERAM
VCCERAM
VCCERAM
VCCERAM
VCCERAM
VCCLSENSE
VCCL_HPS
VCCL_HPS
VCCL_HPS
VCCL_HPS
VCCP
VCCP
VCCP
VCCP
VCCP
VCCP
VCCP
VCCP
VCCP
VCCPLL_HPS
VSIGN_0
VSIGN_1
VSIGP_0
VSIGP_1
HPS Function (3)
Non-Dedicated Tx/Rx Channel
Dedicated Tx/Rx Channel Soft CDR Support
F34
DQS for X4
DQS for X8/X9
DQS for X16/X18
DQS for X32/X36
P20
P21
AN28
AN29
AC13
AC14
AC15
AD15
AD16
C14
D14
AD14
T16
T18
AF17
AH16
AK15
AE20
AF22
AK20
AE25
AG24
AJ23
F22
G24
J23
F17
G19
J18
AE10
AF12
AG9
AB9
AC6
AD8
AA7
W8
Y5
P8
T7
U9
K10
M9
N11
F12
H11
J13
K16
J16
AC19
AE21
AC23
M22
K17
AD12
AC12
AA10
V10
P10
M12
B13
A13
A2
AC20
AC22
AD20
AD22
AE22
AF20
AF21
AG20
AG21
AG22
AH20
AH22
AN1
AN2
AN3
AP2
AP3
B1
C2
T14
T15
AC26
L26
R26
W26
AE27
AE28
AA27
AA28
U27
U28
N27
N28
AC27
AC28
W27
W28
R27
R28
L27
L28
AP29
A29
U13
U17
U18
U22
U23
Y17
L15
L16
M15
M16
AB15
AB16
AB20
AB22
N14
N15
N19
N20
N22
J15
F14
J14
E14
H14
Notes:
(1) For more information about pin definition and pin connection guidelines, refer to the
Arria 10 GT, GX, and SX Device Family Pin Connection Guidelines.
(2) For more information about the external memory interface schemes of the pins with indices, refer to the
Arria10EMIF.xls
(3) For more information about the Hard Processor System functions of the corresponding pins, refer to the
Arria10HPS.xls
PT-10AS048-1.3
Copyright © 2015 Altera Corp
Pin List F34
Page 13 of 24
®
Pin Information for the Arria 10 10AS048 Device
Version 1.3
Note (1)
Bank
Number
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1H
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1G
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1F
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1E
1D
1D
1D
1D
1D
1D
1D
PT-10AS048-1.3
Copyright © 2015 Altera Corp
Index within I/O Bank (2)
VREF
Pin Name/Function
Optional Function(s)
Configuration
Function
REFCLK_GXBL1H_CHTp
REFCLK_GXBL1H_CHTn
GXBL1H_TX_CH5n
GXBL1H_TX_CH5p
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GXBL1H_TX_CH4n
GXBL1H_TX_CH4p
GXBL1H_RX_CH4n,GXBL1H_REFCLK4n
GXBL1H_RX_CH4p,GXBL1H_REFCLK4p
GXBL1H_TX_CH3n
GXBL1H_TX_CH3p
GXBL1H_RX_CH3n,GXBL1H_REFCLK3n
GXBL1H_RX_CH3p,GXBL1H_REFCLK3p
GXBL1H_TX_CH2n
GXBL1H_TX_CH2p
GXBL1H_RX_CH2n,GXBL1H_REFCLK2n
GXBL1H_RX_CH2p,GXBL1H_REFCLK2p
GXBL1H_TX_CH1n
GXBL1H_TX_CH1p
GXBL1H_RX_CH1n,GXBL1H_REFCLK1n
GXBL1H_RX_CH1p,GXBL1H_REFCLK1p
GXBL1H_TX_CH0n
GXBL1H_TX_CH0p
GXBL1H_RX_CH0n,GXBL1H_REFCLK0n
GXBL1H_RX_CH0p,GXBL1H_REFCLK0p
REFCLK_GXBL1H_CHBp
REFCLK_GXBL1H_CHBn
REFCLK_GXBL1G_CHTp
REFCLK_GXBL1G_CHTn
GXBL1G_TX_CH5n
GXBL1G_TX_CH5p
GXBL1G_RX_CH5n,GXBL1G_REFCLK5n
GXBL1G_RX_CH5p,GXBL1G_REFCLK5p
GXBL1G_TX_CH4n
GXBL1G_TX_CH4p
GXBL1G_RX_CH4n,GXBL1G_REFCLK4n
GXBL1G_RX_CH4p,GXBL1G_REFCLK4p
GXBL1G_TX_CH3n
GXBL1G_TX_CH3p
GXBL1G_RX_CH3n,GXBL1G_REFCLK3n
GXBL1G_RX_CH3p,GXBL1G_REFCLK3p
GXBL1G_TX_CH2n
GXBL1G_TX_CH2p
GXBL1G_RX_CH2n,GXBL1G_REFCLK2n
GXBL1G_RX_CH2p,GXBL1G_REFCLK2p
GXBL1G_TX_CH1n
GXBL1G_TX_CH1p
GXBL1G_RX_CH1n,GXBL1G_REFCLK1n
GXBL1G_RX_CH1p,GXBL1G_REFCLK1p
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GXBL1G_TX_CH0p
GXBL1G_RX_CH0n,GXBL1G_REFCLK0n
GXBL1G_RX_CH0p,GXBL1G_REFCLK0p
REFCLK_GXBL1G_CHBp
REFCLK_GXBL1G_CHBn
REFCLK_GXBL1F_CHTp
REFCLK_GXBL1F_CHTn
GXBL1F_TX_CH5n
GXBL1F_TX_CH5p
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GXBL1F_TX_CH4n
GXBL1F_TX_CH4p
GXBL1F_RX_CH4n,GXBL1F_REFCLK4n
GXBL1F_RX_CH4p,GXBL1F_REFCLK4p
GXBL1F_TX_CH3n
GXBL1F_TX_CH3p
GXBL1F_RX_CH3n,GXBL1F_REFCLK3n
GXBL1F_RX_CH3p,GXBL1F_REFCLK3p
GXBL1F_TX_CH2n
GXBL1F_TX_CH2p
GXBL1F_RX_CH2n,GXBL1F_REFCLK2n
GXBL1F_RX_CH2p,GXBL1F_REFCLK2p
GXBL1F_TX_CH1n
GXBL1F_TX_CH1p
GXBL1F_RX_CH1n,GXBL1F_REFCLK1n
GXBL1F_RX_CH1p,GXBL1F_REFCLK1p
GXBL1F_TX_CH0n
GXBL1F_TX_CH0p
GXBL1F_RX_CH0n,GXBL1F_REFCLK0n
GXBL1F_RX_CH0p,GXBL1F_REFCLK0p
REFCLK_GXBL1F_CHBp
REFCLK_GXBL1F_CHBn
REFCLK_GXBL1E_CHTp
REFCLK_GXBL1E_CHTn
GXBL1E_TX_CH5n
GXBL1E_TX_CH5p
GXBL1E_RX_CH5n,GXBL1E_REFCLK5n
GXBL1E_RX_CH5p,GXBL1E_REFCLK5p
GXBL1E_TX_CH4n
GXBL1E_TX_CH4p
GXBL1E_RX_CH4n,GXBL1E_REFCLK4n
GXBL1E_RX_CH4p,GXBL1E_REFCLK4p
GXBL1E_TX_CH3n
GXBL1E_TX_CH3p
GXBL1E_RX_CH3n,GXBL1E_REFCLK3n
GXBL1E_RX_CH3p,GXBL1E_REFCLK3p
GXBL1E_TX_CH2n
GXBL1E_TX_CH2p
GXBL1E_RX_CH2n,GXBL1E_REFCLK2n
GXBL1E_RX_CH2p,GXBL1E_REFCLK2p
GXBL1E_TX_CH1n
GXBL1E_TX_CH1p
GXBL1E_RX_CH1n,GXBL1E_REFCLK1n
GXBL1E_RX_CH1p,GXBL1E_REFCLK1p
GXBL1E_TX_CH0n
GXBL1E_TX_CH0p
GXBL1E_RX_CH0n,GXBL1E_REFCLK0n
GXBL1E_RX_CH0p,GXBL1E_REFCLK0p
REFCLK_GXBL1E_CHBp
REFCLK_GXBL1E_CHBn
REFCLK_GXBL1D_CHTp
REFCLK_GXBL1D_CHTn
GXBL1D_TX_CH5n
GXBL1D_TX_CH5p
GXBL1D_RX_CH5n,GXBL1D_REFCLK5n
GXBL1D_RX_CH5p,GXBL1D_REFCLK5p
GXBL1D_TX_CH4n
HPS Function (3)
Non-Dedicated
Tx/Rx Channel
Dedicated Tx/Rx
Channel
Soft CDR Support
F35
DQS for X4
DQS for X8/X9
DQS for X16/X18
DQS for X32/X36
G26
G25
A25
A26
C25
C26
A29
A30
E25
E26
B31
B32
B27
B28
C33
C34
D27
D28
D31
D32
C29
C30
E33
E34
E29
E30
J26
J25
L26
L25
F31
F32
F27
F28
G33
G34
G29
G30
H31
H32
H27
H28
J33
J34
J29
J30
K31
K32
K27
K28
L33
L34
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L30
N26
N25
R26
R25
M31
M32
M27
M28
N33
N34
N29
N30
P31
P32
P27
P28
R33
R34
R29
R30
T31
T32
T27
T28
U33
U34
U29
U30
U26
U25
W26
W25
V31
V32
V27
V28
W33
W34
W29
W30
Y31
Y32
Y27
Y28
AA33
AA34
AA29
AA30
AB31
AB32
AB27
AB28
AC33
AC34
AC29
AC30
AA26
AA25
AC26
AC25
AD31
AD32
AD27
AD28
AE33
Pin List F35
Page 14 of 24
®
Pin Information for the Arria 10 10AS048 Device
Version 1.3
Note (1)
Bank
Number
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1D
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
1C
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2L
2K
2K
2K
2K
2K
2K
2K
2K
2K
2K
2K
2K
2K
2K
2K
2K
2K
2K
2K
2K
2K
2K
PT-10AS048-1.3
Copyright © 2015 Altera Corp
Index within I/O Bank (2)
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
VREF
Pin Name/Function
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2LN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
GXBL1D_TX_CH4p
GXBL1D_RX_CH4n,GXBL1D_REFCLK4n
GXBL1D_RX_CH4p,GXBL1D_REFCLK4p
GXBL1D_TX_CH3n
GXBL1D_TX_CH3p
GXBL1D_RX_CH3n,GXBL1D_REFCLK3n
GXBL1D_RX_CH3p,GXBL1D_REFCLK3p
GXBL1D_TX_CH2n
GXBL1D_TX_CH2p
GXBL1D_RX_CH2n,GXBL1D_REFCLK2n
GXBL1D_RX_CH2p,GXBL1D_REFCLK2p
GXBL1D_TX_CH1n
GXBL1D_TX_CH1p
GXBL1D_RX_CH1n,GXBL1D_REFCLK1n
GXBL1D_RX_CH1p,GXBL1D_REFCLK1p
GXBL1D_TX_CH0n
GXBL1D_TX_CH0p
GXBL1D_RX_CH0n,GXBL1D_REFCLK0n
GXBL1D_RX_CH0p,GXBL1D_REFCLK0p
REFCLK_GXBL1D_CHBp
REFCLK_GXBL1D_CHBn
REFCLK_GXBL1C_CHTp
REFCLK_GXBL1C_CHTn
GXBL1C_TX_CH5n
GXBL1C_TX_CH5p
GXBL1C_RX_CH5n,GXBL1C_REFCLK5n
GXBL1C_RX_CH5p,GXBL1C_REFCLK5p
GXBL1C_TX_CH4n
GXBL1C_TX_CH4p
GXBL1C_RX_CH4n,GXBL1C_REFCLK4n
GXBL1C_RX_CH4p,GXBL1C_REFCLK4p
GXBL1C_TX_CH3n
GXBL1C_TX_CH3p
GXBL1C_RX_CH3n,GXBL1C_REFCLK3n
GXBL1C_RX_CH3p,GXBL1C_REFCLK3p
GXBL1C_TX_CH2n
GXBL1C_TX_CH2p
GXBL1C_RX_CH2n,GXBL1C_REFCLK2n
GXBL1C_RX_CH2p,GXBL1C_REFCLK2p
GXBL1C_TX_CH1n
GXBL1C_TX_CH1p
GXBL1C_RX_CH1n,GXBL1C_REFCLK1n
GXBL1C_RX_CH1p,GXBL1C_REFCLK1p
GXBL1C_TX_CH0n
GXBL1C_TX_CH0p
GXBL1C_RX_CH0n,GXBL1C_REFCLK0n
GXBL1C_RX_CH0p,GXBL1C_REFCLK0p
REFCLK_GXBL1C_CHBp
REFCLK_GXBL1C_CHBn
IO
IO
IO
IO
IO
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IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
Optional Function(s)
Configuration
Function
GPIO1_IO23,NAND_ADQ15,Trace_D3,EMAC2_RXD3,SPIM0_SS0_N,SPIS1_MISO,EMAC0_MDC,I2C_EMAC0_SCL
GPIO1_IO22,NAND_ADQ14,Trace_D2,EMAC2_RXD2,SPIM0_MISO,SPIS1_SS0_N,EMAC0_MDIO,I2C_EMAC0_SDA
GPIO1_IO21,NAND_ADQ13,Trace_D1,EMAC2_TXD3,SDMMC_DATA7,SPIM0_MOSI,SPIS1_MOSI,I2C_EMAC2_SCL
GPIO1_IO20,NAND_ADQ12,Trace_D0,EMAC2_TXD2,SDMMC_DATA6,SPIM0_CLK,SPIS1_CLK,I2C_EMAC2_SDA
GPIO1_IO19,NAND_ADQ11,Trace_CLK,EMAC2_RXD1,SDMMC_DATA5,SPIM0_SS0_N,EMAC1_MDC,I2C_EMAC1_SCL
GPIO1_IO18,NAND_ADQ10,EMAC2_RXD0,SDMMC_DATA4,SPIM0_MISO,EMAC1_MDIO,I2C_EMAC1_SDA
GPIO1_IO17,NAND_ADQ9,UART1_RTS_N,QSPI_SS3,EMAC2_TXD1,SDMMC_DATA3,SPIM0_SS1_N
GPIO1_IO16,NAND_ADQ8,UART1_CTS_N,QSPI_SS2,EMAC2_TXD0,SDMMC_DATA2
GPIO1_IO15,UART1_RX,Trace_CLK,EMAC2_RX_CTL,SDMMC_DATA1
GPIO1_IO14,NAND_CE_N,UART1_TX,EMAC2_RX_CLK,SDMMC_CCLK
GPIO1_IO13,NAND_RB,EMAC2_TX_CTL,SDMMC_CMD,I2C1_SCL
GPIO1_IO12,NAND_ALE,EMAC2_TX_CLK,SDMMC_DATA0,I2C1_SDA
GPIO1_IO11,NAND_ADQ7,EMAC1_RXD3,SPIS0_MISO,EMAC0_MDC,I2C_EMAC0_SCL
GPIO1_IO10,NAND_ADQ6,EMAC1_RXD2,SPIS0_SS0_N,EMAC0_MDIO,I2C_EMAC0_SDA
GPIO1_IO9,NAND_ADQ5,EMAC1_TXD3,SPIS0_MOSI,EMAC2_MDC,I2C_EMAC2_SCL
GPIO1_IO8,NAND_ADQ4,EMAC1_TXD2,SPIS0_CLK,EMAC2_MDIO,I2C_EMAC2_SDA
GPIO1_IO7,NAND_CLE,UART1_RX,EMAC1_RXD1,SPIS1_MISO,I2C1_SCL
GPIO1_IO6,NAND_ADQ3,UART1_TX,EMAC1_RXD0,SPIS1_SS0_N,I2C1_SDA
PLL_2L_CLKOUT1n,GPIO1_IO5,NAND_ADQ2,UART1_RTS_N,EMAC1_TXD1,SPIS1_MOSI
PLL_2L_CLKOUT1p,PLL_2L_CLKOUT1,PLL_2L_FB1,GPIO1_IO4,NAND_WP_N,UART1_CTS_N,EMAC1_TXD0,SPIM1_SS1_N,SPIS1_CLK
GPIO1_IO3,NAND_RE_N,UART0_RX,EMAC1_RX_CTL,SPIM1_SS0_N,I2C0_SCL
RZQ_2L,GPIO1_IO2,NAND_WE_N,UART0_TX,EMAC1_RX_CLK,SPIM1_MISO,I2C0_SDA
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CLK_2L_1p,GPIO1_IO0,NAND_ADQ0,UART0_CTS_N,EMAC1_TX_CLK,SPIM1_CLK
CLK_2L_0n,GPIO0_IO23,NAND_ADQ15,UART0_RX,USB1_DATA7,EMAC0_RXD3,SPIM1_SS0_N,SPIS0_MISO,I2C0_SCL
CLK_2L_0p,GPIO0_IO22,NAND_ADQ14,UART0_TX,USB1_DATA6,EMAC0_RXD2,SPIM1_MISO,SPIS0_SS0_N,I2C0_SDA
GPIO0_IO21,NAND_ADQ13,UART0_RTS_N,USB1_DATA5,EMAC0_TXD3,SPIM1_MOSI,SPIS0_MOSI,I2C1_SCL
GPIO0_IO20,NAND_ADQ12,UART0_CTS_N,USB1_DATA4,EMAC0_TXD2,SPIM1_CLK,SPIS0_CLK,I2C1_SDA
PLL_2L_CLKOUT0n,GPIO0_IO19,NAND_ADQ11,USB1_DATA3,EMAC0_RXD1,SPIM1_SS1_N
PLL_2L_CLKOUT0p,PLL_2L_CLKOUT0,PLL_2L_FB0,GPIO0_IO18,NAND_ADQ10,USB1_DATA2,EMAC0_RXD0
GPIO0_IO17,NAND_ADQ9,USB1_NXT,EMAC0_TXD1
GPIO0_IO16,NAND_ADQ8,USB1_DATA1,EMAC0_TXD0
GPIO0_IO15,USB1_DATA0,EMAC0_RX_CTL
GPIO0_IO14,NAND_CE_N,USB1_DIR,EMAC0_RX_CLK
GPIO0_IO13,NAND_RB,USB1_STP,EMAC0_TX_CTL
GPIO0_IO12,NAND_ALE,USB1_CLK,EMAC0_TX_CLK
GPIO0_IO11,NAND_ADQ7,USB0_DATA7,SPIM1_SS0_N,SPIS1_MISO,EMAC0_MDC,I2C_EMAC0_SCL
GPIO0_IO10,NAND_ADQ6,USB0_DATA6,SPIM1_MISO,SPIS1_SS0_N,EMAC0_MDIO,I2C_EMAC0_SDA
GPIO0_IO9,NAND_ADQ5,USB0_DATA5,SDMMC_DATA7,SPIM1_MOSI,SPIS1_MOSI,EMAC1_MDC,I2C_EMAC1_SCL
GPIO0_IO8,NAND_ADQ4,USB0_DATA4,SDMMC_DATA6,SPIM1_CLK,SPIS1_CLK,EMAC1_MDIO,I2C_EMAC1_SDA
GPIO0_IO7,NAND_CLE,UART1_RX,USB0_DATA3,SDMMC_DATA5,SPIM0_SS0_N,EMAC2_MDC,I2C_EMAC2_SCL
GPIO0_IO6,NAND_ADQ3,UART1_TX,USB0_DATA2,SDMMC_DATA4,SPIM0_MISO,EMAC2_MDIO,I2C_EMAC2_SDA
GPIO0_IO5,NAND_ADQ2,UART1_RTS_N,QSPI_SS3,USB0_NXT,SDMMC_DATA3,SPIM0_MOSI,I2C0_SCL
GPIO0_IO4,NAND_WP_N,UART1_CTS_N,QSPI_SS2,USB0_DATA1,SDMMC_DATA2,SPIM0_CLK,I2C0_SDA
GPIO0_IO3,NAND_RE_N,UART0_RX,USB0_DATA0,SDMMC_DATA1,SPIS0_MISO,I2C1_SCL
GPIO0_IO2,NAND_WE_N,UART0_TX,USB0_DIR,SDMMC_CCLK,SPIS0_SS0_N,I2C1_SDA
GPIO0_IO1,NAND_ADQ1,UART0_RTS_N,USB0_STP,SDMMC_CMD,SPIM1_SS1_N,SPIS0_MOSI
GPIO0_IO0,NAND_ADQ0,UART0_CTS_N,USB0_CLK,SDMMC_DATA0,SPIM0_SS1_N,SPIS0_CLK
PLL_2K_CLKOUT1n
PLL_2K_CLKOUT1p,PLL_2K_CLKOUT1,PLL_2K_FB1
RZQ_2K
Pin List F35
HPS Function (3)
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
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HPS DIRECT
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HPS DIRECT
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HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS DIRECT
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
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HPS_DDR
HPS_DDR
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HPS_DDR
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HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
HPS_DDR
Non-Dedicated
Tx/Rx Channel
Dedicated Tx/Rx
Channel
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SHARDIFFIO2L_2p
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SHARDIFFIO2L_20p
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SHARDIFFIO2L_22p
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SHARDIFFIO2L_24p
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LVDS2K_1p
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LVDS2K_2p
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F35
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No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
No
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No
No
Yes
Yes
No
No
Yes
Yes
No
No
Yes
Yes
No
No
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Yes
No
No
Yes
Yes
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No
AE34
AE29
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AL33
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AK27
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AN33
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AP27
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A16
B15
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C9
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D9
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A5
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DQ0
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DQ5
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DQS0/CQ0
DQ0
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DQ1
DQ1
DQ1
DQ1
DQ1
DQ1
Page 15 of 24
®
Pin Information for the Arria 10 10AS048 Device
Version 1.3
Note (1)
Bank
Number
2K
2K
2K
2K
2K
2K
2K
2K
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2K
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2A
2A
2A
2A
2A
PT-10AS048-1.3
Copyright © 2015 Altera Corp
Index within I/O Bank (2)
VREF
Pin Name/Function
Optional Function(s)
25
24
23
22
21
20
19
18
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16
15
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16
15
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VREFB2KN0
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VREFB2KN0
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VREFB2KN0
VREFB2KN0
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VREFB2KN0
VREFB2KN0
VREFB2KN0
VREFB2KN0
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DQ10
Page 17 of 24
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Pin Information for the Arria 10 10AS048 Device
Version 1.3
Note (1)
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3B
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HPS
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HPS
HPS
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Copyright © 2015 Altera Corp
Index within I/O Bank (2)
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No
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Yes
No
No
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Yes
No
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Yes
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Yes
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Yes
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Yes
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No
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Yes
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No
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No
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V5
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AB8
AB7
AC9
AB10
AC5
AC4
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AE3
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AF6
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AL3
AL1
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AF9
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AM6
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AL6
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AL8
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AM8
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DQ45
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DQ45
DQ45
DQ45
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DQ46
DQ46
DQ46
DQ46
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DQ46
DQ46
DQ46
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DQ47
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DQ47
DQ47
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DQ20
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DQ20
DQ20
DQ20
DQ20
DQ20
DQ20
DQ20
DQ20
DQ20
DQ20
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DQ11
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DQ11
DQ11
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DQ11
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DQ11
DQ11
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DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
DQ11
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®
Pin Information for the Arria 10 10AS048 Device
Version 1.3
Note (1)
Bank
Number
HPS
HPS
HPS
HPS
HPS
HPS
HPS
HPS
HPS
PT-10AS048-1.3
Copyright © 2015 Altera Corp
Index within I/O Bank (2)
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HPS_DEDICATED_16
HPS_DEDICATED_17
Dedicated Tx/Rx
Channel
Soft CDR Support
F35
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K11
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A33
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AA32
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AJ24
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AJ32
AJ8
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AK29
AK30
AK33
AK34
AK5
AL12
AL17
AL2
AL22
AL24
AL27
AL28
AL31
AL32
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®
Pin Information for the Arria 10 10AS048 Device
Version 1.3
Note (1)
Bank
Number
Index within I/O Bank (2)
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PT-10AS048-1.3
Copyright © 2015 Altera Corp
HPS Function (3)
Non-Dedicated
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Dedicated Tx/Rx
Channel
Soft CDR Support
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AM19
AM2
AM22
AM23
AM24
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AM26
AM29
AM3
AM30
AM33
AM34
AM4
AM9
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AN11
AN16
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AN24
AN27
AN28
AN31
AN32
AN4
AN6
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AP18
AP22
AP24
AP25
AP26
AP29
AP3
AP30
AP33
AP8
B1
B14
B19
B2
B22
B23
B24
B25
B26
B29
B3
B30
B33
B34
B4
B9
C1
C11
C16
C24
C27
C28
C31
C32
C6
D23
D24
D25
D26
D29
D3
D30
D33
D34
D8
E10
E24
E27
E28
E31
E32
E5
F17
F2
F22
F23
F29
F30
F33
F34
F7
G14
G19
G24
G27
G28
G31
G32
G9
H1
H11
H16
H21
H23
H24
H29
H30
H33
H34
H6
J13
J18
J23
J24
J27
J28
J31
J32
J8
K10
K15
Pin List F35
Page 20 of 24
®
Pin Information for the Arria 10 10AS048 Device
Version 1.3
Note (1)
Bank
Number
Index within I/O Bank (2)
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Configuration
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VCC
VCC
VCC
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VCC
VCC
VCC
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VCC
VCC
VCC
VCC
PT-10AS048-1.3
Copyright © 2015 Altera Corp
HPS Function (3)
Non-Dedicated
Tx/Rx Channel
Dedicated Tx/Rx
Channel
Soft CDR Support
F35
DQS for X4
DQS for X8/X9
DQS for X16/X18
DQS for X32/X36
K20
K23
K29
K30
K33
K34
L12
L17
L2
L22
L23
L24
L27
L28
L31
L32
L7
M14
M19
M23
M24
M29
M30
M33
M34
M9
N1
N11
N16
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N28
N31
N32
N6
P13
P18
P23
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P33
P34
P8
R10
R15
R20
R23
R24
R27
R28
R31
R32
T12
T17
T2
T22
T23
T24
T29
T30
T33
T34
T7
U14
U19
U23
U24
U27
U28
U31
U32
U4
U9
V1
V11
V16
V21
V23
V29
V30
V33
V34
V6
W13
W18
W23
W24
W27
W28
W31
W32
W8
Y10
Y15
Y20
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Y24
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Y30
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Y17
AA15
AA16
AA18
AA21
AB15
AB16
AB17
AB21
AB22
AC14
AC15
AC17
AC18
AC19
AC20
Pin List F35
Page 21 of 24
®
Pin Information for the Arria 10 10AS048 Device
Version 1.3
Note (1)
Bank
Number
Index within I/O Bank (2)
VREF
Pin Name/Function
Optional Function(s)
Configuration
Function
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
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VCC
VCC
VCC
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VCC
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VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCC
VCCPT
VCCPT
VCCPT
VCCPT
VCCPT
VCCPT
VCCPT
VCCPT
DNU
DNU
DNU
DNU
DNU
VCCPGM
VCCPGM
TEMPDIODEn
TEMPDIODEp
VCCBAT
VCCA_PLL
VCCA_PLL
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2I
VCCIO2I
VCCIO2I
VCCIO2J
VCCIO2J
VCCIO2J
VCCIO2K
VCCIO2K
VCCIO2K
VCCIO2L
PT-10AS048-1.3
Copyright © 2015 Altera Corp
HPS Function (3)
Non-Dedicated
Tx/Rx Channel
Dedicated Tx/Rx
Channel
Soft CDR Support
F35
DQS for X4
DQS for X8/X9
DQS for X16/X18
DQS for X32/X36
AC22
AD15
AD16
AD17
AD19
AD20
L11
L13
L14
L15
L16
L18
L19
L20
L21
M11
M12
M13
M15
M16
M17
M18
M20
M21
M22
N14
N15
N17
N20
N22
P11
P15
P16
P17
P21
P22
R11
R12
R13
R14
R16
R17
R18
R19
R21
R22
T11
T13
T14
T15
T16
T18
T19
T20
T21
U11
U12
U16
U17
U20
U22
V12
V15
V17
V18
V19
V20
V22
W11
W12
W14
W15
W16
W17
W19
W20
W21
W22
Y11
Y12
Y13
Y14
Y18
Y19
Y21
Y22
AA13
AA14
AA19
AA20
P12
P14
P19
P20
AN22
AP23
AD11
AC10
AD12
AC12
AC13
D2
C2
AB11
V13
V14
AF12
AG9
AH11
AE15
AG14
AH16
AE20
AF22
AG19
C21
D18
E20
D13
Pin List F35
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®
Pin Information for the Arria 10 10AS048 Device
Version 1.3
Note (1)
Bank
Number
Index within I/O Bank (2)
2A
2I
2J
2K
2L
3A
3B
3C
3D
VREF
VREFB2AN0
VREFB2IN0
VREFB2JN0
VREFB2KN0
VREFB2LN0
VREFB3AN0
VREFB3BN0
VREFB3CN0
VREFB3DN0
Pin Name/Function
Optional Function(s)
Configuration
Function
VCCIO2L
VCCIO2L
VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3B
VCCIO3B
VCCIO3B
VCCIO3C
VCCIO3C
VCCIO3C
VCCIO3D
VCCIO3D
VCCIO3D
VCCIOREF_HPS
VCCIO_HPS
VREFB2AN0
VREFB2IN0
VREFB2JN0
VREFB2KN0
VREFB2LN0
VREFB3AN0
VREFB3BN0
VREFB3CN0
VREFB3DN0
VREFN_ADC
VREFP_ADC
VCCH_GXBL
VCCH_GXBL
VCCH_GXBL
VCCH_GXBL
VCCH_GXBL
VCCH_GXBL
VCCR_GXBL1C
VCCR_GXBL1C
VCCR_GXBL1D
VCCR_GXBL1D
VCCR_GXBL1E
VCCR_GXBL1E
VCCR_GXBL1F
VCCR_GXBL1F
VCCR_GXBL1G
VCCR_GXBL1G
VCCR_GXBL1H
VCCR_GXBL1H
VCCT_GXBL1C
VCCT_GXBL1C
VCCT_GXBL1D
VCCT_GXBL1D
VCCT_GXBL1E
VCCT_GXBL1E
VCCT_GXBL1F
VCCT_GXBL1F
VCCT_GXBL1G
VCCT_GXBL1G
VCCT_GXBL1H
VCCT_GXBL1H
RREF_BL
RREF_TL
VCCERAM
VCCERAM
VCCERAM
VCCERAM
VCCLSENSE
VCCL_HPS
VCCL_HPS
VCCL_HPS
VCCL_HPS
VCCP
VCCP
VCCP
VCCP
VCCP
VCCP
VCCP
VCCP
VCCPLL_HPS
VSIGN_0
VSIGN_1
VSIGP_0
VSIGP_1
HPS Function (3)
Non-Dedicated
Tx/Rx Channel
Dedicated Tx/Rx
Channel
Soft CDR Support
F35
DQS for X4
DQS for X8/X9
DQS for X16/X18
DQS for X32/X36
E15
F12
AD8
AE5
AF7
AB4
W3
Y5
M4
P3
R5
G4
J3
K5
J12
H13
AD14
AE16
AE19
K19
G15
AD9
AA11
U10
M10
D5
D4
AB24
AF24
F24
K24
P24
V24
AH25
AH26
AD25
AD26
Y25
Y26
T25
T26
M25
M26
H25
H26
AF25
AF26
AB25
AB26
V25
V26
P25
P26
K25
K26
F25
F26
AN23
A23
U13
U15
U18
U21
Y16
J14
K12
K13
K14
AB12
AB13
AB18
AB20
N12
N13
N18
N19
J15
C4
B5
C3
C5
Notes:
(1) For more information about pin definition and pin connection guidelines, refer to the
Arria 10 GT, GX, and SX Device Family Pin Connection Guidelines.
(2) For more information about the external memory interface schemes of the pins with indices, refer to the
Arria10EMIF.xls
(3) For more information about the Hard Processor System functions of the corresponding pins, refer to the
Arria10HPS.xls
PT-10AS048-1.3
Copyright © 2015 Altera Corp
Pin List F35
Page 23 of 24
Pin Information for the Arria®10 10AS048 Device
Version 1.3
Version Number
Date
1.0
1.1
10/10/2014
11/26/2014
1.2
4/3/2015
1.3
12/30/2015
PT-10AS048-1.3
Copyright © 2015 Altera Corp.
Changes Made
Initial release.
Added Pin List F29.
Added HPS_DDR to bank 2J for Pin List F29.
Added HPS_DDR to bank 2J & 2I for Pin Lists F34 & F35.
Removed the CM_PLL_CLK pins.
Revision History
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